JPH0582671A - 樹脂封止型半導体素子 - Google Patents

樹脂封止型半導体素子

Info

Publication number
JPH0582671A
JPH0582671A JP3238516A JP23851691A JPH0582671A JP H0582671 A JPH0582671 A JP H0582671A JP 3238516 A JP3238516 A JP 3238516A JP 23851691 A JP23851691 A JP 23851691A JP H0582671 A JPH0582671 A JP H0582671A
Authority
JP
Japan
Prior art keywords
island
lead
resin
semiconductor element
semiconductor chip
Prior art date
Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
Pending
Application number
JP3238516A
Other languages
English (en)
Inventor
Tadayoshi Saito
忠義 斎藤
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
NEC Corp
Original Assignee
NEC Corp
Priority date (The priority date is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the date listed.)
Filing date
Publication date
Application filed by NEC Corp filed Critical NEC Corp
Priority to JP3238516A priority Critical patent/JPH0582671A/ja
Publication of JPH0582671A publication Critical patent/JPH0582671A/ja
Pending legal-status Critical Current

Links

Classifications

    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/01Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L2224/26Layer connectors, e.g. plate connectors, solder or adhesive layers; Manufacturing methods related thereto
    • H01L2224/31Structure, shape, material or disposition of the layer connectors after the connecting process
    • H01L2224/32Structure, shape, material or disposition of the layer connectors after the connecting process of an individual layer connector
    • H01L2224/321Disposition
    • H01L2224/32151Disposition the layer connector connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive
    • H01L2224/32221Disposition the layer connector connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive the body and the item being stacked
    • H01L2224/32245Disposition the layer connector connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive the body and the item being stacked the item being metallic
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/01Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L2224/26Layer connectors, e.g. plate connectors, solder or adhesive layers; Manufacturing methods related thereto
    • H01L2224/31Structure, shape, material or disposition of the layer connectors after the connecting process
    • H01L2224/33Structure, shape, material or disposition of the layer connectors after the connecting process of a plurality of layer connectors
    • H01L2224/331Disposition
    • H01L2224/3318Disposition being disposed on at least two different sides of the body, e.g. dual array
    • H01L2224/33181On opposite sides of the body
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/01Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L2224/42Wire connectors; Manufacturing methods related thereto
    • H01L2224/47Structure, shape, material or disposition of the wire connectors after the connecting process
    • H01L2224/48Structure, shape, material or disposition of the wire connectors after the connecting process of an individual wire connector
    • H01L2224/4805Shape
    • H01L2224/4809Loop shape
    • H01L2224/48091Arched
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/01Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L2224/42Wire connectors; Manufacturing methods related thereto
    • H01L2224/47Structure, shape, material or disposition of the wire connectors after the connecting process
    • H01L2224/48Structure, shape, material or disposition of the wire connectors after the connecting process of an individual wire connector
    • H01L2224/481Disposition
    • H01L2224/48151Connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive
    • H01L2224/48221Connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive the body and the item being stacked
    • H01L2224/48245Connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive the body and the item being stacked the item being metallic
    • H01L2224/48247Connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive the body and the item being stacked the item being metallic connecting the wire to a bond pad of the item
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/01Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L2224/42Wire connectors; Manufacturing methods related thereto
    • H01L2224/47Structure, shape, material or disposition of the wire connectors after the connecting process
    • H01L2224/48Structure, shape, material or disposition of the wire connectors after the connecting process of an individual wire connector
    • H01L2224/484Connecting portions
    • H01L2224/48463Connecting portions the connecting portion on the bonding area of the semiconductor or solid-state body being a ball bond
    • H01L2224/48465Connecting portions the connecting portion on the bonding area of the semiconductor or solid-state body being a ball bond the other connecting portion not on the bonding area being a wedge bond, i.e. ball-to-wedge, regular stitch
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/73Means for bonding being of different types provided for in two or more of groups H01L2224/10, H01L2224/18, H01L2224/26, H01L2224/34, H01L2224/42, H01L2224/50, H01L2224/63, H01L2224/71
    • H01L2224/732Location after the connecting process
    • H01L2224/73251Location after the connecting process on different surfaces
    • H01L2224/73265Layer and wire connectors
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2924/00Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
    • H01L2924/15Details of package parts other than the semiconductor or other solid state devices to be connected
    • H01L2924/181Encapsulation
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2924/00Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
    • H01L2924/15Details of package parts other than the semiconductor or other solid state devices to be connected
    • H01L2924/181Encapsulation
    • H01L2924/1815Shape

Abstract

(57)【要約】 【目的】半導体チップの発熱をリードを介して放散さ
せ、信頼性を向上させる。 【構成】樹脂封止型半導体素子において、半導体チップ
2を接着するアイランド11aとこのアイランド11a
と対向するリード1bとの間に高熱伝導材のセラミック
ス5をろう材6により接着し固着する。

Description

【発明の詳細な説明】
【0001】
【産業上の利用分野】本発明は樹脂封止型半導体素子に
関し、特に半導体チップの発熱を放散させる構造の樹脂
封止型半導体素子に関する。
【0002】
【従来の技術】従来の樹脂封止型半導体素子は、図5に
示すように、半導体チップ2を搭載するアイランド11
aとアイランド11aと対向するリード1bとは、樹脂
4により分離されている。この樹脂封止型半導体素子で
は、動作状態での半導体チップ2の発熱は、リード1a
を介してプリント基板8に逃がす構造となっている。こ
の時、アイランド11aとリード1b間が樹脂により分
離されていることから、半導体チップ2の発熱は、リー
ド1aの側に集中することになり、熱放散性が劣ってい
た。
【0003】図6に示すように、従来技術の中で熱放散
性を改良しようとした樹脂封止型半導体素子は、半導体
チップ2の両面をリード1aと対向するリード1bとで
接着して挾持する構造を採用している。本構造では、半
導体チップ2の発熱は、各リード1a,1bを介して放
散させるものである。しかしながら、本構造では、半導
体チップ2の両面を半田7にて半田付けするため、例え
ば、コンベア炉を使用するなど、特殊な組立工程を構成
する必要があり、原価低減に限界がある。さらに、半導
体チップ表面を半田により被覆するため信頼性上の問題
があった。
【0004】
【発明が解決しようとする課題】この従来技術では、半
導体チップを接着してあるアイランドと対向するリード
とが樹脂により分離されているため、熱放散性に劣ると
いう問題点があった。
【0005】また、他方、半導体チップの両面をリード
に接着させる構造では、組立工程が特殊となっており、
かつ、半導体チップの両面を半田付けする構造のため、
P−N接合表面が不安定となり、信頼性に欠けるという
問題点があった。
【0006】本発明の目的は、熱放散性に優れ、信頼性
の高い樹脂封止型半導体素子を提供することにある。
【0007】
【課題を解決するための手段】本発明は、アイランド
と、該アイランドと対向する位置に配置されたリード
と、前記アイランドに搭載された半導体チップと、該半
導体チップの表面電極と前記リードとを接続する内部結
線とを有する樹脂封止型半導体素子において、前記アイ
ランドと前記リード間に挾持されて固定された電気絶縁
性の高熱伝導材を有する。
【0008】
【実施例】次に、本発明の実施例について図面を参照し
て説明する。
【0009】図1は本発明の第1の実施例の断面図であ
る。
【0010】本実施例に用いた樹脂封止型半導体素子
は、電力損失が1Wの2端子樹脂封止定電圧ダイオード
である。
【0011】第1の実施例は、図1に示すように、半導
体チップ2は、半田7によりアイランド11aに接着さ
れ、半導体チップ2の表面電極2aには、内部連結線3
(ここでは、線型が40μmの金線を採用)の一端を超
音波ボンディング方式により接着させ、他端を対向する
リード1bに熱圧着させてある。樹脂4で成形後、リー
ド1a,1bの端部は、L字型に曲げ加工される。
【0012】図2は図1の樹脂封止型半導体素子に採用
したリードフレームの平面図である。
【0013】図2に示すように、第1の実施例に採用し
たリードフレームには、あらかじめ、アイランド11a
とアイランド11aと対向するリード1bとの間に電気
絶縁性の高熱伝導材であるセラミックス5がろう材6に
より接着し固定されている。
【0014】図3は本発明の第2の実施例の断面図であ
る。
【0015】第2の実施例は、図3に示すように、半導
体チップ2を接着するアイランド11aの反対側にセラ
ミックス5を介して対向するリード1bをろう材6によ
り接着する構造を採用している。
【0016】図4は図3の樹脂封止型半導体素子に採用
したリードフレームの平面図である。
【0017】図4に示すように、第2の実施例に採用し
たリードフレームは、あらかじめ、アイランド11aの
片面にセラミックスを介して対向するリード1a,1b
をろう材で接着し固定されている。
【0018】第2の実施例はセラミックス5と、アイラ
ンド11aとリード1bとの接触面積を大きくとれるの
で熱放散をより大きくできる効果がある。
【0019】
【発明の効果】以上説明したように本発明は、半導体チ
ップを接着するアイランドとこのアイランドと対向する
リードとの間にセラミックスなどの高熱伝導物質を介在
させることにより、半導体チップの発熱を全リードにわ
たって放散でき、信頼性の高い樹脂封止型半導体素子が
得られるという効果を有する。
【0020】尚、従来技術との対比で熱抵抗は、約10
〜20%改善される。
【図面の簡単な説明】
【図1】本発明の第1の実施例の断面図である。
【図2】図1の樹脂封止型半導体素子に採用したリード
フレームの平面図である。
【図3】本発明の第2の実施例の断面図である。
【図4】図3の樹脂封止型半導体素子に採用したリード
フレームの平面図である。
【図5】従来の樹脂封止型半導体素子の一例の断面図で
ある。
【図6】従来の樹脂封止型半導体素子の他の例の断面図
である。
【符号の説明】
1a,1b リード 2 半導体チップ 2a 表面電極 3 内部連結線 4 樹脂 5 セラミックス 6 ろう材 7 半田 8 プリント基板 9 基板付用半田

Claims (3)

    【特許請求の範囲】
  1. 【請求項1】 アイランドと、該アイランドと対向する
    位置に配置されたリードと、前記アイランドに搭載され
    た半導体チップと、該半導体チップの表面電極と前記リ
    ードとを接続する内部結線とを有する樹脂封止型半導体
    素子において、前記アイランドと前記リード間に挾持さ
    れて固定された電気絶縁性の高熱伝導材を有することを
    特徴とする樹脂封止型半導体素子。
  2. 【請求項2】 前記高熱伝導材がアイランドとリードの
    それぞれの端面で挾持されていることを特徴とする請求
    項1記載の樹脂封止型半導体素子。
  3. 【請求項3】 前記高熱伝導材がアイランドとリードの
    それぞれの板面で挾持されていることを特徴とする請求
    項1記載の樹脂封止型半導体素子。
JP3238516A 1991-09-19 1991-09-19 樹脂封止型半導体素子 Pending JPH0582671A (ja)

Priority Applications (1)

Application Number Priority Date Filing Date Title
JP3238516A JPH0582671A (ja) 1991-09-19 1991-09-19 樹脂封止型半導体素子

Applications Claiming Priority (1)

Application Number Priority Date Filing Date Title
JP3238516A JPH0582671A (ja) 1991-09-19 1991-09-19 樹脂封止型半導体素子

Publications (1)

Publication Number Publication Date
JPH0582671A true JPH0582671A (ja) 1993-04-02

Family

ID=17031419

Family Applications (1)

Application Number Title Priority Date Filing Date
JP3238516A Pending JPH0582671A (ja) 1991-09-19 1991-09-19 樹脂封止型半導体素子

Country Status (1)

Country Link
JP (1) JPH0582671A (ja)

Cited By (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
KR100844630B1 (ko) * 2006-03-29 2008-07-07 산요덴키가부시키가이샤 반도체 장치

Cited By (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
KR100844630B1 (ko) * 2006-03-29 2008-07-07 산요덴키가부시키가이샤 반도체 장치

Similar Documents

Publication Publication Date Title
JP2671922B2 (ja) 半導体パッケージ
US6330158B1 (en) Semiconductor package having heat sinks and method of fabrication
JP2004047883A (ja) 電力半導体装置
JPH03142847A (ja) 半導体集積回路装置
JP2004014599A (ja) 半導体装置およびその製造方法
KR102341396B1 (ko) 반도체 패키지 및 이에 적용되는 금속 브릿지
JPH0418694B2 (ja)
JPH0645504A (ja) 半導体装置
JPH0637217A (ja) 半導体装置
JPH03174749A (ja) 半導体装置
JPH0582671A (ja) 樹脂封止型半導体素子
JPH07176664A (ja) 半導体装置およびその製造方法
KR100244826B1 (ko) 반도체장치 및 그 제조방법
JP3894749B2 (ja) 半導体装置
JP2004228402A (ja) 半導体装置
JPS6329413B2 (ja)
JPH0574985A (ja) 半導体素子の実装構造
JPH05326625A (ja) Lsi実装構造
JP2800605B2 (ja) 半導体装置
JP3714808B2 (ja) 半導体装置
CN108364940B (zh) 一种电力用逆变电路装置
JP2975783B2 (ja) リードフレームおよび半導体装置
JPH04245459A (ja) 半導体装置
JP2504262Y2 (ja) 半導体モジュ―ル
JPH04320052A (ja) 半導体装置