JPH0418694B2 - - Google Patents

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JPH0418694B2
JPH0418694B2 JP1782385A JP1782385A JPH0418694B2 JP H0418694 B2 JPH0418694 B2 JP H0418694B2 JP 1782385 A JP1782385 A JP 1782385A JP 1782385 A JP1782385 A JP 1782385A JP H0418694 B2 JPH0418694 B2 JP H0418694B2
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Tokyo Shibaura Electric Co Ltd
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    • H01L2924/16152Cap comprising a cavity for hosting the device, e.g. U-shaped cap

Description

【発明の詳細な説明】 〔発明の技術分野〕 本発明はパワー半導体装置ブロツクからなる半
導体装置に関し、更に詳しくはパワー半導体装置
ブロツクが絶縁板ユニツト構造と呼ばれる構造を
もち、モジユール化に好適なものに使用される。
〔発明の技術的背景〕
パワートランジスタやそれを直列、並列に接続
したパワートランジスタモジユールを製作するに
あたつては、それらを高度に共通互換性のあるパ
ワートランジスタブロツクで構成することが便利
である。そのようなモジユールの単位となるブロ
ツクは、ブロツク自体の部品点数が少なく組立工
程が簡単であると共に、モジユール化のための端
子接続が容易であることが必要である。
本発明者は上記の如きパワートランジスタブロ
ツクからなる半導体装置に関し、先に特許出願
(特開昭57−111054号、特開昭57−166037号等)
をしたが、これらのものの概要を添付図面の第8
図乃至第12図を参照して説明する。なお、図面
の説明において同一要素は同一符号で示してあ
る。
第8図は絶縁板ユニツト構造のパワートランジ
スタブロツクを、モールド型のモジユールに組立
てた場合の要部断面図である。即ちパワートラン
ジスタブロツク20は、絶縁板33と、その表面
に配設されたワイヤボンデイング用パツド22,
23とチツプマウント用パツド24を有してい
る。そして、半導体チツプ5をマウント用パツド
24にマウントすると共にパツド22,23にワ
イヤボンデイングする。そしてこのブロツクを2
個20,20′用意し、放熱板7上に接着銅板2
5などを介して接着し、外部端子の接続および樹
脂封止してモジユール化したものである。
このようなものは、部品点数が絶縁板33、ワ
イヤボンデイング用パツド22,23、チツプマ
ウント用パツド24及び接着銅板25の合計5部
品であるだけである。更にワイヤボンデイング用
パツド22,23とチツプマウント用パツド24
とに接着用銅板25同様の銅板を用い、それらを
セラミツク絶縁板33上に直接接合法により配設
した場合には、特に大幅な工程数の短縮が可能に
なる。
上記の如き銅板のセラミツク板に対する直接接
合法とは、表面が酸化した銅板をセラミツク板に
重ねた状態で1065℃以上1085℃以下の実質温度に
保持し、Cu2O−Cu共晶融液で接合面を濡らし、
そのまま冷却して直接接合するという、米国ゼネ
ラルエレクトリツク社の開発に基づく方法を意味
する。この直接接合法に特に適する銅板は、タフ
ピツチ銅、OFHC銅、銀銅などであり、また特に
適するセラミツク板はアルミナなどである。第9
図は直接接合法によるブロツクの斜視図である。
同図において絶縁板33は板厚0.635mmの96%ア
ルミナ板を、またワイヤボンデイング用パツド2
2,23、チツプマウント用パツド24及び接着
銅板25は板厚0.3mmのタフピツチ銅板を用い、
1063℃の窒素雰囲気中に通して一工程でそれらを
強く固着せしめる。次に端子をブロツク周辺部の
端子エリア4,41,42に配設し、それぞれベ
ース、エミツタ、コレクタ端子とし、チツプマウ
ント用パツド24上にチツプ5、また必要に応じ
てダイオード51などをマウントし、ボンデイン
グワイヤ6で接続してパワートランジスタブロツ
ク20を得る。
第10図は並列及び直列接続モールド型パワー
トランジスタモジユールの平面図、第11図aは
並列接続モジユールに用いた外部端子配置図、同
図bは同等価回路図、第12図a直列接続モジユ
ールに用いた外部端子配置図、同図bは同等価回
路図である。なお、第10図〜第12図において
7は放熱板、8は外部端子、91はケース、TR
1,TR2はトランジスタ素子、D1,D2はダ
イオード素子である。
〔背景技術の問題点〕
上記の如き従来装置において、絶縁板に直接接
合される各パツドの角部は尖つている(鋭部を有
する)。第13図は各パツドを接合した絶縁板の
平面図で、第14図はその一部拡大図である。図
示の如く、ワイヤボンデイグ用パツド23、チツ
プマウント用パツド24等の角部は尖つており、
このため角部に応力が集中しやすくなる。
ところで、放熱板への熱伝導を良好にするため
には、絶縁板の厚さは小さく、かつパツドおよび
接着銅板の厚さは比較的大きくすることが望まし
く、例えば第9図の従来例では絶縁板33=
0.635mmに対してパツド22〜24および接着銅
板25=0.3mmの厚さになつている。そして近年、
回路の高集積化と大容量化のためこの傾向はさら
に進み、絶縁板=0.4mm以下、パツドおよび接着
銅板=0.4mm以上厚さのものが要求されてきてい
る。しかしながら、従来の形式のものでこれを実
現すると、パツドの角部における応力の集中は
増々大きくなり、それに反して絶縁板の強度は
増々低下し、従つて角部に「割れ」が発生し易く
なる。この絶縁板33の割れは第14図において
符号101で示すように現われ、このため製品の
歩留りが著しく低下してしまう。
〔発明の目的〕
本発明は上記の如き従来技術の欠点を克服する
ためになされたもので、放熱板への熱伝導を良く
するために絶縁板を薄く、あるいはパツドおよび
接着銅板を厚くした場合にも、絶縁板に「割れ」
が生じたりすることのない半導体装置を提供する
ことを目的とする。
〔発明の概要〕
上記の目的を達成するため本発明は、絶縁板ユ
ニツト構造をもつ半導体装置の絶縁板に直接接合
法で接合されたワイヤボンデイング用パツド、お
よびチツプマウント用パツド等の角部に、丸みを
付けた半導体装置を提供するものである。さらに
本発明は、絶縁板および接着金属(例えば銅)板
についても、角部に丸みを付けた半導体装置を提
供するものである。
〔発明の実施例〕
以下、添付図面の第1図乃至第7図を参照して
本発明のいくつかの実施例を説明する。
第1図は同実施例の要部の斜視図である。絶縁
板(DBC基板)33の上面にはワイヤボンデイ
ング用パツド23およびチツプマウント用パツド
24が直接接合法で接合されており、その角部に
はR=1.0mmの丸みが付けられている。この丸み
はエツチング法、プレス打抜き法等により容易に
付けることができる。また、Rの値は1mmに限ら
ず適宜選択することができる。
第2図は第1図に示す実施例の変形例の要部の
平面図である。第2図aはワイヤボデイング用パ
ツド23およびチツプマウント用パツド24を含
むパツド群の4角を構成する各チツプの角部のみ
に丸みを付けたものである。応力の集中はパツド
群の4角において特に著しく、従つてこの部分で
絶縁板33に「割れ」が生じ易いので、この部分
にのみ丸みを付けることによつて製品の歩留りを
かなり向上できる。
第2図bはパツド群の4辺にある各チツプの角
部にのみ丸みを付けたものである。パツド群の4
角にある各パツドの角部に次いで応力の集中が著
しいのは、パツド群の4辺にある各パツドの角部
である。従つてこれらの部分に丸みをつけること
で、製品の歩留りを大幅に向上できる。
第2図cは各パツドの角部のうち、鈍角部分以
外の角部に丸みを付けたものである。パツド群の
4辺にある各パツドの角部に次いで応力の集中し
易いのは、この鈍角部分以外の内側の角部であ
る。従つてこれらの部分に丸みを付けることで、
絶縁板の「割れ」はほとんど解消される。
第2図dは第1図のものと同等のもので、この
ようにすれば最大の効果が得られる。なお、上記
の第2図b〜dの変形例において、応力集中の大
きさに応じてRの値を変えるようにするとより効
果的である。
第3図は本発明の他の実施例の要部の平面図で
ある。これが第2図aのものと異なる点は、パツ
ド群の角部のみならず絶縁板の角部においても丸
みが付けられていることである。このようにすれ
ば、絶縁板32の下側からの応力に対しても十分
に対応できる。
第4図はこの事情を説明するための半導体装置
の断面図である。放熱板7には半導体モジユール
を囲むようにエポキシ樹脂製のカバー26が接着
剤27により固着されており、チツプ5はゴム状
のチツプエンキヤツプ28で覆われている。そし
て、カバー26内はゲル状のエンキヤツプ剤29
で満されている。
このような半導体装置において、接着剤27は
絶縁板33と放熱板7の間に入り込み易く、これ
らが原因で絶縁板33の角部に応力が集中し易く
なる。そこで第3図に示すように絶縁板の角部に
丸みを持たせれば、パツド23,24等による応
力の集中のみならず、接着剤27による下側から
の応力集中をも緩和できる。なお、第3図ではパ
ツド群の4角を構成する各パツドの角部のみに丸
みを付けたが、第2図b〜dの如く各パツドの他
の角部についても丸みを付けてもよいことは言う
までもない。
第5図は本発明のさらに他の実施例の要部の底
面図である。この実施例では、絶縁板33の底面
に直接接合法で接合された接着銅板25の4角に
丸みを付けている。この方式と前記の方式を併用
すれば、さらに大きな効果をあげることができ
る。
なお、前記の第1図乃至第5図に示す実施例に
おいて、絶縁板、パツドおよび接着銅板の厚さは
特に限定されないが、絶縁板の厚さを0.4mm程度
にしたときに特に有効である。
次に、第6図および第7図を参照して上記実施
例の効果を説明する。
第6図はパツドの角部における丸みの有無と
「割れ」発生率の関係を示す特性図である。図か
ら明らかなように、絶縁板(Al2O3)の厚さt=
0.635mmにおいては、パツドの角部に丸みがない
ときはパツドの厚さを0.4mm以下としなければな
らないが、パツドの角部に丸みがあるときはパツ
ドの厚さを0.6mm以上とすることができる。また、
絶縁板の厚さt=0.4mmにおいては、パツドの角
部に丸みがないときはパツドの厚さを0.15mm以下
としなければならず、実用に供することが難しく
なるが、パツドの角部に丸みを付ければパツドの
厚さを0.4mm以上とすることができ、大きな放熱
効果を発揮できる。
パツドの角部に丸みを付けることは、外部端子
の半田付けによる応力集中にも有効である。第7
図はその事情を説明するためのもので第7図aは
斜視図、第7図bはそのA−A線断面図である。
第7図において、外部端子8の厚さt1は0.7〜0.8
mm程度であり、半田43の厚さt2も0.5mm程度に
達する。このため、ワイヤボンデイング用パツド
23の外部端子近傍の角部には応力集中が特に著
しく、「割れ」が発生し易くなる。しかしながら、
本発明の如く角部に丸みを付ければ、応力集中を
やわらげて製品の歩留りの向上にもなる。
さらに本発明によれば、角部の丸みの有無によ
つて絶縁板、パツドの厚さ、あるいは放熱効果の
表示ができるという格別の効果がある。すなわ
ち、前述のように絶縁板およびパツド等の厚さと
放熱効果には相関関係があり、かつ絶縁板が薄く
なれば「割れ」が生じやすく、パツド等が厚くな
れば「割れ」が生じやすくなるという関係があ
る。そこで、放熱効果を最大にするために最も
「割れ」易くなつたものを例えば第2図dの如き
構成とし、次に「割れ」易くなつたものを第2図
cの如き構成とし、順次、放熱効果の大きい順す
なわち「割れ」易くなつたものの順に第2図b,
aの如き構成とする。このようにすれば、一見し
て放熱効果の大小、許容発熱量の大小等を判別で
きる。
なお、以上説明した効果は、絶縁板として
Al2O3のセラミツクを用いた場合に限らず、AlN
等を用いたときにも奏することができ、パツド等
として銅板以外の金属板を用いた場合にも奏する
ことができる。
〔発明の効果〕
上記の如く本発明では、絶縁板ユニツト構造を
もつ半導体装置の絶縁板に直接接合されたパツド
等の角部に丸みを付けるようにしたので、放熱板
への熱伝導を良くするために絶縁板を薄く、ある
いはパツドおよび接着銅板を厚くした場合にも、
絶縁板に「割れ」が生じたりすることなく、従つ
て製品の歩留りを著しく向上させることのできる
半導体装置が得られる。また、角部に丸みを付け
ることは容易に実現できるので、特に製造コスト
を上昇させることもない。
【図面の簡単な説明】
第1図は本発明の一実施例の要部の斜視図、第
2図は同実施例の変形例の要部の平面図、第3図
は本発明の他の実施例の要部の平面図、第4図は
同実施例に特有の効果を説明するための断面図、
第5図は本発明のさらに他の実施例の要部の底面
図、第6図は本発明の効果を説明する特性図、第
7図は本発明の格別の効果を説明するための斜視
図および断面図、第8図は絶縁基板を用いた従来
モジユールの要部断面図、第9図はこの絶縁基板
にチツプを搭載したときの斜視図、第10図はこ
のモジユールの完成前の平面図、第11図はこの
モジユールの平面図および等価回路図、第12図
はこのモジユールの他の例の平面図および等価回
路図、第13図は従来装置の要部の平面図、第1
4図はその一部拡大図である。 5……チツプ、7……放熱板、8……外部端
子、23……ワイヤボンデイング用パツド、24
……チツプマウント用パツド、25……接着銅
板、26……カバー、27……接着剤、28……
チツプエンキヤツプ、33……絶縁板。

Claims (1)

  1. 【特許請求の範囲】 1 ほぼ方形の絶縁板の上面に直接接合法で少な
    くともワイヤボンデイング用パツドおよびチツプ
    マウント用パツドを含むパツド群を接合し、この
    絶縁板の下面に接着金属板を介して直接接合法で
    放熱板を接合した半導体装置において、 前記パツド群を構成する各パツドの角部に丸み
    を付けたことを特徴とする半導体装置。 2 前記パツド群の4角を構成する前記各パツド
    の角部に丸みを付けた特許請求の範囲第1項記載
    の半導体装置。 3 前記パツド群の4辺内にある前記各パツドの
    角部に丸みを付けた特許請求の範囲第1項記載の
    半導体装置。 4 前記各パツドの各角部のうち鈍角部分を除く
    他の角部に丸みを付けた特許請求の範囲第1項記
    載の半導体装置。 5 ほぼ方形の絶縁板の上面に直接接合法で少な
    くともワイヤボンデイング用パツドおよびチツプ
    マウント用パツドを含むパツド群を接合し、この
    絶縁板の下面に接着金属板を介して直接接合法で
    放熱板を接合した半導体装置において、 前記パツド群を構成する各パツドの角部に丸み
    を付け、かつ前記絶縁板の4角に丸みを付けたこ
    とを特徴とする半導体装置。 6 前記パツド群の4角を構成する前記各パツド
    の角部に丸みを付けた特許請求の範囲第5項記載
    の半導体装置。 7 ほぼ方形の絶縁板の上面に直接接合法で少な
    くともワイヤボンデイング用パツドおよびチツプ
    マウント用パツドを含むパツド群を接合し、この
    絶縁板の下面に接着金属板を介して直接接合法で
    放熱板を接合した半導体装置において、 前記パツド群を構成する各パツドの角部に丸み
    を付け、かつ前記絶縁板および接着金属板の4角
    に丸みを付けたことを特徴とする半導体装置。 8 前記パツド群の4角を構成する前記各パツド
    の角部に丸みを付けた特許請求の範囲第7項記載
    の半導体装置。
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US5906310A (en) * 1994-11-10 1999-05-25 Vlt Corporation Packaging electrical circuits
US5876859A (en) * 1994-11-10 1999-03-02 Vlt Corporation Direct metal bonding
US5945130A (en) * 1994-11-15 1999-08-31 Vlt Corporation Apparatus for circuit encapsulation
JP2732823B2 (ja) * 1995-02-02 1998-03-30 ヴィエルティー コーポレーション はんだ付け方法
EP1814153A3 (en) * 1996-09-12 2008-09-24 Ibiden Co., Ltd. Circuit board for mounting electronic parts
EP0883173B1 (en) 1996-09-12 2007-09-12 Ibiden Co., Ltd. Circuit board for mounting electronic parts
JP2017130633A (ja) * 2016-01-22 2017-07-27 豊田合成株式会社 発光装置
JP6673100B2 (ja) * 2016-08-24 2020-03-25 トヨタ自動車株式会社 半導体装置
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