JPH0575675U - デジタルオシロスコープ - Google Patents

デジタルオシロスコープ

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JPH0575675U
JPH0575675U JP234492U JP234492U JPH0575675U JP H0575675 U JPH0575675 U JP H0575675U JP 234492 U JP234492 U JP 234492U JP 234492 U JP234492 U JP 234492U JP H0575675 U JPH0575675 U JP H0575675U
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JP
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signal
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trigger
inputting
clock
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JP234492U
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洋 金子
克規 光永
茂 竹澤
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Yokogawa Electric Corp
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Yokogawa Electric Corp
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Abstract

(57)【要約】 【目的】外部クロックを入力するための外部クロックイ
ンターフェイスが不要となり、また外部クロックの振幅
の制限がなくなり、任意のタイミングでサンプリングを
行うことができるデジタルオシロスコープを実現するこ
と。 【構成】被測定信号を入力するためフロントエンドと、
フロントエンドからの信号を入力しデシタルデータに変
換するＡ／Ｄ変換器と、Ａ／Ｄ変換器からのデジタルデ
ータ出力を格納するメモリと、フロントエンドからの信
号の振幅比較をするしトリガ信号を発生するトリガコン
パレータと、トリガ信号を入力し、論理設定手段からの
信号に基づいてトリガコンパレータからのトリガ信号を
選択して出力する選択手段と、選択手段から出力された
トリガ信号を入力し、トリガ信号と内部クロックのどち
らかをサンプリングクロックとして選択し、そのサンプ
リングクロックを用いて、時間計測を行うタイムベース
設けたデジタルオシロスコープである。

Description

【考案の詳細な説明】
【０００１】
【産業上の利用分野】
本考案は、複数の入力端子を有するデジタルオシロスコープに関し、詳しくは 観測すべく入力した波形をサンプリングクロックに使用したデジタルオシロスコ ープに関する。
【０００２】
【従来の技術】
従来のデジタルオシロスコープにおいて、観察する入力信号同期するようなタ イミングでサンプリングしたいとする。このときは、入力端子から入力している 観測波形と同等の周波数の信号を、外部クロックを入力するための、外部クロッ クインターフェイスから入力し、このクロックを用いてサンプリングする必要が あった。この外部クロックインターフェイスは、デジタルオシロスコープを安価 にするために、減衰率の幅を制限したりしなければならなかった。
【０００３】
【考案が解決しようとする課題】
このため、サンプリングクロックとして用いる外部クロックの振幅はある一定 の値に定められていた。 また内部クロックのみをサンプリングクロックとして用いるとそのサンプリン グの周期に自由度がなくなるといった問題があった。
【０００４】 本考案では、このような問題を解決し、簡単な構成で自由度のあるサンプリン グの周期でサンプリングを行うことの可能なデジタルオシロスコープを実現する ことにある。
【０００５】
【課題を解決するための手段】
本考案は、被測定信号を入力するための複数の入力端子の各々に対しその入力 信号における入力波形の振幅を増幅あるいは減衰させることで振幅を正規化する ための複数のフロントエンドと、 前記各々のフロントエンドからの信号を入力し下記タイムベースからの信号に 基づいてデシタルデータに変換する複数のアナログ／デジタル変換器と、 前記各々のアナログ／デジタル変換器からのデジタルデータ出力を格納するた めの複数のメモリと、 前記各々フロントエンドからの信号があるスレショルドを超えたか否かを判別 しトリガ信号を発生するトリガコンパレータと、 前記複数のトリガコンパレータからのトリガ信号を入力し、論理設定手段から の信号に基づいてトリガコンパレータからのトリガ信号を選択して出力する選択 手段と、 前記選択手段から出力されたトリガ信号を入力し、トリガ信号と内部クロック のどちらかを選択しサンプリングクロックとして出力するタイムベースと、 前記複数のメモリからの信号を入力し、データ処理を行うデータプロセッサと を設け、被測定信号を入力するための端子から入力した信号を用いてサンプリン グクロックを発生することを特徴とするデジタルオシロスコープである。
【０００６】
【作用】
本考案では、複数の入力信号のうち１つを外部クロックとして利用することに より、外部クロックインターフェイスの必要をなくす。また、入力信号を正規化 して利用することにより、振幅の制限をとり除き、外部クロッククロックインタ ーフェイスと同等もしくはそれ以上の帯域をもつことにより、任意の繰り返し信 号を外部クロックとして、利用し、任意のタイミングでサンプリングを行うこと ができる。
【０００７】
【実施例】
以下本考案を図面を用いて詳細に説明する。 図１は本考案の実施例の基本的構成図である。図１において、１０，２０，４ ０は入力部、Ｉ10，Ｉ20，Ｉ40は、入力端子、Ｏは表示回路等への出力端子であ る。なお、入力部１０，２０，４０は同一の構成をもつものである。
【０００８】 １１，２１，４１はフロントエンドで、被測定信号を入力するための複数の入 力端子Ｉ10，Ｉ20，Ｉ40の各々に対しその入力信号における入力波形の振幅を増 幅あるいは減衰させることで振幅を正規化する。１２，２２，４２はアナログ／ デジタル変換器（以下、Ａ／Ｄ変換器と呼ぶ）で、各々のフロントエンド１１， ２１，４１からの信号を入力し、タイムベース７からの信号に基づいてデシタル データに変換する。１３，２３，４３はメモリで、各々のＡ／Ｄ変換器１２，２ ２，４２からのデジタルデータを格納する。１４，２４，４４はトリガコンパレ ータで、各々のフロントエンド１１，２１，４１からの信号があるスレショルド を超えたか否かを判別しトリガ信号を発生する。５は論理設定手段で、選択手段 ６でトリガコンパレータ１４の出力，２４の出力，…４４の出力を入力し これらの信号のなかから、選択した出力をタイムべース７に出力する。タイムべ ース７は、この入力した信号をもとに、基準クロックで同期をとりサンプリング クロックをの接続で示されるように各Ａ／Ｄ変換器１２，２２，４２に出力す る。８はデジタルシグナルプロセッサ（以下、ＤＳＰと呼ぶ）で、メモリ１３， ２３，４３に格納されているデータを入力しデータ処理を行う。このＤＳＰ８の 出力が表示回路等を経て、表示される。またこの図には示されないが、図１内の 全体の動作を制御する制御手段が存在し、タイミングの統合、論理設定手段５へ の指令などの制御を行っているものとする。
【０００９】 このような構成におけるサンプリングの動作について説明する。このとき入力 端子Ｉ10から入力した信号をトリガのための信号として用いて、入力端子Ｉ20か ら入力した信号をサンプリングした場合のタイムチャートを図２に示す。は入 力端子Ｉ10から入力した信号がスレッショルドレベルより高いか低いかをトリガ コンパレータ１４で判断した出力で矩形波を、基準クロックで同期をとったもの である。この信号で入力端子Ｉ20から入力した信号のサンプリングを行う。
【００１０】 まず、具体的手段について述べる。論理設定手段５というのは、ＣＰＵ等から の指令であり、選択手段６はマルチプレクサに該当する。タイムベース７では、 基準クロックを持っており、この基準クロックを分周などした信号もしくは選択 手段６から入力した信号をサンプリングクロックとして出力する。またタイム ベース７において、サンプリングクロックの位相をずらす動作も行っている。
【００１１】 よって選択手段６は複数のトリガ信号〜から、波形取り込みの開始点を決 めるトリガ信号を選択し、サンプリングクロックとして利用するにあたって、ト リガ信号に利用した信号自身を観測するときは、サンプリングクロックの位相を ずらすことによりサンプリングクロックの自身の波形も観測できる。７は、コン トローラで外部クロック、内部クロックの選択を行う。
【００１２】
【考案の効果】
本考案によれば、外部クロックを入力するための外部クロックインターフェイ スが不要となり、また外部クロックの振幅の制限がなくなり、任意のタイミング でサンプリングを行うことができる。 尚、ＣＰＵ等における設定によってはサンプリングクロックとして利用してい る信号自身も観測することができるため、複数の入力信号をすべて観測しつつサ ンプリングポイントを確認することができる。
【図面の簡単な説明】
【図１】本考案の構成図である。
【図２】本考案に係るサンプリングの動作を示すタイム
チャートである。
【符号の説明】
１１，２１，４１ フロントエンド １２，２２，４２ Ａ／Ｄ変換器 １３，２３，４３ メモリ １４，２４，４４ トリガコンパレータ ５ 論理設定手段 ６ 選択手段 ７ タイムベース ８ ＤＳＰ

Claims (1)

    【実用新案登録請求の範囲】
  1. 【請求項１】被測定信号を入力するための複数の入力端
    子の各々に対しその入力信号における入力波形の振幅を
    増幅あるいは減衰させることで振幅を正規化するための
    複数のフロントエンドと、 前記各々のフロントエンドからの信号を入力し下記タイ
    ムベースからの信号に基づいてデシタルデータに変換す
    る複数のアナログ／デジタル変換器と、 前記各々のアナログ／デジタル変換器からのデジタルデ
    ータ出力を格納するための複数のメモリと、 前記各々フロントエンドからの信号があるスレショルド
    を超えたか否かを判別しトリガ信号を発生するトリガコ
    ンパレータと、 前記複数のトリガコンパレータからのトリガ信号を入力
    し、論理設定手段からの信号に基づいてトリガコンパレ
    ータからのトリガ信号を選択して出力する選択手段と、 前記選択手段から出力されたトリガ信号を入力し、トリ
    ガ信号と内部クロックのどちらかを選択しサンプリング
    クロックとして出力するタイムベースと、 前記複数のメモリからの信号を入力し、データ処理を行
    うデータプロセッサとを設け、被測定信号を入力するた
    めの端子から入力した信号を用いてサンプリングクロッ
    クを発生することを特徴とするデジタルオシロスコー
    プ。
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JPH0575675U true JPH0575675U (ja) 1993-10-15
JP2554471Y2 JP2554471Y2 (ja) 1997-11-17

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* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
US11431379B1 (en) 2021-03-31 2022-08-30 Teradyne, Inc. Front-end module

Cited By (2)

* Cited by examiner, † Cited by third party
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US11431379B1 (en) 2021-03-31 2022-08-30 Teradyne, Inc. Front-end module
WO2022212249A1 (en) * 2021-03-31 2022-10-06 Teradyne, Inc. Front-end module

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