JPH0449505A - 磁気記憶装置のピーク検出回路 - Google Patents
磁気記憶装置のピーク検出回路Info
- Publication number
- JPH0449505A JPH0449505A JP2160149A JP16014990A JPH0449505A JP H0449505 A JPH0449505 A JP H0449505A JP 2160149 A JP2160149 A JP 2160149A JP 16014990 A JP16014990 A JP 16014990A JP H0449505 A JPH0449505 A JP H0449505A
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- pulse
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- 238000001514 detection method Methods 0.000 claims description 10
- 230000001934 delay Effects 0.000 claims description 6
- 230000000630 rising effect Effects 0.000 claims description 5
- 230000005415 magnetization Effects 0.000 abstract description 3
- 230000003111 delayed effect Effects 0.000 description 8
- 238000010586 diagram Methods 0.000 description 4
- 230000000694 effects Effects 0.000 description 2
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
〔産業上の利用分野〕
本発明は磁気記憶装置のデータ再生回路に使用するピー
ク検出回路に関する。
ク検出回路に関する。
従来の磁気記憶装置のデータ再生回路に使用するピーク
検出回路は、磁気記憶媒体から磁気ヘッドが読出した再
生信号を微分する微分器と、この微分器からの出力信号
の零交差点を検出するコンパレータと、コンパレータの
出力パルスの立−Ｅりおよび立下りの両時点において所
定の時間幅のパルス信号を発生するパルサーとを備えて
構成されており、微分した再生信号の零交差点を検出す
ることによってピーク検出を行っている。
検出回路は、磁気記憶媒体から磁気ヘッドが読出した再
生信号を微分する微分器と、この微分器からの出力信号
の零交差点を検出するコンパレータと、コンパレータの
出力パルスの立−Ｅりおよび立下りの両時点において所
定の時間幅のパルス信号を発生するパルサーとを備えて
構成されており、微分した再生信号の零交差点を検出す
ることによってピーク検出を行っている。
上述したような従来の磁気記憶装置のピーク検出回路は
、磁気記憶媒体に対して記録再生するときに生じる各種
の非対称性（書込み電流の記録タイミングのずれや外部
磁界の影響による波形の歪や記録再生ヘッドの帯磁等）
のため、再生信号に波形の歪が発生し、このためピーク
検出回路の出力信号にも非対称なパルスが発生し、読出
し動作の余裕度が著しく低下するという欠点がある。
、磁気記憶媒体に対して記録再生するときに生じる各種
の非対称性（書込み電流の記録タイミングのずれや外部
磁界の影響による波形の歪や記録再生ヘッドの帯磁等）
のため、再生信号に波形の歪が発生し、このためピーク
検出回路の出力信号にも非対称なパルスが発生し、読出
し動作の余裕度が著しく低下するという欠点がある。
本発明の磁気記憶装置のピーク検出回路は、磁気記憶媒
体からの再生信号を微分して正負再極性の信号を出力す
る微分器と、前記微分器からの正極性の出力信号を一定
の時間だけ遅延する第一の遅延回路と、前記微分器から
の負極性の出力信号を制御信号によって指定された時間
だけ遅延する第二の遅延回路と、何記第−および第二の
遅延回路の出力信号の零交差点を検出してパルス信号に
変換して出力するコンパレータと、前記コンパレータの
出力のパルス信号の立上りまたは立下りの時点において
所定の時間幅のピークパルスを発生するパルサーと、前
記コンパレータの出力のパルス信号の高レベルの部分と
低レベルの部分との時間差を検出してその差に対応した
ほぼ直流レベルの信号を前記制御信号として出力する位
相比較器とを備えている。
体からの再生信号を微分して正負再極性の信号を出力す
る微分器と、前記微分器からの正極性の出力信号を一定
の時間だけ遅延する第一の遅延回路と、前記微分器から
の負極性の出力信号を制御信号によって指定された時間
だけ遅延する第二の遅延回路と、何記第−および第二の
遅延回路の出力信号の零交差点を検出してパルス信号に
変換して出力するコンパレータと、前記コンパレータの
出力のパルス信号の立上りまたは立下りの時点において
所定の時間幅のピークパルスを発生するパルサーと、前
記コンパレータの出力のパルス信号の高レベルの部分と
低レベルの部分との時間差を検出してその差に対応した
ほぼ直流レベルの信号を前記制御信号として出力する位
相比較器とを備えている。
次に本発明の実施例について図面を参照して説明する。
第１図は本発明の一実施例を示すブロック図、第２図は
第１図の実施例の各信号の波形を示す波形図である。
第１図の実施例の各信号の波形を示す波形図である。
第１図において、微分器１０の入力信号は、磁気記憶媒
体から磁気ヘッドが読出した再生信号１であり、その正
極性の出力信号１１は遅延素子２０を介してコンパレー
タ４０に入力し、負極性の出力信号１２は可変遅延素子
３０を介して同じくコンパレータ４０に入力している。
体から磁気ヘッドが読出した再生信号１であり、その正
極性の出力信号１１は遅延素子２０を介してコンパレー
タ４０に入力し、負極性の出力信号１２は可変遅延素子
３０を介して同じくコンパレータ４０に入力している。
コンパレータ４０の出力信号は、パルサー５０および位
相比較器６０に入力し１位相比較器６０の出力信号は制
御信号６１として可変遅延素ＴＦ３０の制御端子にに入
力する。パルサー５０の出力信号はピークパルス３とし
て後段の回路に出力される。
相比較器６０に入力し１位相比較器６０の出力信号は制
御信号６１として可変遅延素ＴＦ３０の制御端子にに入
力する。パルサー５０の出力信号はピークパルス３とし
て後段の回路に出力される。
次に、上述の実施例の動作について第１図および第２図
を参照して説明する。
を参照して説明する。
磁気記録媒体からの再生信号１は、微分器１０で微分さ
れ、その正極性の出力信号１１は、遅延素子２０におい
て一定時間だけ遅延されて遅延信号２１としてコンパレ
ータ４０に入力し、負極性の出力信号１２は可変遅延素
子３０において制御信号６１によって指定される時間だ
け遅延さて遅延信号３１として同じくコンパレータに入
力する。コンパレータ４０は、遅延信号２１および３１
の零交差点で変化するパルス信号４１および４２を出力
してパルサー５０および位相比較器６０に送る。
れ、その正極性の出力信号１１は、遅延素子２０におい
て一定時間だけ遅延されて遅延信号２１としてコンパレ
ータ４０に入力し、負極性の出力信号１２は可変遅延素
子３０において制御信号６１によって指定される時間だ
け遅延さて遅延信号３１として同じくコンパレータに入
力する。コンパレータ４０は、遅延信号２１および３１
の零交差点で変化するパルス信号４１および４２を出力
してパルサー５０および位相比較器６０に送る。
パルサー５０は、パルス信号４１および４２の立上りの
時点において所定の時間幅のパルス信号を発生してピー
クパルス３として後段の回路に送出する。位相比較器６
０は、パルス信号４１の高レベルの部分と低レベルの部
分との時間差（ＴＩＯ−Ｔ２Ｏ）またはパルス信号４１
とパルス信号４２の高レベルの部分の時間差（ＴＩＯａ
−Ｔ２Ｏ）を検出してその差に対応したほば直流レベル
の信号を制御信号６１と１７で出力する。Ｔ１０とＴ２
０が等しい場合は、制御信号６１は０ボルトであり、こ
のときの可変遅延素子３０の遅延時間は遅延素子２０の
遅延時間と同じである。
時点において所定の時間幅のパルス信号を発生してピー
クパルス３として後段の回路に送出する。位相比較器６
０は、パルス信号４１の高レベルの部分と低レベルの部
分との時間差（ＴＩＯ−Ｔ２Ｏ）またはパルス信号４１
とパルス信号４２の高レベルの部分の時間差（ＴＩＯａ
−Ｔ２Ｏ）を検出してその差に対応したほば直流レベル
の信号を制御信号６１と１７で出力する。Ｔ１０とＴ２
０が等しい場合は、制御信号６１は０ボルトであり、こ
のときの可変遅延素子３０の遅延時間は遅延素子２０の
遅延時間と同じである。
再生信号ｌに何らかの原因によって波形に波形歪１ａが
発生すると、出力信号１１および１２にも波形歪１１ａ
および１２ａが発生し、それらの零交差点の位置がずれ
るため、コンパレータ４０の出力のパルス信号４１およ
び４２は、第２図において破線で示した波形４２ａのよ
うになる。従ってピークパルス３は、パルス信号４１の
高レベルの部分と低レベルの部分との時間差（Ｔ１］、
−Ｔ２１）だけ破線で示すように非対称になるが、この
とき同時に、位相比較器６０の出力の制御信号６１は、
時間差（Ｔ１１Ｔ２１）がＯでないため、制御信号６１
． ａに示すように正の電位となり、可変遅延素子３０
の遅延時間が増加して遅延信号３１は参照符号３１ａに
示す位置に遅延される。この結果、パルス信号４２も同
様にパルス信号４２ａに示すように遅延され、パルス信
号４１および４２ａの立上りの時点において生成される
ピークパルス３ａは、対称な波形に復帰する。
発生すると、出力信号１１および１２にも波形歪１１ａ
および１２ａが発生し、それらの零交差点の位置がずれ
るため、コンパレータ４０の出力のパルス信号４１およ
び４２は、第２図において破線で示した波形４２ａのよ
うになる。従ってピークパルス３は、パルス信号４１の
高レベルの部分と低レベルの部分との時間差（Ｔ１］、
−Ｔ２１）だけ破線で示すように非対称になるが、この
とき同時に、位相比較器６０の出力の制御信号６１は、
時間差（Ｔ１１Ｔ２１）がＯでないため、制御信号６１
． ａに示すように正の電位となり、可変遅延素子３０
の遅延時間が増加して遅延信号３１は参照符号３１ａに
示す位置に遅延される。この結果、パルス信号４２も同
様にパルス信号４２ａに示すように遅延され、パルス信
号４１および４２ａの立上りの時点において生成される
ピークパルス３ａは、対称な波形に復帰する。
以上説明したように、本発明の磁気記憶装置のピーク検
出回路は、微分信号の零交差点検出用のコンパレータの
出力信号のタイミングを監視し、タイミングずれが生じ
たときに一方の極性の出力信号の遅延時間を変えること
により、書込み電流の記録タイミングのずれや外部磁界
の影響による波形の歪や記録再生ヘッドの帯磁等によっ
て発生する再生信号の波形の歪またはピークパルスのタ
イミングのずれに起因する読出し動作の余裕度の低下を
改善できるという効果がある。
出回路は、微分信号の零交差点検出用のコンパレータの
出力信号のタイミングを監視し、タイミングずれが生じ
たときに一方の極性の出力信号の遅延時間を変えること
により、書込み電流の記録タイミングのずれや外部磁界
の影響による波形の歪や記録再生ヘッドの帯磁等によっ
て発生する再生信号の波形の歪またはピークパルスのタ
イミングのずれに起因する読出し動作の余裕度の低下を
改善できるという効果がある。
第１図は本発明の一実施例を示すブロック図、第２図は
第１図の実施例の各信号の波形を示す波形図である。 １０・・・・・・微分器、２０・−・・・・遅延素子、
３０・・・・−・可変遅延素子、４０・・・・・・コン
パレータ、５０・・・・・・パルサー、６０・・・・・
・位相比較器。
第１図の実施例の各信号の波形を示す波形図である。 １０・・・・・・微分器、２０・−・・・・遅延素子、
３０・・・・−・可変遅延素子、４０・・・・・・コン
パレータ、５０・・・・・・パルサー、６０・・・・・
・位相比較器。
Claims (1)
- 【特許請求の範囲】 １、磁気記憶媒体からの再生信号を微分して正負両極性
の信号を出力する微分器と、前記微分器からの正極性の
出力信号を一定の時間だけ遅延する第一の遅延回路と、
前記微分器からの負極性の出力信号を制御信号によって
指定された時間だけ遅延する第二の遅延回路と、前記第
一および第二の遅延回路の出力信号の零交差点を検出し
てパルス信号に変換して出力するコンパレータと、前記
コンパレータの出力のパルス信号の立上りまたは立下り
の時点において所定の時間幅のピークパルスを発生する
パルサーと、前記コンパレータの出力のパルス信号の高
レベルの部分と低レベルの部分との時間差を検出してそ
の差に対応したほぼ直流レベルの信号を前記制御信号と
して出力する位相比較器とを備えることを特徴とする磁
気記憶装置のピーク検出回路。 ２、磁気記憶媒体からの再生信号を微分して正負両極性
の信号を出力する微分器と、前記微分器からの正極性の
出力信号を一定の時間だけ遅延する第一の遅延回路と、
前記微分器からの負極性の出力信号を制御信号によって
指定された時間だけ遅延する第二の遅延回路と、前記第
一および第二の遅延回路の出力信号の零交差点を検出し
て正負両極性のパルス信号に変換して出力するコンパレ
ータと、前記コンパレータの出力の正負両極性のパルス
信号の立上りまたは立下りの時点において所定の時間幅
のピークパルスを発生するパルサーと、前記コンパレー
タの出力の正負再極性のパルス信号を入力してその一方
のパルス信号の高レベルの部分と低レベルの部分との時
間差または両者の高レベルの部分または低レベルの部分
の時間差を検出してその差に対応したほぼ直流レベルの
信号を前記制御信号として出力する位相比較器とを備え
ることを特徴とする磁気記憶装置のピーク検出回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP2160149A JPH0449505A (ja) | 1990-06-19 | 1990-06-19 | 磁気記憶装置のピーク検出回路 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP2160149A JPH0449505A (ja) | 1990-06-19 | 1990-06-19 | 磁気記憶装置のピーク検出回路 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH0449505A true JPH0449505A (ja) | 1992-02-18 |
Family
ID=15708933
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP2160149A Pending JPH0449505A (ja) | 1990-06-19 | 1990-06-19 | 磁気記憶装置のピーク検出回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH0449505A (ja) |
-
1990
- 1990-06-19 JP JP2160149A patent/JPH0449505A/ja active Pending
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