JPH04259202A - チップ部品 - Google Patents
チップ部品Info
- Publication number
- JPH04259202A JPH04259202A JP3104050A JP10405091A JPH04259202A JP H04259202 A JPH04259202 A JP H04259202A JP 3104050 A JP3104050 A JP 3104050A JP 10405091 A JP10405091 A JP 10405091A JP H04259202 A JPH04259202 A JP H04259202A
- Authority
- JP
- Japan
- Prior art keywords
- board
- coated
- terminal
- film
- solder
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Pending
Links
- 239000000758 substrate Substances 0.000 claims abstract description 14
- 229910000679 solder Inorganic materials 0.000 claims abstract description 12
- 238000004519 manufacturing process Methods 0.000 claims abstract description 7
- 238000000034 method Methods 0.000 claims abstract description 6
- 239000004020 conductor Substances 0.000 claims 1
- 239000000919 ceramic Substances 0.000 abstract description 4
- 239000000126 substance Substances 0.000 abstract description 4
- VNNRSPGTAMTISX-UHFFFAOYSA-N chromium nickel Chemical group [Cr].[Ni] VNNRSPGTAMTISX-UHFFFAOYSA-N 0.000 abstract description 3
- 238000001259 photo etching Methods 0.000 abstract description 3
- 238000004544 sputter deposition Methods 0.000 abstract description 3
- 238000005476 soldering Methods 0.000 abstract 1
- 239000010408 film Substances 0.000 description 13
- 238000009713 electroplating Methods 0.000 description 3
- 229910018487 Ni—Cr Inorganic materials 0.000 description 2
- 239000000853 adhesive Substances 0.000 description 2
- 230000001070 adhesive effect Effects 0.000 description 2
- 238000007796 conventional method Methods 0.000 description 2
- 239000011248 coating agent Substances 0.000 description 1
- 238000000576 coating method Methods 0.000 description 1
- 238000000151 deposition Methods 0.000 description 1
- 238000010586 diagram Methods 0.000 description 1
- 230000000694 effects Effects 0.000 description 1
- 238000010438 heat treatment Methods 0.000 description 1
- 239000000463 material Substances 0.000 description 1
- 239000010409 thin film Substances 0.000 description 1
- 238000001771 vacuum deposition Methods 0.000 description 1
Landscapes
- Apparatuses And Processes For Manufacturing Resistors (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【0001】
【産業上の利用分野】本発明は、薄膜化電子部品の製造
法に関するものである。
法に関するものである。
【0002】
【従来の技術】従来チップ部品の外部端子形成は、セラ
ミック基板等の電気的絶縁基板の両面或は片面に真空着
膜法により着膜した下地膜を、ホトエッチング法により
図1の如くパタン形成を行い、図2或は図3に示す如く
構造にした後、基板を図4の如く短冊状に分割し、更に
図5或は図6の如く該短冊状基板の長方片に沿った3面
に電気的媒体をスパッタ等により着膜し、電解めっきを
施して、図7或は図8に示す如く構造を持つ外部端子を
形成していた。
ミック基板等の電気的絶縁基板の両面或は片面に真空着
膜法により着膜した下地膜を、ホトエッチング法により
図1の如くパタン形成を行い、図2或は図3に示す如く
構造にした後、基板を図4の如く短冊状に分割し、更に
図5或は図6の如く該短冊状基板の長方片に沿った3面
に電気的媒体をスパッタ等により着膜し、電解めっきを
施して、図7或は図8に示す如く構造を持つ外部端子を
形成していた。
【0003】
【発明が解決しようとする課題】従来、外部端子を形成
するには電気的媒体として下地膜が必要であり、材料の
制約及び工程の複雑さがチップ部品製造の障害となって
いた。
するには電気的媒体として下地膜が必要であり、材料の
制約及び工程の複雑さがチップ部品製造の障害となって
いた。
【0004】
【課題を解決するための手段】本発明は、コの字型はん
だ被覆端子を外部端子とし、導電性物質により機能性膜
との接合を図ることにより、電解めっきの媒体が不要で
ある。
だ被覆端子を外部端子とし、導電性物質により機能性膜
との接合を図ることにより、電解めっきの媒体が不要で
ある。
【0005】
【実施例1】この実施例に於ては、電気的絶縁基板とし
て50mm×60mm、厚みが0.4mmのセラミック
基板を用いた。該基板表面にスパツタ法によりニッケル
クロム系の抵抗膜及び一次電極膜を着膜した後、該被膜
をホト・エッチング法で図1及び図3の如くパタンを形
成した。次いで、該パタン形成済み基板に250〜40
0℃で1時間以上の熱処理を施した後、レーザ光で抵抗
値調整を行なった。次いで図4の如く基板を短冊状にダ
イサーで分割した。次いで、はんだペーストを塗布した
コの字型はんだ被覆端子を図9の如く嵌め込んだ後、リ
フローにより一次電極膜とコの字型はんだ被覆端子との
接合を行なった。次いで短冊状の基板を図10の如くダ
イサーで分割し完成した。
て50mm×60mm、厚みが0.4mmのセラミック
基板を用いた。該基板表面にスパツタ法によりニッケル
クロム系の抵抗膜及び一次電極膜を着膜した後、該被膜
をホト・エッチング法で図1及び図3の如くパタンを形
成した。次いで、該パタン形成済み基板に250〜40
0℃で1時間以上の熱処理を施した後、レーザ光で抵抗
値調整を行なった。次いで図4の如く基板を短冊状にダ
イサーで分割した。次いで、はんだペーストを塗布した
コの字型はんだ被覆端子を図9の如く嵌め込んだ後、リ
フローにより一次電極膜とコの字型はんだ被覆端子との
接合を行なった。次いで短冊状の基板を図10の如くダ
イサーで分割し完成した。
【0006】
【実施例2】この実施例では、「実施例1」のコの字型
はんだ被覆端子に介す導電物質が、はんだペーストであ
ったのに対し硬化性接着剤を塗布した端子を嵌め込んだ
後、接着剤を硬化することにより抵抗膜とコの字型はん
だ被覆端子との接合を行ないチップ部品を完成した。
はんだ被覆端子に介す導電物質が、はんだペーストであ
ったのに対し硬化性接着剤を塗布した端子を嵌め込んだ
後、接着剤を硬化することにより抵抗膜とコの字型はん
だ被覆端子との接合を行ないチップ部品を完成した。
【発明の効果】本発明の製造法によりチップ部品の製造
が容易、かつ安価で実施可能となる。
が容易、かつ安価で実施可能となる。
【図1】従来及び本発明共通の機能性膜パタンを示した
上面図である。
上面図である。
【図2】従来の機能性膜パタンを示した側面図(A−A
′)である。
′)である。
【図3】従来及び本発明共通の機能性膜パタンを示した
側面図(A−A′)である。
側面図(A−A′)である。
【図4】従来及び本発明共通の短冊状に分割(A−A′
,B−B′)した基板を示した上面図である。
,B−B′)した基板を示した上面図である。
【図5】「図2」のパタンに電気的媒体を形成した、従
来の構造を示した断面図(A−B)である。
来の構造を示した断面図(A−B)である。
【図6】「図3」のパタンに電気的媒体を形成した、従
来の構造を示した断面図(A−B)である。
来の構造を示した断面図(A−B)である。
【図7】「図2」のパタンによる従来の外部端子を示す
断面図(A−B)である。
断面図(A−B)である。
【図8】「図3」のパタンによる従来の外部端子を示す
断面図(A−B)である。
断面図(A−B)である。
【図9】本発明の外部端子を示した断面図(A−B)で
ある。
ある。
【図10】本発明の製造法で製造したチップ部品を示す
立体図である
立体図である
1 セラミック基板
2 ニッケルクロム系抵抗膜
3 一次電極膜
4 電解めっき媒体用被膜
5 外部端子
6 導電性物質
7 コの字型はんだ被覆端子
Claims (2)
- 【請求項1】電気的絶縁基板上に機能性膜を形成した後
、該基板を短冊状に分割し、短冊状の長方片に沿った両
側に導電性物質を介し、コの字型はんだ被覆端子を嵌め
込み外部端子とし、更にダイサーでチップに分割するこ
とを特徴とするチップ部品の製造方法。 - 【請求項2】「請求項1」の製造方法により製造したチ
ップ部品。
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP3104050A JPH04259202A (ja) | 1991-02-13 | 1991-02-13 | チップ部品 |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP3104050A JPH04259202A (ja) | 1991-02-13 | 1991-02-13 | チップ部品 |
Publications (1)
Publication Number | Publication Date |
---|---|
JPH04259202A true JPH04259202A (ja) | 1992-09-14 |
Family
ID=14370387
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP3104050A Pending JPH04259202A (ja) | 1991-02-13 | 1991-02-13 | チップ部品 |
Country Status (1)
Country | Link |
---|---|
JP (1) | JPH04259202A (ja) |
Cited By (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
EP0795878A3 (en) * | 1996-03-13 | 1998-05-27 | Kamaya Electric Co., Ltd. | Chip resistor |
-
1991
- 1991-02-13 JP JP3104050A patent/JPH04259202A/ja active Pending
Cited By (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
EP0795878A3 (en) * | 1996-03-13 | 1998-05-27 | Kamaya Electric Co., Ltd. | Chip resistor |
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