JPH04181823A - データキャリア及び識別システム - Google Patents
データキャリア及び識別システムInfo
- Publication number
- JPH04181823A JPH04181823A JP2311102A JP31110290A JPH04181823A JP H04181823 A JPH04181823 A JP H04181823A JP 2311102 A JP2311102 A JP 2311102A JP 31110290 A JP31110290 A JP 31110290A JP H04181823 A JPH04181823 A JP H04181823A
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- JP
- Japan
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- 230000005540 biological transmission Effects 0.000 claims abstract description 7
- 238000001514 detection method Methods 0.000 abstract description 9
- 238000000034 method Methods 0.000 description 11
- 238000010586 diagram Methods 0.000 description 7
- 230000004044 response Effects 0.000 description 3
- 238000004891 communication Methods 0.000 description 2
- 230000000694 effects Effects 0.000 description 2
- 230000006870 function Effects 0.000 description 2
- 240000002853 Nelumbo nucifera Species 0.000 description 1
- 235000006508 Nelumbo nucifera Nutrition 0.000 description 1
- 235000006510 Nelumbo pentapetala Nutrition 0.000 description 1
- 238000005516 engineering process Methods 0.000 description 1
- 230000002747 voluntary effect Effects 0.000 description 1
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- Near-Field Transmission Systems (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
〔産業上の利用分野］
本発明は工作機の工具や工場における部品３製品の管理
又は物流システムの物品識別システムに用いられるデー
タキャリアに関するものである。
又は物流システムの物品識別システムに用いられるデー
タキャリアに関するものである。
〔従来の技術］
従来工作機の工具の管理や工場における組立搬送ライン
での部品、製品の識別等を機械化するためには、工具１
部品、製品等の種々の物品を識別して管理するシステム
が必要となる。そこで特開平１−１６３９９１号のよう
に識別対象物にメモリを有するデータキャリアを設け、
外部からデータ伝送によってデータキャリアに必要な情
報を書込んでおき、必要に応じてその情報を読出すよう
にした物品識別システムが提案されている。このような
データキャリアはパレット等に取付けて用いられ、パレ
ットの搬送経路の側方に配置された書込／読出制御ユニ
ットからデータキャリアに必要なデータを書込み又は読
出すように構成される。そしてこのような従来の物品識
別システムでは、書込／読出制御ユニットからデータキ
ャリアに伝送データのチェックコードを付さず、又は単
なる水平パリティピントを付してデータを伝送するよう
にしている。
での部品、製品の識別等を機械化するためには、工具１
部品、製品等の種々の物品を識別して管理するシステム
が必要となる。そこで特開平１−１６３９９１号のよう
に識別対象物にメモリを有するデータキャリアを設け、
外部からデータ伝送によってデータキャリアに必要な情
報を書込んでおき、必要に応じてその情報を読出すよう
にした物品識別システムが提案されている。このような
データキャリアはパレット等に取付けて用いられ、パレ
ットの搬送経路の側方に配置された書込／読出制御ユニ
ットからデータキャリアに必要なデータを書込み又は読
出すように構成される。そしてこのような従来の物品識
別システムでは、書込／読出制御ユニットからデータキ
ャリアに伝送データのチェックコードを付さず、又は単
なる水平パリティピントを付してデータを伝送するよう
にしている。
このようにデータキャリアからリードライトヘッド側に
データを伝送する際には、同期コードやステータスに加
えてデータ及びパリティピット等を付して伝送される。
データを伝送する際には、同期コードやステータスに加
えてデータ及びパリティピット等を付して伝送される。
しかしメモリのデータ自体が変化すること（メモリ化け
）が生じてもステータス情報は既に伝送されているため
、メモリ化け情報を書込／読出制御ユニット側に伝える
ことができないという問題点があった。
）が生じてもステータス情報は既に伝送されているため
、メモリ化け情報を書込／読出制御ユニット側に伝える
ことができないという問題点があった。
本発明はこのような従来の物品識別システムの問題点に
鑑みてなされたものであって、メモリ化けが生じても書
込／読出制御ユニット側でこのような状態を確実に認識
できるようにすることを技術的課題とする。
鑑みてなされたものであって、メモリ化けが生じても書
込／読出制御ユニット側でこのような状態を確実に認識
できるようにすることを技術的課題とする。
本発明は第１図に示すように、データを保持するメモリ
ｌ、外部から与えられるコマンドとデータを復調し、メ
モリより読出されたデータを伝送するデータ伝送手段２
を有し、識別対象である物品に取付けられるデータキャ
リアであって、データキャリアのデータライト時にメモ
リの異なった領域に同一のデータを書込むデータライト
手段３と、データの読出し時に指定アドレスに対応する
複数の領域のデータを読出すことにより書込まれたデー
タの一致を判別するメモリ化け検知手段４と、データの
読出終了後にメモリ化け検知手段によりメモリ化けの検
出の有無に応してＣＲＣチェックコードをそのまま又は
反転して送出するＣＲＣチェックコード送出手段５と、
を具備することを特徴とするものである。
ｌ、外部から与えられるコマンドとデータを復調し、メ
モリより読出されたデータを伝送するデータ伝送手段２
を有し、識別対象である物品に取付けられるデータキャ
リアであって、データキャリアのデータライト時にメモ
リの異なった領域に同一のデータを書込むデータライト
手段３と、データの読出し時に指定アドレスに対応する
複数の領域のデータを読出すことにより書込まれたデー
タの一致を判別するメモリ化け検知手段４と、データの
読出終了後にメモリ化け検知手段によりメモリ化けの検
出の有無に応してＣＲＣチェックコードをそのまま又は
反転して送出するＣＲＣチェックコード送出手段５と、
を具備することを特徴とするものである。
〔作用］
このような特徴を有する本発明によれば、データキャリ
アへのデータの書込み時にはメモリの異なった領域にデ
ータを書込む。そして書込／読出制御ユニット側からリ
ードコマンドが与えられたときには、メモリ化け検知手
段によって書込んだアドレスに対応する複数の領域から
データを読出し、それらの一致を判別することによって
メモリ化けの検知を行っている。そしてメモリ化けが検
知されなければ読出したデータに加えてＣＲＣチェンク
コードをそのまま付し、メモリ化けが検知されればＣＲ
Ｃチェックコードを反転して書込／読出制御ユニット側
に送出するようにしている。
アへのデータの書込み時にはメモリの異なった領域にデ
ータを書込む。そして書込／読出制御ユニット側からリ
ードコマンドが与えられたときには、メモリ化け検知手
段によって書込んだアドレスに対応する複数の領域から
データを読出し、それらの一致を判別することによって
メモリ化けの検知を行っている。そしてメモリ化けが検
知されなければ読出したデータに加えてＣＲＣチェンク
コードをそのまま付し、メモリ化けが検知されればＣＲ
Ｃチェックコードを反転して書込／読出制御ユニット側
に送出するようにしている。
［実施例］
第２図は本発明の一実施例による物品識別システムの構
成を示すブロック図である。本図において物品識別シス
テムは識別の対象となる部品が搬送されるパレット１１
に直接取付けられるデータキャリア１２と、データキャ
リア１２にデータを書込み及び読出すリードライトヘッ
ド１３、及びリードライトヘッド１３に接続されてその
動作を制御するＩＤコントローラ１４が設けられる。リ
ードライトヘッド１３及びＩＤコントローラ１４は書込
／読出制御ユニットを構成している。又■Ｄコントロー
ラ１４は上位のコンピュータ１５に接続されている。
成を示すブロック図である。本図において物品識別シス
テムは識別の対象となる部品が搬送されるパレット１１
に直接取付けられるデータキャリア１２と、データキャ
リア１２にデータを書込み及び読出すリードライトヘッ
ド１３、及びリードライトヘッド１３に接続されてその
動作を制御するＩＤコントローラ１４が設けられる。リ
ードライトヘッド１３及びＩＤコントローラ１４は書込
／読出制御ユニットを構成している。又■Ｄコントロー
ラ１４は上位のコンピュータ１５に接続されている。
さてＩＤコントローラ１４は第３図にブロック図を示す
ように、データキャリアＩ２へのデータの書込み及び読
取りを制御するマイクロプロセッサ（ＣＰＵ）２１とそ
のシステムプログラム及びデータを保持するメモリ２２
が設けられ、又上位のコンピュータ１５との人出力を行
う入出力インターフェース２３が設けられる。リードラ
イトヘッド１３はＣＰＵ２１より出力が与えられデータ
キャリア１２に伝送すべきデータを変調する変調回路２
４と、その出力によって駆動される送信部２５を有して
いる。送信部２５は例えばコイルからＦＳＫ変調された
信号を出力することによってデータキャリア１２にデー
タを伝送するものである。又データキャリア１２から得
られる受信信号は受信部２６を介して復調回路２７に与
えられる。
ように、データキャリアＩ２へのデータの書込み及び読
取りを制御するマイクロプロセッサ（ＣＰＵ）２１とそ
のシステムプログラム及びデータを保持するメモリ２２
が設けられ、又上位のコンピュータ１５との人出力を行
う入出力インターフェース２３が設けられる。リードラ
イトヘッド１３はＣＰＵ２１より出力が与えられデータ
キャリア１２に伝送すべきデータを変調する変調回路２
４と、その出力によって駆動される送信部２５を有して
いる。送信部２５は例えばコイルからＦＳＫ変調された
信号を出力することによってデータキャリア１２にデー
タを伝送するものである。又データキャリア１２から得
られる受信信号は受信部２６を介して復調回路２７に与
えられる。
復調回路２７はこの信号を復調してＣＰＵ２１に与える
ものである。
ものである。
次にデータキャリア１２の構成について第４図を参照し
つつ説明する。第４図において、送受信部３１はリード
ライトヘッド１３より出射される周波数の信号を受信及
び送信するものであり、その受信出力は復調回路３２に
与えられる。復調回路３２はこの信号を復調しそのデー
タを元の信号に変換して制御部３３に与えている。制御
部３３にはハスを介してメモリ３４が接続される。制御
部３３は後述するようにＴＤコントローラ１４から与え
られたコマンド及びデータに従ってデータを書込み又は
読出すように制御するデータライト手段３．メモリ化け
検知手段４及びＣＲＣのチェックコードを送出するＣＲ
Ｃチェックコード送出手段５を構成している。そしてメ
モリ３４から読出されたデータはシリアル信号に変換さ
れ、変調回路３５を介して送受信部３１に与えられる。
つつ説明する。第４図において、送受信部３１はリード
ライトヘッド１３より出射される周波数の信号を受信及
び送信するものであり、その受信出力は復調回路３２に
与えられる。復調回路３２はこの信号を復調しそのデー
タを元の信号に変換して制御部３３に与えている。制御
部３３にはハスを介してメモリ３４が接続される。制御
部３３は後述するようにＴＤコントローラ１４から与え
られたコマンド及びデータに従ってデータを書込み又は
読出すように制御するデータライト手段３．メモリ化け
検知手段４及びＣＲＣのチェックコードを送出するＣＲ
Ｃチェックコード送出手段５を構成している。そしてメ
モリ３４から読出されたデータはシリアル信号に変換さ
れ、変調回路３５を介して送受信部３１に与えられる。
送受信部３１は例えば従来例のように共振回路の共振周
波数を異ならせることによって信号をリードライトヘッ
ド１４側に与えるものである。ここで送受信部３１．復
調回路３２及び変調回路３５はＩＤコントローラから与
えられたコマンドのデータを復調すると共に、読出され
たデータを伝送するデータ伝送手段２を構成している。
波数を異ならせることによって信号をリードライトヘッ
ド１４側に与えるものである。ここで送受信部３１．復
調回路３２及び変調回路３５はＩＤコントローラから与
えられたコマンドのデータを復調すると共に、読出され
たデータを伝送するデータ伝送手段２を構成している。
第５図はメモリ３４のメモリマツプを示す図である。本
図に示すようにライトデータ１を「００１１１１００Ｊ
、 ライトデータ２をｒｌｌｌｌｌｌｌｌ」とすると
、それらのライトデータをアドレス’０ＯＯＯＪ、アド
レス「０００２Ｊに書込む。そして奇数のアドレスｒｏ
ｏｏ１」及び「０００３」にはライトデータ１及び２を
夫々反転させたデータを書込んだ状態を示している。こ
のようにデータライト手段３によって書込むべきデータ
が与えられたときには偶数のアドレスにそのデータを書
込むと共に、奇数のアドレスにはその反転データを書込
むようにメモリを用いる。この場合にはメモリの容量は
通常の場合に比べて各となり、読出す場合には偶数及び
奇数アドレスを同時に読出すことが必要となるためアク
セス回数も２倍となるが、後述するように信顧性を向上
させるこ七ができる。
図に示すようにライトデータ１を「００１１１１００Ｊ
、 ライトデータ２をｒｌｌｌｌｌｌｌｌ」とすると
、それらのライトデータをアドレス’０ＯＯＯＪ、アド
レス「０００２Ｊに書込む。そして奇数のアドレスｒｏ
ｏｏ１」及び「０００３」にはライトデータ１及び２を
夫々反転させたデータを書込んだ状態を示している。こ
のようにデータライト手段３によって書込むべきデータ
が与えられたときには偶数のアドレスにそのデータを書
込むと共に、奇数のアドレスにはその反転データを書込
むようにメモリを用いる。この場合にはメモリの容量は
通常の場合に比べて各となり、読出す場合には偶数及び
奇数アドレスを同時に読出すことが必要となるためアク
セス回数も２倍となるが、後述するように信顧性を向上
させるこ七ができる。
次にこれに対応する書込／読出制御ユニット側の動作に
ついて第６図及び第７図のフローチャートを参照しつつ
説明する。まずステップ４１においてリードライトヘッ
ド側からデータを読出すためのリードコマンドをデータ
キャリア１２に送出する。このコマンドを送出すればス
テップ４２に進んでデータキャリア１２からの応答を待
受ける。−方データキャリア１２側では第７図（ａ）に
示すようにコマンドの受信を待受けており（ステップ５
１）、リードコマンドがあればルーチン５２に進んでデ
ータリードとメモリ化けの検知を行う。ルーチン５２は
第７図（ｂ）に示すようにステップ５３．５４において
偶数アドレス及び奇数アドレスのデータを読取る。
ついて第６図及び第７図のフローチャートを参照しつつ
説明する。まずステップ４１においてリードライトヘッ
ド側からデータを読出すためのリードコマンドをデータ
キャリア１２に送出する。このコマンドを送出すればス
テップ４２に進んでデータキャリア１２からの応答を待
受ける。−方データキャリア１２側では第７図（ａ）に
示すようにコマンドの受信を待受けており（ステップ５
１）、リードコマンドがあればルーチン５２に進んでデ
ータリードとメモリ化けの検知を行う。ルーチン５２は
第７図（ｂ）に示すようにステップ５３．５４において
偶数アドレス及び奇数アドレスのデータを読取る。
そしてステップ５５に進んで奇数アドレスのデータを反
転させ、このデータと偶数アドレスのデータとを比較す
る。このデータが一致している場合にはメモリでのデー
タ化けがないものと判断しくステップ５６）、不一致の
場合にはメモリ化けがあるものと判断して（ステップ５
７）このルーチンを終える。そしてステップ５８に進ん
でメモリ化けの有無を判別し、メモリ化けがあればステ
ップ５９に進んでＣＲＣを反転したデータをステータス
、リードデータに続けて書込／読出制御ユニットのり−
ドライトヘッド側に送出する。一方メモリ化けがなけれ
ばステップ５８からステップ６０に進んでステータス、
リードデータにＣＲＣデータを付加してリードコマンド
に対する応答を終える。これに対してリードライトヘッ
ド側では、データキャリア１２からの応答があればステ
ップ４３に進んでＣＲＣエラーの有無をチエツクする。
転させ、このデータと偶数アドレスのデータとを比較す
る。このデータが一致している場合にはメモリでのデー
タ化けがないものと判断しくステップ５６）、不一致の
場合にはメモリ化けがあるものと判断して（ステップ５
７）このルーチンを終える。そしてステップ５８に進ん
でメモリ化けの有無を判別し、メモリ化けがあればステ
ップ５９に進んでＣＲＣを反転したデータをステータス
、リードデータに続けて書込／読出制御ユニットのり−
ドライトヘッド側に送出する。一方メモリ化けがなけれ
ばステップ５８からステップ６０に進んでステータス、
リードデータにＣＲＣデータを付加してリードコマンド
に対する応答を終える。これに対してリードライトヘッ
ド側では、データキャリア１２からの応答があればステ
ップ４３に進んでＣＲＣエラーの有無をチエツクする。
ＣＲＣエラーがなければエラーなしとして処理を終了し
くステップ４４）、ＣＲＣエラーがあればステップ４５
に進んでＣＲＣを反転したときにＣＲＣエラーがあるが
どうかをチエツクする。ＣＲＣの反転によるエラーがあ
れば通信時のエラーと判別される（ステップ４６）。従
ってステップ４１に戻って再びコマンドを送出して同様
の処理を繰り返す。そしてＣＲＣを反転した場合にエラ
ーがなければデータキャリア内のメモリ３４でデータが
変化しているメモリ化けが生しているものと判断される
（ステップ４７）。この場合には再びデータを読出す必
要がないので、そのまま処理を終了する。ここでデータ
キャリアの制御部３３はルーチン５２においてデータを
読出した際に指定アドレスに対応する複数の領域のデー
タを読出し、書込まれたデータの一致を判別するメモリ
化け検知手段４の機能を達成しており、ステップ５８〜
６０においてメモリ化け検知手段によりメモリ化けの検
出の有無に応じてＣＲＣチェックコードをそのまま又は
反転して送出するＣＲＣチェックコード送出手段５の機
能を達成している。
くステップ４４）、ＣＲＣエラーがあればステップ４５
に進んでＣＲＣを反転したときにＣＲＣエラーがあるが
どうかをチエツクする。ＣＲＣの反転によるエラーがあ
れば通信時のエラーと判別される（ステップ４６）。従
ってステップ４１に戻って再びコマンドを送出して同様
の処理を繰り返す。そしてＣＲＣを反転した場合にエラ
ーがなければデータキャリア内のメモリ３４でデータが
変化しているメモリ化けが生しているものと判断される
（ステップ４７）。この場合には再びデータを読出す必
要がないので、そのまま処理を終了する。ここでデータ
キャリアの制御部３３はルーチン５２においてデータを
読出した際に指定アドレスに対応する複数の領域のデー
タを読出し、書込まれたデータの一致を判別するメモリ
化け検知手段４の機能を達成しており、ステップ５８〜
６０においてメモリ化け検知手段によりメモリ化けの検
出の有無に応じてＣＲＣチェックコードをそのまま又は
反転して送出するＣＲＣチェックコード送出手段５の機
能を達成している。
以上詳細に説明したように本発明では、データキャリア
にデータを書込みデータを読出す際にはメモリ化けの有
無を判別して、メモリ化けがあればＣＲＣチェックコー
ドを反転させて送出するようにしている。従って書込／
読出制御ユニット側でメモリのデータ化けを判別するこ
とができ、これを伝えることができる。従ってシステム
全体の信幀性を向上させることが可能となる。又従来の
通信プロトコルと共通性があり、メモリ化け情報を示す
ための領域も不要になるという効果が得られる。
にデータを書込みデータを読出す際にはメモリ化けの有
無を判別して、メモリ化けがあればＣＲＣチェックコー
ドを反転させて送出するようにしている。従って書込／
読出制御ユニット側でメモリのデータ化けを判別するこ
とができ、これを伝えることができる。従ってシステム
全体の信幀性を向上させることが可能となる。又従来の
通信プロトコルと共通性があり、メモリ化け情報を示す
ための領域も不要になるという効果が得られる。
第１図は本発明の機能的構成を示すブロック図、第２図
は本発明に用いられる物品識別システムの全体構成を示
すブロック図、第３図はＩＤコントローラ及びリードラ
イトヘッドの構成を示すブロック図、第４図はデータキ
ャリアの構成を示すブロック図、第５図はメモリ３４の
メモリマツプ、第６図は本実施例によるＩＤコントロー
ラ側の動作を示すフローチャート、第７図（ａ）及び（
ｂ）は本発明のデータキャリアの動作を示すフローチャ
ートである。 １．３，１ｌ−−−一・−メモリ ２−・−データ伝
送手段３−−−−−−・データライト手段 ４−ｍ−
−−−・メモリ化け検知手段 ５、−−−−−−−、
ＣＲＣチェックコード送出手段１２−・−・−データキ
ャリア １３−−−−−−リードライトヘッド １
４−−−−−・・ＩＤコントローラ １５− ・・−
上位コンピュータ ２ｌ−−−−−ＣＰＵ ３３
−・−・−制御部 第１図 第２図 第３図 第４図 第５図 第７図（ａ） 第７図（ｂ） 手 続 補 正 書（自発） １、事件の表示 平成２年特許願第３１１１０２号 住 所 京都府京都市右京区花園土堂町１０番地名 称
（２９４） オムロン株式会社代表者 立 石
義 雄 ４、代理人 住 所 ５５５０大阪府大阪市西区北堀江１丁目５番２
号四ツ橋新興産ビル 〜ｙ゛−−・′ ５、補正の対象 図面 ６、補正の内容 第７図を別紙の通り訂正します。 以上 ・ゝ−Ｓ＼ （−＼ 第７図（ａ） 第７図（ｂ）
は本発明に用いられる物品識別システムの全体構成を示
すブロック図、第３図はＩＤコントローラ及びリードラ
イトヘッドの構成を示すブロック図、第４図はデータキ
ャリアの構成を示すブロック図、第５図はメモリ３４の
メモリマツプ、第６図は本実施例によるＩＤコントロー
ラ側の動作を示すフローチャート、第７図（ａ）及び（
ｂ）は本発明のデータキャリアの動作を示すフローチャ
ートである。 １．３，１ｌ−−−一・−メモリ ２−・−データ伝
送手段３−−−−−−・データライト手段 ４−ｍ−
−−−・メモリ化け検知手段 ５、−−−−−−−、
ＣＲＣチェックコード送出手段１２−・−・−データキ
ャリア １３−−−−−−リードライトヘッド １
４−−−−−・・ＩＤコントローラ １５− ・・−
上位コンピュータ ２ｌ−−−−−ＣＰＵ ３３
−・−・−制御部 第１図 第２図 第３図 第４図 第５図 第７図（ａ） 第７図（ｂ） 手 続 補 正 書（自発） １、事件の表示 平成２年特許願第３１１１０２号 住 所 京都府京都市右京区花園土堂町１０番地名 称
（２９４） オムロン株式会社代表者 立 石
義 雄 ４、代理人 住 所 ５５５０大阪府大阪市西区北堀江１丁目５番２
号四ツ橋新興産ビル 〜ｙ゛−−・′ ５、補正の対象 図面 ６、補正の内容 第７図を別紙の通り訂正します。 以上 ・ゝ−Ｓ＼ （−＼ 第７図（ａ） 第７図（ｂ）
Claims (1)
- （１）データを保持するメモリ、外部から与えられるコ
マンドとデータを復調し、前記メモリより読出されたデ
ータを伝送するデータ伝送手段を有し、識別対象である
物品に取付けられるデータキャリアであって、 データキャリアのデータライト時にメモリの異なった領
域に同一のデータを書込むデータライト手段と、 データの読出し時に指定アドレスに対応する複数の領域
のデータを読出すことにより書込まれたデータの一致を
判別するメモリ化け検知手段と、前記データの読出終了
後に前記メモリ化け検知手段によりメモリ化けの検出の
有無に応じてＣＲＣチェックコードをそのまま又は反転
して送出するＣＲＣチェックコード送出手段と、を具備
することを特徴とするデータキャリア。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP2311102A JP3007926B2 (ja) | 1990-11-15 | 1990-11-15 | データキャリア及び識別システム |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP2311102A JP3007926B2 (ja) | 1990-11-15 | 1990-11-15 | データキャリア及び識別システム |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPH04181823A true JPH04181823A (ja) | 1992-06-29 |
| JP3007926B2 JP3007926B2 (ja) | 2000-02-14 |
Family
ID=18013168
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP2311102A Expired - Lifetime JP3007926B2 (ja) | 1990-11-15 | 1990-11-15 | データキャリア及び識別システム |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JP3007926B2 (ja) |
Cited By (8)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP2013081190A (ja) * | 2004-11-24 | 2013-05-02 | Qualcomm Inc | 巡回冗長検査を実行するためのシステム及び方法 |
| US8719334B2 (en) | 2003-09-10 | 2014-05-06 | Qualcomm Incorporated | High data rate interface |
| US8730913B2 (en) | 2004-03-10 | 2014-05-20 | Qualcomm Incorporated | High data rate interface apparatus and method |
| US8730069B2 (en) | 2005-11-23 | 2014-05-20 | Qualcomm Incorporated | Double data rate serial encoder |
| US8745251B2 (en) | 2000-12-15 | 2014-06-03 | Qualcomm Incorporated | Power reduction system for an apparatus for high data rate signal transfer using a communication protocol |
| US8756294B2 (en) | 2003-10-29 | 2014-06-17 | Qualcomm Incorporated | High data rate interface |
| US8812706B1 (en) | 2001-09-06 | 2014-08-19 | Qualcomm Incorporated | Method and apparatus for compensating for mismatched delays in signals of a mobile display interface (MDDI) system |
| US8873584B2 (en) | 2004-11-24 | 2014-10-28 | Qualcomm Incorporated | Digital data interface device |
Families Citing this family (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| WO2014058051A1 (ja) * | 2012-10-12 | 2014-04-17 | 国際計測器株式会社 | ２軸出力モータ、モータユニット、動力シミュレータ、ねじり試験装置、回転ねじり試験装置、タイヤ試験装置、直動アクチュエータ及び加振装置 |
-
1990
- 1990-11-15 JP JP2311102A patent/JP3007926B2/ja not_active Expired - Lifetime
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Also Published As
| Publication number | Publication date |
|---|---|
| JP3007926B2 (ja) | 2000-02-14 |
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