JPH04152624A - 薄膜半導体装置の製造方法 - Google Patents
薄膜半導体装置の製造方法Info
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- JPH04152624A JPH04152624A JP27815190A JP27815190A JPH04152624A JP H04152624 A JPH04152624 A JP H04152624A JP 27815190 A JP27815190 A JP 27815190A JP 27815190 A JP27815190 A JP 27815190A JP H04152624 A JPH04152624 A JP H04152624A
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Landscapes
- Thin Film Transistor (AREA)
- Recrystallisation Techniques (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
[産業上の利用分野コ
本発明は、薄膜半導体装置及びその製造方法に係わり、
特に、結晶性の優れたシリコン薄膜を利用した薄膜半導
体装置及びその製造方法に関する。
特に、結晶性の優れたシリコン薄膜を利用した薄膜半導
体装置及びその製造方法に関する。
[従来の技術]
近年、SOIあるいは、三次元ICや、大型液晶表示パ
ネルや、高速で高解像度の密着型イメージセンサ等への
ニーズが高まるにつれて、絶縁性非晶質材料上に、高性
能な薄膜半導体装置の実現する技術が重要になってきた
。
ネルや、高速で高解像度の密着型イメージセンサ等への
ニーズが高まるにつれて、絶縁性非晶質材料上に、高性
能な薄膜半導体装置の実現する技術が重要になってきた
。
石英基板、ガラス基板等の絶縁性非晶質基板あるいはS
i 02等の絶縁性非晶質層上に、結晶方位の揃った
結晶粒径の大きな多結晶シリコン薄膜、あるいは単結晶
シリコン薄膜を形成する方法は、5OI(Silico
n On In5ulator)技術として知られ
ている。 (参考文献 S0工構造形成技術、産業図書
)、 大きく分類すると、再結晶化法、エピタキシャ
ル法、絶縁層埋め込み法、貼り合わせ法という方法があ
る。再結晶化法は、レーザーアニールあるいは電子ビー
ムアニールによりシリコンを溶融再結晶化させる方法と
、熱処理により溶融する温度までは昇温させずに結晶成
長させる固相成長法の2つに分類される。前記レーザー
アニール等による溶融再結晶化法は、大面積化に対して
技術的困難が大きい。この方法に比較して、低温熱処理
においても容易に再結晶化できるという点で固相成長法
が優れている。550℃の低温熱処理にもかかわらずシ
リコン薄膜の結晶粒が成長したという結果も報告されて
いる。 (参考文献 IEEE Electr。
i 02等の絶縁性非晶質層上に、結晶方位の揃った
結晶粒径の大きな多結晶シリコン薄膜、あるいは単結晶
シリコン薄膜を形成する方法は、5OI(Silico
n On In5ulator)技術として知られ
ている。 (参考文献 S0工構造形成技術、産業図書
)、 大きく分類すると、再結晶化法、エピタキシャ
ル法、絶縁層埋め込み法、貼り合わせ法という方法があ
る。再結晶化法は、レーザーアニールあるいは電子ビー
ムアニールによりシリコンを溶融再結晶化させる方法と
、熱処理により溶融する温度までは昇温させずに結晶成
長させる固相成長法の2つに分類される。前記レーザー
アニール等による溶融再結晶化法は、大面積化に対して
技術的困難が大きい。この方法に比較して、低温熱処理
においても容易に再結晶化できるという点で固相成長法
が優れている。550℃の低温熱処理にもかかわらずシ
リコン薄膜の結晶粒が成長したという結果も報告されて
いる。 (参考文献 IEEE Electr。
n D e v i c e L e t t e
r s、 v o 1. EDL−8,No、8
.p361.August1987)。そこで、本発明
は、固相成長法における従来技術の問題点を解決し、よ
り優れた固相成長技術の確立を主旨とする。
r s、 v o 1. EDL−8,No、8
.p361.August1987)。そこで、本発明
は、固相成長法における従来技術の問題点を解決し、よ
り優れた固相成長技術の確立を主旨とする。
[発明が解決しようとする課題]
従来の技術では、多結晶シリコン薄膜をCVD法で成膜
し、Si゛をイオン注入して該多結晶シリコン薄膜を非
晶質化した後、600′C程度の熱処理を100時間近
く行っていた。このため、高価なイオン注入装置を必要
としたほか、熱処理時間が極めて長いという欠点があっ
た。
し、Si゛をイオン注入して該多結晶シリコン薄膜を非
晶質化した後、600′C程度の熱処理を100時間近
く行っていた。このため、高価なイオン注入装置を必要
としたほか、熱処理時間が極めて長いという欠点があっ
た。
また、固相成長法においては、酸素等の不純物によって
結晶成長が妨害される。そこで、EB蒸着法、スパッタ
法、MBE法等で非晶質シリコン薄膜を成膜する場合は
、極めて清浄で、しかも超高真空なチャンバー内で成膜
しなければいけない。
結晶成長が妨害される。そこで、EB蒸着法、スパッタ
法、MBE法等で非晶質シリコン薄膜を成膜する場合は
、極めて清浄で、しかも超高真空なチャンバー内で成膜
しなければいけない。
従って、量産時の能力に問題があり、メンテナンスも容
易ではなくなる。
易ではなくなる。
プラズマCVD法で成膜された非晶質シリコン薄膜は、
不純物は非常に少ないが、膜中に多くの水素を含んでい
る。その水素が固相成長を阻害するため、あるいは急激
な熱処理により水素が爆発的に放出するために、固相成
長させる非晶質シリコン薄膜の成膜方法としてプラズマ
CVD法は適していなし八と従来考えられていた。
不純物は非常に少ないが、膜中に多くの水素を含んでい
る。その水素が固相成長を阻害するため、あるいは急激
な熱処理により水素が爆発的に放出するために、固相成
長させる非晶質シリコン薄膜の成膜方法としてプラズマ
CVD法は適していなし八と従来考えられていた。
低温で良質のゲート絶縁膜を形成する技術が重要となっ
てきた。熱酸化法は、900〜1200℃程度の高温プ
ロセスであるため、 (1)安価なガラス基板上に素子
を形成できない、 (2)不純物の横拡散。 (3)三
次元ICでは下層部の素子に悪影響(不純物の拡散など
)を与える。 (4)poly−3iの熱酸化膜は絶縁
耐圧が不十分で界面準位密度が大きい等の問題がある。
てきた。熱酸化法は、900〜1200℃程度の高温プ
ロセスであるため、 (1)安価なガラス基板上に素子
を形成できない、 (2)不純物の横拡散。 (3)三
次元ICでは下層部の素子に悪影響(不純物の拡散など
)を与える。 (4)poly−3iの熱酸化膜は絶縁
耐圧が不十分で界面準位密度が大きい等の問題がある。
現在、CVD法や、光CVD法や、プラズマCVD法な
どでゲート酸化膜を形成する技術が検討されている。
どでゲート酸化膜を形成する技術が検討されている。
本発明の目的は、上述の問題点を解決し、簡便で実用的
なプラズマCVD法で成膜された非晶質シリコン薄膜を
熱処理することにより、大粒径の多結晶シリコン薄膜を
形成すると同時により優れたゲート酸化膜を形成できる
面相成長法を提供することである。
なプラズマCVD法で成膜された非晶質シリコン薄膜を
熱処理することにより、大粒径の多結晶シリコン薄膜を
形成すると同時により優れたゲート酸化膜を形成できる
面相成長法を提供することである。
[課題を解決するための手段]
本発明の薄膜半導体装置の製造方法は、絶縁性非晶質材
料上の非単結晶半導体薄膜を固相成長させる工程を少な
くとも有する薄膜半導体装置の製造方法において、前記
固相成長法は、酸素ガス分圧99.99%以上の酸素雰
囲気中で行うことを特徴とする。
料上の非単結晶半導体薄膜を固相成長させる工程を少な
くとも有する薄膜半導体装置の製造方法において、前記
固相成長法は、酸素ガス分圧99.99%以上の酸素雰
囲気中で行うことを特徴とする。
(2)〔a〕 絶縁性非晶質材料上に水素を含有する
非単結晶半導体薄膜を堆積させる工程、 〔b〕 該非単結晶半導体薄膜を熱処理することによ
り水素を放出させる工程、 固相成長法により該非単結晶半導体 薄膜を結晶成長させる工程、 結晶成長させた非単結晶半導体薄膜 に半導体装置を形成する工程を少なく とも有することを特徴とする。
非単結晶半導体薄膜を堆積させる工程、 〔b〕 該非単結晶半導体薄膜を熱処理することによ
り水素を放出させる工程、 固相成長法により該非単結晶半導体 薄膜を結晶成長させる工程、 結晶成長させた非単結晶半導体薄膜 に半導体装置を形成する工程を少なく とも有することを特徴とする。
前記非単結晶半導体薄膜を、プラズマCVD法により堆
積させることを特徴とする。
積させることを特徴とする。
(4) 前記非単結晶半導体薄膜を熱処理するこ(C)
(d)
とにより水素を放出させる工程において、熱処理温度が
400〜500℃であることを特徴とする。
400〜500℃であることを特徴とする。
(5) 前記固相成長法は、500〜700″Cの低温
アニールであることを特徴とする。
アニールであることを特徴とする。
[実旌例コ
絶縁性非晶質材料上に、非単結晶半導体薄膜を成膜する
。前記絶縁性非晶質材料としては、石英基板、ガラス基
板、窒化膜あるいはSiO2膜等が用いられる0石英基
板を用いる場合はプロセス温度は1200℃程度まで許
容されるが、ガラス基板を用いる場合は、600℃以下
の低温プロセスに制限される。また、不純物の放出拡散
を抑えるために酸化膜あるいは窒素化膜を堆積させた石
英基板やガラス基板を用いる場合もある。本発明は、石
英基板を用い、前記非単結晶半導体薄膜としてSi薄膜
を用いた場合を実施例として説明する。
。前記絶縁性非晶質材料としては、石英基板、ガラス基
板、窒化膜あるいはSiO2膜等が用いられる0石英基
板を用いる場合はプロセス温度は1200℃程度まで許
容されるが、ガラス基板を用いる場合は、600℃以下
の低温プロセスに制限される。また、不純物の放出拡散
を抑えるために酸化膜あるいは窒素化膜を堆積させた石
英基板やガラス基板を用いる場合もある。本発明は、石
英基板を用い、前記非単結晶半導体薄膜としてSi薄膜
を用いた場合を実施例として説明する。
プラズマCVD装置を用い、第1図(2)〔a〕に示す
ように石英基板1−1上に、5iHaとH2の混合ガス
を、13.56MHzの高周波グロー放電により分解さ
せて非晶質Si膜1−2を堆積させる。
ように石英基板1−1上に、5iHaとH2の混合ガス
を、13.56MHzの高周波グロー放電により分解さ
せて非晶質Si膜1−2を堆積させる。
前記混合ガスの5iHa分圧は10〜20%、デボ中の
内圧は0.5〜1.5torr程度である。
内圧は0.5〜1.5torr程度である。
基板温度は250℃以下、180℃程度が適している。
赤外吸収測定より結合水素量を求めたところ約8ato
mic%であった。
mic%であった。
続いて、該非晶質Si膜を、400℃〜500℃で熱処
理して水素を放出させる。この工程は、水素の爆発的な
脱離を防ぐことを目的としている。
理して水素を放出させる。この工程は、水素の爆発的な
脱離を防ぐことを目的としている。
次に前記非晶質シリコン薄膜1−2をフォトリソグラフ
ィ法によりバターニングして第1図〔b〕1−3に示す
ように島状非晶質シリコン薄膜にする。
ィ法によりバターニングして第1図〔b〕1−3に示す
ように島状非晶質シリコン薄膜にする。
次に、前記島状非晶質シリコン薄膜1−3を固相成長さ
せる。固相成長方法は、石英管による炉アニールが便利
である。アニール雰囲気としては、酸素ガス主体とする
。酸素ガス分圧を99.99%以上とする。この様な酸
素ガス雰囲気では混入不純物が非常に少なく、清浄なア
ニール処理ができる。固相成長アニール温度は500℃
〜700℃とする。この様な低温アニールでは選択的に
、結晶成長の活性化エネルギーの小さな結晶方位を持つ
結晶粒のみが成長し、しかもゆっくりと大きく成長する
。しかも酸素雰囲気中での熱処理なので固相成長と同時
にシリコン表面には非常に薄い酸化膜が形成される。シ
リコンの酸化工程は酸化膜厚の範囲によって大きく2つ
の領域に分類される。1つは膜厚が約20nm以下の初
期増速酸化の領域であり、他方は20nm以上の酸化膜
厚で定義される1inear−parabolic酸化
領域である。酸化初期では酸化速度が増速されるので6
00℃という低温にもかかわらず薄い酸化膜が形成され
る。16時間の熱処理でシリコンの結晶粒径は2μm以
上、酸化膜厚は数十A程度となる。第1図(C)におい
て、1−4は固相成長シリコン薄膜を示し、1−5は酸
素雰囲気中で固相成長したことによって形成された薄い
酸化膜を示している。
せる。固相成長方法は、石英管による炉アニールが便利
である。アニール雰囲気としては、酸素ガス主体とする
。酸素ガス分圧を99.99%以上とする。この様な酸
素ガス雰囲気では混入不純物が非常に少なく、清浄なア
ニール処理ができる。固相成長アニール温度は500℃
〜700℃とする。この様な低温アニールでは選択的に
、結晶成長の活性化エネルギーの小さな結晶方位を持つ
結晶粒のみが成長し、しかもゆっくりと大きく成長する
。しかも酸素雰囲気中での熱処理なので固相成長と同時
にシリコン表面には非常に薄い酸化膜が形成される。シ
リコンの酸化工程は酸化膜厚の範囲によって大きく2つ
の領域に分類される。1つは膜厚が約20nm以下の初
期増速酸化の領域であり、他方は20nm以上の酸化膜
厚で定義される1inear−parabolic酸化
領域である。酸化初期では酸化速度が増速されるので6
00℃という低温にもかかわらず薄い酸化膜が形成され
る。16時間の熱処理でシリコンの結晶粒径は2μm以
上、酸化膜厚は数十A程度となる。第1図(C)におい
て、1−4は固相成長シリコン薄膜を示し、1−5は酸
素雰囲気中で固相成長したことによって形成された薄い
酸化膜を示している。
次に第1図(d)に示されているように、ゲート酸化1
11[1−8を形成する。該ゲート酸化膜の形成方法と
してはLPCVD法、あるいは光励起CVD法、あるい
はプラズマCVD法、ECRプラズマCVD法、あるい
は高真空蒸着法、あるいはプラズマ酸化法、あるいは高
圧酸化法などのような500℃以下の低温方法がある。
11[1−8を形成する。該ゲート酸化膜の形成方法と
してはLPCVD法、あるいは光励起CVD法、あるい
はプラズマCVD法、ECRプラズマCVD法、あるい
は高真空蒸着法、あるいはプラズマ酸化法、あるいは高
圧酸化法などのような500℃以下の低温方法がある。
該低温方法で成膜されたゲート酸化膜は、熱処理するこ
とによってより緻密で界面準位の少ない優れた膜となる
。
とによってより緻密で界面準位の少ない優れた膜となる
。
非晶質絶縁基板1−1として石英基板を用いる場合は、
熱酸化法によることができる。該熱酸化法にはdry酸
化法とwet酸化法とがあるが、酸化温度は1000℃
以上と高いが膜質が優れていることからdry酸化法の
方が適している。シリコン表面には薄い酸化膜1−5が
すでに形成されているが、その膜厚は数十人と薄いので
前述したとおり初期増速酸化の領域である。従って、S
i/ S x O2界面の酸化が進行し、優れた界面が
形成される。
熱酸化法によることができる。該熱酸化法にはdry酸
化法とwet酸化法とがあるが、酸化温度は1000℃
以上と高いが膜質が優れていることからdry酸化法の
方が適している。シリコン表面には薄い酸化膜1−5が
すでに形成されているが、その膜厚は数十人と薄いので
前述したとおり初期増速酸化の領域である。従って、S
i/ S x O2界面の酸化が進行し、優れた界面が
形成される。
次に第1図(e)に示されるように、ゲート電極1−7
を形成する。該ゲート電極材料としては多結晶シリコン
薄膜、あるいはモリブデンシリサイド、あるいはアルミ
ニュウムやクロムなどのような金属膜、あるいはITO
や5n02などのような透明性導電膜などを用いること
ができる。成層方法としては、CVD法、スパッタ法、
真空蒸着法、プラズマCVD法等の方法があるが、ここ
での詳しい説明は省略する。
を形成する。該ゲート電極材料としては多結晶シリコン
薄膜、あるいはモリブデンシリサイド、あるいはアルミ
ニュウムやクロムなどのような金属膜、あるいはITO
や5n02などのような透明性導電膜などを用いること
ができる。成層方法としては、CVD法、スパッタ法、
真空蒸着法、プラズマCVD法等の方法があるが、ここ
での詳しい説明は省略する。
続いて第111(f)に示すように、前記ゲート電極1
−7をマスクとして不純物をイオン注入し、自己整合的
にソース領域1−8およびドレイン領域1−9を形成す
る。前記不純物としては、Nchトランジスタを作製す
る場合はPoあるいはAS゛を用い、Pchトランジス
タを作製する場合はB″等を用いる。不純物添加方法と
しては、イオン注入法の他に、レーザードーピング法あ
るいはプラズマドーピング法あるいはイオンシャワー法
などの方法がある。1−10で示される矢印は不純物の
イオンビームを表している。前記絶縁性非晶質材料1−
1として石英基板を用いた場合には熱拡散法を使うこと
ができる。不純物温度は、lXl0”から1 x 10
”cm−’程度とする。前記薄い酸化膜1−5と前記ゲ
ート酸化膜1−6との総合膜厚が例えば1200Aの場
合、リンイオンは80〜120keV程度、ボロンイオ
ンは30〜80keV程度の加速電圧でイオン注入する
。
−7をマスクとして不純物をイオン注入し、自己整合的
にソース領域1−8およびドレイン領域1−9を形成す
る。前記不純物としては、Nchトランジスタを作製す
る場合はPoあるいはAS゛を用い、Pchトランジス
タを作製する場合はB″等を用いる。不純物添加方法と
しては、イオン注入法の他に、レーザードーピング法あ
るいはプラズマドーピング法あるいはイオンシャワー法
などの方法がある。1−10で示される矢印は不純物の
イオンビームを表している。前記絶縁性非晶質材料1−
1として石英基板を用いた場合には熱拡散法を使うこと
ができる。不純物温度は、lXl0”から1 x 10
”cm−’程度とする。前記薄い酸化膜1−5と前記ゲ
ート酸化膜1−6との総合膜厚が例えば1200Aの場
合、リンイオンは80〜120keV程度、ボロンイオ
ンは30〜80keV程度の加速電圧でイオン注入する
。
続いて第1図(g)に示されるように、層間絶縁膜1−
11を積層する。該眉間絶縁膜材料としては、酸化膜あ
るいは窒化膜などを用いる。絶縁性が良好ならば膜厚は
いくらでもよいが、数千人から数μm程度が普通である
。窒化膜の形成方法としては、LPCVD法あるいはプ
ラズマCVD法などが簡単である0反応には、アンモニ
アガス(N H3)とシランガスと窒素ガスとの混合ガ
ス、あるいはシランガスと窒素ガスとの混合ガスなどを
用いる。
11を積層する。該眉間絶縁膜材料としては、酸化膜あ
るいは窒化膜などを用いる。絶縁性が良好ならば膜厚は
いくらでもよいが、数千人から数μm程度が普通である
。窒化膜の形成方法としては、LPCVD法あるいはプ
ラズマCVD法などが簡単である0反応には、アンモニ
アガス(N H3)とシランガスと窒素ガスとの混合ガ
ス、あるいはシランガスと窒素ガスとの混合ガスなどを
用いる。
ここで、水素プラズマ法、あるいは水素イオン注入法、
あるいはプラズマ窒化膜からの水素の拡散法などの方法
で水素イオンを導入すると、ゲート酸化膜界面あるいは
シリコン膜中の結晶粒界に存在するダングリングボンド
などの欠陥が不活性化され、電気的特性が飛躍的に改善
される。この様な水素化工程は、層間絶縁膜1−11を
積層する前におこなってもよい。
あるいはプラズマ窒化膜からの水素の拡散法などの方法
で水素イオンを導入すると、ゲート酸化膜界面あるいは
シリコン膜中の結晶粒界に存在するダングリングボンド
などの欠陥が不活性化され、電気的特性が飛躍的に改善
される。この様な水素化工程は、層間絶縁膜1−11を
積層する前におこなってもよい。
次に第1図(h)に示すように、前記層間絶縁膜及びゲ
ート絶縁膜にコンタクトホールを形成し、コンタクト電
極を形成しソース電極1−12およびドレイン電極1−
13とする。該ソース電極及びドレイン電極は、アルミ
ニュウムなどの金属材料で形成する。この様にして薄膜
トランジスタが形成される。
ート絶縁膜にコンタクトホールを形成し、コンタクト電
極を形成しソース電極1−12およびドレイン電極1−
13とする。該ソース電極及びドレイン電極は、アルミ
ニュウムなどの金属材料で形成する。この様にして薄膜
トランジスタが形成される。
[発明の効果コ
プラズマCVDによって成膜された非晶質Si膜は多い
場合は数10%の水素を含んでいる。そして、TEN観
察、ラマン測定、X線回折測定、ESR測定、S IM
S分析等の結果より、非晶質Si膜中に含まれる水素が
、固相成長を遅らせていることがしられている。従って
、従来の固相成長法では、非晶質Si膜から水素が脱離
するのに長時間を要し、2μm以上の大粒径Si膜を成
長させるためには100時間に近い長時間アニールが必
要であった。また、固相成長後、いったん大気に出して
からゲート酸化層を形成していたので界面に不純物が付
着したり界面準位が多くなるという問題があった。
場合は数10%の水素を含んでいる。そして、TEN観
察、ラマン測定、X線回折測定、ESR測定、S IM
S分析等の結果より、非晶質Si膜中に含まれる水素が
、固相成長を遅らせていることがしられている。従って
、従来の固相成長法では、非晶質Si膜から水素が脱離
するのに長時間を要し、2μm以上の大粒径Si膜を成
長させるためには100時間に近い長時間アニールが必
要であった。また、固相成長後、いったん大気に出して
からゲート酸化層を形成していたので界面に不純物が付
着したり界面準位が多くなるという問題があった。
本発明においては、固相成長の前に、400°C〜50
0°Cの熱処理により水素を放出させて、爆発的な水素
の放出を防ぎ空孔等の欠陥の発生を極力抑えた。そして
島状にパターニングした後、酸素雰囲気中で固相成長さ
せるので、固相成長のアニール温度が600℃程度の低
温でも結晶核発生に長時間アニールを必要とせず、潜伏
時間を非常に短くすることが可能となる。酸素雰囲気の
酸素純度が99.99%以上なので不純物の少ない酸化
膜が形成される。また、シリコン膜が固相成長すると同
時にシリコン表面が連続的に酸化されるので、極めて清
浄な界面が形成される。この様に、本発明は、数μmの
結晶粒径をもった大粒径のSi膜を形成することを可能
にするばかりでなく、清浄なS i / S i○2界
面の形成に対して極めて大きな効果がある。
0°Cの熱処理により水素を放出させて、爆発的な水素
の放出を防ぎ空孔等の欠陥の発生を極力抑えた。そして
島状にパターニングした後、酸素雰囲気中で固相成長さ
せるので、固相成長のアニール温度が600℃程度の低
温でも結晶核発生に長時間アニールを必要とせず、潜伏
時間を非常に短くすることが可能となる。酸素雰囲気の
酸素純度が99.99%以上なので不純物の少ない酸化
膜が形成される。また、シリコン膜が固相成長すると同
時にシリコン表面が連続的に酸化されるので、極めて清
浄な界面が形成される。この様に、本発明は、数μmの
結晶粒径をもった大粒径のSi膜を形成することを可能
にするばかりでなく、清浄なS i / S i○2界
面の形成に対して極めて大きな効果がある。
1〜2時間という非常に短時間で大粒径のSi膜が得ら
れるので、薄膜トランジスタを作成する場合の工程時間
の短縮化、及びスルーブツトの向上、ひいてはコストダ
ウンに対して本発明は極めて大きな効果がある。
れるので、薄膜トランジスタを作成する場合の工程時間
の短縮化、及びスルーブツトの向上、ひいてはコストダ
ウンに対して本発明は極めて大きな効果がある。
非晶質絶縁基板上に結晶性の優れたシリコン薄膜を作製
することが可能になったのでSOI技術の発展に大きく
寄与するものである。フォト工程数はまったく増えない
、600℃以下の低温のプロセスでも作製が可能なので
、価格が安くて耐熱温度が低いガラス基板をもちいるこ
とができる。
することが可能になったのでSOI技術の発展に大きく
寄与するものである。フォト工程数はまったく増えない
、600℃以下の低温のプロセスでも作製が可能なので
、価格が安くて耐熱温度が低いガラス基板をもちいるこ
とができる。
優れたシリコン薄膜が得られるのにかかわらずコストア
ップとはならない。
ップとはならない。
本発明によって得られた大粒径多結晶シリコン薄膜を用
いて薄膜トランジスタを作成すると、優れた特性が得ら
れる。従来に比べて、薄膜トランジスタのON電流は増
大しOFF電流は小さくなる。またスレッシュホルド電
圧も小さくなりトランジスタ特性が大きく改善される。
いて薄膜トランジスタを作成すると、優れた特性が得ら
れる。従来に比べて、薄膜トランジスタのON電流は増
大しOFF電流は小さくなる。またスレッシュホルド電
圧も小さくなりトランジスタ特性が大きく改善される。
NチャネルとPチャネルとの特性の不釣合いさも改善さ
れる。
れる。
非晶質絶縁基板上に優れた特性の薄膜トランジスタを作
製することが可能となるので、ドライバー回路を同一基
板上に集積したアクティブマトリクス基板に応用した場
合にも十分な高速動作が実現される。さらに、電源電圧
の低減、消費電流の低減、信頼性の向上に対して大きな
効果がある。
製することが可能となるので、ドライバー回路を同一基
板上に集積したアクティブマトリクス基板に応用した場
合にも十分な高速動作が実現される。さらに、電源電圧
の低減、消費電流の低減、信頼性の向上に対して大きな
効果がある。
また、600℃以下の低温プロセスによる作製も可能な
ので、アクティブマトリクス基板の低価格化及び大面積
化に対してもその効果は大きい。
ので、アクティブマトリクス基板の低価格化及び大面積
化に対してもその効果は大きい。
本発明を、充電変換素子とその走査回路を同一チップ内
に集積した密着型イメージセンサ−に応用した場合には
、読み取り速度の高速化、高解像度化、さらに階調をと
る場合に非常に大きな効果をうみだす。高解像度化が達
成されるとカラー読み取り用密着型イメージセンサ−へ
の応用も容易となる。もちろん電源電圧の低減、消費電
流の低減、信頼性の向上に対してもその効果は大きい。
に集積した密着型イメージセンサ−に応用した場合には
、読み取り速度の高速化、高解像度化、さらに階調をと
る場合に非常に大きな効果をうみだす。高解像度化が達
成されるとカラー読み取り用密着型イメージセンサ−へ
の応用も容易となる。もちろん電源電圧の低減、消費電
流の低減、信頼性の向上に対してもその効果は大きい。
また低温プロセスによって作製することができるので、
密着型イメージセンサ−チップの長尺化が可能となり、
−本のチップでA4サイズあるいはA3サイズの様な大
型ファクシミリ用の読み取り装置を実現できる。従って
、センサーチップの二本継ぎのような手数がかかり信頼
性の悪い技術を回避することができ、実装歩留りも向上
される。
密着型イメージセンサ−チップの長尺化が可能となり、
−本のチップでA4サイズあるいはA3サイズの様な大
型ファクシミリ用の読み取り装置を実現できる。従って
、センサーチップの二本継ぎのような手数がかかり信頼
性の悪い技術を回避することができ、実装歩留りも向上
される。
石英基板やガラス基板だけではなく、サファイア基板(
A1203)あるいはM g O−A 1203゜B
P、 Ca F 2等の結晶性絶縁基板も用いること
ができる。
A1203)あるいはM g O−A 1203゜B
P、 Ca F 2等の結晶性絶縁基板も用いること
ができる。
以上薄膜トランジスタを例として説明したが、バイポー
ラトランジスタあるいはへテロ接合バイポーラトランジ
スタなど薄膜を利用した素子に対しても、本発明を応用
することができる。また、三次元デバイスのようなSO
I技術を利用した素子に対しても、本発明を応用するこ
とができる。
ラトランジスタあるいはへテロ接合バイポーラトランジ
スタなど薄膜を利用した素子に対しても、本発明を応用
することができる。また、三次元デバイスのようなSO
I技術を利用した素子に対しても、本発明を応用するこ
とができる。
第1図(2)〔a〕から(h)は、本発明の実施例を示
すTPTの工程断面図である。 絶縁性非晶質材料 非晶質Si膜 固相成長させたSi膜 固相成長中に形成された 薄い酸化膜 ゲート酸化膜 以上
すTPTの工程断面図である。 絶縁性非晶質材料 非晶質Si膜 固相成長させたSi膜 固相成長中に形成された 薄い酸化膜 ゲート酸化膜 以上
Claims (5)
- (1)絶縁性非晶質材料上の非単結晶半導体薄膜を固相
成長させる工程を少なくとも有する薄膜半導体装置の製
造方法において、前記固相成長法は、酸素ガス分圧99
.99%以上の酸素雰囲気中で行うことを特徴とする薄
膜半導体装置の製造方法。 - (2) 〔a〕絶縁性非晶質材料上に水素を含有する非単結晶半
導体薄膜を堆積させる工程、 〔b〕該非単結晶半導体薄膜を熱処理することにより水
素を放出させる工程、 〔c〕固相成長法により該非単結晶半導体薄膜を結晶成
長させる工程、 〔d〕結晶成長させた非単結晶半導体薄膜に半導体装置
を形成する工程を少なくとも有することを特徴とする請
求項1記載の薄膜半導体装置の製造方法。 - (3)前記非単結晶半導体薄膜を、プラズマCVD法に
より堆積させることを特徴とする請求項1記載の薄膜半
導体装置の製造方法。 - (4)前記非単結晶半導体薄膜を熱処理することにより
水素を放出させる工程において、熱処理温度が400〜
500℃であることを特徴とする請求項1記載の薄膜半
導体装置の製造方法。 - (5)前記固相成長法は、500〜700℃の低温アニ
ールであることを特徴とする請求項1記載の薄膜半導体
装置の製造方法。
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP27815190A JPH04152624A (ja) | 1990-10-17 | 1990-10-17 | 薄膜半導体装置の製造方法 |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP27815190A JPH04152624A (ja) | 1990-10-17 | 1990-10-17 | 薄膜半導体装置の製造方法 |
Publications (1)
Publication Number | Publication Date |
---|---|
JPH04152624A true JPH04152624A (ja) | 1992-05-26 |
Family
ID=17593302
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP27815190A Pending JPH04152624A (ja) | 1990-10-17 | 1990-10-17 | 薄膜半導体装置の製造方法 |
Country Status (1)
Country | Link |
---|---|
JP (1) | JPH04152624A (ja) |
Cited By (8)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPH0766426A (ja) * | 1993-08-27 | 1995-03-10 | Semiconductor Energy Lab Co Ltd | 半導体装置およびその作製方法 |
US5563093A (en) * | 1993-01-28 | 1996-10-08 | Kawasaki Steel Corporation | Method of manufacturing fet semiconductor devices with polysilicon gate having large grain sizes |
US5966594A (en) * | 1993-07-27 | 1999-10-12 | Semiconductor Energy Laboratory Co., Ltd. | Semiconductor device and method for manufacturing the same |
US6329229B1 (en) | 1993-11-05 | 2001-12-11 | Semiconductor Energy Laboratory Co., Ltd. | Method for processing semiconductor device, apparatus for processing a semiconductor and apparatus for processing semiconductor device |
KR100302203B1 (ko) * | 1997-09-25 | 2002-09-26 | 가부시끼가이샤 도시바 | 다결정실리콘박막의제조방법 |
KR100305524B1 (ko) * | 1997-09-18 | 2002-10-04 | 가부시끼가이샤 도시바 | 플랫패널의제조방법 |
US7320905B2 (en) | 1998-08-21 | 2008-01-22 | Semiconductor Energy Laboratory Co., Ltd. | Semiconductor device provided with semiconductor circuit made of semiconductor element and method of fabricating the same |
JP2008098653A (ja) * | 1998-08-21 | 2008-04-24 | Semiconductor Energy Lab Co Ltd | 半導体装置の作製方法 |
-
1990
- 1990-10-17 JP JP27815190A patent/JPH04152624A/ja active Pending
Cited By (10)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
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US6210997B1 (en) | 1993-07-27 | 2001-04-03 | Semiconductor Energy Laboratory Co., Ltd. | Semiconductor device and method for manufacturing the same |
US6465284B2 (en) | 1993-07-27 | 2002-10-15 | Semiconductor Energy Laboratory Co., Ltd. | Semiconductor device and method for manufacturing the same |
JPH0766426A (ja) * | 1993-08-27 | 1995-03-10 | Semiconductor Energy Lab Co Ltd | 半導体装置およびその作製方法 |
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JP2008098653A (ja) * | 1998-08-21 | 2008-04-24 | Semiconductor Energy Lab Co Ltd | 半導体装置の作製方法 |
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