JPH03262090A - マイクロコンピュータ及びこれを用いた非接触ｉｃカード - Google Patents
マイクロコンピュータ及びこれを用いた非接触ｉｃカードInfo
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- JPH03262090A JPH03262090A JP2059929A JP5992990A JPH03262090A JP H03262090 A JPH03262090 A JP H03262090A JP 2059929 A JP2059929 A JP 2059929A JP 5992990 A JP5992990 A JP 5992990A JP H03262090 A JPH03262090 A JP H03262090A
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- G—PHYSICS
- G06—COMPUTING; CALCULATING OR COUNTING
- G06K—GRAPHICAL DATA READING; PRESENTATION OF DATA; RECORD CARRIERS; HANDLING RECORD CARRIERS
- G06K19/00—Record carriers for use with machines and with at least a part designed to carry digital markings
- G06K19/06—Record carriers for use with machines and with at least a part designed to carry digital markings characterised by the kind of the digital marking, e.g. shape, nature, code
- G06K19/067—Record carriers with conductive marks, printed circuits or semiconductor circuit elements, e.g. credit or identity cards also with resonating or responding marks without active components
- G06K19/07—Record carriers with conductive marks, printed circuits or semiconductor circuit elements, e.g. credit or identity cards also with resonating or responding marks without active components with integrated circuit chips
- G06K19/0723—Record carriers with conductive marks, printed circuits or semiconductor circuit elements, e.g. credit or identity cards also with resonating or responding marks without active components with integrated circuit chips the record carrier comprising an arrangement for non-contact communication, e.g. wireless communication circuits on transponder cards, non-contact smart cards or RFIDs
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- B—PERFORMING OPERATIONS; TRANSPORTING
- B61—RAILWAYS
- B61L—GUIDING RAILWAY TRAFFIC; ENSURING THE SAFETY OF RAILWAY TRAFFIC
- B61L25/00—Recording or indicating positions or identities of vehicles or trains or setting of track apparatus
- B61L25/02—Indicating or recording positions or identities of vehicles or trains
- B61L25/04—Indicating or recording train identities
- B61L25/043—Indicating or recording train identities using inductive tags
-
- G—PHYSICS
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- G06K—GRAPHICAL DATA READING; PRESENTATION OF DATA; RECORD CARRIERS; HANDLING RECORD CARRIERS
- G06K7/00—Methods or arrangements for sensing record carriers, e.g. for reading patterns
- G06K7/0008—General problems related to the reading of electronic memory record carriers, independent of its reading method, e.g. power transfer
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- G08G—TRAFFIC CONTROL SYSTEMS
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Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
〔産業上の利用分野〕
この発明は、マイクロコンピュータ及びこれを用いた非
接触ＩＣカードに関する。
接触ＩＣカードに関する。
第５図に従来の非接触ＩＣカードの構造を示す。
ＣＰ Ｕ （１）にＲＯＭ（２ａ）、ＲＡ Ｍ （２ｂ
）、送信回路（３）及び受信回路（４）がそれぞれ接続
されており、これらによりマイクロコンピュータ（５）
が構成されている。このマイクロコンピュータ（５）の
送信回路（３）及び受信回路（４）にはそれぞれデータ
送信アンテナ（６）及びデータ受信アンテナ（７）が接
続され、ＣＰ Ｕ （１）にはバッテリ（８）及び発振
子（９）が接続されている。そして、ＩＣカードは、耐
環境性の向上を図るため、その全体が樹脂等により封止
されている。
）、送信回路（３）及び受信回路（４）がそれぞれ接続
されており、これらによりマイクロコンピュータ（５）
が構成されている。このマイクロコンピュータ（５）の
送信回路（３）及び受信回路（４）にはそれぞれデータ
送信アンテナ（６）及びデータ受信アンテナ（７）が接
続され、ＣＰ Ｕ （１）にはバッテリ（８）及び発振
子（９）が接続されている。そして、ＩＣカードは、耐
環境性の向上を図るため、その全体が樹脂等により封止
されている。
ＣＰ Ｕ （１）にはバッテリ（８）から電源電圧が供
給されると共に発振子（９）からはクロック信号が供給
され、これによりＣＰ Ｕ （１）は予めＲＯＭ （２
ｍ）に格納されていたプログラムに基づいて作動する。
給されると共に発振子（９）からはクロック信号が供給
され、これによりＣＰ Ｕ （１）は予めＲＯＭ （２
ｍ）に格納されていたプログラムに基づいて作動する。
このＩＣカードは電磁波を用いて外部とのデータの授受
を行うものである。データの受信時には、外部からの電
磁波が受信アンテナ（７）で受信され、受信回路（４）
でデータに復調された後、ＣＰ Ｕ （１）に入力され
る。そして、ＣＰ Ｕ （１）でデータ処理が行われ、
必要に応じてデータがＲＡ Ｍ （２ｂ）に記憶される
。一方、データの送信時には、ＣＰ Ｕ （１）からデ
ータが送信回路（３）に出力され、ここで搬送波がこの
データにより変調された後、送信アンテナ（６）から送
信される。
を行うものである。データの受信時には、外部からの電
磁波が受信アンテナ（７）で受信され、受信回路（４）
でデータに復調された後、ＣＰ Ｕ （１）に入力され
る。そして、ＣＰ Ｕ （１）でデータ処理が行われ、
必要に応じてデータがＲＡ Ｍ （２ｂ）に記憶される
。一方、データの送信時には、ＣＰ Ｕ （１）からデ
ータが送信回路（３）に出力され、ここで搬送波がこの
データにより変調された後、送信アンテナ（６）から送
信される。
第６図に受信回路（４）の構成例を示す、受信アンテナ
（７）にはコンデンサ（１１）が接続されており、これ
らにより特定の周波数の電磁波を選択的に受信するため
の共振回路（１２）が形成されている。共振回路（１２
）には受信データの有無を判別するための比較器（１３
）の第１入力端が接続されており、この比較器（１３）
の第２入力端には比較器（１３）の基準電圧を決定する
ための抵抗（１４）及び（１５）が接続されている。比
較器（１３）の出力端はダイオード（１６）を介してＣ
Ｐ Ｕ （１）に接続されている。また、ダイオード（
１６）の出力端にはコンデンサ（１７）及び放電抵抗（
１８）が接続されている。
（７）にはコンデンサ（１１）が接続されており、これ
らにより特定の周波数の電磁波を選択的に受信するため
の共振回路（１２）が形成されている。共振回路（１２
）には受信データの有無を判別するための比較器（１３
）の第１入力端が接続されており、この比較器（１３）
の第２入力端には比較器（１３）の基準電圧を決定する
ための抵抗（１４）及び（１５）が接続されている。比
較器（１３）の出力端はダイオード（１６）を介してＣ
Ｐ Ｕ （１）に接続されている。また、ダイオード（
１６）の出力端にはコンデンサ（１７）及び放電抵抗（
１８）が接続されている。
そして、第７図に示すように、外部装置から送信データ
を表す電磁波がこのＩＣカードに発せられると、電磁波
は受信アンテナ（７）で受信され、この受信アンテナ（
７）の発生電圧が比較器（１３）に入力される。比較器
（１３）ではデータの復調が行われ、比較器（１３）か
ら復調データがダイオード（１６）を介してＣＰ Ｕ
（１）に入力される。
を表す電磁波がこのＩＣカードに発せられると、電磁波
は受信アンテナ（７）で受信され、この受信アンテナ（
７）の発生電圧が比較器（１３）に入力される。比較器
（１３）ではデータの復調が行われ、比較器（１３）か
ら復調データがダイオード（１６）を介してＣＰ Ｕ
（１）に入力される。
しかしながら、受信アンテナ（））はコンデンサ（１１
）と共に共振回路（１２）を構成しているので、受信ア
ンテナ（７）での発生電圧は急峻な立ち上がり及び立ち
下がりをすることができず、徐々に上昇し、徐々に下降
する。このため、比較器（１３）内の検出レベル及び受
信アンテナ（７）の発生電圧の大きさ等によって、第７
図に示すように復調データの幅が大きく変動してしまい
、データの正確な受信が困難になるという問題点があっ
た。尚、比較器（１３）の検出レベルの変動はＩＣカー
ドの製造バラツキにより発生し、受信アンテナ（））の
発生電圧は外部装置とＩＣカードとの距離によって大き
く変動する。
）と共に共振回路（１２）を構成しているので、受信ア
ンテナ（７）での発生電圧は急峻な立ち上がり及び立ち
下がりをすることができず、徐々に上昇し、徐々に下降
する。このため、比較器（１３）内の検出レベル及び受
信アンテナ（７）の発生電圧の大きさ等によって、第７
図に示すように復調データの幅が大きく変動してしまい
、データの正確な受信が困難になるという問題点があっ
た。尚、比較器（１３）の検出レベルの変動はＩＣカー
ドの製造バラツキにより発生し、受信アンテナ（））の
発生電圧は外部装置とＩＣカードとの距離によって大き
く変動する。
特に、データの送信間隔が短くなると、電磁波を受信し
ないにも拘わらず共振回路（１２）には電圧が残り、誤
った受信を行う恐れが生ずる。
ないにも拘わらず共振回路（１２）には電圧が残り、誤
った受信を行う恐れが生ずる。
この発明はこのような問題点を解消するためになされた
もので、共振回路を介して正確にデータを入力すること
のできるマイクロコンピュータを提供することを目的と
する。
もので、共振回路を介して正確にデータを入力すること
のできるマイクロコンピュータを提供することを目的と
する。
また、この発明はこのようなマイクロコンピュータを用
いてデータの正確な受信を行うことのできる非接触ＩＣ
カードを提供することも目的としている。
いてデータの正確な受信を行うことのできる非接触ＩＣ
カードを提供することも目的としている。
この発明に係るマイクロコンピュータは、共振回路を介
して入力信号が入力されるマイクロコンピュータであっ
て、データを処理するためのＣＰＵと、入力信号を検出
する入力回路と、入力回路が入力信号を検出したときに
所定の長さの復調信号をＣＰＵへ入力させる復号回路と
、入力回路が入力信号を検出したときに共振回路の電気
振動を減衰させる減衰回路と、ＣＰＵからの出力信号を
外部へ出力させるための出力回路とを備えたものである
。
して入力信号が入力されるマイクロコンピュータであっ
て、データを処理するためのＣＰＵと、入力信号を検出
する入力回路と、入力回路が入力信号を検出したときに
所定の長さの復調信号をＣＰＵへ入力させる復号回路と
、入力回路が入力信号を検出したときに共振回路の電気
振動を減衰させる減衰回路と、ＣＰＵからの出力信号を
外部へ出力させるための出力回路とを備えたものである
。
尚、減衰回路は、共振回路の出力電圧を共振回路にフィ
ードバックさせるように構成することができる。
ードバックさせるように構成することができる。
また、出力口路は出力信号を共振回路に出力し、減衰回
路は出力回路から共振回路に出力された出力信号がオン
状態からオフ状態に変化したときに共振回路に発生する
電気振動を減衰させるように構成することもできる。
路は出力回路から共振回路に出力された出力信号がオン
状態からオフ状態に変化したときに共振回路に発生する
電気振動を減衰させるように構成することもできる。
また、この発明に係る非接触ＩＣカードは、外部とのデ
ータの送受信を非接触で行うためのアンテナ回路と、デ
ータを処理するためのＣＰＵと、アンテナ回路で受信さ
れた受信信号を検出する受信回路と、受信回路が受信信
号を検出したときに所定の長さの復調信号をＣＰＵへ入
力させる復号回路と、受信回路が受信信号を検出したと
きにアンテナ回路の電気振動を減衰させる減衰回路と、
ＣＰＵからの送信信号をアンテナ回路を介して外部へ送
信するための送信回路とを備えたものである。
ータの送受信を非接触で行うためのアンテナ回路と、デ
ータを処理するためのＣＰＵと、アンテナ回路で受信さ
れた受信信号を検出する受信回路と、受信回路が受信信
号を検出したときに所定の長さの復調信号をＣＰＵへ入
力させる復号回路と、受信回路が受信信号を検出したと
きにアンテナ回路の電気振動を減衰させる減衰回路と、
ＣＰＵからの送信信号をアンテナ回路を介して外部へ送
信するための送信回路とを備えたものである。
この発明に係るマイクロコンピュータにおいては、入力
回路が入力信号を検出すると、復号回路が所定の長さの
復調信号をＣＰＵへ入力させる一方、減衰回路が共振回
路の電気振動を減衰させる。
回路が入力信号を検出すると、復号回路が所定の長さの
復調信号をＣＰＵへ入力させる一方、減衰回路が共振回
路の電気振動を減衰させる。
また、この発明の非接触ＩＣカードにおいては、受信回
路が受信信号を検出すると、復号回路が所定の長さの復
調信号をＣＰＵへ入力させる一方、減衰回路がアンテナ
回路の電気振動を減衰させる。
路が受信信号を検出すると、復号回路が所定の長さの復
調信号をＣＰＵへ入力させる一方、減衰回路がアンテナ
回路の電気振動を減衰させる。
以下、この発明の実施例を添付図面に基づいて説明する
。
。
第１図は本発明の一実施例に係る非接触ＩＣカードの構
造を示すブロック図である。この非接触ＩＣカードは、
マイクロコンピュータ（５０）、アンテナ回路（６０）
、バッテリ（８）及び発振子（９）を有している。マイ
クロコンピュータ（５０）は一つのＩＣチップに形成さ
れており、データの処理を行うためのｃ Ｐ Ｕ （１
）を有している。このＣＰ Ｕ （１）にＲＯＭ （２
ａ）、ＲＡＭ （２ｂ）、送信回路（出力回路）（３０
）が接続されると共に復号回路（１０）を介して受信回
路（入力回路）（４０）が接続されている。また、送信
回路（３０）及び受信回路（４０）には減衰回路（２０
）が接続されている。
造を示すブロック図である。この非接触ＩＣカードは、
マイクロコンピュータ（５０）、アンテナ回路（６０）
、バッテリ（８）及び発振子（９）を有している。マイ
クロコンピュータ（５０）は一つのＩＣチップに形成さ
れており、データの処理を行うためのｃ Ｐ Ｕ （１
）を有している。このＣＰ Ｕ （１）にＲＯＭ （２
ａ）、ＲＡＭ （２ｂ）、送信回路（出力回路）（３０
）が接続されると共に復号回路（１０）を介して受信回
路（入力回路）（４０）が接続されている。また、送信
回路（３０）及び受信回路（４０）には減衰回路（２０
）が接続されている。
このマイクロコンピュータ（５０）のＣＰ Ｕ （１）
にはバッテリ（８）及び発振子（９）が接続され、送信
回路（３０）及び受信回路（４０）にはアンテナ回路（
６０）が接続されている。
にはバッテリ（８）及び発振子（９）が接続され、送信
回路（３０）及び受信回路（４０）にはアンテナ回路（
６０）が接続されている。
ＲＯＭ （２ｍ＞にはＣＰ Ｕ （１）を作動させるた
めのプログラムが予め格納されている。また、この非接
触ＩＣカードは、耐環境性の向上を図るため、その全体
が樹脂等により封止されている。
めのプログラムが予め格納されている。また、この非接
触ＩＣカードは、耐環境性の向上を図るため、その全体
が樹脂等により封止されている。
ここで、送信回路（３０）、受信回路（４０）及び減衰
回路（２０）の内部構成を第２図に示す、アンテナ（６
１）と並列にコンデンサ（６２）が接続され、これによ
り所定の周波数の電磁波を送受信するための共振回路で
あるアンテナ回路（６０）が形成されている。
回路（２０）の内部構成を第２図に示す、アンテナ（６
１）と並列にコンデンサ（６２）が接続され、これによ
り所定の周波数の電磁波を送受信するための共振回路で
あるアンテナ回路（６０）が形成されている。
このアンテナ回路（６０）に抵抗（３１）及びトランジ
スタ（３２）を介してスイッチ回路（３３）が接続され
、スイッチ回路（３３）にＣＰ Ｕ （１）が接続され
ている。
スタ（３２）を介してスイッチ回路（３３）が接続され
、スイッチ回路（３３）にＣＰ Ｕ （１）が接続され
ている。
また、スイッチ回路（３３）の制御端子にはＣＰ Ｕ
（１）から送信信号が入力される。これら抵抗（３１）
、トランジスタ（３２）及びスイッチ回路（３３）によ
り送信回路（３０）が構成されている。
（１）から送信信号が入力される。これら抵抗（３１）
、トランジスタ（３２）及びスイッチ回路（３３）によ
り送信回路（３０）が構成されている。
また、アンテナ回路（６０）と抵抗（３１）との接続点
Ａには比較器（４１）の第１入力端が接続されており、
この比較器（４１）の第２入力端には比較器（４１）の
基準電圧を決定するための抵抗（４２）及び（４３）が
接続されている。比較器（４１）の出力端はアンド回路
（４４）の一方の入力端に接続され、アンド回路（４４
）の他方の入力端にはＣＰ Ｕ （１）から受信イネー
ブル信号が入力される。これら比較器（４１）、抵抗（
４２）、（４３）及びアンド回路（４４）により受信回
路（４０）が構成されている。
Ａには比較器（４１）の第１入力端が接続されており、
この比較器（４１）の第２入力端には比較器（４１）の
基準電圧を決定するための抵抗（４２）及び（４３）が
接続されている。比較器（４１）の出力端はアンド回路
（４４）の一方の入力端に接続され、アンド回路（４４
）の他方の入力端にはＣＰ Ｕ （１）から受信イネー
ブル信号が入力される。これら比較器（４１）、抵抗（
４２）、（４３）及びアンド回路（４４）により受信回
路（４０）が構成されている。
さらに、アンテナ回路（６０）と抵抗（３１）との接続
点Ａには比較器（２１）の第１入力端が接続されている
、この比較器（２１）の第２入力端は接地され、出力端
はスイッチ回路（２２）を介してトランジスタ（３２）
とスイッチ回路（３３）との接続点Ｂに接続されている
。この接続点Ｂと電源ラインとの間にはスイッチ回路（
２３）が接続されている。また、受信回路（４０）のア
ンドｒｇＪ路（４４）の出力端には抑止信号発生回路（
２４）が接続されている。この抑止信号発生回路（２４
）は、アンド回路（４４）を介して“Ｈ”レベルの信号
が入力されるとデータ１７２ビツト幅の”Ｈ”レベルの
受信抑止信号を出力する。この抑止信号発生回路（２４
）の出力は、オア回路（２５）を介してスイッチ回路（
２２）の制御端子に接続されると共にインバータ回路（
２６）及びアンド回路（２７）を介してスイッチ回路（
２３）の制御端子に接続されている。これら比較器（２
１）、スイッチ回路（２２）及び（２３）、抑止信号発
生回路（２４）、オア回路（２５）、インバータ回路（
２６）及びアンド回路（２７）により減衰回路（２０）
が構成されている。
点Ａには比較器（２１）の第１入力端が接続されている
、この比較器（２１）の第２入力端は接地され、出力端
はスイッチ回路（２２）を介してトランジスタ（３２）
とスイッチ回路（３３）との接続点Ｂに接続されている
。この接続点Ｂと電源ラインとの間にはスイッチ回路（
２３）が接続されている。また、受信回路（４０）のア
ンドｒｇＪ路（４４）の出力端には抑止信号発生回路（
２４）が接続されている。この抑止信号発生回路（２４
）は、アンド回路（４４）を介して“Ｈ”レベルの信号
が入力されるとデータ１７２ビツト幅の”Ｈ”レベルの
受信抑止信号を出力する。この抑止信号発生回路（２４
）の出力は、オア回路（２５）を介してスイッチ回路（
２２）の制御端子に接続されると共にインバータ回路（
２６）及びアンド回路（２７）を介してスイッチ回路（
２３）の制御端子に接続されている。これら比較器（２
１）、スイッチ回路（２２）及び（２３）、抑止信号発
生回路（２４）、オア回路（２５）、インバータ回路（
２６）及びアンド回路（２７）により減衰回路（２０）
が構成されている。
また、受信回路（４０）内のアンド回路（４４）の出力
端には復号回路（１０）が接続されている。復号回路（
ｌＯ）は、アンド回路（４４）からの入力信号が“Ｌ”
レベルから“Ｈ″レベル立ち上がると１ビツト幅の受信
データ（復調信号）“０”を復調してＣＰ Ｕ （１）
に出力し、それ以外のときは受信データ“１”をＣＰ
Ｕ （１）に出力する。
端には復号回路（１０）が接続されている。復号回路（
ｌＯ）は、アンド回路（４４）からの入力信号が“Ｌ”
レベルから“Ｈ″レベル立ち上がると１ビツト幅の受信
データ（復調信号）“０”を復調してＣＰ Ｕ （１）
に出力し、それ以外のときは受信データ“１”をＣＰ
Ｕ （１）に出力する。
尚、スイッチ回路（２２）、（２３）及び（３３）はそ
れぞれ制御端子に接続されたオア回路（２５）の出力、
アンド回路（２７〉の出力及びＣＰ Ｕ （１）からの
送信信号によって開閉制御され、これらの信号が“Ｈ”
レベルのときに閉じるようになっている。
れぞれ制御端子に接続されたオア回路（２５）の出力、
アンド回路（２７〉の出力及びＣＰ Ｕ （１）からの
送信信号によって開閉制御され、これらの信号が“Ｈ”
レベルのときに閉じるようになっている。
次に、第３Ａ！ｇ及び第３Ｂ図に示す信号波形図を参照
してこの実施例の動作を説明する。ＣＰＵ（１）にはバ
ッテリ（８）から電源電圧Ｖｃｃが供給されると共に発
振子（９）からはクロック信号が供給され、ＣＰ Ｕ
（１）は予めＲＯＭ （２ａ）に格納されていたプログ
ラムに基づいて作動する。
してこの実施例の動作を説明する。ＣＰＵ（１）にはバ
ッテリ（８）から電源電圧Ｖｃｃが供給されると共に発
振子（９）からはクロック信号が供給され、ＣＰ Ｕ
（１）は予めＲＯＭ （２ａ）に格納されていたプログ
ラムに基づいて作動する。
データの送信時においては、第３Ａ図に示すように、Ｃ
Ｐ Ｕ （１）は１ビツトの送信データ“０″に対し前
半１７２ビット分だけ“Ｈ′″レベルとなる送信信号と
後半１７２ビット分だけ“Ｈ”レベルとなる送信抑止信
号とを出力すると共にこれら送信信号及び送信抑止信号
の双方が′Ｌ”レベルのときに“Ｈ”レベルとなるオフ
指令信号をアンド回路（２７）に出力する。
Ｐ Ｕ （１）は１ビツトの送信データ“０″に対し前
半１７２ビット分だけ“Ｈ′″レベルとなる送信信号と
後半１７２ビット分だけ“Ｈ”レベルとなる送信抑止信
号とを出力すると共にこれら送信信号及び送信抑止信号
の双方が′Ｌ”レベルのときに“Ｈ”レベルとなるオフ
指令信号をアンド回路（２７）に出力する。
時刻ｔ、にＣＰ Ｕ （１）から“Ｈ”レベルの送信信
号が送信回路（３０）に出力されると、この送信信号に
よってスイッチ回１ （３３）が閉成され、ＣＰ Ｕ
（１）からトランジスタ（３２）に搬送波が印加される
。これにより、トランジスタ（３２）はオン状態となり
アンテナ回路（６０）が駆動されて電磁波が外部に送出
される。
号が送信回路（３０）に出力されると、この送信信号に
よってスイッチ回１ （３３）が閉成され、ＣＰ Ｕ
（１）からトランジスタ（３２）に搬送波が印加される
。これにより、トランジスタ（３２）はオン状態となり
アンテナ回路（６０）が駆動されて電磁波が外部に送出
される。
送信信号は送信データ“０”の１７２ビット分が経過し
た時刻ｔ２に“Ｌ”レベルに立ち下がるので、スイッチ
回路（３３）は開成されるが、同時に今度は送信抑止信
号が“Ｌ”レベルから“Ｈ″″″レベルち上がり、オア
回路（２５）を介してスイッチ回路（２２）が閉成され
る。これにより、比較器（２１）の出力がトランジスタ
（３２）に印加されることとなる。このとき、アンテナ
回路（６０）では、時刻ｔ１〜ｔ、の間に生じていた振
動が自由振動を繰り返しながら減衰しようとする。この
振動が正の半サイクルのときは、比較器（２１）の出力
が“Ｈ″レベルなるので、トランジスタ（３２）はオフ
状態となる。ところが、アンテナ回路（６０）における
自由振動が負の半サイクルのときは、比較器（２１）の
出力は“Ｌ”レベルとなるので、トランジスタ（３２）
はオン状態となる。
た時刻ｔ２に“Ｌ”レベルに立ち下がるので、スイッチ
回路（３３）は開成されるが、同時に今度は送信抑止信
号が“Ｌ”レベルから“Ｈ″″″レベルち上がり、オア
回路（２５）を介してスイッチ回路（２２）が閉成され
る。これにより、比較器（２１）の出力がトランジスタ
（３２）に印加されることとなる。このとき、アンテナ
回路（６０）では、時刻ｔ１〜ｔ、の間に生じていた振
動が自由振動を繰り返しながら減衰しようとする。この
振動が正の半サイクルのときは、比較器（２１）の出力
が“Ｈ″レベルなるので、トランジスタ（３２）はオフ
状態となる。ところが、アンテナ回路（６０）における
自由振動が負の半サイクルのときは、比較器（２１）の
出力は“Ｌ”レベルとなるので、トランジスタ（３２）
はオン状態となる。
このため、電圧がアンテナ回Ｎ （６０）に逆相でフィ
ードバックされることとなり、アンテナ回路（６０）に
蓄積されていたエネルギーが消耗される。その結果、第
３Ａ図に示すように、アンテナ回路（６０）における振
動は時刻ｔ２の後、急速に減衰し安定する。
ードバックされることとなり、アンテナ回路（６０）に
蓄積されていたエネルギーが消耗される。その結果、第
３Ａ図に示すように、アンテナ回路（６０）における振
動は時刻ｔ２の後、急速に減衰し安定する。
その後、時刻ｔ、に送信データ“１″に対応して送信信
号及び送信抑止信号の双方が″Ｌ″レベルになると、今
度はオフ指令信号が“Ｌ”レベルから“Ｈ”レベルに立
ち上がる。このとき、受信状態ではないので抑止信号発
生口１ （２４）から出力される受信抑止信号は“Ｌ”
レベルであり、インバータ回路（２６）によりアンド回
路（２７）には“Ｈ”レベルの信号が入力されている。
号及び送信抑止信号の双方が″Ｌ″レベルになると、今
度はオフ指令信号が“Ｌ”レベルから“Ｈ”レベルに立
ち上がる。このとき、受信状態ではないので抑止信号発
生口１ （２４）から出力される受信抑止信号は“Ｌ”
レベルであり、インバータ回路（２６）によりアンド回
路（２７）には“Ｈ”レベルの信号が入力されている。
従って、アンド回路（２７）がら“Ｈ”レベルのオフ信
号がスイッチ回路（２３）に印加される。これにより、
スイッチ回路（２３）が閉成され、トランジスタ（３２
）は完全にオフ状態となる。
号がスイッチ回路（２３）に印加される。これにより、
スイッチ回路（２３）が閉成され、トランジスタ（３２
）は完全にオフ状態となる。
このように、アンテナ回路（６０）の電圧が正のときは
トランジスタ（３２）をオフ状態とし、負のときはその
値を用いてトランジスタ（３２）の駆動能力を増加する
ように構成したので、アンテナ回路（６０）に発生した
自由振動を短時間に減衰させることができると共にトラ
ンジスタ（３２）における不用な発振の発生が防止され
る。尚、アンテナ回路（６０）におけるわずかな振れに
トランジスタ（３２）が動作しないように、比較器（２
１）の基準電圧はＯＶよりわずかに負側に設定した方が
望ましい。
トランジスタ（３２）をオフ状態とし、負のときはその
値を用いてトランジスタ（３２）の駆動能力を増加する
ように構成したので、アンテナ回路（６０）に発生した
自由振動を短時間に減衰させることができると共にトラ
ンジスタ（３２）における不用な発振の発生が防止され
る。尚、アンテナ回路（６０）におけるわずかな振れに
トランジスタ（３２）が動作しないように、比較器（２
１）の基準電圧はＯＶよりわずかに負側に設定した方が
望ましい。
送信抑止信号は送信信号を反転することによって形成す
ることもできる。
ることもできる。
一方、データの受信時においては、第３Ｂ図に示すよう
に、時刻ｔ４に外部装置（図示せず）からデータ“０″
に対応する電磁波が発せられると、この電磁波を受信し
たアンテナ回路（６０）に電圧が発生する。この電圧は
比較器（４１）で抵抗（４２）及び（４３）により形成
される基準電圧と比較され、時刻ｔｓにアンテナ回路（
６０）の発生電圧が基準電圧を越えると、比較器（４１
）から“Ｈ″レベル信号がアンド回路（４４）に出力さ
れる。このとき、アンド回路（４４）にはＣＰ Ｕ （
１）から受信可能状態であることを示す“Ｈ”レベルの
受信イネーブル信号が入力されているため、比較器（４
１）の出力信号はアンド回路（４４）を介して抑止信号
発生回路（２４）に入力する。その結果、抑止信号発生
回路（２４）から１７２ビット幅の“Ｈ”レベルの受信
抑止信号がオア回路（２５）を介してスイッチ回路（２
２）に印加される。これにより、スイッチ回路（２２）
は閉成され、上述した送信時と同様にしてアンテナ回路
（６０）の電気振動が抑止される。すなわち、第３Ｂ図
のように、アンテナ回路（６０）に発生する電圧は時刻
ｔ５の後、急速に減衰し安定する。
に、時刻ｔ４に外部装置（図示せず）からデータ“０″
に対応する電磁波が発せられると、この電磁波を受信し
たアンテナ回路（６０）に電圧が発生する。この電圧は
比較器（４１）で抵抗（４２）及び（４３）により形成
される基準電圧と比較され、時刻ｔｓにアンテナ回路（
６０）の発生電圧が基準電圧を越えると、比較器（４１
）から“Ｈ″レベル信号がアンド回路（４４）に出力さ
れる。このとき、アンド回路（４４）にはＣＰ Ｕ （
１）から受信可能状態であることを示す“Ｈ”レベルの
受信イネーブル信号が入力されているため、比較器（４
１）の出力信号はアンド回路（４４）を介して抑止信号
発生回路（２４）に入力する。その結果、抑止信号発生
回路（２４）から１７２ビット幅の“Ｈ”レベルの受信
抑止信号がオア回路（２５）を介してスイッチ回路（２
２）に印加される。これにより、スイッチ回路（２２）
は閉成され、上述した送信時と同様にしてアンテナ回路
（６０）の電気振動が抑止される。すなわち、第３Ｂ図
のように、アンテナ回路（６０）に発生する電圧は時刻
ｔ５の後、急速に減衰し安定する。
また、時刻ｔ、にアンド回路（４４）の出力は復号回路
（１０）に入力し、これにより復号回路（１０）から１
ビット幅の受信データ“０”がＣＰ Ｕ （１）に出力
される。従って、受信電磁波の強度によって受信データ
に歪みを発生することが防止される。
（１０）に入力し、これにより復号回路（１０）から１
ビット幅の受信データ“０”がＣＰ Ｕ （１）に出力
される。従って、受信電磁波の強度によって受信データ
に歪みを発生することが防止される。
時刻ｔ、から１／２ビット分の時間が経過した時刻ｔ６
に受信抑止信号がＨ”レベルから“Ｌ″レベル立ち下が
ると、インバータ回路（２６）を介してアンド回路（２
７）に“Ｈ”レベルの信号が入力される。
に受信抑止信号がＨ”レベルから“Ｌ″レベル立ち下が
ると、インバータ回路（２６）を介してアンド回路（２
７）に“Ｈ”レベルの信号が入力される。
このとき、送信状態ではないので送信信号及び送信抑止
信号はどちらも“Ｌ″レベルあり、ＣＰＵ（１）からは
ｍ Ｈ＊レベルのオフ指令信号がアンド回路（２））に
入力されている。従って、アンド回路（２７）から“Ｈ
”レベルのオフ信号がスイッチ回路（２３）に印加され
、これによりスイッチ回路（２３）が閉成されてトラン
ジスタ（３２）は完全にオフ状態となる。
信号はどちらも“Ｌ″レベルあり、ＣＰＵ（１）からは
ｍ Ｈ＊レベルのオフ指令信号がアンド回路（２））に
入力されている。従って、アンド回路（２７）から“Ｈ
”レベルのオフ信号がスイッチ回路（２３）に印加され
、これによりスイッチ回路（２３）が閉成されてトラン
ジスタ（３２）は完全にオフ状態となる。
このようにして時刻ｔ、における次のビットのデータ受
信に備えるが、このときには既にアンテナ回路（６０）
の電気振動は十分に抑止されている。
信に備えるが、このときには既にアンテナ回路（６０）
の電気振動は十分に抑止されている。
すなわち、各ビット毎にアンテナ回路（６０）の受信電
圧は一旦“０”レベルに戻り、“０”レベルから受信電
磁波に応じて電圧が上昇する。このため、電磁波を受信
してから受信データを検出するまでの時間遅れが各ビッ
トで一定となり、歪みの発生を防止することができる。
圧は一旦“０”レベルに戻り、“０”レベルから受信電
磁波に応じて電圧が上昇する。このため、電磁波を受信
してから受信データを検出するまでの時間遅れが各ビッ
トで一定となり、歪みの発生を防止することができる。
また、データの転送速度を向上させることもできる。
受信データがＣＰ Ｕ （１）に入力されると、ＣＰＵ
（１）は予めＲＯＭ（２ａ）に格納されているプログラ
ムに基づいてデータ処理を行い、必要に応じてデータを
ＲＡ Ｍ （２ｂ）に記憶したり、データの送信を行う
。
（１）は予めＲＯＭ（２ａ）に格納されているプログラ
ムに基づいてデータ処理を行い、必要に応じてデータを
ＲＡ Ｍ （２ｂ）に記憶したり、データの送信を行う
。
尚、上記の実施例では、アンテナ回路（６０）を送信及
び受信の双方に共用させたが、送信用のアンテナ回路を
独立して設け、アンテナ回路（６０）を受信専用に用い
る場合の回路構成を第４図に示す。
び受信の双方に共用させたが、送信用のアンテナ回路を
独立して設け、アンテナ回路（６０）を受信専用に用い
る場合の回路構成を第４図に示す。
すなわち、第２図の回路において、オア回路（２５）、
アンド回路（２７）、（４４）及びスイッチ回路（３３
）が不要となる。ただし、送信用のアンテナ回路の電気
振動を減衰させる必要がある場合には比較器（２１）、
スイッチ回路（２２）、（２３）及びトランジスタ（３
２）等を送信回路にも設けなければならないため、第２
図のような構成とした方がマイクロコンピュータ（５０
）のチップ面積は少なくて済む。
アンド回路（２７）、（４４）及びスイッチ回路（３３
）が不要となる。ただし、送信用のアンテナ回路の電気
振動を減衰させる必要がある場合には比較器（２１）、
スイッチ回路（２２）、（２３）及びトランジスタ（３
２）等を送信回路にも設けなければならないため、第２
図のような構成とした方がマイクロコンピュータ（５０
）のチップ面積は少なくて済む。
以上説明したように、この発明に係るマイクロコンピュ
ータは、共振回路を介して入力信号が入力されるマイク
ロコンピュータであって、データを処理するためのＣＰ
Ｕと、入力信号を検出する入力回路と、入力回路が入力
信号を検出したときに所定の長さの復調信号をＣＰＵへ
入力させる復号回路と、入力回路が入力信号を検出した
ときに共振回路の電気振動を減衰させる減衰回路と、Ｃ
ＰＵからの出力信号を外部へ出力させるための出力回路
とを備えているので、正確にデータを入力することがで
きる。
ータは、共振回路を介して入力信号が入力されるマイク
ロコンピュータであって、データを処理するためのＣＰ
Ｕと、入力信号を検出する入力回路と、入力回路が入力
信号を検出したときに所定の長さの復調信号をＣＰＵへ
入力させる復号回路と、入力回路が入力信号を検出した
ときに共振回路の電気振動を減衰させる減衰回路と、Ｃ
ＰＵからの出力信号を外部へ出力させるための出力回路
とを備えているので、正確にデータを入力することがで
きる。
また、この発明に係る非接触ＩＣカードは、外部とのデ
ータの送受信を非接触で行うためのアンテナ回路と、デ
ータを処理するためのＣＰＵと、アンテナ回路で受信さ
れた受信信号を検出する受信回路と、受信回路が受信信
号を検出したときに所定の長さの復調信号をＣＰＵへ入
力させる復号回路と、受信回路が受信信号を検出したと
きにアンテナ回路の電気振動を減衰させる減衰回路と、
ＣＰＵからの送信信号をアンテナ回路を介して外部へ送
信するための送信回路とを備えているので、正確にデー
タを受信することができる。
ータの送受信を非接触で行うためのアンテナ回路と、デ
ータを処理するためのＣＰＵと、アンテナ回路で受信さ
れた受信信号を検出する受信回路と、受信回路が受信信
号を検出したときに所定の長さの復調信号をＣＰＵへ入
力させる復号回路と、受信回路が受信信号を検出したと
きにアンテナ回路の電気振動を減衰させる減衰回路と、
ＣＰＵからの送信信号をアンテナ回路を介して外部へ送
信するための送信回路とを備えているので、正確にデー
タを受信することができる。
第１図はこの発明の一実施例に係る非接触ＩＣカードの
構造を示すブロック図、第２図は実施例に用いられたマ
イクロコンピュータ内の受信回路、送信回路及び減衰回
路を示す回路図、第３Ａ図及び第３Ｂ図はそれぞれ送信
時及び受信時における第２図の回路の各部の信号波形図
、第４図は他の実施例を示す部分回路図、第５図は従来
の非接触ＩＣカードを示すブロック図、第６図は第５図
のＩＣカードに用いられたマイクロコンピュータ内の受
信回路を示す回路図、第７図は第６図の回路の動作を示
す信号波形図である。 図において、（１）はＣＰＵ、（２ａ）はＲＯＭ、（２
ｂ）はＲＡＭ、（１０）は復号回路、（２０）は減衰回
路、（３０）は送信回路、（４０）は受信回路、 （５
０）はマイクロコンピュータ、（６０）はアンテナ回路
である。 なお、各図中同一符号は同一または相当部分を示す。
構造を示すブロック図、第２図は実施例に用いられたマ
イクロコンピュータ内の受信回路、送信回路及び減衰回
路を示す回路図、第３Ａ図及び第３Ｂ図はそれぞれ送信
時及び受信時における第２図の回路の各部の信号波形図
、第４図は他の実施例を示す部分回路図、第５図は従来
の非接触ＩＣカードを示すブロック図、第６図は第５図
のＩＣカードに用いられたマイクロコンピュータ内の受
信回路を示す回路図、第７図は第６図の回路の動作を示
す信号波形図である。 図において、（１）はＣＰＵ、（２ａ）はＲＯＭ、（２
ｂ）はＲＡＭ、（１０）は復号回路、（２０）は減衰回
路、（３０）は送信回路、（４０）は受信回路、 （５
０）はマイクロコンピュータ、（６０）はアンテナ回路
である。 なお、各図中同一符号は同一または相当部分を示す。
Claims (4)
- （１）共振回路を介して入力信号が入力されるマイクロ
コンピュータであつて、 データを処理するためのＣＰＵと、 入力信号を検出する入力回路と、 前記入力回路が入力信号を検出したときに所定の長さの
復調信号を前記ＣＰＵへ入力させる復号回路と、 前記入力回路が入力信号を検出したときに前記共振回路
の電気振動を減衰させる減衰回路と、前記ＣＰＵからの
出力信号を外部へ出力させるための出力回路と、 を備えたことを特徴とするマイクロコンピュータ。 - （２）前記減衰回路は、前記共振回路の出力電圧を前記
共振回路にフィードバックさせる請求項１記載のマイク
ロコンピュータ。 - （３）前記出力回路は出力信号を前記共振回路に出力し
、前記減衰回路は前記出力回路から前記共振回路に出力
された出力信号がオン状態からオフ状態に変化したとき
に前記共振回路に発生する電気振動を減衰させる請求項
１記載のマイクロコンピュータ。 - （４）外部とのデータの送受信を非接触で行うためのア
ンテナ回路と、 データを処理するためのＣＰＵと、 前記アンテナ回路で受信された受信信号を検出する受信
回路と、 前記受信回路が受信信号を検出したときに所定の長さの
復調信号を前記ＣＰＵへ入力させる復号回路と、 前記受信回路が受信信号を検出したときに前記アンテナ
回路の電気振動を減衰させる減衰回路と、前記ＣＰＵか
らの送信信号を前記アンテナ回路を介して外部へ送信す
るための送信回路と を備えたことを特徴とする非接触ＩＣカード。
Priority Applications (5)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP5992990A JP2569194B2 (ja) | 1990-03-13 | 1990-03-13 | マイクロコンピュータ及びこれを用いた非接触ｉｃカード |
| FR9009782A FR2659764B1 (fr) | 1990-03-13 | 1990-07-31 | Micro-ordinateur et carte a circuits integres sans contact utilisant un tel micro-ordinateur. |
| GB9019429A GB2242043B (en) | 1990-03-13 | 1990-09-06 | A microcomputer and a non-contact IC card using this microcomputer |
| US07/892,410 US5308968A (en) | 1990-03-13 | 1992-06-01 | Non-contact IC card which actively attenuates its resonance circuit as it receives data |
| US08/197,866 US5396056A (en) | 1990-03-13 | 1994-02-17 | Non-contact IC card having an active attenuation circuit |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP5992990A JP2569194B2 (ja) | 1990-03-13 | 1990-03-13 | マイクロコンピュータ及びこれを用いた非接触ｉｃカード |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPH03262090A true JPH03262090A (ja) | 1991-11-21 |
| JP2569194B2 JP2569194B2 (ja) | 1997-01-08 |
Family
ID=13127308
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP5992990A Expired - Fee Related JP2569194B2 (ja) | 1990-03-13 | 1990-03-13 | マイクロコンピュータ及びこれを用いた非接触ｉｃカード |
Country Status (4)
| Country | Link |
|---|---|
| US (2) | US5308968A (ja) |
| JP (1) | JP2569194B2 (ja) |
| FR (1) | FR2659764B1 (ja) |
| GB (1) | GB2242043B (ja) |
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| JP2002366908A (ja) * | 2001-06-11 | 2002-12-20 | Hitachi Maxell Ltd | リーダライタ及びそれを用いた通信システム |
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1990
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- 1990-09-06 GB GB9019429A patent/GB2242043B/en not_active Expired - Fee Related
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| JP2002366908A (ja) * | 2001-06-11 | 2002-12-20 | Hitachi Maxell Ltd | リーダライタ及びそれを用いた通信システム |
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