JPH0323916B2 - - Google Patents
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- Publication number
- JPH0323916B2 JPH0323916B2 JP57110629A JP11062982A JPH0323916B2 JP H0323916 B2 JPH0323916 B2 JP H0323916B2 JP 57110629 A JP57110629 A JP 57110629A JP 11062982 A JP11062982 A JP 11062982A JP H0323916 B2 JPH0323916 B2 JP H0323916B2
- Authority
- JP
- Japan
- Prior art keywords
- character
- address
- output
- generator
- image memory
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Expired - Lifetime
Links
- 238000000034 method Methods 0.000 claims description 11
- 238000010586 diagram Methods 0.000 description 4
- 230000006870 function Effects 0.000 description 1
Landscapes
- Digital Computer Display Output (AREA)
- Controls And Circuits For Display Device (AREA)
Description
【発明の詳細な説明】
(1) 発明の技術分野
本発明は画像メモリへの文字書込み方式に関
し、より詳しくは、画面表示用のビツト・マツ
プ・メモリや、レーザプリンタ等の出力機器の１
ページ分のパターンバツフア等、画像情報を保持
する画像メモリへの文字パターンの書込みにおい
て、文字パターンを文字単位に処理し、かつ画像
メモリへの文字パターンの書込みをビツト単位に
行うことにより、文字の位置や方向を自由に選択
できるようにした画像メモリへの文字書込み方式
に関する。
し、より詳しくは、画面表示用のビツト・マツ
プ・メモリや、レーザプリンタ等の出力機器の１
ページ分のパターンバツフア等、画像情報を保持
する画像メモリへの文字パターンの書込みにおい
て、文字パターンを文字単位に処理し、かつ画像
メモリへの文字パターンの書込みをビツト単位に
行うことにより、文字の位置や方向を自由に選択
できるようにした画像メモリへの文字書込み方式
に関する。
(2) 発明の背景
図面や写真等を表示するグラフイツクデイスプ
レイ装置や画像プリンタをオフイスで用いる場
合、簡単なハードウエアで、安価に、文字の大き
さや方向を自由に変えることが可能な表示装置が
要求される。
レイ装置や画像プリンタをオフイスで用いる場
合、簡単なハードウエアで、安価に、文字の大き
さや方向を自由に変えることが可能な表示装置が
要求される。
(3) 従来技術と問題点
従来、オフイスで用いられるような簡単な表示
装置においては、画像メモリは手書き文字、図
面、写真等のデータのみを格納しており、キヤラ
クタ・ジエネレータに格納された文字パターンの
データは画像メモリを介することなく、直接に表
示画面あるいは表示用紙の１ページの所定の場所
に出力されていた。このため、表示された文字は
同一の大きさでしかも同一の方向に書かれたもの
であり、従つて従来の表示装置は限定された用途
にしか使用できなかつた。
装置においては、画像メモリは手書き文字、図
面、写真等のデータのみを格納しており、キヤラ
クタ・ジエネレータに格納された文字パターンの
データは画像メモリを介することなく、直接に表
示画面あるいは表示用紙の１ページの所定の場所
に出力されていた。このため、表示された文字は
同一の大きさでしかも同一の方向に書かれたもの
であり、従つて従来の表示装置は限定された用途
にしか使用できなかつた。
(4) 発明の目的
本発明の目的は上述の従来技術における問題に
かんがみ、キヤラクタ・ジエネレータから画像メ
モリに文字パターンのデータを１ビツトずつ書込
むという構想に基づき、画像メモリへの文字書込
み方式において、キヤラクタ・ジエネレータに格
納された文字パターンのデータを、画像メモリ
に、任意の方向、任意の大きさ、および任意の位
置で書込み可能にすることにある。
かんがみ、キヤラクタ・ジエネレータから画像メ
モリに文字パターンのデータを１ビツトずつ書込
むという構想に基づき、画像メモリへの文字書込
み方式において、キヤラクタ・ジエネレータに格
納された文字パターンのデータを、画像メモリ
に、任意の方向、任意の大きさ、および任意の位
置で書込み可能にすることにある。
(5) 発明の構成
上記の目的達成のための本発明の要旨は、画像
出力手段、該画像出力手段の１ページ分または１
画面分をビツトマツプ状態に格納する画像メモ
リ、文字パターンの数値情報を格納するキヤラク
タ・ジエネレータ、該キヤラクタ・ジエネレータ
に格納されている文字パターンの数値情報を該画
像メモリに書込ませる文字書込み回路、および該
キヤラクタ・ジエネレータと該文字書込み回路と
を制御する制御装置を具備し、該文字書込み回路
は、該制御装置から与えられる文字の表示方向、
表示位置および表示する大きさの指示に基づいて
該画像メモリへの書込みアドレスを１ビツト毎に
演算し、それにより該文字パターンの数値情報を
該表示方向、表示位置および表示する大きさの指
示に応じて該画像メモリに書き込むようにしたこ
とを特徴とする画像メモリへの文字書込み方式に
ある。
出力手段、該画像出力手段の１ページ分または１
画面分をビツトマツプ状態に格納する画像メモ
リ、文字パターンの数値情報を格納するキヤラク
タ・ジエネレータ、該キヤラクタ・ジエネレータ
に格納されている文字パターンの数値情報を該画
像メモリに書込ませる文字書込み回路、および該
キヤラクタ・ジエネレータと該文字書込み回路と
を制御する制御装置を具備し、該文字書込み回路
は、該制御装置から与えられる文字の表示方向、
表示位置および表示する大きさの指示に基づいて
該画像メモリへの書込みアドレスを１ビツト毎に
演算し、それにより該文字パターンの数値情報を
該表示方向、表示位置および表示する大きさの指
示に応じて該画像メモリに書き込むようにしたこ
とを特徴とする画像メモリへの文字書込み方式に
ある。
(6) 発明の実施例
以下、本発明の実施例を図面によつて説明す
る。
る。
第１図は本発明の一実施例による画像メモリへ
の文字書込み方式を実施するための装置を示すブ
ロツク回路図である。本実施例においては、１ワ
ードは16ビツトで構成されている。表示動作にお
いては、CPU１は外部インターフエース３を介
して外部装置から１ページ分あるいは一画面分
（以下、１ページ分として説明をする）の出力デ
ータを受取る。出力データには１ページ分の文字
コードと出力アドレスが含まれている。CPU１
はプログラムメモリ５のプログラムの制御の下に
以下の動作を管理する。
の文字書込み方式を実施するための装置を示すブ
ロツク回路図である。本実施例においては、１ワ
ードは16ビツトで構成されている。表示動作にお
いては、CPU１は外部インターフエース３を介
して外部装置から１ページ分あるいは一画面分
（以下、１ページ分として説明をする）の出力デ
ータを受取る。出力データには１ページ分の文字
コードと出力アドレスが含まれている。CPU１
はプログラムメモリ５のプログラムの制御の下に
以下の動作を管理する。
(1) CPU１は１ページ分の文字コードを、その
文字が格納されているキヤラクタ・ジエネレー
タのアドレスであるC.Gアドレスに変換してC.
G.アドレス・バツフア・メモリ９にセツトし、
１ページ分の文字の出力アドレスは文字出力ア
ドレス・バツフア・メモリ１１にセツトする。
出力アドレスはこの文字の表示位置の先頭アド
レス、表示方向、および表示する文字の大きさ
を指定する情報を含んでいる。１ページ分のC.
Gアドレス及び出力アドレスを文字出力アドレ
ス・バツフア・メモリ１１にセツトし終ると
CPU１はマイクロプロセツサ１７に起動割込
みをかける。マイクロプロセツサ１７は以後
１ページ分のデータをCPU１と独立して処理
する。
文字が格納されているキヤラクタ・ジエネレー
タのアドレスであるC.Gアドレスに変換してC.
G.アドレス・バツフア・メモリ９にセツトし、
１ページ分の文字の出力アドレスは文字出力ア
ドレス・バツフア・メモリ１１にセツトする。
出力アドレスはこの文字の表示位置の先頭アド
レス、表示方向、および表示する文字の大きさ
を指定する情報を含んでいる。１ページ分のC.
Gアドレス及び出力アドレスを文字出力アドレ
ス・バツフア・メモリ１１にセツトし終ると
CPU１はマイクロプロセツサ１７に起動割込
みをかける。マイクロプロセツサ１７は以後
１ページ分のデータをCPU１と独立して処理
する。
(2) マイクロプロセツサ１７はC.Gアドレス・バ
ツフア・メモリ１１にセツトされているC.Gア
ドレスの先頭アドレスを読出してC.Gアドレ
ス・レジスタ１３にセツトし、それによりキヤ
ラクタ・ジエネレータ７から１ワード（16ビツ
ト）のデータを読出して、レジスタＡ１５にセ
ツトする。レジスタＡ１５にセツトされた１ワ
ードのデータは文字の横方向の１ラスタ走査線
分である。
ツフア・メモリ１１にセツトされているC.Gア
ドレスの先頭アドレスを読出してC.Gアドレ
ス・レジスタ１３にセツトし、それによりキヤ
ラクタ・ジエネレータ７から１ワード（16ビツ
ト）のデータを読出して、レジスタＡ１５にセ
ツトする。レジスタＡ１５にセツトされた１ワ
ードのデータは文字の横方向の１ラスタ走査線
分である。
(3) マイクロプロセツサ１７はレジスタＡ１５に
セツトされた１ワードのデータを自己の内部レ
ジスタに取り込む。文字書込用マイクロプロセ
ツサ１７としては、サイクルタイム100＋１秒
程度の高速のプロセツサを用いる。１８は文字
書込用マイクロプロセツサ１７を制御するプロ
グラムメモリである。
セツトされた１ワードのデータを自己の内部レ
ジスタに取り込む。文字書込用マイクロプロセ
ツサ１７としては、サイクルタイム100＋１秒
程度の高速のプロセツサを用いる。１８は文字
書込用マイクロプロセツサ１７を制御するプロ
グラムメモリである。
(4) マイクロプロセツサ１７は文字出力アドレ
ス・バツフア・メモリ１１に格納されている出
力アドレスを読出し、文字の表示位置の先頭ア
ドレスX0およびY0をＸ方向アドレスレジスタ
１９およびＹ方向アドレスレジスタ２１にそれ
ぞれセツトする。文字の表示方向および表示す
る文字の大きさを指定する情報は文字書込用マ
イクロプロセツサ１７の内部レジスタに取り込
み、保持する。
ス・バツフア・メモリ１１に格納されている出
力アドレスを読出し、文字の表示位置の先頭ア
ドレスX0およびY0をＸ方向アドレスレジスタ
１９およびＹ方向アドレスレジスタ２１にそれ
ぞれセツトする。文字の表示方向および表示す
る文字の大きさを指定する情報は文字書込用マ
イクロプロセツサ１７の内部レジスタに取り込
み、保持する。
(5) 文字書込用マイクロプロセツサ１７に取込ま
れている１ワードのデータの最上位ビツトのデ
ータを１ビツトデータレジスタ２３にセツトす
る。１ビツトデータレジスタ２３にセツトされ
たダータは、画像メモリ２５の、Ｘ方向アドレ
スレジスタ１９およびＹ方向アドレスレジスタ
２１によつて指定されたアドレス（X0、Y0）
に書込まれる。
れている１ワードのデータの最上位ビツトのデ
ータを１ビツトデータレジスタ２３にセツトす
る。１ビツトデータレジスタ２３にセツトされ
たダータは、画像メモリ２５の、Ｘ方向アドレ
スレジスタ１９およびＹ方向アドレスレジスタ
２１によつて指定されたアドレス（X0、Y0）
に書込まれる。
(6) 文字書込用マイクロプロセツサ１７は、文字
の表示方向および表示すべき文字の大きさの情
報を参照して次の書込みアドレスX1，Y1を計
算し、再びＸ方向アドレスレジスタ１９および
Ｙ方向アドレスレジスタ２１に格納する。例え
ば文字を横方向に表示する場合で、大きさは標
準サイズの場合、次の書込みアドレスはX1＝
X0＋１、Y1＝Y0となり、文字縦方向に標準サ
イズで表示する場合はX1＝X0、Y1＝Y0＋１と
なる。
の表示方向および表示すべき文字の大きさの情
報を参照して次の書込みアドレスX1，Y1を計
算し、再びＸ方向アドレスレジスタ１９および
Ｙ方向アドレスレジスタ２１に格納する。例え
ば文字を横方向に表示する場合で、大きさは標
準サイズの場合、次の書込みアドレスはX1＝
X0＋１、Y1＝Y0となり、文字縦方向に標準サ
イズで表示する場合はX1＝X0、Y1＝Y0＋１と
なる。
(7) 文字書込用マイクロプロセツサ１７に書込ま
れている１ワードのデータの最上位ビツトの次
の位のビツトデータを１ビツトデータレジスタ
２３にセツトする。このデータは画像メモリ２
３のアドレス（X1、Y1）に書込まれる。
れている１ワードのデータの最上位ビツトの次
の位のビツトデータを１ビツトデータレジスタ
２３にセツトする。このデータは画像メモリ２
３のアドレス（X1、Y1）に書込まれる。
(8) 以下、(5)から(7)までの動作と同様の動作を繰
返し、文字書込用マイクロプロセツサ１７に取
込まれた１ワードのデータのすべてのビツトが
画像メモリ２５に書込まれると、文字書込用マ
イクロプロセツサ１７は、画像メモリ２５上の
次のラスタ走査線における文字の表示位置の先
頭アドレスX′0、Y′0をそれぞれＸ方向アドレス
レジスタ１９およびＹ方向アドレスレジスタ２
１にセツトする。
返し、文字書込用マイクロプロセツサ１７に取
込まれた１ワードのデータのすべてのビツトが
画像メモリ２５に書込まれると、文字書込用マ
イクロプロセツサ１７は、画像メモリ２５上の
次のラスタ走査線における文字の表示位置の先
頭アドレスX′0、Y′0をそれぞれＸ方向アドレス
レジスタ１９およびＹ方向アドレスレジスタ２
１にセツトする。
(9) マイクロプロセツサ１７はC.Gアドレスをプ
ラス１してC.Gアドレスレジスタ１３にセツト
し、それによりキヤラクタ・ジエネレータ７か
らの次の１ワードのデータをレジスタＡにセツ
トする。
ラス１してC.Gアドレスレジスタ１３にセツト
し、それによりキヤラクタ・ジエネレータ７か
らの次の１ワードのデータをレジスタＡにセツ
トする。
以下、上記(3)から(8)までの動作と同様の動作を
実行する。
実行する。
以上の動作を繰り返すことにより１文字分の書
込みが終了すると、マイクロプロセツサ１７は次
に表示すべき１文字分の情報を上記(2)〜(9)の動作
と同様にして処理し、以下同様の動作を行なう。
込みが終了すると、マイクロプロセツサ１７は次
に表示すべき１文字分の情報を上記(2)〜(9)の動作
と同様にして処理し、以下同様の動作を行なう。
こうして、画像メモリ２５には表示パネルの一
画面または出力用紙の１ページ分のデータがビツ
トマツプ状に格納される。なお、写真、図面等の
文字以外のデータは図示しない他の周知の手段で
画像メモリに格納される。
画面または出力用紙の１ページ分のデータがビツ
トマツプ状に格納される。なお、写真、図面等の
文字以外のデータは図示しない他の周知の手段で
画像メモリに格納される。
第２図は第１図に示したキヤラクタ・ジエネレ
ータ７に格納されている文字のデータと、この文
字のデータを画像メモリ２５に書込んだ様子を示
す図である。同図において、キヤラクタ・ジエネ
レータ７に格納されている文字Ａのデータは、ワ
ードW0、W1、W2、…の各々を構成する16ビツ
トのデータからなつている。例えばワードW0は
データD0〜D15からなつている。図において文字
の存在するビツトは“１”、文字の存在しないビ
ツトは“０”を表わしている。画像メモリ２５に
は横方向に表示する場合と縦方向に表示する場合
の２つの場合の書込みデータが示されている。上
側に示される文字Ａは横方向に表示する場合であ
り、書込みアドレスは（X0、Y0）、（X0＋１、
Y0）、…、（X0＋15、Y0）、（X0、Y0＋１）、（X0
＋１、Y0＋１）、…、（X0＋15、Y0＋１）、…と
変化して書込みが行なわれる。下側に示される文
字Ａは縦方向に表示する場合であり、書込みアド
レスは（X0、Y0）、（X0、Y0＋１）、…（X0、Y0
＋15）、（X0＋１、Y0）、（X0＋１、Y0＋１）、…、
（X0＋１、Y0＋15）、…と変化して書込みが行な
われることがわかる。なお、第２図の画像メモリ
２５は、表示される一画面または出力プリント用
紙一頁に対応する表現にしてあり、物理的な格納
位置を示すものではない。
ータ７に格納されている文字のデータと、この文
字のデータを画像メモリ２５に書込んだ様子を示
す図である。同図において、キヤラクタ・ジエネ
レータ７に格納されている文字Ａのデータは、ワ
ードW0、W1、W2、…の各々を構成する16ビツ
トのデータからなつている。例えばワードW0は
データD0〜D15からなつている。図において文字
の存在するビツトは“１”、文字の存在しないビ
ツトは“０”を表わしている。画像メモリ２５に
は横方向に表示する場合と縦方向に表示する場合
の２つの場合の書込みデータが示されている。上
側に示される文字Ａは横方向に表示する場合であ
り、書込みアドレスは（X0、Y0）、（X0＋１、
Y0）、…、（X0＋15、Y0）、（X0、Y0＋１）、（X0
＋１、Y0＋１）、…、（X0＋15、Y0＋１）、…と
変化して書込みが行なわれる。下側に示される文
字Ａは縦方向に表示する場合であり、書込みアド
レスは（X0、Y0）、（X0、Y0＋１）、…（X0、Y0
＋15）、（X0＋１、Y0）、（X0＋１、Y0＋１）、…、
（X0＋１、Y0＋15）、…と変化して書込みが行な
われることがわかる。なお、第２図の画像メモリ
２５は、表示される一画面または出力プリント用
紙一頁に対応する表現にしてあり、物理的な格納
位置を示すものではない。
表示文字の大きさの制御も、文字書込用マイク
ロプロセツサ１７において出力アドレスを適切に
計算することにより可能であることは明らかであ
る。例えばキヤラクタジエネレータ７の１ビツト
のデータを２ビツトのアドレスで画像メモリに格
納すれば標準の大きさの４倍となり、キヤラク
タ・ジエネレータ７の２ビツトのデータを１ビツ
トのアドレスで画像メモリに格納すれば1/4倍に
なる。
ロプロセツサ１７において出力アドレスを適切に
計算することにより可能であることは明らかであ
る。例えばキヤラクタジエネレータ７の１ビツト
のデータを２ビツトのアドレスで画像メモリに格
納すれば標準の大きさの４倍となり、キヤラク
タ・ジエネレータ７の２ビツトのデータを１ビツ
トのアドレスで画像メモリに格納すれば1/4倍に
なる。
なお、１ワードは16ビツトに限ることなく、32
ビツト等他のビツト構成でも本発明の適用範囲に
入る。実施例では文字書込み回路をマイクロプロ
セツサを用いたプログラム制御方式で構成した
が、同様の機能を集積回路（IC）を用いたラン
ダムロジツクで構成することも、もちろん可能で
あり、その方がより高速の処理を実現できる。
ビツト等他のビツト構成でも本発明の適用範囲に
入る。実施例では文字書込み回路をマイクロプロ
セツサを用いたプログラム制御方式で構成した
が、同様の機能を集積回路（IC）を用いたラン
ダムロジツクで構成することも、もちろん可能で
あり、その方がより高速の処理を実現できる。
(7) 発明の効果
以上説明したように、本発明によれば、キヤラ
クタ・ジエネレータから画像メモリに文字パター
ンのデータを１ビツトずつ書込むことにより、画
像メモリへの文字書込み方式において、構造が簡
単で安価なハードウエアを用いて、キヤラクタ・
ジエネレータに格納された文字パターンのデータ
を画像メモリに、任意の方向、任意の大きさ、お
よび任意の位置で書込むことができ、従つて画像
メモリを用いた表示装置に、任意の大きさ、方
向、および位置で文字を表示することができるた
め、オフイス用表示装置に極めて有用である。
クタ・ジエネレータから画像メモリに文字パター
ンのデータを１ビツトずつ書込むことにより、画
像メモリへの文字書込み方式において、構造が簡
単で安価なハードウエアを用いて、キヤラクタ・
ジエネレータに格納された文字パターンのデータ
を画像メモリに、任意の方向、任意の大きさ、お
よび任意の位置で書込むことができ、従つて画像
メモリを用いた表示装置に、任意の大きさ、方
向、および位置で文字を表示することができるた
め、オフイス用表示装置に極めて有用である。
第１図は本発明の一実施例による画像メモリへ
の文字書込方式を実施するための装置を示すブロ
ツク回路図、第２図は第１図に示したキヤラクタ
ジエネレータに格納されている文字のデータと、
この文字のデータを画像メモリに書込んだ様子を
示す図である。 １……中央処理装置、３……外部インターフエ
ース、５……プログラムメモリ、７……キヤラク
タ・ジエネレータ、９……C.G.アドレス・バツフ
ア・メモリ、１１……文字出力アドレス・バツフ
ア・メモリ、１３……C.G.アドレス・レジスタ、
１５……レジスタＡ、１７……文字書込用マイク
ロプロセツサ、１９……Ｘ方向アドレス・レジス
タ、２１……Ｙ方向アドレス・レジスタ、２３…
…１ビツト・データ・レジスタ、２５……画像メ
モリ。
の文字書込方式を実施するための装置を示すブロ
ツク回路図、第２図は第１図に示したキヤラクタ
ジエネレータに格納されている文字のデータと、
この文字のデータを画像メモリに書込んだ様子を
示す図である。 １……中央処理装置、３……外部インターフエ
ース、５……プログラムメモリ、７……キヤラク
タ・ジエネレータ、９……C.G.アドレス・バツフ
ア・メモリ、１１……文字出力アドレス・バツフ
ア・メモリ、１３……C.G.アドレス・レジスタ、
１５……レジスタＡ、１７……文字書込用マイク
ロプロセツサ、１９……Ｘ方向アドレス・レジス
タ、２１……Ｙ方向アドレス・レジスタ、２３…
…１ビツト・データ・レジスタ、２５……画像メ
モリ。
Claims (1)
- 【特許請求の範囲】 １ 文字コードと、文字の表示位置の先頭アドレ
ス、表示方向および表示する文字の大きさを指定
する情報を含んでなる出力アドレスとを含む１ペ
ージ分または１画面分のデータを出力する画像出
力手段と、 前記画像出力手段の出力データの１ページ分ま
たは１画面分をビツトマツプ状態に格納する画像
メモリと、 前記画像出力手段からの出力データを受取り各
種の制御を行う制御装置と、 文字パターンの数値情報を格納するキヤラク
タ・ジエネレータと、 前記制御装置の制御のもとに、１ページ分また
は１画面分の文字コードから変換されたキヤラク
タ・ジエネレータアドレスがセツトされるキヤラ
クタ・ジエネレータアドレスバツフアメモリと、 前記制御装置の制御のもとに、１ページ分また
は１画面分の文字の出力アドレスがセツトされる
文字出力アドレスバツフアメモリと、 前記制御装置の制御のもとに、前記キヤラク
タ・ジエネレータに格納されている文字パターン
の数値情報を前記画像メモリに書込む文字書込み
回路を具備し、 前記文字書込み回路は、前記制御装置により起
動されたとき、前記キヤラクタ・ジエネレータア
ドレスバツフアメモリから読出したキヤラクタ・
ジエネレータアドレスにもとづいてキヤラクタ・
ジエネレータから１ワードのデータを読出し、さ
らに前記文字出力アドレスバツフアメモリに格納
されている対応文字の出力アドレスを読出し、該
出力アドレスに含まれる文字の表示方向、表示位
置および表示する文字の大きさを指定する情報に
もとづいて前記画像メモリへの書込みアドレスを
１ビツト毎に演算し、それにより前記文字パター
ンの数値情報を該表示方向、表示位置および表示
する文字の大きさに応じて前記画像メモリに書き
込むようにしたことを特徴とする画像メモリへの
文字書込み方式。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP57110629A JPS592074A (ja) | 1982-06-29 | 1982-06-29 | 画像メモリへの文字書込み方式 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP57110629A JPS592074A (ja) | 1982-06-29 | 1982-06-29 | 画像メモリへの文字書込み方式 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS592074A JPS592074A (ja) | 1984-01-07 |
| JPH0323916B2 true JPH0323916B2 (ja) | 1991-03-29 |
Family
ID=14540605
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP57110629A Granted JPS592074A (ja) | 1982-06-29 | 1982-06-29 | 画像メモリへの文字書込み方式 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS592074A (ja) |
Families Citing this family (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP2521918B2 (ja) * | 1986-08-05 | 1996-08-07 | 富士ゼロックス株式会社 | 文字発生装置 |
Citations (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS55161279A (en) * | 1979-06-01 | 1980-12-15 | Casio Computer Co Ltd | Converter for vertical horizontal writing of character pattern |
-
1982
- 1982-06-29 JP JP57110629A patent/JPS592074A/ja active Granted
Patent Citations (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS55161279A (en) * | 1979-06-01 | 1980-12-15 | Casio Computer Co Ltd | Converter for vertical horizontal writing of character pattern |
Also Published As
| Publication number | Publication date |
|---|---|
| JPS592074A (ja) | 1984-01-07 |
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