JPH03145919A - 接地外れ保護回路を有する電子回路装置 - Google Patents
接地外れ保護回路を有する電子回路装置Info
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- JPH03145919A JPH03145919A JP1281759A JP28175989A JPH03145919A JP H03145919 A JPH03145919 A JP H03145919A JP 1281759 A JP1281759 A JP 1281759A JP 28175989 A JP28175989 A JP 28175989A JP H03145919 A JPH03145919 A JP H03145919A
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- H02—GENERATION; CONVERSION OR DISTRIBUTION OF ELECTRIC POWER
- H02H—EMERGENCY PROTECTIVE CIRCUIT ARRANGEMENTS
- H02H3/00—Emergency protective circuit arrangements for automatic disconnection directly responsive to an undesired change from normal electric working condition with or without subsequent reconnection ; integrated protection
- H02H3/16—Emergency protective circuit arrangements for automatic disconnection directly responsive to an undesired change from normal electric working condition with or without subsequent reconnection ; integrated protection responsive to fault current to earth, frame or mass
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- H02H—EMERGENCY PROTECTIVE CIRCUIT ARRANGEMENTS
- H02H5/00—Emergency protective circuit arrangements for automatic disconnection directly responsive to an undesired change from normal non-electric working conditions with or without subsequent reconnection
- H02H5/10—Emergency protective circuit arrangements for automatic disconnection directly responsive to an undesired change from normal non-electric working conditions with or without subsequent reconnection responsive to mechanical injury, e.g. rupture of line, breakage of earth connection
- H02H5/105—Emergency protective circuit arrangements for automatic disconnection directly responsive to an undesired change from normal non-electric working conditions with or without subsequent reconnection responsive to mechanical injury, e.g. rupture of line, breakage of earth connection responsive to deterioration or interruption of earth connection
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- H03K17/08—Modifications for protecting switching circuit against overcurrent or overvoltage
- H03K17/082—Modifications for protecting switching circuit against overcurrent or overvoltage by feedback from the output to the control circuit
- H03K17/0822—Modifications for protecting switching circuit against overcurrent or overvoltage by feedback from the output to the control circuit in field-effect transistor switches
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Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
[発明の目的]
(産業上の利用分野)
本発明は、例えば車載用交流レギュレータ等に用いられ
る電子回路に係り、特に前記電子回路の接地端子が外れ
た際における接地電位変化より前記電子回路を保護する
ことに関する。
る電子回路に係り、特に前記電子回路の接地端子が外れ
た際における接地電位変化より前記電子回路を保護する
ことに関する。
(従来の技術)
一般に車載用交流レギュレータ等に用いられる電子回路
は、その回路構成内にある出力スイッチング素子が接地
されるローサイドスイッチ方式の制御による回路構成が
多く採用されている。
は、その回路構成内にある出力スイッチング素子が接地
されるローサイドスイッチ方式の制御による回路構成が
多く採用されている。
第4図にローサイドスイッチ方式の制御による電子回路
を示す。すなわち、外部回路Aからの信号を入力する入
力端子1が出力ドライバ回路2に接続され、この出力ド
ライバ回路2が出力スイッチング素子3に接続される。
を示す。すなわち、外部回路Aからの信号を入力する入
力端子1が出力ドライバ回路2に接続され、この出力ド
ライバ回路2が出力スイッチング素子3に接続される。
そして、この出力スイッチング素子3が制御回路の出力
端子4に接続される。
端子4に接続される。
そして前記出力ドライバ回路2は、7は源端子5を介し
て外部電源5aに接続される。さらに前記出力ドライバ
回路2と前記出力スイッチング素子3とが、それぞれに
接地端子7に接地されている。
て外部電源5aに接続される。さらに前記出力ドライバ
回路2と前記出力スイッチング素子3とが、それぞれに
接地端子7に接地されている。
また、前記出力端子4には外部負荷8aの一端が接続さ
れ、その負荷8aの他端は前記外部電源6aに接続され
ている。
れ、その負荷8aの他端は前記外部電源6aに接続され
ている。
よって、前記制御回路は前記出力ドライバ回路2からの
駆動信号が、前記出力スイッチング素子3を駆動し、該
出力スイッチング素子3に接続する前記出力端子4から
出力される。
駆動信号が、前記出力スイッチング素子3を駆動し、該
出力スイッチング素子3に接続する前記出力端子4から
出力される。
第5図は、出力スイッチング素子を外部電源に接続し、
外部負荷を接地したハイサイドスイッチ方式の制御によ
る電子回路の構成を示す。
外部負荷を接地したハイサイドスイッチ方式の制御によ
る電子回路の構成を示す。
すなわち第4図と同様に、外部回路Aからの信号を入力
する入力端子9が出力ドライバ回路10に接続され、こ
の出力ドライバ回路10が出力スイッチング素子11に
接続される。そしてこの出力スイッチング素子11が制
御回路の出力端子12に接続される。
する入力端子9が出力ドライバ回路10に接続され、こ
の出力ドライバ回路10が出力スイッチング素子11に
接続される。そしてこの出力スイッチング素子11が制
御回路の出力端子12に接続される。
そして前記出力ドライバ回路10と出力スイッチング素
子11とが、電源端子13を介して外部電源6bに接続
され、前記出力ドライバ回路10は接地端子14に接地
されている。また前記出力端子12には、外部負荷8b
の一端が接続され、その負荷8bの他端は接地されてい
る。
子11とが、電源端子13を介して外部電源6bに接続
され、前記出力ドライバ回路10は接地端子14に接地
されている。また前記出力端子12には、外部負荷8b
の一端が接続され、その負荷8bの他端は接地されてい
る。
このハイサイドスイッチ方式による制御回路は、前述し
たローサイドスイッチ方式による制御回路に比べて、外
部負荷が接地されているため、実施の際に外部負荷の交
換等が容易に行うことができ、取扱い而の利点がある。
たローサイドスイッチ方式による制御回路に比べて、外
部負荷が接地されているため、実施の際に外部負荷の交
換等が容易に行うことができ、取扱い而の利点がある。
この利点によって、電子回路の実施は前記ローサイドス
イッチ方式からハイサイドスイッチ方式の制御による電
子回路に替えられつつある。
イッチ方式からハイサイドスイッチ方式の制御による電
子回路に替えられつつある。
(発明が解決しようとする課題)
しかしながら、前述した第4図のハイサイドスイッチ方
式の制御による電子回路には、接地端子14が接地から
外れた際に制御上の安全等の考慮がなされていない。
式の制御による電子回路には、接地端子14が接地から
外れた際に制御上の安全等の考慮がなされていない。
つまり、前記接地端子14が接地から外れた場合に、外
部電源6bの印加電圧が前記接地端子14に制御回路を
構成する回路等から回り込み、前記接地端子14の電位
を上昇させる。この電位」二昇によって、前記接地端子
14を基準電位とした前記外部電源6bから印加電圧値
が、見かけ上は、電圧時fしたようになる。
部電源6bの印加電圧が前記接地端子14に制御回路を
構成する回路等から回り込み、前記接地端子14の電位
を上昇させる。この電位」二昇によって、前記接地端子
14を基準電位とした前記外部電源6bから印加電圧値
が、見かけ上は、電圧時fしたようになる。
従って、前記出力スイッチング素子11は、基準電圧が
変動している状態中に入力信号が入力し、しかも前記外
部電源6bから前記印加電圧の供給を受け、出力端子1
2を介して外部負荷8bに印加している。この制御回路
の出力制御が不安定な状態のまま、出力は停止せず、出
力制御不能になる可能性が高い。 そこで本発明は、ハ
イサイドスイッチ方式の制御による電子回路を採用する
にあって、前記電子回路の接地端子が接地から外れた場
合でも出力を制御できる保護手段を有する電子回路を提
供することを目的とする。
変動している状態中に入力信号が入力し、しかも前記外
部電源6bから前記印加電圧の供給を受け、出力端子1
2を介して外部負荷8bに印加している。この制御回路
の出力制御が不安定な状態のまま、出力は停止せず、出
力制御不能になる可能性が高い。 そこで本発明は、ハ
イサイドスイッチ方式の制御による電子回路を採用する
にあって、前記電子回路の接地端子が接地から外れた場
合でも出力を制御できる保護手段を有する電子回路を提
供することを目的とする。
[発明の構成]
(課題を解決するための手段)
本発明は従来技術のもつ課題を解決するために、外部電
源に接続すべき電源端子と、外部接地電位点に接続すべ
き接地端子と、外部回路からの入力信号が入力される入
力端子と、一端が接地された外部負荷の他端に接続すべ
き出力端子と、前記電源端子と前記接地端子との間に接
続され、前記入力された入力信号に応じて駆動され、出
力する電子回路と、前記接地端子が前記外部接地電位点
から外れたことを前記接地端子の電位変化から検出する
接地端子外れ検出手段と、前記接地端子外れ検出手段か
らの検出信号が入力されることによって、前記電子回路
への入力信号の遮断および該電子回路の駆動を停止させ
ることにより回路素子を保護する保護回路を具備するこ
とを特徴とする電子回路をもちいる。
源に接続すべき電源端子と、外部接地電位点に接続すべ
き接地端子と、外部回路からの入力信号が入力される入
力端子と、一端が接地された外部負荷の他端に接続すべ
き出力端子と、前記電源端子と前記接地端子との間に接
続され、前記入力された入力信号に応じて駆動され、出
力する電子回路と、前記接地端子が前記外部接地電位点
から外れたことを前記接地端子の電位変化から検出する
接地端子外れ検出手段と、前記接地端子外れ検出手段か
らの検出信号が入力されることによって、前記電子回路
への入力信号の遮断および該電子回路の駆動を停止させ
ることにより回路素子を保護する保護回路を具備するこ
とを特徴とする電子回路をもちいる。
さらに前述した保護回路は、前記接地端子外れ検出回路
からの第1の検出信号の入力に応じて、前記出力スイッ
チング素子の駆動を停止すると共に第2の検出信号を出
力する低電圧保護回路と、前記入力端子と前記出力ドラ
イバ回路との間に挿入され、前記接地端子外れ検出手段
からの第1の検出信号および前記低電圧保護回路からの
第2の検出信号が供給された時、前記入力信号を遮断す
ることにより、前記出力ドライバ回路の駆動電圧出力を
停止させる入力遮断回路とからなり、この保護回路を有
する電子回路を用いる。
からの第1の検出信号の入力に応じて、前記出力スイッ
チング素子の駆動を停止すると共に第2の検出信号を出
力する低電圧保護回路と、前記入力端子と前記出力ドラ
イバ回路との間に挿入され、前記接地端子外れ検出手段
からの第1の検出信号および前記低電圧保護回路からの
第2の検出信号が供給された時、前記入力信号を遮断す
ることにより、前記出力ドライバ回路の駆動電圧出力を
停止させる入力遮断回路とからなり、この保護回路を有
する電子回路を用いる。
(作用)
以上のような構成によると、本発明の保護回路を有する
ハイサイドスイッチ方式の制御による電子回路は、接地
端子が接地から外れた場合でも、出力制御を安定な状態
に維持でき、前記電子回路の回路素子の保護と安全を図
ることができる。
ハイサイドスイッチ方式の制御による電子回路は、接地
端子が接地から外れた場合でも、出力制御を安定な状態
に維持でき、前記電子回路の回路素子の保護と安全を図
ることができる。
(実施例)
以下、図面を参照して本発明の実施例を詳細に説明する
。
。
第1図は、本発明の実施例に係る保護手段となる保護回
路、検出回路等を採用したハイサイドスイッチ(負荷接
地)方式の制御による電子回路の構成を示すブロック図
である。
路、検出回路等を採用したハイサイドスイッチ(負荷接
地)方式の制御による電子回路の構成を示すブロック図
である。
すなわち、外部回路の出力端子Aが入力端子15を介し
て、入力遮断回路16に接続される。
て、入力遮断回路16に接続される。
この入力遮断回路16が、出力ドライバ回路17に接続
され、さらに前記出力ドライバ回路17が、出力スイッ
チング素子18に接続される。
され、さらに前記出力ドライバ回路17が、出力スイッ
チング素子18に接続される。
さらに前記出力ドライバ回路17と出力スイッチング回
路素子18とは、外部電源20が接続した電源端子21
にそれぞれ接続される。
路素子18とは、外部電源20が接続した電源端子21
にそれぞれ接続される。
また、この出力スイッチング素子18が電子回路の出力
端子1つに接続される。そして前記出力スイッチング素
子18は、出力接地間回路22を介して、外部接地され
た接地端子23に接続されている。
端子1つに接続される。そして前記出力スイッチング素
子18は、出力接地間回路22を介して、外部接地され
た接地端子23に接続されている。
また、前記出力ドライバ回路17に保護手段となる低電
圧保護回路24と接地端子外れ記憶回路25とがそれぞ
れ接続され、前記接地端子外れ記憶回路25と接地端子
外れ検出回路26が接続されている。さらに前記出力端
子19には、他端が接地された外部負荷27の一端が接
続されている。
圧保護回路24と接地端子外れ記憶回路25とがそれぞ
れ接続され、前記接地端子外れ記憶回路25と接地端子
外れ検出回路26が接続されている。さらに前記出力端
子19には、他端が接地された外部負荷27の一端が接
続されている。
このような構成をもつ制御回路は、外部回路の出力端子
Aから入力信号が、前記入力遮断回路16を介して、前
記出力ドライバ回路17に入力し、該出力ドライバ回路
17からの駆動信号によって、前記出力スイッチング素
子18が駆動され、前記外部負荷27へ出力されている
。
Aから入力信号が、前記入力遮断回路16を介して、前
記出力ドライバ回路17に入力し、該出力ドライバ回路
17からの駆動信号によって、前記出力スイッチング素
子18が駆動され、前記外部負荷27へ出力されている
。
ところが、前記接地端子23が接地から外れた場合に、
外部電源20の印加電圧が前記接地端子23に制御回路
を構成する回路等から回り込み、前記接地端子23の電
位を上昇させる。この電位上昇によって、前記接地端子
23を基準電位とした前記外部電源20から印加電圧値
が、見かけ上は、電圧降下したようになる。
外部電源20の印加電圧が前記接地端子23に制御回路
を構成する回路等から回り込み、前記接地端子23の電
位を上昇させる。この電位上昇によって、前記接地端子
23を基準電位とした前記外部電源20から印加電圧値
が、見かけ上は、電圧降下したようになる。
この電圧降下が生じた場合に、前記低電圧保護回路24
が動作し、前記出力ドライバ回路17からの駆動信号を
前記接地端子23と同じ電位におとし、前記出力スイッ
チング素子18が駆動しないようにしている。
が動作し、前記出力ドライバ回路17からの駆動信号を
前記接地端子23と同じ電位におとし、前記出力スイッ
チング素子18が駆動しないようにしている。
また前記接地端子23が外部接地から外れた場合に、前
記接地端子外れ検出回路26は、前記接地端子23から
前記出力接地間回路22を介して前記出力端子1つ側に
流れる電流によって生じる電圧差により動作し、前記接
地端子外れ記憶回路25に接地端子外れの信号を送る。
記接地端子外れ検出回路26は、前記接地端子23から
前記出力接地間回路22を介して前記出力端子1つ側に
流れる電流によって生じる電圧差により動作し、前記接
地端子外れ記憶回路25に接地端子外れの信号を送る。
その前記接地端子外れ記憶回路25は、前記接地端子外
れの信号と前記低電圧保護回路24から出される保護動
作の信号とにより、前記入力遮断回路16に入力遮断の
信号を送る。
れの信号と前記低電圧保護回路24から出される保護動
作の信号とにより、前記入力遮断回路16に入力遮断の
信号を送る。
前記入力遮断回路16は、入力遮断の信号を入力される
ことにより、外部回路からの入力信号を遮断し、前記出
力ドライバ回路17が駆動しないようにしている。
ことにより、外部回路からの入力信号を遮断し、前記出
力ドライバ回路17が駆動しないようにしている。
このようにして、接地端子が接地から外れた場合でも、
前記出力ドライバ回路17と前記出力スイッチング素子
18が駆動しないようにして、出力制御を安定な状態し
、前記制御回路を保護している。
前記出力ドライバ回路17と前記出力スイッチング素子
18が駆動しないようにして、出力制御を安定な状態し
、前記制御回路を保護している。
この出力ドライバ回路17にはチャージボンプロ路を採
用する回路構成を想定しているが、前記スイッチング素
子18をS〆動できれば良い。
用する回路構成を想定しているが、前記スイッチング素
子18をS〆動できれば良い。
つぎに、それぞれのブロックに回路素子を用いた第2図
を参照して実施例としてさらに詳細に説明する。すなイ
つち、前記出カスイツチング回路素r18はMO5FE
T出力トランジスタTrlからなり、ドレインが前記電
源端子21に接続され、ソースが前記出力端子19およ
び前記整流回路歯T−22であるダイオード28に接続
され、ゲートが前記出力ドライバ回路17にそれぞれ接
続される。
を参照して実施例としてさらに詳細に説明する。すなイ
つち、前記出カスイツチング回路素r18はMO5FE
T出力トランジスタTrlからなり、ドレインが前記電
源端子21に接続され、ソースが前記出力端子19およ
び前記整流回路歯T−22であるダイオード28に接続
され、ゲートが前記出力ドライバ回路17にそれぞれ接
続される。
また前記出力端子1つには、前記外部負荷27としてコ
イル29が接続されている。
イル29が接続されている。
そして前記低電圧保護回路24において、トランジスタ
Tr2は、コレクタが前記電源端子21に接続され、エ
ミッタが接続点Bを介して前記出力ドライバ回路17に
接続され、ベースがアノードを接地するツェナダイオー
ド30のカソードにそれぞれ接続される。さらに前記ト
ランジスタTr2のコレクタとベースとに抵抗R1の両
端が接続され、これらによって内部電源が構成されてい
る。
Tr2は、コレクタが前記電源端子21に接続され、エ
ミッタが接続点Bを介して前記出力ドライバ回路17に
接続され、ベースがアノードを接地するツェナダイオー
ド30のカソードにそれぞれ接続される。さらに前記ト
ランジスタTr2のコレクタとベースとに抵抗R1の両
端が接続され、これらによって内部電源が構成されてい
る。
また前記接続点Cは、接続点Cおよび抵抗R2を介して
、ソースを接地したトランジスタTr3のドレインに接
続されている。
、ソースを接地したトランジスタTr3のドレインに接
続されている。
そして前記接続点Cに抵抗R3の一端が接続され、さら
に前記抵抗R3の他端と、抵抗R4の一端と、抵抗R5
の一端とがそれぞれ接続点りで接続される。また、前記
抵抗R4の他端は接地されており、前記抵抗R5の他端
はトランジスタTr4のドレインに接続している。この
トランジスタTr4のソースは接地され、ゲートは前記
トランジスタTr3のゲートと共通接続(接続点E)さ
れて、これらのトランジスタTr3 、Tr4はミラー
回路構成になっている。
に前記抵抗R3の他端と、抵抗R4の一端と、抵抗R5
の一端とがそれぞれ接続点りで接続される。また、前記
抵抗R4の他端は接地されており、前記抵抗R5の他端
はトランジスタTr4のドレインに接続している。この
トランジスタTr4のソースは接地され、ゲートは前記
トランジスタTr3のゲートと共通接続(接続点E)さ
れて、これらのトランジスタTr3 、Tr4はミラー
回路構成になっている。
また前記電源端子21に一端を接続する抵抗R6は、他
端がトランジスタTr5のドレインに接続される。その
トランジスタTr5は、ソースが接地され、ゲートが前
記接続点りに接続されている。
端がトランジスタTr5のドレインに接続される。その
トランジスタTr5は、ソースが接地され、ゲートが前
記接続点りに接続されている。
このトランジスタTr5のドレインは、接続点Eに接続
されると共にトランジスタTr[iのゲートにそれぞれ
接続されている。
されると共にトランジスタTr[iのゲートにそれぞれ
接続されている。
このトランジスタTr6のドレインは、前記出力ドライ
バ回路17の出力端に接続され、ソースは接地されてい
る。以上による回路および素子等から低電圧保護回路2
4が構成される。
バ回路17の出力端に接続され、ソースは接地されてい
る。以上による回路および素子等から低電圧保護回路2
4が構成される。
また前記接地端子外れ検出回路26において、ベース接
地のnpn)ランジスタTr7により構成されている。
地のnpn)ランジスタTr7により構成されている。
このトランジスタTr7のコレクタは、抵抗R7を介し
て前記接続点Cに接続され、またエミッタは前記ダイオ
ード28のカソードに接続され、ベースが接地されてい
る。
て前記接続点Cに接続され、またエミッタは前記ダイオ
ード28のカソードに接続され、ベースが接地されてい
る。
また前記入力端子15と前記出力ドライバ回路17の入
力端との間に、前記入力端子15からの入力信号を遮断
する遮断回路16となるインバータ回路素子31とNO
R回路32とが直列挿入されている。このNOR回路3
2の他方の入力端には、前記接地端子外れ記憶回路25
の出力端が接続されている。
力端との間に、前記入力端子15からの入力信号を遮断
する遮断回路16となるインバータ回路素子31とNO
R回路32とが直列挿入されている。このNOR回路3
2の他方の入力端には、前記接地端子外れ記憶回路25
の出力端が接続されている。
この接地端子外れ記憶回路25は、3個のNOR回路3
3,34.35を用いてラッチ回路構成されたものであ
る。このラッチ回路の入力端は、前記トランジスタTr
3のドレインと前記トランジスタTr7のコレクタとに
それぞれ接続され、この出力端は前記NOR回路32の
一方の入力端子に接続されている。
3,34.35を用いてラッチ回路構成されたものであ
る。このラッチ回路の入力端は、前記トランジスタTr
3のドレインと前記トランジスタTr7のコレクタとに
それぞれ接続され、この出力端は前記NOR回路32の
一方の入力端子に接続されている。
以上の構成の制御回路の動作は、接地端子23が接地か
ら外れた場合に、外部電源20の印加電圧が、前記接地
端子23に制御回路を構成する回路等から回り込み、前
記接地端子23の電位を上昇させる。
ら外れた場合に、外部電源20の印加電圧が、前記接地
端子23に制御回路を構成する回路等から回り込み、前
記接地端子23の電位を上昇させる。
これにより、前記接地端子23の電位は、出力端子19
の電圧とダイオード28の順方向で発生する電圧との和
になり、外部電源20の印加電圧程度まで前記接地端子
23の電位を上昇させる。
の電圧とダイオード28の順方向で発生する電圧との和
になり、外部電源20の印加電圧程度まで前記接地端子
23の電位を上昇させる。
この前記電位が上昇した時に、前記ダイオード28によ
って発生する電位差が前記トランジスタTr7をオンさ
せ、該トランジスタTr7のコレクタの電位を降下させ
る。
って発生する電位差が前記トランジスタTr7をオンさ
せ、該トランジスタTr7のコレクタの電位を降下させ
る。
また前記電位上昇によって、見掛上、前記外部電源20
からの印加電圧が、降下した様になり、前記低電圧保護
回路24が動作する。
からの印加電圧が、降下した様になり、前記低電圧保護
回路24が動作する。
この動作は、前記印加電圧の見掛上の降下により、山部
電源の出力電圧をも降下させ、この出力電圧によって動
作している前記トランジスタTr5をオフさせ、そして
前記トランジスタTr6をオンさせる。この前記トラン
ジスタTr6のオンによって、前記出力スイッチング回
路素子18のゲート電圧が降下され、前記トランジスタ
Triはオフされる。
電源の出力電圧をも降下させ、この出力電圧によって動
作している前記トランジスタTr5をオフさせ、そして
前記トランジスタTr6をオンさせる。この前記トラン
ジスタTr6のオンによって、前記出力スイッチング回
路素子18のゲート電圧が降下され、前記トランジスタ
Triはオフされる。
さらに、この時に前記接地端子外れ記憶回路25の入力
信号において、NOR回路33にトランジスタTr7の
コレクタから入力される信号が、ハイ(H)信号からロ
ー(L)信号に反転され、前記低電圧保護回路24のト
ランジスタTr3のドレインから入力される信号もH信
号からL信号に共に反転される。
信号において、NOR回路33にトランジスタTr7の
コレクタから入力される信号が、ハイ(H)信号からロ
ー(L)信号に反転され、前記低電圧保護回路24のト
ランジスタTr3のドレインから入力される信号もH信
号からL信号に共に反転される。
そして、前記接地端子外れ記憶回路25からNOR回路
32に印加する出力信号が、L信号からH信号に反転さ
れる。
32に印加する出力信号が、L信号からH信号に反転さ
れる。
これより、前記NOR回路32の一方の入力端子がH信
号になるため、これの他方の入力端子に外部入力端子か
らの入力信号が入力しても、該NOR回路32からはそ
の入力信号が出力されない。従って、出力ドライバ回路
17は駆動しない状態となる。
号になるため、これの他方の入力端子に外部入力端子か
らの入力信号が入力しても、該NOR回路32からはそ
の入力信号が出力されない。従って、出力ドライバ回路
17は駆動しない状態となる。
また、本実施例の回路構成では、接地端子外れ記憶回路
25から接地端子外れの認識する信号を前記NOR回路
32にフィードバックする構成を採ったが、前記出力ス
イッチング素子18を直接オフさせても良い。
25から接地端子外れの認識する信号を前記NOR回路
32にフィードバックする構成を採ったが、前記出力ス
イッチング素子18を直接オフさせても良い。
さらに、前記スイッチング素子18は、MOSFETを
採用したが、ハイサイドスイッチ方式でオン・オフ動作
ができる素子であれば良い。
採用したが、ハイサイドスイッチ方式でオン・オフ動作
ができる素子であれば良い。
同様に前記接地端子外れ検出回路26が、トランジスタ
Tr7と抵抗R7とによって構成したが、前記出力接地
間回路22に流れる電流を検出できる素子あれば良い。
Tr7と抵抗R7とによって構成したが、前記出力接地
間回路22に流れる電流を検出できる素子あれば良い。
また制御回路内のそれぞれの回路および素子の接地は共
通接続されている。
通接続されている。
また、第2図の制御回路の接地端子が外れた状態の場合
の出力端子1つから出力する出力波形を第3図(a)乃
至(d)に示す。
の出力端子1つから出力する出力波形を第3図(a)乃
至(d)に示す。
すなわち第3図(a)乃至(C)は、第2図に示す低電
圧保護回路24のみを具備する制御回路(出力接地間回
路22.接地端子外れ記憶回路25および接地端子外れ
検出回路26を除いた回路)の出力波形で、出力端子1
9に接続される外部負荷27の負荷値(リアクタンス)
を(a)く(b)< (C)の順で大きくして、波形を
測定したものである。
圧保護回路24のみを具備する制御回路(出力接地間回
路22.接地端子外れ記憶回路25および接地端子外れ
検出回路26を除いた回路)の出力波形で、出力端子1
9に接続される外部負荷27の負荷値(リアクタンス)
を(a)く(b)< (C)の順で大きくして、波形を
測定したものである。
この波形図は、出力スイッチング素子18のトランジス
タ丁rlのゲートにかかる駆動電圧が、前記低電圧保護
回路24のトランジスタTrBのオンによって基準電圧
(接地端子23の端子電圧)まで降下する。しかし、外
部端子15からの断続的な入力信号が出力ドライバ回路
17に入力されるため、脈流の駆動電圧が前記トランジ
スタTrlのゲートに印加され、断続的にスイッチング
を行い、出力端子19に前記出力波形に示す不安定な出
力が外部負荷27にかかる。
タ丁rlのゲートにかかる駆動電圧が、前記低電圧保護
回路24のトランジスタTrBのオンによって基準電圧
(接地端子23の端子電圧)まで降下する。しかし、外
部端子15からの断続的な入力信号が出力ドライバ回路
17に入力されるため、脈流の駆動電圧が前記トランジ
スタTrlのゲートに印加され、断続的にスイッチング
を行い、出力端子19に前記出力波形に示す不安定な出
力が外部負荷27にかかる。
また第3図(d)は、第2図に示す本実施例の制御回路
の出力端子1つより出力される出力波形図である。
の出力端子1つより出力される出力波形図である。
前述した低電圧保護回路24に加えて、前記接地端子外
れ検出回路26と前記接地端子外れ記憶回路25との動
作により、外部端子15からの入力信号が前記出力ドラ
イバ回路17に入力されず、前記出力スイッチング回路
索子18が動作せず、この制御回路からは完全に出力さ
れない状態になる。
れ検出回路26と前記接地端子外れ記憶回路25との動
作により、外部端子15からの入力信号が前記出力ドラ
イバ回路17に入力されず、前記出力スイッチング回路
索子18が動作せず、この制御回路からは完全に出力さ
れない状態になる。
このような保護回路、検出回路等を採用したハイサイド
スイッチング方式の制御による電子回路の一連の動作に
よって、接地端子外れが認識され、前記出力スイッチン
グ素子18を不動作状態にし、出力が停止され、出力制
御不能に陥ることが回避される。
スイッチング方式の制御による電子回路の一連の動作に
よって、接地端子外れが認識され、前記出力スイッチン
グ素子18を不動作状態にし、出力が停止され、出力制
御不能に陥ることが回避される。
また、本発明はこの様な実施例に限定されるものでなく
、他にも発明の要旨を逸脱しない範囲で神々の変形や応
用が可能であることは勿論である。
、他にも発明の要旨を逸脱しない範囲で神々の変形や応
用が可能であることは勿論である。
[発明の効果]
以」二詳述したような本発明の保護手段をも゛するハイ
サイドスイッチ方式の制御による電子回路は、外部接地
と該制御回路の接地端子が外れた場合に、出力制御不能
に陥ること無く出力を停止させることができ、前記制御
回路の保護と安全とを図ることができる。
サイドスイッチ方式の制御による電子回路は、外部接地
と該制御回路の接地端子が外れた場合に、出力制御不能
に陥ること無く出力を停止させることができ、前記制御
回路の保護と安全とを図ることができる。
第1図は本発明の実施例に係る保護回路、検出回路等を
採用したハイサイドスイッチ方式の制御による電子回路
の構成を示すブロック図、第2図は第1図の電子回路の
構成を示す回路図、第3図(a)乃至(d)は第2図の
電子回路の出力端子から出力波形を示す波形図、第4図
は従来のローサイドスイッチ方式制御による電子回路の
構成を示すブロック図、第5図は従来のl\イサイドス
イッチ方式の制御による電子回路の構成を示すブロック
図。 17・・・出力ドライバ回路、18・・・出力スイッチ
ング回路素子、19・・・出力端子、20・・・外部電
源、22・・・出力接地間回路、23・・・接地端子、
24・・・低電圧保護回路、25・・・接地端子外れ記
憶回路、26・・・接地端子外れ検出回路、27・・・
外部負6:I0
採用したハイサイドスイッチ方式の制御による電子回路
の構成を示すブロック図、第2図は第1図の電子回路の
構成を示す回路図、第3図(a)乃至(d)は第2図の
電子回路の出力端子から出力波形を示す波形図、第4図
は従来のローサイドスイッチ方式制御による電子回路の
構成を示すブロック図、第5図は従来のl\イサイドス
イッチ方式の制御による電子回路の構成を示すブロック
図。 17・・・出力ドライバ回路、18・・・出力スイッチ
ング回路素子、19・・・出力端子、20・・・外部電
源、22・・・出力接地間回路、23・・・接地端子、
24・・・低電圧保護回路、25・・・接地端子外れ記
憶回路、26・・・接地端子外れ検出回路、27・・・
外部負6:I0
Claims (2)
- (1)外部電源に接続すべき電源端子と、 外部接地電位点に接続すべき接地端子と、 外部回路からの入力信号が入力される入力端子と、 一端が接地された外部負荷の他端に接続すべき出力端子
と、 前記入力端子に入力された入力信号に応じて駆動される
電子回路と、 前記接地端子が前記外部接地電位点から外れたことを前
記接地端子の電位変化として検出する接地端子外れ検出
回路と、 前記接地端子外れ検出回路からの検出信号に応答して、
前記電子回路を保護する保護回路を具備することを特徴
とする接地外れ保護回路を有する電子回路装置。 - (2)前記電子回路が前記入力端子からの入力信号を受
ける出力ドライバ回路と、該出力ドライバ回路からの出
力信号を受ける出力スイッチング回路とからなり、前記
保護回路が少なくとも前記電源端子と前記接地端子間電
圧が所定レベル以下のとき、前記出力スイッチング素子
の駆動を停止すると共に低電圧検出信号を出力する低電
圧保護回路と、 前記入力端子と前記出力ドライバ回路との間に挿入され
、前記接地端子外れ検出回路からの検出信号および前記
低電圧保護回路からの低電圧検出信号が供給された時、
前記入力信号を遮断することにより、前記出力ドライバ
回路の駆動電圧出力を停止させる入力遮断回路とからな
ることを特徴とする請求項(1)記載の接地外れ保護回
路を有する電子回路装置。
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---|---|---|---|
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US07/604,242 US5166852A (en) | 1989-10-31 | 1990-10-29 | Electronic circuit device for protecting electronic circuits from unwanted removal of ground terminal |
EP90120784A EP0426103B1 (en) | 1989-10-31 | 1990-10-30 | Electronic circuit device for protecting electronic circuits from unwanted removal of ground terminal |
KR1019900017453A KR930003176B1 (ko) | 1989-10-31 | 1990-10-30 | 접지해제 보호회로를 갖는 전자 회로장치 |
DE69020684T DE69020684T2 (de) | 1989-10-31 | 1990-10-30 | Elektronische Schutzanordnung für elektronische Schaltungen gegen unerwünschte Unterbrechung des Erdungsanschlusses. |
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---|---|
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1989
- 1989-10-31 JP JP1281759A patent/JP2504586B2/ja not_active Expired - Fee Related
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1990
- 1990-10-29 US US07/604,242 patent/US5166852A/en not_active Expired - Fee Related
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- 1990-10-30 DE DE69020684T patent/DE69020684T2/de not_active Expired - Fee Related
- 1990-10-30 EP EP90120784A patent/EP0426103B1/en not_active Expired - Lifetime
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