JPH03123077A - 両面加工半導体素子の製造方法 - Google Patents
両面加工半導体素子の製造方法Info
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- JPH03123077A JPH03123077A JP1260786A JP26078689A JPH03123077A JP H03123077 A JPH03123077 A JP H03123077A JP 1260786 A JP1260786 A JP 1260786A JP 26078689 A JP26078689 A JP 26078689A JP H03123077 A JPH03123077 A JP H03123077A
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Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
産業上の利用分野
本発明は薄膜によって形成される半導体素子の製造方法
に関する。
に関する。
従来の技術
従来 多くの半導体素子は基板の1主面のみを加工し製
造してい九 例外的なものとしては例えば単結晶シリコ
ンの太陽電池である。単結晶シリコンを基板として用(
\ 受光面の拡散を行1.X、表面電極を形成し 裏面
の電極を基板の第2の主面に形成してい九 すなわち基
板の両主面を加工して半導体素子を形成してい九 また 従来集積回路製造方法に代表された微細加工は単
結晶シリコンの1主面のみを加工してい九 発明が解決しようとする課題 1主面のみを加ニレ 半導体素子を製造する場合、その
製造工程が複雑になればなるほど、基板の位置合わせが
むずかしくなり、前工程で発生したゴミ、キズ等が不良
の原因になってい九課題を解決するための手段 半導体素子を薄膜で構成する場合、薄膜を堆積する第1
の基板上で薄膜の第1の主面を加工し別に用意された第
2の基板と薄膜加工面を張り合わゼ(第1の基板を取り
除き、薄膜の第2の主面を加工する。
造してい九 例外的なものとしては例えば単結晶シリコ
ンの太陽電池である。単結晶シリコンを基板として用(
\ 受光面の拡散を行1.X、表面電極を形成し 裏面
の電極を基板の第2の主面に形成してい九 すなわち基
板の両主面を加工して半導体素子を形成してい九 また 従来集積回路製造方法に代表された微細加工は単
結晶シリコンの1主面のみを加工してい九 発明が解決しようとする課題 1主面のみを加ニレ 半導体素子を製造する場合、その
製造工程が複雑になればなるほど、基板の位置合わせが
むずかしくなり、前工程で発生したゴミ、キズ等が不良
の原因になってい九課題を解決するための手段 半導体素子を薄膜で構成する場合、薄膜を堆積する第1
の基板上で薄膜の第1の主面を加工し別に用意された第
2の基板と薄膜加工面を張り合わゼ(第1の基板を取り
除き、薄膜の第2の主面を加工する。
作用
薄膜の両主面を別々に加工することによって、主面あた
りの加工工数はほぼ半減し 段差の違いも半減するため
位置合わせが簡単になる。また前工程が少なくなるので
ゴミ、キズの発生確率も減少L 不良発生確率を小さく
できる。
りの加工工数はほぼ半減し 段差の違いも半減するため
位置合わせが簡単になる。また前工程が少なくなるので
ゴミ、キズの発生確率も減少L 不良発生確率を小さく
できる。
実施例
本発明による1実施例について図面を用いて詳しく説明
する。本実施例は液晶テレビの液晶駆動スイッヂング素
子アレイとなる薄膜トランジスタ(Tr”T)とその信
号を伝える電極の製造方法である。第1図に工程順の段
面図を示した透水性の基板1、例えばガラス繊維を整形
したものやセラミックス魂 の上に次の工程で熱的機械
的に耐え得る金属ここではCr2を蒸着し 第1SiN
3、さらにTPTの半導体層としてaSi:I(4、T
PTのゲート絶縁膜として第2SiN5、TaOx 6
、半導体保護膜としての第23iN6、電極としてのI
rO2、Al1を順に蒸着する。微細加工用のレジスト
9を塗布し 露光現像した後を第1図に示し九 第2図はIrO2とAl1をエツチングした様子を示i
’o 10はTPTのトランジスタ領域でありゲート電
極が選択的に残っている。 11はTPTの信号を伝え
る電極が存在する画素領域である。
する。本実施例は液晶テレビの液晶駆動スイッヂング素
子アレイとなる薄膜トランジスタ(Tr”T)とその信
号を伝える電極の製造方法である。第1図に工程順の段
面図を示した透水性の基板1、例えばガラス繊維を整形
したものやセラミックス魂 の上に次の工程で熱的機械
的に耐え得る金属ここではCr2を蒸着し 第1SiN
3、さらにTPTの半導体層としてaSi:I(4、T
PTのゲート絶縁膜として第2SiN5、TaOx 6
、半導体保護膜としての第23iN6、電極としてのI
rO2、Al1を順に蒸着する。微細加工用のレジスト
9を塗布し 露光現像した後を第1図に示し九 第2図はIrO2とAl1をエツチングした様子を示i
’o 10はTPTのトランジスタ領域でありゲート電
極が選択的に残っている。 11はTPTの信号を伝え
る電極が存在する画素領域である。
画素領域にある光を通さない金属 ここではA18を取
り除くためにレジストを印刷する。 トランジスタ領域
10と画素領域11が寸法精度よくエツチングされてい
るのでレジストは精度の低い印刷で充分である。
り除くためにレジストを印刷する。 トランジスタ領域
10と画素領域11が寸法精度よくエツチングされてい
るのでレジストは精度の低い印刷で充分である。
画素領域11のAl1をエツチングし レジストを除去
し 基板を洗浄乾燥した後、透光性基板12に接着剤1
3を塗布して、堆積した薄膜2.3、4、5、6、7、
8を透水性基板1とではさむように接着する。接着完了
後、透水性基板」二に形成された金属 本実施例では2
のCrをエツチングする。Crのエツチング液に浸せば
透水性基板1から染み込んで簡単にCrはエツチング
され 透水性基板1と透光性基板12とを分離すること
ができる。透水性基板1を分離したところを第3図に示
しへ 第13iN3にレジストを塗布し 透光性基板12側か
ら光を照射L A18をマスクにして裏面露光する。
し 基板を洗浄乾燥した後、透光性基板12に接着剤1
3を塗布して、堆積した薄膜2.3、4、5、6、7、
8を透水性基板1とではさむように接着する。接着完了
後、透水性基板」二に形成された金属 本実施例では2
のCrをエツチングする。Crのエツチング液に浸せば
透水性基板1から染み込んで簡単にCrはエツチング
され 透水性基板1と透光性基板12とを分離すること
ができる。透水性基板1を分離したところを第3図に示
しへ 第13iN3にレジストを塗布し 透光性基板12側か
ら光を照射L A18をマスクにして裏面露光する。
この裏面露光によって第1SiNを選択的にエツチング
した(第4図)。
した(第4図)。
次にn3型a−3i:HI3を堆積L コンタクト窓1
5を開けるためにn9、i型a−3i:HI3、4、お
よび第2SiN5、 TaOx6をエツチングし九 そ
の後ソー人 ドレイン電極として用いる第2A]16を
堆積した(第5図)。第2Al 16を選択的にエツチ
ングするためレジストを塗布する。第1SiN3によっ
てTPTのチャンネル長が決まっているので、印刷法な
どの簡単な方法によってレジストは塗布できる。第2A
116をエツチングし完成した様子を第6図に示す。
5を開けるためにn9、i型a−3i:HI3、4、お
よび第2SiN5、 TaOx6をエツチングし九 そ
の後ソー人 ドレイン電極として用いる第2A]16を
堆積した(第5図)。第2Al 16を選択的にエツチ
ングするためレジストを塗布する。第1SiN3によっ
てTPTのチャンネル長が決まっているので、印刷法な
どの簡単な方法によってレジストは塗布できる。第2A
116をエツチングし完成した様子を第6図に示す。
以」二説明した実施例(よ 連続で製造できる。この方
法を示したのが第7図に示した工程概略図である。この
工程概略図(よ 2系統から成り立っている。第1の系
統は透水性基板を用いる工程であり、第2の系統は透光
性基板を用いる系統である。
法を示したのが第7図に示した工程概略図である。この
工程概略図(よ 2系統から成り立っている。第1の系
統は透水性基板を用いる工程であり、第2の系統は透光
性基板を用いる系統である。
第1の系統と第2の系統の接点が基板を透水性から透光
性に入れ換える工程が含まれる。第7図の工程を詳しく
説明する。
性に入れ換える工程が含まれる。第7図の工程を詳しく
説明する。
第1の系統右下の洗浄、乾燥工程101によって透水性
基板をきれいにLCr堆積工程102によって透水性基
板に Crを堆積し九 第1SIN、 i型a−3i
:H,第2SiN、TaOx。
基板をきれいにLCr堆積工程102によって透水性基
板に Crを堆積し九 第1SIN、 i型a−3i
:H,第2SiN、TaOx。
ITOlAIを工程順に堆積し 基板を充分に冷却した
後、 レジスト塗布110、露光111、現像112を
行っ′FC,Al/■TOをエツチングした後レジスト
を除去し レジストを印刷しt、 AIエッヂング1
20の後、 レジストを除去し 洗浄乾燥を行っ九 こ
こまでが第2図から第3図にかけての工程である。
後、 レジスト塗布110、露光111、現像112を
行っ′FC,Al/■TOをエツチングした後レジスト
を除去し レジストを印刷しt、 AIエッヂング1
20の後、 レジストを除去し 洗浄乾燥を行っ九 こ
こまでが第2図から第3図にかけての工程である。
−・方、透光性基板は第2の系統左上から投入しく13
0)、洗浄乾燥後、樹脂を塗布し九 次に熱処理を行い
ながら、第1の系統でできあがった透水性の基板上の加
工品と張り合わせ、Cr腐食液+3]中で透水性基板を
透光性基板から分離させμ このとき透水性基板上に形
成されていた加工品は透光性基板上に移し返られる。透
光性基板を洗浄し乾燥した後、 レジストを塗布し裏面
露光して第1SiNをエツチングし九 n゛型a3i:
IIを堆積し レジストを塗布し コンタクト窓開は用
の露光現像140を行っtan”″、i型a−8J:)
1、 SiN、TaOxをエツチングした後、基板を洗
浄しソー人 ドレイン電極用のA1を堆積し九 次にレ
ジストを印刷LAI/n”型aSi:Hをエツチングし
てレジストを除去すれば透光性基板上にTFTアレイが
完成する。
0)、洗浄乾燥後、樹脂を塗布し九 次に熱処理を行い
ながら、第1の系統でできあがった透水性の基板上の加
工品と張り合わせ、Cr腐食液+3]中で透水性基板を
透光性基板から分離させμ このとき透水性基板上に形
成されていた加工品は透光性基板上に移し返られる。透
光性基板を洗浄し乾燥した後、 レジストを塗布し裏面
露光して第1SiNをエツチングし九 n゛型a3i:
IIを堆積し レジストを塗布し コンタクト窓開は用
の露光現像140を行っtan”″、i型a−8J:)
1、 SiN、TaOxをエツチングした後、基板を洗
浄しソー人 ドレイン電極用のA1を堆積し九 次にレ
ジストを印刷LAI/n”型aSi:Hをエツチングし
てレジストを除去すれば透光性基板上にTFTアレイが
完成する。
」1記の実施例に於て(よ レジストを使用する工程は
5回であり、厳密なマスク合わせが必要な露光はコンタ
クト窓開は工程140の1回だけである。さらにTPT
を構成する薄膜堆積は連続&へしかも凹凸の少ない表面
に行うことができるた取局所的な膜厚変化は小さいので
、静電破壊は起こりにくく、ダストが残りにくい。
5回であり、厳密なマスク合わせが必要な露光はコンタ
クト窓開は工程140の1回だけである。さらにTPT
を構成する薄膜堆積は連続&へしかも凹凸の少ない表面
に行うことができるた取局所的な膜厚変化は小さいので
、静電破壊は起こりにくく、ダストが残りにくい。
また 本発明は本質的に一、 バッチ処理ではなく連
続に製造することができる。
続に製造することができる。
発明の効果
本発明によれば薄膜の両主面を別々に加工することによ
って、主面あたりの加工工数はほぼ半減し 段差の違い
も半減するため位置合わせが簡単になる。また前工程が
少なくなるのでゴミ、キズの発生確率も減少し 不良発
生確率を小さくできる。
って、主面あたりの加工工数はほぼ半減し 段差の違い
も半減するため位置合わせが簡単になる。また前工程が
少なくなるのでゴミ、キズの発生確率も減少し 不良発
生確率を小さくできる。
第1図〜第6図(上 本発明の一実施例における両面加
工半導体素子の製造方法を示す工程断面は第7図は本発
明の一実施例における連続製造法の流れ図である。 1・・・・透水性基板、 3・・・・第−SiN、 4
・・・・a−8]: Hl 5・・・・第二SiN、
6 ・・−・T a OX、 7・・・・ITOl 8
・・・・第−Al、 10・・・・トランジスタ領*
11・・・・画素領@ 12・・・・透光性基板、
13・・・・接着前 14・・・・n”a−3i:T
(、15・・・・コンタクト窓 16・・・・第二A1
.30・・・・裏面露光されたレジスト。
工半導体素子の製造方法を示す工程断面は第7図は本発
明の一実施例における連続製造法の流れ図である。 1・・・・透水性基板、 3・・・・第−SiN、 4
・・・・a−8]: Hl 5・・・・第二SiN、
6 ・・−・T a OX、 7・・・・ITOl 8
・・・・第−Al、 10・・・・トランジスタ領*
11・・・・画素領@ 12・・・・透光性基板、
13・・・・接着前 14・・・・n”a−3i:T
(、15・・・・コンタクト窓 16・・・・第二A1
.30・・・・裏面露光されたレジスト。
Claims (2)
- (1)被加工品の両主面を、上記被加工品の基板を代え
ることによって、別々に加工することを特徴とする両面
加工半導体素子の製造方法 - (2)第1基板上に堆積された薄膜の第1主面を加工し
た後、上記加工面と第2基板とを張り合わせ、上記第1
基板を取り除き、上記薄膜の第2の主面を加工すること
を特徴とする両面加工半導体素子の製造方法
Priority Applications (3)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP1260786A JPH03123077A (ja) | 1989-10-05 | 1989-10-05 | 両面加工半導体素子の製造方法 |
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