CN102254861A - 薄膜晶体管矩阵基板及显示面板的制造方法 - Google Patents
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- 239000000758 substrate Substances 0.000 title claims abstract description 37
- 239000011159 matrix material Substances 0.000 title claims abstract description 26
- 238000004519 manufacturing process Methods 0.000 title claims abstract description 23
- 239000010409 thin film Substances 0.000 title abstract description 11
- 239000010410 layer Substances 0.000 claims abstract description 223
- 229920002120 photoresistant polymer Polymers 0.000 claims abstract description 119
- 238000000034 method Methods 0.000 claims abstract description 55
- 238000000059 patterning Methods 0.000 claims abstract description 46
- 239000004065 semiconductor Substances 0.000 claims abstract description 28
- 238000005530 etching Methods 0.000 claims abstract description 17
- 239000011241 protective layer Substances 0.000 claims abstract description 17
- 238000001039 wet etching Methods 0.000 claims abstract description 9
- 239000011248 coating agent Substances 0.000 claims abstract description 6
- 238000000576 coating method Methods 0.000 claims abstract description 6
- 239000010408 film Substances 0.000 claims description 19
- 239000004973 liquid crystal related substance Substances 0.000 claims description 9
- 239000012212 insulator Substances 0.000 claims description 6
- 238000004380 ashing Methods 0.000 claims description 5
- 238000010438 heat treatment Methods 0.000 claims description 5
- 238000004528 spin coating Methods 0.000 claims description 3
- 229910052751 metal Inorganic materials 0.000 abstract description 5
- 239000002184 metal Substances 0.000 abstract description 5
- 150000002739 metals Chemical class 0.000 abstract 1
- 229910021417 amorphous silicon Inorganic materials 0.000 description 6
- 239000000463 material Substances 0.000 description 6
- 238000000623 plasma-assisted chemical vapour deposition Methods 0.000 description 5
- 229910052782 aluminium Inorganic materials 0.000 description 3
- 238000005516 engineering process Methods 0.000 description 3
- 229910021420 polycrystalline silicon Inorganic materials 0.000 description 3
- 229920005591 polysilicon Polymers 0.000 description 3
- VYPSYNLAJGMNEJ-UHFFFAOYSA-N silicon dioxide Inorganic materials O=[Si]=O VYPSYNLAJGMNEJ-UHFFFAOYSA-N 0.000 description 3
- 229910045601 alloy Inorganic materials 0.000 description 2
- 239000000956 alloy Substances 0.000 description 2
- 230000005540 biological transmission Effects 0.000 description 2
- 230000015572 biosynthetic process Effects 0.000 description 2
- 238000005229 chemical vapour deposition Methods 0.000 description 2
- 229910052804 chromium Inorganic materials 0.000 description 2
- 229910052802 copper Inorganic materials 0.000 description 2
- 239000011521 glass Substances 0.000 description 2
- 229910052750 molybdenum Inorganic materials 0.000 description 2
- 150000004767 nitrides Chemical class 0.000 description 2
- 238000001259 photo etching Methods 0.000 description 2
- 238000004151 rapid thermal annealing Methods 0.000 description 2
- 238000007761 roller coating Methods 0.000 description 2
- 229910052709 silver Inorganic materials 0.000 description 2
- 229910052715 tantalum Inorganic materials 0.000 description 2
- 229910052719 titanium Inorganic materials 0.000 description 2
- 229910052721 tungsten Inorganic materials 0.000 description 2
- OAICVXFJPJFONN-UHFFFAOYSA-N Phosphorus Chemical compound [P] OAICVXFJPJFONN-UHFFFAOYSA-N 0.000 description 1
- 229910052581 Si3N4 Inorganic materials 0.000 description 1
- 229910004205 SiNX Inorganic materials 0.000 description 1
- 239000004411 aluminium Substances 0.000 description 1
- XAGFODPZIPBFFR-UHFFFAOYSA-N aluminium Chemical compound [Al] XAGFODPZIPBFFR-UHFFFAOYSA-N 0.000 description 1
- GPBUGPUPKAGMDK-UHFFFAOYSA-N azanylidynemolybdenum Chemical compound [Mo]#N GPBUGPUPKAGMDK-UHFFFAOYSA-N 0.000 description 1
- 238000010276 construction Methods 0.000 description 1
- 238000000151 deposition Methods 0.000 description 1
- 230000008021 deposition Effects 0.000 description 1
- 238000007598 dipping method Methods 0.000 description 1
- 239000012535 impurity Substances 0.000 description 1
- 238000011065 in-situ storage Methods 0.000 description 1
- 229910052698 phosphorus Inorganic materials 0.000 description 1
- 239000011574 phosphorus Substances 0.000 description 1
- 238000000206 photolithography Methods 0.000 description 1
- 239000010453 quartz Substances 0.000 description 1
- 230000000717 retained effect Effects 0.000 description 1
- 229910021332 silicide Inorganic materials 0.000 description 1
- FVBUAEGBCNSCDD-UHFFFAOYSA-N silicide(4-) Chemical compound [Si-4] FVBUAEGBCNSCDD-UHFFFAOYSA-N 0.000 description 1
- 239000000377 silicon dioxide Substances 0.000 description 1
- HQVNEWCFYHHQES-UHFFFAOYSA-N silicon nitride Chemical group N12[Si]34N5[Si]62N3[Si]51N64 HQVNEWCFYHHQES-UHFFFAOYSA-N 0.000 description 1
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- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L29/00—Semiconductor devices specially adapted for rectifying, amplifying, oscillating or switching and having potential barriers; Capacitors or resistors having potential barriers, e.g. a PN-junction depletion layer or carrier concentration layer; Details of semiconductor bodies or of electrodes thereof ; Multistep manufacturing processes therefor
- H01L29/66—Types of semiconductor device ; Multistep manufacturing processes therefor
- H01L29/66007—Multistep manufacturing processes
- H01L29/66075—Multistep manufacturing processes of devices having semiconductor bodies comprising group 14 or group 13/15 materials
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- H01L29/66409—Unipolar field-effect transistors
- H01L29/66477—Unipolar field-effect transistors with an insulated gate, i.e. MISFET
- H01L29/66742—Thin film unipolar transistors
- H01L29/6675—Amorphous silicon or polysilicon transistors
- H01L29/66765—Lateral single gate single channel transistors with inverted structure, i.e. the channel layer is formed after the gate
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- G—PHYSICS
- G02—OPTICS
- G02F—OPTICAL DEVICES OR ARRANGEMENTS FOR THE CONTROL OF LIGHT BY MODIFICATION OF THE OPTICAL PROPERTIES OF THE MEDIA OF THE ELEMENTS INVOLVED THEREIN; NON-LINEAR OPTICS; FREQUENCY-CHANGING OF LIGHT; OPTICAL LOGIC ELEMENTS; OPTICAL ANALOGUE/DIGITAL CONVERTERS
- G02F1/00—Devices or arrangements for the control of the intensity, colour, phase, polarisation or direction of light arriving from an independent light source, e.g. switching, gating or modulating; Non-linear optics
- G02F1/01—Devices or arrangements for the control of the intensity, colour, phase, polarisation or direction of light arriving from an independent light source, e.g. switching, gating or modulating; Non-linear optics for the control of the intensity, phase, polarisation or colour
- G02F1/13—Devices or arrangements for the control of the intensity, colour, phase, polarisation or direction of light arriving from an independent light source, e.g. switching, gating or modulating; Non-linear optics for the control of the intensity, phase, polarisation or colour based on liquid crystals, e.g. single liquid crystal display cells
- G02F1/133—Constructional arrangements; Operation of liquid crystal cells; Circuit arrangements
- G02F1/136—Liquid crystal cells structurally associated with a semi-conducting layer or substrate, e.g. cells forming part of an integrated circuit
- G02F1/1362—Active matrix addressed cells
- G02F1/136231—Active matrix addressed cells for reducing the number of lithographic steps
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- G—PHYSICS
- G02—OPTICS
- G02F—OPTICAL DEVICES OR ARRANGEMENTS FOR THE CONTROL OF LIGHT BY MODIFICATION OF THE OPTICAL PROPERTIES OF THE MEDIA OF THE ELEMENTS INVOLVED THEREIN; NON-LINEAR OPTICS; FREQUENCY-CHANGING OF LIGHT; OPTICAL LOGIC ELEMENTS; OPTICAL ANALOGUE/DIGITAL CONVERTERS
- G02F1/00—Devices or arrangements for the control of the intensity, colour, phase, polarisation or direction of light arriving from an independent light source, e.g. switching, gating or modulating; Non-linear optics
- G02F1/01—Devices or arrangements for the control of the intensity, colour, phase, polarisation or direction of light arriving from an independent light source, e.g. switching, gating or modulating; Non-linear optics for the control of the intensity, phase, polarisation or colour
- G02F1/13—Devices or arrangements for the control of the intensity, colour, phase, polarisation or direction of light arriving from an independent light source, e.g. switching, gating or modulating; Non-linear optics for the control of the intensity, phase, polarisation or colour based on liquid crystals, e.g. single liquid crystal display cells
- G02F1/133—Constructional arrangements; Operation of liquid crystal cells; Circuit arrangements
- G02F1/136—Liquid crystal cells structurally associated with a semi-conducting layer or substrate, e.g. cells forming part of an integrated circuit
- G02F1/1362—Active matrix addressed cells
- G02F1/1368—Active matrix addressed cells in which the switching element is a three-electrode device
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Abstract
本发明提供一种薄膜晶体管矩阵基板及显示面板的制造方法。此制造方法包括如下步骤:依序形成栅极、栅极绝缘层、半导体层、欧姆接触层、电极层及第一光阻层于所述透明基材上;图案化所述第一光阻层;蚀刻所述欧姆接触层及所述电极层;涂布第二光阻层于所述图案化第一光阻层上,以及沟道内;移除所述图案化第一光阻层上的所述第二光阻层,并保留所述沟道内的所述第二光阻层;蚀刻所述半导体层;移除所述图案化第一光阻层及所述第二光阻层;形成保护层于所述沟道、所述源电极及所述漏电极上;以及形成像素电极层于所述保护层上,本发明可减少制程的光掩膜数,且仅需对金属进行一次湿蚀刻。
Description
【技术领域】
本发明涉及薄膜晶体管制造技术领域,特别是涉及一种薄膜晶体管矩阵基板及显示面板的制造方法。
【背景技术】
液晶显示器(Liquid Crystal Display,LCD)已被广泛应用于各种电子产品中,液晶显示器大部分为背光型液晶显示器,其是由液晶显示面板及背光模块(backlight module)所组成。一般的液晶显示面板包含彩色滤光片(Color Filter,CF)基板及薄膜晶体管(Thin Film Transistor,TFT)矩阵基板。CF基板上设有多个彩色滤光片和共同电极。TFT矩阵基板上设有多条彼此平行的扫描线、多条彼此平行的数据线、多个薄膜晶体管及像素电极,其中扫描线是垂直于数据线,且两相邻扫描线和两相邻数据线之间可界定像素(Pixel)区域。
在TFT矩阵基板的制程中,需使用多道光掩膜来进行光刻制程(Photo-lithography),然而,光掩膜相当昂贵,光掩膜数越多则TFT制程所需的成本越高,且增加制程时间及复杂度。再者,在光刻制程中,可能需进行多次湿蚀刻(wet etch),而容易对金属线造成影响。
故,有必要提供一种薄膜晶体管矩阵基板及显示面板的制造方法,以解决现有技术所存在的问题。
【发明内容】
本发明提供一种薄膜晶体管矩阵基板及显示面板的制造方法,以解决TFT制程问题。
本发明的主要目的在于提供一种薄膜晶体管矩阵基板的制造方法,所述制造方法包括如下步骤:
形成栅极于透明基材上;
依序形成栅极绝缘层、半导体层、欧姆接触层、电极层及第一光阻层于所述透明基材及所述栅极上;
图案化所述第一光阻层,以形成一沟道,所述沟道是形成于所述栅极的上方;
蚀刻所述欧姆接触层及所述电极层,以移除部分的所述欧姆接触层及部分的所述电极层,并形成源电极及漏电极于所述沟道的相对两侧;
涂布第二光阻层于所述图案化第一光阻层上,以及所述沟道内;
移除所述图案化第一光阻层上的所述第二光阻层,并保留所述沟道内的所述第二光阻层;
蚀刻所述半导体层,以移除部分所述半导体层;
移除所述图案化第一光阻层及所述第二光阻层;
形成保护层于所述沟道、所述源电极及所述漏电极上;以及
形成像素电极层于所述保护层上,其中所述像素电极层是电性连接于所述漏电极。
本发明的另一目的在于提供一种显示面板的制造方法,所述制造方法包括如下步骤:
形成栅极于透明基材上;
依序形成栅极绝缘层、半导体层、欧姆接触层、电极层及第一光阻层于所述透明基材及所述栅极上;
图案化所述第一光阻层,以形成一沟道,所述沟道是形成于所述栅极的上方;
蚀刻所述欧姆接触层及所述电极层,以移除部分的所述欧姆接触层及部分的所述电极层,并形成源电极及漏电极于所述沟道的相对两侧;
涂布第二光阻层于所述图案化第一光阻层上,以及所述沟道内;
移除所述图案化第一光阻层上的所述第二光阻层,并保留所述沟道内的所述第二光阻层;
蚀刻所述半导体层,以移除部分所述半导体层;
移除所述图案化第一光阻层及所述第二光阻层;
形成保护层于所述沟道、所述源电极及所述漏电极上;以及
形成像素电极层于所述保护层上,其中所述像素电极层是电性连接于所述漏电极,以完成一薄膜晶体管矩阵基板;以及
形成一液晶层于所述薄膜晶体管矩阵基板与彩色滤光片基板之间。
在本发明的一实施例中,当蚀刻所述欧姆接触层及所述电极层时,对所述欧姆接触层及所述电极层进行一次湿蚀刻,以移除所述欧姆接触层及所述电极层未被所述图案化第一光阻层遮蔽的部分。
在本发明的一实施例中,当涂布所述第二光阻层时,利用旋涂法、刮刀涂布法或滚轮涂布来涂布所述第二光阻层。
在本发明的一实施例中,在涂布所述第二光阻层后,在所述沟道内的所述第二光阻层的厚度是大于在所述图案化第一光阻层上的所述第二光阻层的厚度。
在本发明的一实施例中,当移除在所述图案化第一光阻层上的所述第二光阻层时,利用加热灰化来移除在所述漏电极及所述源电极上的所述第二光阻层。
在本发明的一实施例中,当蚀刻所述半导体层时,利用所述图案化第一光阻层及在所述沟道内的所述第二光阻层来作为光掩膜,并对所述半导体层进行干蚀刻。
在本发明的一实施例中,当移除所述图案化第一光阻层及所述第二光阻层时,利用剥离方式来移除所述图案化第一光阻层及所述第二光阻层。
本发明的薄膜晶体管矩阵基板及显示面板的制造方法可减少制程所需的光掩膜数,进而减少制程成本及时间。再者,本发明的方法亦可减少湿蚀刻的步骤,因而可减少湿蚀刻对组件的影响。又,本发明的制造方法可使用一般光掩膜来完成,而不需使用多段式调整光掩膜,因而大幅降低制程成本。
为让本发明的上述内容能更明显易懂,下文特举优选实施例,并配合所附图式,作详细说明如下:
【附图说明】
图1显示依照本发明的一实施例的显示面板与背光模块的剖面示意图;以及
图2A至图2I显示依照本发明的一实施例的显示面板的薄膜晶体管矩阵的制程剖面示意图。
【具体实施方式】
以下各实施例的说明是参考附加的图式,用以例示本发明可用以实施的特定实施例。本发明所提到的方向用语,例如「上」、「下」、「前」、「后」、「左」、「右」、「内」、「外」、「侧面」等,仅是参考附加图式的方向。因此,使用的方向用语是用以说明及理解本发明,而非用以限制本发明。
在图中,结构相似的单元是以相同标号表示。
请参照图1,其显示依照本发明的一实施例的显示面板与背光模块的剖面示意图。本实施例的薄膜晶体管(TFT)矩阵基板的制造方法可应用于显示面板100(例如液晶显示面板)的制造过程中,以制造晶体管的保护层。当应用本实施例的显示面板100来制造一液晶显示装置时,可设置液晶显示面板100于背光模块200上,因而形成液晶显示装置。此显示面板100可包括第一基板110、第二基板120、液晶层130、第一偏光片140及第二偏光片150。第一基板110和第二基板120的基板材料可为玻璃基板或可挠性塑料基板,在本实施例中,第一基板110可例如为薄膜晶体管(Thin Film Transistor,TFT)矩阵基板,而第二基板120可例如为彩色滤光片(Color Filter,CF)基板。值得注意的是,在一些实施例中,彩色滤光片和TFT矩阵亦可配置在同一基板上。
如图1所示,液晶层130是形成于第一基板110与第二基板120之间。第一偏光片140是设置第一基板110的一侧,并相对于液晶层130(即第一基板110的入光侧),第二偏光片150是设置第二基板120的一侧,并相对于液晶层130(即第二基板120的出光侧)。
请参照图2A至图2I,其显示依照本发明的一实施例的显示面板的薄膜晶体管矩阵的制程剖面示意图。当制造本实施例之TFT矩阵基板(如第一基板110)时,首先,如图2A所示,形成栅极112于透明基材111上,此透明基材111例如为石英或玻璃基材,此栅极112可通过光刻工艺(第一道光掩膜制程)来形成,其材料例如为Al、Ag、Cu、Mo、Cr、W、Ta、Ti、氮化金属或上述任意组合的合金,亦可为具有耐热金属薄膜和低电阻率薄膜的多层结构,例如氮化钼薄膜和铝薄膜的双层结构。
如图2B所示,接着,依序形成栅极绝缘层113、半导体层114、欧姆接触层115、电极层116及第一光阻层101于透明基材111及栅极112上。栅极绝缘层113的材料例如为氮化硅(SiNx)或氧化硅(SiOx),其例如是以等离子体增强化学气相沉积(PlasmaEnhanced Chemical Vapor Deposition,PECVD)方式来沉积形成。本实施例的半导体层114的材料优选为多晶硅(Poly-Silicon)。在本实施例中,半导体层114可先沉积一非晶硅(a-Si)层,接着,对此非晶硅层进行快速热退火(Rapid thermal annealing,RTA)步骤,藉以使此非晶硅层再结晶成一多晶硅层。欧姆接触层115的材料例如是由重掺杂有N型杂质(例如磷)的N+非晶硅(a-Si)或其硅化物所形成,或者例如是以化学气相沉积方式临场(In-situ)沉积形成。电极层116的材料例如Al、Ag、Cu、Mo、Cr、W、Ta、Ti、氮化金属或上述任意组合的合金。
如图2C所示,接着,图案化第一光阻层101(第二道光掩膜制程),以形成一沟道C于第一光阻层101上。此时,所述沟道C是形成于栅极112的上方,并曝露出电极层116的表面。在本实施例中,可利用一般的光掩膜来蚀刻第一光阻层101,以图案化第一光阻层101。
如图2D所示,接着,蚀刻欧姆接触层115及电极层116,以移除部分的欧姆接触层115及部分的电极层116,并形成漏电极116a及源电极116b于沟道C的相对两侧。此时,可利用图案化后的第一光阻层101来作为光掩膜,并对欧姆接触层115及电极层116进行一次湿蚀刻,以移除欧姆接触层115及电极层116未被图案化第一光阻层101遮蔽的部分(特别是位于沟道C的部分)。
如图2E所示,接着,涂布第二光阻层102于图案化第一光阻层101上,以及沟道C内。此时,可利用旋涂法、刮刀涂布法或滚轮涂布(Roller Coating)来涂布第二光阻层102。由于沟道C为凹陷处且第二光阻层102会填满沟道C的凹陷,因此,相较于图案化第一光阻层101上的第二光阻层102,沟道C内的第二光阻层102可具有较大的厚度。
如图2F所示,接着,移除图案化第一光阻层101上的所述第二光阻层102,并保留所述沟道C内的所述第二光阻层102。在本实施例中,可利用加热灰化(heart ashing)来处理第二光阻层102,以移除此图案化第一光阻层101上的所述第二光阻层102。由于在沟道C内的所述第二光阻层102的厚度是大于在图案化第一光阻层101上的第二光阻层102的厚度,因此,当移除图案化第一光阻层101上的所述第二光阻层102时,在沟道C内的所述第二光阻层102仍可被保留住,并遮蔽住沟道C。
如图2G所示,接着,蚀刻半导体层114,以移除部分的半导体层114。此时,可利用图案化第一光阻层101以及在沟道C内的所述第二光阻层102来作为光掩膜,并对半导体层114进行另一次干蚀刻,以移除半导体层114未被图案化第一光阻层101及第二光阻层102遮蔽的部分,而图案化半导体层114,其中此图案化后的半导体层114可作为薄膜晶体管的半导体岛结构。如图2G所示,接着,移除图案化第一光阻层101及第二光阻层102,可例如利用剥离(Strip)方式来移除光阻层101、102。
接着,如图2H所示,形成保护层118于沟道C、源电极116b及漏电极116a上(第三道光掩膜制程),其中保护层118具有至少一接孔118a,以暴露出部分漏电极116a。其中,保护层118可通过等离子体增强化学气相沉积(PECVD)设备来形成。
接着,如图2I所示,可先形成一透光导电层(例如ITO、IZO、AZO、GZO、TCO或ZnO)于保护层118上,接着通过光刻工艺来图案化此透光导电层(第四道光掩膜制程),以形成像素电极层119于保护层118上。由于像素电极层119是覆盖于接孔118a上,因而可利用保护层118的接孔118a来电性连接于漏电极116a,故完成本实施例的薄膜晶体管矩阵基板110。
由上述可知,本发明的薄膜晶体管矩阵基板及显示面板的制造方法仅需四道光掩膜来完成TFT矩阵基板,因而可减少制程所需的光掩膜数,进而减少制程成本及时间。再者,在第二道光掩膜制程中,仅需进行一次湿蚀刻,因而减少湿蚀刻对组件的影响。又,由于本发明的制造方法可使用一般光掩膜来完成,而不需使用多段式调整光掩膜(Multi Tone Mask,MTM),因而大幅降低制程成本。
综上所述,虽然本发明已以优选实施例揭露如上,但上述优选实施例并非用以限制本发明,本领域的普通技术人员,在不脱离本发明的精神和范围内,均可作各种更动与润饰,因此本发明的保护范围以权利要求界定的范围为准。
Claims (10)
1.一种薄膜晶体管矩阵基板的制造方法,其特征在于:所述制造方法包括如下步骤:
形成栅极于透明基材上;
依序形成栅极绝缘层、半导体层、欧姆接触层、电极层及第一光阻层于所述透明基材及所述栅极上;
图案化所述第一光阻层,以形成一沟道,所述沟道是形成于所述栅极的上方;
蚀刻所述欧姆接触层及所述电极层,以移除部分的所述欧姆接触层及部分的所述电极层,并形成源电极及漏电极于所述沟道的相对两侧;
涂布第二光阻层于所述图案化第一光阻层上,以及所述沟道内;
移除所述图案化第一光阻层上的所述第二光阻层,并保留所述沟道内的所述第二光阻层;
蚀刻所述半导体层,以移除部分所述半导体层;
移除所述图案化第一光阻层及所述第二光阻层;
形成保护层于所述沟道、所述源电极及所述漏电极上;以及
形成像素电极层于所述保护层上,其中所述像素电极层是电性连接于所述漏电极。
2.根据权利要求1所述的方法,其特征在于:当蚀刻所述欧姆接触层及所述电极层时,对所述欧姆接触层及所述电极层进行一次湿蚀刻,以移除所述欧姆接触层及所述电极层未被所述图案化第一光阻层遮蔽的部分。
3.根据权利要求1所述的方法,其特征在于:当涂布所述第二光阻层时,利用旋涂法、刮刀涂布法或滚轮涂布来涂布所述第二光阻层。
4.根据权利要求1所述的方法,其特征在于:在涂布所述第二光阻层后,在所述沟道内的所述第二光阻层的厚度是大于在所述图案化第一光阻层上的所述第二光阻层的厚度。
5.根据权利要求1所述的方法,其特征在于:当移除在所述图案化第一光阻层上的所述第二光阻层时,利用加热灰化来移除在所述图案化第一光阻层上的所述第二光阻层。
6.根据权利要求1所述的方法,其特征在于:当蚀刻所述半导体层时,利用所述图案化第一光阻层及在所述沟道内的所述第二光阻层来作为光掩膜,并对所述半导体层进行干蚀刻。
7.根据权利要求1所述的方法,其特征在于:当移除所述图案化第一光阻层及所述第二光阻层时,利用剥离方式来移除所述图案化第一光阻层及所述第二光阻层。
8.一种显示面板的制造方法,其特征在于:所述制造方法包括如下步骤:
形成栅极于透明基材上;
依序形成栅极绝缘层、半导体层、欧姆接触层、电极层及第一光阻层于所述透明基材及所述栅极上;
图案化所述第一光阻层,以形成一沟道,所述沟道是形成于所述栅极的上方;
蚀刻所述欧姆接触层及所述电极层,以移除部分的所述欧姆接触层及部分的所述电极层,并形成源电极及漏电极于所述沟道的相对两侧;
涂布第二光阻层于所述图案化第一光阻层上,以及所述沟道内;
移除所述图案化第一光阻层上的所述第二光阻层,并保留所述沟道内的所述第二光阻层;
蚀刻所述半导体层,以移除部分所述半导体层;
移除所述图案化第一光阻层及所述第二光阻层;
形成保护层于所述沟道、所述源电极及所述漏电极上;以及
形成像素电极层于所述保护层上,其中所述像素电极层是电性连接于所述漏电极,以完成一薄膜晶体管矩阵基板;以及
形成一液晶层于所述薄膜晶体管矩阵基板与彩色滤光片基板之间。
9.根据权利要求8所述的方法,其特征在于:在涂布所述第二光阻层后,在所述沟道内的所述第二光阻层的厚度是大于在所述图案化第一光阻层上的所述第二光阻层的厚度。
10.根据权利要求8所述的方法,其特征在于:当移除在所述图案化第一光阻层上的所述第二光阻层时,利用加热灰化来移除在所述图案化第一光阻层上的所述第二光阻层。
Priority Applications (2)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
CN201110229711.2A CN102254861B (zh) | 2011-08-11 | 2011-08-11 | 薄膜晶体管矩阵基板及显示面板的制造方法 |
PCT/CN2011/080644 WO2013020322A1 (zh) | 2011-08-11 | 2011-10-11 | 薄膜晶体管矩阵基板及显示面板的制造方法 |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
CN201110229711.2A CN102254861B (zh) | 2011-08-11 | 2011-08-11 | 薄膜晶体管矩阵基板及显示面板的制造方法 |
Publications (2)
Publication Number | Publication Date |
---|---|
CN102254861A true CN102254861A (zh) | 2011-11-23 |
CN102254861B CN102254861B (zh) | 2014-01-22 |
Family
ID=44982025
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
CN201110229711.2A Active CN102254861B (zh) | 2011-08-11 | 2011-08-11 | 薄膜晶体管矩阵基板及显示面板的制造方法 |
Country Status (2)
Country | Link |
---|---|
CN (1) | CN102254861B (zh) |
WO (1) | WO2013020322A1 (zh) |
Cited By (4)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
CN104766859A (zh) * | 2015-04-28 | 2015-07-08 | 深圳市华星光电技术有限公司 | Tft基板的制作方法及其结构 |
WO2019223076A1 (zh) * | 2018-05-21 | 2019-11-28 | 深圳市华星光电技术有限公司 | 金属氧化物薄膜晶体管及其制作方法、显示器 |
WO2020000630A1 (zh) * | 2018-06-25 | 2020-01-02 | 深圳市华星光电半导体显示技术有限公司 | 阵列基板及其制作方法、显示面板 |
CN114864603A (zh) * | 2022-05-12 | 2022-08-05 | 北海惠科光电技术有限公司 | 阵列基板及其制备方法、显示面板 |
Families Citing this family (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
CN112838049B (zh) * | 2019-11-25 | 2023-03-28 | 深超光电(深圳)有限公司 | 导电结构的制备方法和薄膜晶体管阵列基板的制备方法 |
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CN101114619A (zh) * | 2007-08-29 | 2008-01-30 | 友达光电股份有限公司 | 薄膜晶体管及其应用的显示元件的制造方法 |
CN101170085A (zh) * | 2006-10-27 | 2008-04-30 | 中华映管股份有限公司 | 薄膜晶体管阵列基板及其制作方法 |
-
2011
- 2011-08-11 CN CN201110229711.2A patent/CN102254861B/zh active Active
- 2011-10-11 WO PCT/CN2011/080644 patent/WO2013020322A1/zh active Application Filing
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US10950716B2 (en) | 2018-05-21 | 2021-03-16 | Shenzhen China Star Optoelectronics Technology Co., Ltd. | Metal oxide TFT, manufacturing method thereof, and display device |
WO2020000630A1 (zh) * | 2018-06-25 | 2020-01-02 | 深圳市华星光电半导体显示技术有限公司 | 阵列基板及其制作方法、显示面板 |
CN114864603A (zh) * | 2022-05-12 | 2022-08-05 | 北海惠科光电技术有限公司 | 阵列基板及其制备方法、显示面板 |
US11948946B2 (en) * | 2022-05-12 | 2024-04-02 | Beihai Hkc Optoelectronics Technology Co., Ltd. | Array substrate, method for manufacturing the same, and display panel |
Also Published As
Publication number | Publication date |
---|---|
CN102254861B (zh) | 2014-01-22 |
WO2013020322A1 (zh) | 2013-02-14 |
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C06 | Publication | ||
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