JPH0286116A - マスクアライメント方法 - Google Patents

マスクアライメント方法

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Publication number
JPH0286116A
JPH0286116A JP63238245A JP23824588A JPH0286116A JP H0286116 A JPH0286116 A JP H0286116A JP 63238245 A JP63238245 A JP 63238245A JP 23824588 A JP23824588 A JP 23824588A JP H0286116 A JPH0286116 A JP H0286116A
Authority
JP
Japan
Prior art keywords
vernier
scale
alignment
substrate
epitaxial layer
Prior art date
Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
Pending
Application number
JP63238245A
Other languages
English (en)
Inventor
Satomi Kajiwara
里美 梶原
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
Fuji Electric Co Ltd
Original Assignee
Fuji Electric Co Ltd
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Filing date
Publication date
Application filed by Fuji Electric Co Ltd filed Critical Fuji Electric Co Ltd
Priority to JP63238245A priority Critical patent/JPH0286116A/ja
Publication of JPH0286116A publication Critical patent/JPH0286116A/ja
Pending legal-status Critical Current

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Landscapes

  • Exposure And Positioning Against Photoresist Photosensitive Materials (AREA)
  • Exposure Of Semiconductors, Excluding Electron Or Ion Beam Exposure (AREA)

Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【発明の詳細な説明】 〔産業上の利用分野〕 本発明は、基板上にエピタキシャル層を成長させたのち
、基板上の所定の位置の直上にエピタキシャル層表面上
の膜などのパターンの所定の位置を合わせるマスクアラ
イメント方法に関する。
〔従来の技術〕
半導体装置の製造のために、半導体基板上にエピタキシ
ャル層を成長させるときシリコンによる結晶成長速度が
面方位により相違するため、エピタキシャル層は基板面
に垂直に成長しない、従って、例えば基板表面に不純物
埋込層を形成すると、エピタキシャル層表面の、その埋
込層に対応するパターンが埋込層の直上に位置しないパ
ターンシフトが生ずる。そのため、例えば埋込層の直上
に素子形成のための不純物の導入を行うことが困難とな
る。パターンシフトの量と方間はエピタキシャル層の成
膜時の温度、速度に太き(依存している。このため、−
触的には、このパターンシフトの量と方向は、エピタキ
シャル層の膜厚、結晶方位から予測し、エピタキシャル
層上の酸化膜のパターン形成のためのフォト工程のマス
クアライメント作業時に、マスクアライナで予測したパ
ターンシフト量だけ顕微鏡を用いての目視で補正してい
る。
〔発明が解決しようとする課題〕
ところが、最近フォト工程のマスクアライメントにレー
ザ光を利用したオートアライメントが用いられるように
なった。しかるに、このオートアライメント時には、レ
ーザ光がレジスト層中を通るときに屈折することによっ
て、「オフセット」と呼ばれるずれ量があり、例えばオ
フセットをXとすると「+方向に7irm」のパターン
シフト補正を行わせて、実際には「+7n±X」のシフ
トが行われ、このXの値が大きい場合やウェハごとにば
らつきがある場合、耐圧不良などの素子特性不良の原因
となるという問題があった。
本発明の課題は、上述のような問題を解決し、パターン
シフト量あるいはそれにオフセットを加えた補正値を予
測でなく実際に検知して、フォトマスクと半導体基板と
の位置を正確に合わせることのできるマスクアライメン
ト方法を提供することにある。
〔課題を解決するための手段〕 上記の課題の解決のために、本発明は、半導体基板上に
設けられた平行な不純物埋込層よりなる目盛りを有する
主尺とフォトマスクに設けられた平行な目盛りを有する
副尺とからなるアライメントバーニヤを用い、主尺の設
けられた基板上にエピタキシャル層を成長させ、フォト
マスクの副尺目盛りの一つを基板の主尺目盛りの一つの
直上に置き、埋込層から成長してエピタキシャル層の表
面に生じた凸部と重なる副尺目盛りを見出して位置合わ
せ時の補正量を検知するものとする。
〔作用〕
フォトマスク上の副尺と主尺である半導体基板の不純物
埋込層の上から平行に成長するエピタキシャル層の表面
に生じた凸部とが重なる位置を見出せば、エピタキシャ
ル層成長時のパターンシフト量が検知でき、フォトレジ
スト膜を通して同様な操作を行えば、パターンシフト量
にフォトレジスト膜における屈折によるオフセットが加
えられた量が検知でき、フォトマスクを半導体基板に対
しその量だけずれた方向に補正してマスクアライメント
を行えば、パターンシフト、またオートアライメントの
際にはオフセットの影響が補償される。
〔実施例〕
第1図(al、(b)は本発明の一実施例に用いるアラ
イメントバーニアを1000倍に拡大して示す、第1図
talにおいては、シリコン基[3に選択拡散により平
行で等しい間隔d、を置いて形成された埋込層が主尺の
目盛り1となる。第1図伽)においてはフォトマスク4
に平行で等しい間隔d8を置いて形成されたパターンが
副尺の目盛り2となる。公知のように主尺の目盛りの間
隔の1/nの分解能でパターンシフトを補正する必要の
ある場合は、主尺のn±1倍の長さをn等分した間隔で
副尺の目盛りを設ければよい0図の例では、主尺1の目
盛り間隔d1を10101l分解能を2μすなわちnM
5と設定したので、副尺2の目盛りは10 X (5+
1)/ 5 = 12からdx−12−の間隔にしであ
る0分解能21mの設定であるから左端の目盛りに01
左から3番目゛に4.5番目の目盛りに8の番号を付け
ておく。
第2図は第1図に示したアライメントバーニアを用いて
の本発明の一実施例でパターンシフト量の検知方法を示
し、シリコン基板3の表面上にエピタキシャル層5を堆
積する。この際、バーニアの主尺目盛り1としての埋込
層の不純物はエピタキシャル層中に広がるが、その上に
堆積するエピタキシャル層は前述により基板面に垂直方
向に成長せず、傾いて成長するため、エピタキシャル層
5の上に生ずる凸部6にはパターンシフトが生じて主尺
目盛り1の直上からiだけずれる。このようにして作成
された主尺目盛りlを内部に有する基体上にフォトマス
ク4を配置する。この際フォトマスク4の縁部はシリコ
ン基板3の縁部の直上に位置するように、換言すれば第
3図に示すように、フォトマスクの左端の副尺目盛り2
が番号0の付された主尺目盛り1の直上に位置するよう
にする必要がある0次いで、光学wA微鏡を用いてフォ
トマスク4上から観察し、凸部6のうちアライメントバ
ーニアの副尺目盛り2の重なるものを見出す、この場合
は4の番号を付した副尺目盛り4が重なっているのでパ
ターンシフト量lが4Jrmであることがわかる。従っ
てフォト工程時にモニタにより得られるこのパターンシ
フト量を補正したマスクアライメントを行えば、エピタ
キシャル層上の所期の位置へのパターン形成ができる。
第4図は別の実施例を示し、エピタキシャル層5上の酸
化膜7を成膜し、その上にフォトレジスト層8を塗布し
、オートアライメントしたフォトマスクを用いてレジス
ト層8の所定の部分を除去したのち、エツチングにより
酸化膜7に開口部を形成する場合である。この場合は、
主尺目盛り1はシリコン基板3の素子に用いられない縁
部に、副尺目盛り2は酸化膜開口部形成のためのフォト
マスク4の縁部に形成しておき、オートアライメントの
際レーザ光により凸部6に重なる副尺目盛り2を見出し
、オフセットを含んだパターンシフト量を検知し、マス
クアライメント位置の補正を自動的に行う。
〔発明の効果〕
本発明によれば、エピタキシャル層堆積前の基板に不純
物埋込層で主尺目盛りを、またフォトマスクに副尺目盛
りを形成することにより、埋込層からのエピタキシャル
層成長により生ずる凸部のパターンシフト量が主尺と副
尺とからなるアライメントバーニアより検知できる。こ
の結果、エピタキシャル成長の方向性に基づくパターン
シフトあるいはさらにレーザ光のフォトレジスト層中で
の屈折に基づくオートアライメント時のオフセントを、
半導体基板ごとのフォト工程時に、モニタあるいは基板
自体に形成したアライメントバーニアにより実際に検知
することによって、埋込層に対応する所期の位置へのフ
ォト工程が正確に実施でき、得られる効果は極めて大き
い。
【図面の簡単な説明】
第1図(al、(blは本発明の一実施例に用いるアラ
イメントバーニアの主尺および副尺を示す平面図、第2
図、第3図は第1図に示したアライメントバーニアを用
いての本発明の一実施例の説明図で、第2図は断面図、
第3図は平面図、第4図は本発明の別の実施例を示す断
面図である。 1:主尺目盛り、2:glff尺目盛り、3:シリコン
基板、4=フオトマスク、5:エピタキシャル第2図 / 4フイトヱスク 第1図 第3図

Claims (1)

    【特許請求の範囲】
  1. 1)半導体基板上に設けられた平行な不純物埋込層より
    なる目盛りを有する主尺とフォトマスクに設けられた平
    行な目盛りを有する副尺とからなるアライメントバーニ
    ヤを用い、主尺の設けられた基板上にエピタキシャル層
    を成長させ、フォトマスクの副尺目盛りの一つを基板の
    主尺目盛りの一つの直上に置き、埋込層から成長してエ
    ピタキシャル層の表面に生じた凸部と重なる副尺目盛り
    を見出して位置合わせ時の補正量を検知することを特徴
    とするマスクアライメント方法。
JP63238245A 1988-09-22 1988-09-22 マスクアライメント方法 Pending JPH0286116A (ja)

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Cited By (2)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP2007311669A (ja) * 2006-05-22 2007-11-29 Toshiba Corp 半導体装置及びその製造方法
WO2022193915A1 (zh) * 2021-03-18 2022-09-22 上海信及光子集成技术有限公司 测量外延前后光刻套刻误差的方法及结构

Citations (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS5147028A (ja) * 1974-10-21 1976-04-22 Fukuda Metal Foil Powder Dodenseitoryo

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