JPH0276025A - プリンタ装置の制御方式 - Google Patents
プリンタ装置の制御方式Info
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- JPH0276025A JPH0276025A JP63229267A JP22926788A JPH0276025A JP H0276025 A JPH0276025 A JP H0276025A JP 63229267 A JP63229267 A JP 63229267A JP 22926788 A JP22926788 A JP 22926788A JP H0276025 A JPH0276025 A JP H0276025A
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- 238000000034 method Methods 0.000 claims description 16
- 238000010586 diagram Methods 0.000 description 5
- 239000013598 vector Substances 0.000 description 4
- 230000000694 effects Effects 0.000 description 1
- 238000000926 separation method Methods 0.000 description 1
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
［産業上の利用分野］
本発明は、プリンタ装置の制御方式に関し、特に、ベク
トル記述された印刷情報の描画を行うプリンタ装置の制
御方式に関する。
トル記述された印刷情報の描画を行うプリンタ装置の制
御方式に関する。
［従来の技術］
従来、この種の描画を行うプリンタ装置の制御方式の一
例が、アドベ システム社のポスト スクリプト ラン
グエツジ リフエレンス マニュアルに記載されている
。このマニュアルによれば、プリンタ装置内の制御部に
おいて、印刷情報をマイクロプロセッサユニット（以下
、’ＭＰＵＪ ）：、。
例が、アドベ システム社のポスト スクリプト ラン
グエツジ リフエレンス マニュアルに記載されている
。このマニュアルによれば、プリンタ装置内の制御部に
おいて、印刷情報をマイクロプロセッサユニット（以下
、’ＭＰＵＪ ）：、。
称す）のインストラクションサイクルをもって逐次解読
と処理を行い、その結果を描画用メモリ（以下、ｒＶＭ
、と称す）へ書込んでいた。
と処理を行い、その結果を描画用メモリ（以下、ｒＶＭ
、と称す）へ書込んでいた。
［発明が解決しようとする課題］
上述した従来のベクトル記述された印刷情報の描画を行
なうプリンタ装置の制御方式は、ＭＰＵのインストラク
ションサイクルにより、情報の解読、その処理、そして
、その結果のＶＭへの書込みを行っているので、グラフ
ィクス等の単位印刷ページ当りの印刷情報が多い場合・
には、処理と書込みの時間もそれに従って増加する。そ
れにより、プリンタ装置としての印刷時間が増加し、１
枚印刷するのに数１０分を要する等のケースもあり、実
用的でないという欠点があった。
なうプリンタ装置の制御方式は、ＭＰＵのインストラク
ションサイクルにより、情報の解読、その処理、そして
、その結果のＶＭへの書込みを行っているので、グラフ
ィクス等の単位印刷ページ当りの印刷情報が多い場合・
には、処理と書込みの時間もそれに従って増加する。そ
れにより、プリンタ装置としての印刷時間が増加し、１
枚印刷するのに数１０分を要する等のケースもあり、実
用的でないという欠点があった。
［課題を解決するための手段］
本発明の目的は、上述した従来技術の欠点を解決し、ベ
クトル記述された印刷情報の解読と処理を効率化し、Ｖ
Ｍへの描画サイクルをＶＭの最少アクセスタイムとする
ことにより、ページ当りの印刷情報か多いグラフィクス
等においても高速印刷できるプリンタ装置の制御方式を
提供することである。
クトル記述された印刷情報の解読と処理を効率化し、Ｖ
Ｍへの描画サイクルをＶＭの最少アクセスタイムとする
ことにより、ページ当りの印刷情報か多いグラフィクス
等においても高速印刷できるプリンタ装置の制御方式を
提供することである。
本発明のベクトル記述印刷情報の描画を行うプリンタ装
置の制御方式は、上記目的を達成するため、印刷情報バ
ッファと、複数の印刷情報レジスタと、複数の算術論理
演算部と、複数のデータ・アドレスレジスタと、描画メ
モリインターフェイスユニットから成るインタプリタと
を含むことを特徴とする。
置の制御方式は、上記目的を達成するため、印刷情報バ
ッファと、複数の印刷情報レジスタと、複数の算術論理
演算部と、複数のデータ・アドレスレジスタと、描画メ
モリインターフェイスユニットから成るインタプリタと
を含むことを特徴とする。
［実施例］
次に、本発明に係るプリンタ装置の制御方式の一実施例
について図面を参照して説明する。
について図面を参照して説明する。
第１図は、本発明に係るプリンタ装置の制御方式の一実
施例の構成図である。
施例の構成図である。
１はプリンタ装置制御部のバス、２は上位装置とのイン
ターフェイス制御部、３は上位装置とのインターフェイ
スラインである。４はＭＰＵ、５はファームウェア（以
下、「Ｆ／Ｗ」と称す）。
ターフェイス制御部、３は上位装置とのインターフェイ
スラインである。４はＭＰＵ、５はファームウェア（以
下、「Ｆ／Ｗ」と称す）。
６はインタプリタ、７は印刷情報バッファである。
８ａ、９ａ、１０ａ及びｌｌａは印刷情報レジスタ、８
ｂ、９ｂ、１０ｂ及びｌｌｂは算術論理演算部（以下、
ｒＡＬＵ」と称す）そして、８ｃ。
ｂ、９ｂ、１０ｂ及びｌｌｂは算術論理演算部（以下、
ｒＡＬＵ」と称す）そして、８ｃ。
９ｃ、及び１０ｃ及びｌｌｃはデータ・アドレスレジス
タである。１２は描画メモリインターフェイス（以下、
ｒＶＭＩＵ、と称す）、１３はＶＭ。
タである。１２は描画メモリインターフェイス（以下、
ｒＶＭＩＵ、と称す）、１３はＶＭ。
１４はプリンタ駆動部である。
第２図（Ａ）及び（８）は、印刷結果の実例の平面図で
ある。
ある。
また、第３図（Ａ＞及び（Ｂ）は、第２図（Ａ）及び（
Ｂ）の図形を描くためのベクトル記述印刷情報を示すプ
ログラムである。
Ｂ）の図形を描くためのベクトル記述印刷情報を示すプ
ログラムである。
図において、ｘｌ’ ３／ｉは１５の、Ｘ２ ・３／２
は１６の、Ｘｌ・ｙ、は１７の、そして、Ｘ６・ｙ６は
１８の位置の座標を示す、また、ル・ｈとＸ、・舅は、
１７から１８までの三次元曲線を描くための座標を示す
。
は１６の、Ｘｌ・ｙ、は１７の、そして、Ｘ６・ｙ６は
１８の位置の座標を示す、また、ル・ｈとＸ、・舅は、
１７から１８までの三次元曲線を描くための座標を示す
。
ｘ７’ ｙ７は１９の、Ｘｉ ・３’３は２０の、そし
て、Ｘｓ・ｙ、は２１の位置の座標を示す、他のアルフ
ァベットはインタプリタ６により解読、実行されるオペ
レータである。
て、Ｘｓ・ｙ、は２１の位置の座標を示す、他のアルフ
ァベットはインタプリタ６により解読、実行されるオペ
レータである。
これらの印刷情報は、上位装置よりインター７エイスラ
イン３を通してインターフェイス制御部２へ送られ、Ｍ
ＰＵ４とＦ／Ｗ５により印字情報バッファ７へ記憶され
る。ＭＰＵ４とＦ／Ｗ５により、印字情報の最初の処理
単位の’ＸＩ”Ａｍｏｖｅｔｏ」と’Ｘｘ・ｙ２１ｉｎ
ｅｔｏＪが印刷情報レジスタ８ａへ記憶される。これを
ＡＬＵ８ｂが解読と処理を行ない、その結果のデータと
アドレスをデータ・アドレスレジスタ８ｃへ記憶し、さ
らに、ＶＭＩＵ１２を通じてＶＭ１３に送り描画（メモ
リ書込）を行う、描画は１ペ一ジ分の描画が完了するま
で続けられる 第４図（Ａ）及び（Ｂ）を用いて、印刷情報の解読から
描画までの様子を説明する。
イン３を通してインターフェイス制御部２へ送られ、Ｍ
ＰＵ４とＦ／Ｗ５により印字情報バッファ７へ記憶され
る。ＭＰＵ４とＦ／Ｗ５により、印字情報の最初の処理
単位の’ＸＩ”Ａｍｏｖｅｔｏ」と’Ｘｘ・ｙ２１ｉｎ
ｅｔｏＪが印刷情報レジスタ８ａへ記憶される。これを
ＡＬＵ８ｂが解読と処理を行ない、その結果のデータと
アドレスをデータ・アドレスレジスタ８ｃへ記憶し、さ
らに、ＶＭＩＵ１２を通じてＶＭ１３に送り描画（メモ
リ書込）を行う、描画は１ペ一ジ分の描画が完了するま
で続けられる 第４図（Ａ）及び（Ｂ）を用いて、印刷情報の解読から
描画までの様子を説明する。
２２から４２までは、ＶＭ１３の空間において描画され
たアドレスの一部を図式化して示したものである。４３
は描画されるアドレスの列を図式化して点線で示したも
のである。
たアドレスの一部を図式化して示したものである。４３
は描画されるアドレスの列を図式化して点線で示したも
のである。
最初の印刷情報’ｘｌ・３Ａ ｍｏｖｅｔｏ」と’Ｘ
ｚ、ｙ２１ｉｎｅｔＯＪをＡＬＵ８ａが受けると、Ｘｓ
・兄から冷・ｙ２までの直線を描画すべくアドレスとデ
ータ（この場合１．白黒反転描画の場は０）を次々と発
生する。まず、Ｘ＋ ’ ｙ、よりＶＭアドレス２２を
発生し、次に絢・ｙ、よりＶＭアドレス２５までの描画
上の直線アドレスを２３．２４のように発生し、それを
データ・アドレスレジスタ８ｃへ記憶し、さらに、ＶＭ
ＩＵ１２を通じてＶＭ１３へ送り描画を行う。
ｚ、ｙ２１ｉｎｅｔＯＪをＡＬＵ８ａが受けると、Ｘｓ
・兄から冷・ｙ２までの直線を描画すべくアドレスとデ
ータ（この場合１．白黒反転描画の場は０）を次々と発
生する。まず、Ｘ＋ ’ ｙ、よりＶＭアドレス２２を
発生し、次に絢・ｙ、よりＶＭアドレス２５までの描画
上の直線アドレスを２３．２４のように発生し、それを
データ・アドレスレジスタ８ｃへ記憶し、さらに、ＶＭ
ＩＵ１２を通じてＶＭ１３へ送り描画を行う。
これにより、第２図（Ａ）の１５から１６までの直線（
この場合１ドツトライン）を描画する。
この場合１ドツトライン）を描画する。
一方、ＭＰＵ４とＦ／Ｗ５により２番目の印刷情報’
Ｘ２ ’ ３１０ Ｊと’Ｘ３・ｙｔ ｌ１ｎｅｔｏ
」が印刷情報レジスタ９ａへ記憶され、ＡＬＵ９ｂがＸ
。
Ｘ２ ’ ３１０ Ｊと’Ｘ３・ｙｔ ｌ１ｎｅｔｏ
」が印刷情報レジスタ９ａへ記憶され、ＡＬＵ９ｂがＸ
。
・ｈよりＶＭアドレス２５１次に２６．２７のようにＸ
３・ｙ３の２８まで発生し、それを、データ・アドレス
レジスタ９Ｃへ記憶し、さらに、ＶＭｊＵ１２を通じて
Ｖ Ｍ １’ ３へ送り描画する。よって第２図（Ａ＞
の１６から１７まで描画される。
３・ｙ３の２８まで発生し、それを、データ・アドレス
レジスタ９Ｃへ記憶し、さらに、ＶＭｊＵ１２を通じて
Ｖ Ｍ １’ ３へ送り描画する。よって第２図（Ａ＞
の１６から１７まで描画される。
またＭＰＵ４とＦ／Ｗ５により、３番目の印刷情報「Ｘ
、・ｙ３ Ｊと「冷・ｙ４、Ｘｉ・ｙ２、冷・ＹｅＣｕ
ｒｖｅｔｏ」が印刷情報レジスタ１０ａへ記憶され、Ａ
ＬＵｌｏｂがＸｉ ’ Ｙ３よりＶＭアドレス２８、次
に２９．３０のように冷・ｙ６の３１まで三次元曲線ア
ドレスを発生し、それを、データ・アドレスレジスタ１
０ｃへ記憶し、さらにＶＭＩＵ１２を通じてＶＭ１３へ
送り描画する。このようにして、第２図（Ａ）１７から
１８まで描画される。
、・ｙ３ Ｊと「冷・ｙ４、Ｘｉ・ｙ２、冷・ＹｅＣｕ
ｒｖｅｔｏ」が印刷情報レジスタ１０ａへ記憶され、Ａ
ＬＵｌｏｂがＸｉ ’ Ｙ３よりＶＭアドレス２８、次
に２９．３０のように冷・ｙ６の３１まで三次元曲線ア
ドレスを発生し、それを、データ・アドレスレジスタ１
０ｃへ記憶し、さらにＶＭＩＵ１２を通じてＶＭ１３へ
送り描画する。このようにして、第２図（Ａ）１７から
１８まで描画される。
ＭＰＵ４とＦ／Ｗ５により４番目の印７］・情報「Ｘｓ
・ｙ６Ｊとｒｃ Ｉ ｏｓｅｐａｔｈ」か印刷情報レ
ジスタｌｌａへ記憶され、ＡＬＵｌｌｂか冷・ｙ６より
ＶＭアドレス３１１次に、３２．３３のようにＸ＋ ”
Ａの２２までの直線のアドレスを発生し、それを、デー
タ・アドレスレジスタｌｌｃへ記憶し、さらに、ＶＭＩ
Ｕ１２を通じてＶＭ１３へ送り描画する。このようにし
て、第２図（Ａ）の１８から１５まで描画し、第２図（
Ａ＞の図形の描画を完了する。
・ｙ６Ｊとｒｃ Ｉ ｏｓｅｐａｔｈ」か印刷情報レ
ジスタｌｌａへ記憶され、ＡＬＵｌｌｂか冷・ｙ６より
ＶＭアドレス３１１次に、３２．３３のようにＸ＋ ”
Ａの２２までの直線のアドレスを発生し、それを、デー
タ・アドレスレジスタｌｌｃへ記憶し、さらに、ＶＭＩ
Ｕ１２を通じてＶＭ１３へ送り描画する。このようにし
て、第２図（Ａ）の１８から１５まで描画し、第２図（
Ａ＞の図形の描画を完了する。
印刷情報の解読と処理を最初に終了したＡＬＵ８ｂは印
刷情報レジスタ８ａを空、にする０次に、ＭＰＵ４とＦ
／Ｗ５により、印刷情報バッファ７から５番目の印刷情
報’ Ｘ７・ｙＶ ｍ ｏ ｖ ｅ ｔ ｏ Ｊと「
拘・ｙ、 １ｉｎｅｔｏ」が印刷情報レジスタ８ａへ
記憶され、同様の解読と処理を行って、第４図（Ａ）の
３４．３５．３６から３７まテｖＭアドレスを発生し、
第２図（Ｂ）の１９から２０まで描画する。
刷情報レジスタ８ａを空、にする０次に、ＭＰＵ４とＦ
／Ｗ５により、印刷情報バッファ７から５番目の印刷情
報’ Ｘ７・ｙＶ ｍ ｏ ｖ ｅ ｔ ｏ Ｊと「
拘・ｙ、 １ｉｎｅｔｏ」が印刷情報レジスタ８ａへ
記憶され、同様の解読と処理を行って、第４図（Ａ）の
３４．３５．３６から３７まテｖＭアドレスを発生し、
第２図（Ｂ）の１９から２０まで描画する。
このように、次々と空になった印刷情報レジスタへ印刷
情報を記憶し、同様の描画を行って第２図（Ｂ）の図形
の描画を完了する。
情報を記憶し、同様の描画を行って第２図（Ｂ）の図形
の描画を完了する。
また、描画（すなわちＶＭ１３へ書込み）は、ＶＭＩＵ
１２がデータ・アドレスレジスタ８ｃ→９Ｃ→１０ｃ→
ｌｌｃの順序で行い、この切替の周期はＶＭ１３の最小
アクセスタイムをもって行う。
１２がデータ・アドレスレジスタ８ｃ→９Ｃ→１０ｃ→
ｌｌｃの順序で行い、この切替の周期はＶＭ１３の最小
アクセスタイムをもって行う。
上位装置よりページの区切の情報が送られると、ＭＰＵ
４とＦ／Ｗ５がこれを検出する。さらに、１ペ一ジ分全
ての描画完了を印刷情報レジスタから検知すると、ＶＭ
１３の描画データが、グリンタエンジン部１４へ送られ
、印刷を行う。
４とＦ／Ｗ５がこれを検出する。さらに、１ペ一ジ分全
ての描画完了を印刷情報レジスタから検知すると、ＶＭ
１３の描画データが、グリンタエンジン部１４へ送られ
、印刷を行う。
第５図は、インタプリタの処理サイクルとＶＭへの書込
サイクルのタイミングを示したものである０図中、４４
はＡＬＵ８ｂからデータ・アドレスレジスタ８ｃヘデー
タとアドレスがセットされたことを示し、４５はこのセ
ットされた内容がＶＭＩＵ１２を通じてＶＭ１３へ送ら
れ、リセットされたことを示す、４６．４７はデータ・
アドレスレジスタ９ｃのセットとリセット、４８．４９
はデータ・アドレスレジスタ１０ｃのセットとリセット
、５０．５１はデータ・アドレスレジスタ１１ｃのセッ
トとリセット、５２はデータ・アドレスレジスタ８ｃの
内容をＶＭ１３へ送るタイミング、５３はデータ・アド
レスレジスタ９ｃの内容をＶＭ１３へ送るタイミング、
５４はデータ・アドレスレジスタ１０ｃの内容をＶＭ１
３へ送るタイミング、５５はデータ・アドレスレジスタ
１１ｃの内容をＶＭ１３へ送るタイミングを示す。
サイクルのタイミングを示したものである０図中、４４
はＡＬＵ８ｂからデータ・アドレスレジスタ８ｃヘデー
タとアドレスがセットされたことを示し、４５はこのセ
ットされた内容がＶＭＩＵ１２を通じてＶＭ１３へ送ら
れ、リセットされたことを示す、４６．４７はデータ・
アドレスレジスタ９ｃのセットとリセット、４８．４９
はデータ・アドレスレジスタ１０ｃのセットとリセット
、５０．５１はデータ・アドレスレジスタ１１ｃのセッ
トとリセット、５２はデータ・アドレスレジスタ８ｃの
内容をＶＭ１３へ送るタイミング、５３はデータ・アド
レスレジスタ９ｃの内容をＶＭ１３へ送るタイミング、
５４はデータ・アドレスレジスタ１０ｃの内容をＶＭ１
３へ送るタイミング、５５はデータ・アドレスレジスタ
１１ｃの内容をＶＭ１３へ送るタイミングを示す。
セットされたデータ・アドレスレジスタ８ｃは、タイミ
ング５２にてＶＭ１３へ内容を送るとりセツトされる。
ング５２にてＶＭ１３へ内容を送るとりセツトされる。
同様に、データ・アドレスレジスタ９Ｃはタイミング５
３にて、データ・アドレスレジスタ１０ｃはタイミング
５４にて、データ・アドレスレジスタｌｌｃはタイミン
グ５５にてＶＭ１３へ内容を送ると、それぞれリセット
される。
３にて、データ・アドレスレジスタ１０ｃはタイミング
５４にて、データ・アドレスレジスタｌｌｃはタイミン
グ５５にてＶＭ１３へ内容を送ると、それぞれリセット
される。
ＶＭ１３へ送るタイミング５２．５３，５４．５５の周
期は、ＶＭの最小アクセスタイムである。
期は、ＶＭの最小アクセスタイムである。
「発明の効果〕
以上説明したように本発明は、プリンタ装置の制御部に
おいて、印刷情報バッファと、複数の印刷情報レジスタ
と、複数のＡＬＵと、複数のデータ・アドレスレジスタ
と、ＶＭＩＵから成るインタプリタを有することにより
、ベクトル記述された印刷情報の解読と処理を効率化し
、ＶＭへの描画サイクルをＶＭの最小アクセスタイムと
することにより、ページ当りの印刷情報が多いグラフィ
クス等においても高速印刷できる効果がある。
おいて、印刷情報バッファと、複数の印刷情報レジスタ
と、複数のＡＬＵと、複数のデータ・アドレスレジスタ
と、ＶＭＩＵから成るインタプリタを有することにより
、ベクトル記述された印刷情報の解読と処理を効率化し
、ＶＭへの描画サイクルをＶＭの最小アクセスタイムと
することにより、ページ当りの印刷情報が多いグラフィ
クス等においても高速印刷できる効果がある。
第１図は、本発明に係るプリンタ装置の制御方式の一実
施例の構成図である。 第２図（Ａ）及び（Ｂ）は、印刷結果の実例の平面図で
ある。 第３図（Ａ＞及び（Ｂ）は、第２図（Ａ）及び（Ｂ）の
図形を描くためのベクトル記述印刷情報のプログラムを
示す図である。 第４図（Ａ）及び（Ｂ）はＶＭ全空間アドレスを図式化
して示した説明図である。そして、第５図は、インタプ
リタの処理サイクルとＶＭへの書込みサイクルのタイミ
ングを示す図である。 １・・・プリンタ装置制御部のバス ２・・・インターフェイス制御部 ４・・・ＭＰＵ ５．Ｆ／Ｗ６・・・イン
タプリタ １３・・・ＶＭ１４・・・プリンタエンジ
ン部
施例の構成図である。 第２図（Ａ）及び（Ｂ）は、印刷結果の実例の平面図で
ある。 第３図（Ａ＞及び（Ｂ）は、第２図（Ａ）及び（Ｂ）の
図形を描くためのベクトル記述印刷情報のプログラムを
示す図である。 第４図（Ａ）及び（Ｂ）はＶＭ全空間アドレスを図式化
して示した説明図である。そして、第５図は、インタプ
リタの処理サイクルとＶＭへの書込みサイクルのタイミ
ングを示す図である。 １・・・プリンタ装置制御部のバス ２・・・インターフェイス制御部 ４・・・ＭＰＵ ５．Ｆ／Ｗ６・・・イン
タプリタ １３・・・ＶＭ１４・・・プリンタエンジ
ン部
Claims (1)
- 印刷情報バッファと、複数の印刷情報レジスタと、複数
の算術論理演算部と、複数のデータ・アドレスレジスタ
と、描画メモリインターフェイスユニットから成るイン
タプリタとを含むことを特徴とするベクトル記述印刷情
報の描画を行うプリンタ装置の制御方式。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP63229267A JPH0276025A (ja) | 1988-09-13 | 1988-09-13 | プリンタ装置の制御方式 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP63229267A JPH0276025A (ja) | 1988-09-13 | 1988-09-13 | プリンタ装置の制御方式 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH0276025A true JPH0276025A (ja) | 1990-03-15 |
Family
ID=16889435
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP63229267A Pending JPH0276025A (ja) | 1988-09-13 | 1988-09-13 | プリンタ装置の制御方式 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH0276025A (ja) |
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US5776860A (en) * | 1993-02-26 | 1998-07-07 | Nippon Zeon Co., Ltd. | Plant growth promoter |
| JP2003237149A (ja) * | 2002-02-22 | 2003-08-27 | Canon Inc | 描画処理装置および描画処理方法およびコンピュータが読み取り可能な記憶媒体およびプログラム |
-
1988
- 1988-09-13 JP JP63229267A patent/JPH0276025A/ja active Pending
Cited By (3)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US5776860A (en) * | 1993-02-26 | 1998-07-07 | Nippon Zeon Co., Ltd. | Plant growth promoter |
| JP2003237149A (ja) * | 2002-02-22 | 2003-08-27 | Canon Inc | 描画処理装置および描画処理方法およびコンピュータが読み取り可能な記憶媒体およびプログラム |
| JP4695815B2 (ja) * | 2002-02-22 | 2011-06-08 | キヤノン株式会社 | 描画処理装置および描画処理方法およびコンピュータが読み取り可能な記憶媒体およびプログラム |
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