JPH0238601U - - Google Patents

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JPH0238601U
JPH0238601U JP11765588U JP11765588U JPH0238601U JP H0238601 U JPH0238601 U JP H0238601U JP 11765588 U JP11765588 U JP 11765588U JP 11765588 U JP11765588 U JP 11765588U JP H0238601 U JPH0238601 U JP H0238601U
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majority
circuit
systems
flip
synchronization signals
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JP11765588U
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  • Safety Devices In Control Systems (AREA)
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Description

【図面の簡単な説明】
第1図はこの考案による多数決同期制御回路の
一実施例を示す図、第2図は従来の多数決同規制
御回路の例を示す図、第3図は第1図を説明する
ためのタイミング図である。3aは第1の選択回
路、3bは第2の選択回路、3cは第3の選択回
路、3は多数決回路、5はAND回路、5aは第
1のフリツプフロツプ、5bは第2のフリツプフ
ロツプ、5cは第3のフリツプフロツプである。
尚、図中同一符号は同一又は相当部分を示す。

Claims (1)

    【実用新案登録請求の範囲】
  1. 並列同期動作を目的とする3系統の外部回路a
    ,b,c及びdよりそれぞれ出力される同期信号
    a,dを選択する第1の選択回路、同期信号b,
    dを選択する第2の選択回路、同様に同期信号c
    ,dを選択する第3の選択回路、前記選択回路に
    より選択された3系統の同期信号が与えられる多
    数決回路、同様に3系統の同期信号が入力される
    AND回路、前記多数決回路で2out ot
    3の多数決演算の結果より多数決エラーの発生し
    た系統を記憶する第1、第2及び第3のフリツプ
    フロツプ、前記第1、第2及び第3のフリツプフ
    ロツプの出力により、多数決エラーの発生した系
    統を除いた3系統で多数決を行うことを特徴とす
    る多数決同期制御回路。
JP11765588U 1988-09-07 1988-09-07 Pending JPH0238601U (ja)

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JP11765588U JPH0238601U (ja) 1988-09-07 1988-09-07

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JPH0238601U true JPH0238601U (ja) 1990-03-14

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ID=31361302

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