JPH02128440U - - Google Patents

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JPH02128440U
JPH02128440U JP3690989U JP3690989U JPH02128440U JP H02128440 U JPH02128440 U JP H02128440U JP 3690989 U JP3690989 U JP 3690989U JP 3690989 U JP3690989 U JP 3690989U JP H02128440 U JPH02128440 U JP H02128440U
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majority
circuit
output
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selection circuit
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Description

【図面の簡単な説明】
第1図はこの考案による多数決同期制御回路の
一実施例を示す図、第2図は従来の多数決同期制
御回路の例を示す図、第3図は第1図を説明する
ためのタイミング図である。2……多数決回路、
8……プライオリテイエンコーダ、4……第1の
選択回路、5……第2の選択回路である。尚、図
中同一符号は同一又は相当部分を示す。
補正 平1.7.14 図面の簡単な説明を次のように補正する。 明細書第6頁第19行目を次のように補正する
。「ためのタイミング図、第4図は第2図に示す
ものを説明するためのタイミング図である。2…
…多数決回路、8」。

Claims (1)

    【実用新案登録請求の範囲】
  1. 並列同期動作を目的とする3系統の外部回路a
    ,b及びcよりそれぞれ出力される同期信号a,
    b及びc、前記同期信号が与えられる多数決回路
    、前記多数決回路で2 out of 3の多数
    決演算の結果より多数決エラーの発生した系統を
    エンコードするプライオリテイエンコーダ、前記
    プライオリテイエンコーダの出力信号により多数
    決エラーの発生した系統を除く2系統から1系統
    を選択する第1の選択回路、前記多数決回路の出
    力と第1の選択回路の出力を多数エラー信号によ
    り切り替える第2の選択回路を備えた多数決同期
    制御回路。
JP3690989U 1989-03-30 1989-03-30 Pending JPH02128440U (ja)

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JP3690989U JPH02128440U (ja) 1989-03-30 1989-03-30

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JPH02128440U true JPH02128440U (ja) 1990-10-23

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