JPH0234110B2 - - Google Patents
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- Publication number
- JPH0234110B2 JPH0234110B2 JP56075233A JP7523381A JPH0234110B2 JP H0234110 B2 JPH0234110 B2 JP H0234110B2 JP 56075233 A JP56075233 A JP 56075233A JP 7523381 A JP7523381 A JP 7523381A JP H0234110 B2 JPH0234110 B2 JP H0234110B2
- Authority
- JP
- Japan
- Prior art keywords
- output
- circuit
- flip
- flop
- signal
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Expired - Lifetime
Links
- 238000001514 detection method Methods 0.000 claims description 5
- 230000001934 delay Effects 0.000 claims 1
- 230000000630 rising effect Effects 0.000 claims 1
- 238000010586 diagram Methods 0.000 description 2
- 239000003990 capacitor Substances 0.000 description 1
- 238000007796 conventional method Methods 0.000 description 1
Classifications
-
- G—PHYSICS
- G11—INFORMATION STORAGE
- G11B—INFORMATION STORAGE BASED ON RELATIVE MOVEMENT BETWEEN RECORD CARRIER AND TRANSDUCER
- G11B20/00—Signal processing not specific to the method of recording or reproducing; Circuits therefor
- G11B20/22—Signal processing not specific to the method of recording or reproducing; Circuits therefor for reducing distortions
Landscapes
- Engineering & Computer Science (AREA)
- Signal Processing (AREA)
- Signal Processing For Digital Recording And Reproducing (AREA)
Description
【発明の詳細な説明】
本発明は雑音の重畳した信号から情報信号を取
り出すための信号検出回路に関するものであり、
特に実質的な信号対雑音比の向上を図ることを目
的とするものである。
り出すための信号検出回路に関するものであり、
特に実質的な信号対雑音比の向上を図ることを目
的とするものである。
一般に、デイジタル情報記録再生において、デ
イジタル２進信号を情報記録媒体に記録し読み出
す場合、通常この読出出力はコンパレータに入力
され２進符号に復号されるが、読出出力としては
信号にノイズが重畳されて得られるため、重畳し
たノイズによつて符号誤りが発生する。この誤り
は誤り訂正符号によつて訂正および補正が可能で
あるが、ノイズの性質あるいは信号の規則性を使
つた訂正もある程度有効な場合がある。第１図に
従来例を示す。第１図において、記録媒体として
の磁気テープ１に記録された情報信号はその記録
媒体に摺動するヘツド２により再生され、そのヘ
ツド２の出力は増巾器３によつて増巾した後にコ
ンパレータ４，５に入力され２進符号に復号され
る。この符号をインバータ６、OR論理回路７、
インバータ８，９より成る論理回路へ入力し、コ
ンデンサ１０によつてスパイク状のノイズを吸収
する。第２図に第１図の回路のタイミングチヤー
トを示す。ａは増巾器３の出力であり、ｂ，ｃは
それぞれコンパレータ４，５の出力、ｄはOR論
理回路７の出力、ｅはインバータ８の出力で、ス
パイクパルスのルが抑圧されている。ｆはインバ
ータ９の出力で、スパイクパルスは除去されてい
るが巾の大きいノイズは除去されていない。この
ように従来の様な方法では雑音の除去に限界があ
り、信号対雑音比の悪いあるいは低い周波数成分
のノイズを多く含む読み出し出力に対しては有効
に動作しにくいという問題があつた。
イジタル２進信号を情報記録媒体に記録し読み出
す場合、通常この読出出力はコンパレータに入力
され２進符号に復号されるが、読出出力としては
信号にノイズが重畳されて得られるため、重畳し
たノイズによつて符号誤りが発生する。この誤り
は誤り訂正符号によつて訂正および補正が可能で
あるが、ノイズの性質あるいは信号の規則性を使
つた訂正もある程度有効な場合がある。第１図に
従来例を示す。第１図において、記録媒体として
の磁気テープ１に記録された情報信号はその記録
媒体に摺動するヘツド２により再生され、そのヘ
ツド２の出力は増巾器３によつて増巾した後にコ
ンパレータ４，５に入力され２進符号に復号され
る。この符号をインバータ６、OR論理回路７、
インバータ８，９より成る論理回路へ入力し、コ
ンデンサ１０によつてスパイク状のノイズを吸収
する。第２図に第１図の回路のタイミングチヤー
トを示す。ａは増巾器３の出力であり、ｂ，ｃは
それぞれコンパレータ４，５の出力、ｄはOR論
理回路７の出力、ｅはインバータ８の出力で、ス
パイクパルスのルが抑圧されている。ｆはインバ
ータ９の出力で、スパイクパルスは除去されてい
るが巾の大きいノイズは除去されていない。この
ように従来の様な方法では雑音の除去に限界があ
り、信号対雑音比の悪いあるいは低い周波数成分
のノイズを多く含む読み出し出力に対しては有効
に動作しにくいという問題があつた。
本発明はこのような従来の欠点を解消するもの
であり、特に信号に問題となるノイズが含まれて
いる２進信号の記録読み出し出力から信号の検出
を行なうためになされたもので、２進復号された
記録読み出し出力の信号処理を行なうことによつ
て信号のみを取り出そうとするものである。
であり、特に信号に問題となるノイズが含まれて
いる２進信号の記録読み出し出力から信号の検出
を行なうためになされたもので、２進復号された
記録読み出し出力の信号処理を行なうことによつ
て信号のみを取り出そうとするものである。
以下、本発明について実施例の図面と共に説明
する。第３図は本発明の実施例を示しており、第
３図は本発明の実施例を示しており、第３図にお
いて、１は記録媒体、２はヘツド、３は増幅器、
４，５はコンパレータ、６はインバータ、７は
OR論理回路、２０はクロツク入力端子、２１は
出力端子、２２はＤ−フリツプフロツプ、２３，
２４は８ビツトシフトレジスタ、２５はウオレス
ツリー回路、２６はデジタル比較器、２７は
NOR論理回路、２８はAND論理回路である。ま
た第４図にこのタイミングチヤートを示す。記録
媒体１からヘツド２により再生された第４図ａに
示される信号は増幅器３により増幅されて、コン
パレータ４，５により記録信号のパルスのエツジ
に相当する第４図ｂ，ｃに示される信号が抽出さ
れる。第４図ｃの波形はインバータ６により反転
され、第４図ｂの波形とOR論理回路７により合
成されてＤ−フリツプフロツプ２２に入力され
る。クロツク入力端子２０には第４図ｔに示され
るクロツクが印加される。この入力信号はクロツ
クによつてＤフリツプフロツプ２２においてサン
プルされ、そのＱ端子に第４図ｄに示す出力を発
生する。またＤフリツプフロツプ２２のＱ出力は
同じクロツクによつてシフトレジスタ２３，２４
で次々にシフトしていき、第４図ｅ〜ｍの出力を
発生する。この時ウオレスツリー２５はシフトレ
シスタ２３の出力端子に出力される“１”の数を
合計して第４図ｎ〜ｐを出力する。また、ウオレ
スツリー２５の出力はデイジタルコンパレータ２
６に接続され“１”の数が３個以上の時、第４図
ｑに示すＡ＞Ｂの判定出力を発生する。この判定
基準とは別にＤフリツプフロツプ２２の出力と第
４図ｍに示すシフトレジスタ２４の出力がともに
“０”であるかどうかをNOR論理回路２７で判定
し、デイジタルコンパレータ２６の先の結果との
ANDをAND論理回路２８によつて取つて第４図
ｓに示す出力を得る。このAND論理回路２８の
出力ではスパイク状のノイズが完全に除去されて
いることがわかる。
する。第３図は本発明の実施例を示しており、第
３図は本発明の実施例を示しており、第３図にお
いて、１は記録媒体、２はヘツド、３は増幅器、
４，５はコンパレータ、６はインバータ、７は
OR論理回路、２０はクロツク入力端子、２１は
出力端子、２２はＤ−フリツプフロツプ、２３，
２４は８ビツトシフトレジスタ、２５はウオレス
ツリー回路、２６はデジタル比較器、２７は
NOR論理回路、２８はAND論理回路である。ま
た第４図にこのタイミングチヤートを示す。記録
媒体１からヘツド２により再生された第４図ａに
示される信号は増幅器３により増幅されて、コン
パレータ４，５により記録信号のパルスのエツジ
に相当する第４図ｂ，ｃに示される信号が抽出さ
れる。第４図ｃの波形はインバータ６により反転
され、第４図ｂの波形とOR論理回路７により合
成されてＤ−フリツプフロツプ２２に入力され
る。クロツク入力端子２０には第４図ｔに示され
るクロツクが印加される。この入力信号はクロツ
クによつてＤフリツプフロツプ２２においてサン
プルされ、そのＱ端子に第４図ｄに示す出力を発
生する。またＤフリツプフロツプ２２のＱ出力は
同じクロツクによつてシフトレジスタ２３，２４
で次々にシフトしていき、第４図ｅ〜ｍの出力を
発生する。この時ウオレスツリー２５はシフトレ
シスタ２３の出力端子に出力される“１”の数を
合計して第４図ｎ〜ｐを出力する。また、ウオレ
スツリー２５の出力はデイジタルコンパレータ２
６に接続され“１”の数が３個以上の時、第４図
ｑに示すＡ＞Ｂの判定出力を発生する。この判定
基準とは別にＤフリツプフロツプ２２の出力と第
４図ｍに示すシフトレジスタ２４の出力がともに
“０”であるかどうかをNOR論理回路２７で判定
し、デイジタルコンパレータ２６の先の結果との
ANDをAND論理回路２８によつて取つて第４図
ｓに示す出力を得る。このAND論理回路２８の
出力ではスパイク状のノイズが完全に除去されて
いることがわかる。
以上のように本発明では、デイジタル情報記録
再生によつて２進記録読み出し信号に雑音が重畳
して正確な信号検出がむずかしい場合でも信号の
実質的な信号対雑音比を改善することができる利
点を有するものである。
再生によつて２進記録読み出し信号に雑音が重畳
して正確な信号検出がむずかしい場合でも信号の
実質的な信号対雑音比を改善することができる利
点を有するものである。
第１図は従来の方式による信号検出装置の回路
図、第２図はそのタイミングチヤート、第３図は
本発明による一実施例を示す信号検出回路の回路
図、第４図はそのタイミングチヤートである。 ２２……Ｄフリツプフロツプ、２３，２４……
シフトレジスタ、２５……ウオレスツリー、２６
……デイジタル比較器、２７……NOR論理回路、
２８……AND論理回路。
図、第２図はそのタイミングチヤート、第３図は
本発明による一実施例を示す信号検出回路の回路
図、第４図はそのタイミングチヤートである。 ２２……Ｄフリツプフロツプ、２３，２４……
シフトレジスタ、２５……ウオレスツリー、２６
……デイジタル比較器、２７……NOR論理回路、
２８……AND論理回路。
Claims (1)
- １ 記録波形パルスの立上がりおよび立下がりエ
ツジを検出するためのスレツシヨルドレベルの異
なる２系統のコンパレータと、上記コンパレータ
のうちの一方の出力を反転させるインバータと、
上記コンパレータのうちの他方の出力と前記イン
バータの出力の論理和をとるOR回路と、前記
OR回路の出力を遅延させるＤ−フリツプフロツ
プと、前記Ｄ−フリツプフロツプの出力を順次シ
フトさせる多段シフトレジスタと、前記Ｄ−フリ
ツプフロツプと多段シフトレジスタのためのクロ
ツク供給手段と、前記多段シフトレジスタの出力
の１の数の和を計数する計数回路と、前記計数回
路による計数結果をあらかじめ別に設定しておい
た基準値と比較する比較回路と、前記Ｄ−フリツ
プフロツプ出力と多段シフトレジスタの適当な出
力のNORをとるNOR回路と、前記NOR回路出
力と比較回路出力のANDをとるAND回路とによ
り、再生パルスの立上がりおよび立下がりのノイ
ズをとることを特徴とする信号検出回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP56075233A JPS57189315A (en) | 1981-05-18 | 1981-05-18 | Signal detecting circuit |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP56075233A JPS57189315A (en) | 1981-05-18 | 1981-05-18 | Signal detecting circuit |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS57189315A JPS57189315A (en) | 1982-11-20 |
| JPH0234110B2 true JPH0234110B2 (ja) | 1990-08-01 |
Family
ID=13570290
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP56075233A Granted JPS57189315A (en) | 1981-05-18 | 1981-05-18 | Signal detecting circuit |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS57189315A (ja) |
Citations (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS5535463U (ja) * | 1978-08-29 | 1980-03-07 |
-
1981
- 1981-05-18 JP JP56075233A patent/JPS57189315A/ja active Granted
Patent Citations (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS5535463U (ja) * | 1978-08-29 | 1980-03-07 |
Also Published As
| Publication number | Publication date |
|---|---|
| JPS57189315A (en) | 1982-11-20 |
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