JPH0226081A - 光半導体集積回路素子の封止構造 - Google Patents

光半導体集積回路素子の封止構造

Info

Publication number
JPH0226081A
JPH0226081A JP63176408A JP17640888A JPH0226081A JP H0226081 A JPH0226081 A JP H0226081A JP 63176408 A JP63176408 A JP 63176408A JP 17640888 A JP17640888 A JP 17640888A JP H0226081 A JPH0226081 A JP H0226081A
Authority
JP
Japan
Prior art keywords
light
semiconductor element
transparent substrate
sealing resin
metal pads
Prior art date
Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
Pending
Application number
JP63176408A
Other languages
English (en)
Inventor
Yukiaki Komatsu
幸哲 小松
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
Fuji Electric Co Ltd
Original Assignee
Fuji Electric Co Ltd
Priority date (The priority date is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the date listed.)
Filing date
Publication date
Application filed by Fuji Electric Co Ltd filed Critical Fuji Electric Co Ltd
Priority to JP63176408A priority Critical patent/JPH0226081A/ja
Publication of JPH0226081A publication Critical patent/JPH0226081A/ja
Pending legal-status Critical Current

Links

Classifications

    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/01Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L2224/10Bump connectors; Manufacturing methods related thereto
    • H01L2224/15Structure, shape, material or disposition of the bump connectors after the connecting process
    • H01L2224/16Structure, shape, material or disposition of the bump connectors after the connecting process of an individual bump connector
    • H01L2224/161Disposition
    • H01L2224/16151Disposition the bump connector connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive
    • H01L2224/16221Disposition the bump connector connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive the body and the item being stacked
    • H01L2224/16225Disposition the bump connector connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive the body and the item being stacked the item being non-metallic, e.g. insulating substrate with or without metallisation
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/01Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L2224/26Layer connectors, e.g. plate connectors, solder or adhesive layers; Manufacturing methods related thereto
    • H01L2224/31Structure, shape, material or disposition of the layer connectors after the connecting process
    • H01L2224/32Structure, shape, material or disposition of the layer connectors after the connecting process of an individual layer connector
    • H01L2224/321Disposition
    • H01L2224/32151Disposition the layer connector connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive
    • H01L2224/32221Disposition the layer connector connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive the body and the item being stacked
    • H01L2224/32225Disposition the layer connector connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive the body and the item being stacked the item being non-metallic, e.g. insulating substrate with or without metallisation
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/01Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L2224/42Wire connectors; Manufacturing methods related thereto
    • H01L2224/47Structure, shape, material or disposition of the wire connectors after the connecting process
    • H01L2224/48Structure, shape, material or disposition of the wire connectors after the connecting process of an individual wire connector
    • H01L2224/4805Shape
    • H01L2224/4809Loop shape
    • H01L2224/48091Arched
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/01Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L2224/42Wire connectors; Manufacturing methods related thereto
    • H01L2224/47Structure, shape, material or disposition of the wire connectors after the connecting process
    • H01L2224/48Structure, shape, material or disposition of the wire connectors after the connecting process of an individual wire connector
    • H01L2224/481Disposition
    • H01L2224/48151Connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive
    • H01L2224/48221Connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive the body and the item being stacked
    • H01L2224/48245Connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive the body and the item being stacked the item being metallic
    • H01L2224/48247Connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive the body and the item being stacked the item being metallic connecting the wire to a bond pad of the item
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/73Means for bonding being of different types provided for in two or more of groups H01L2224/10, H01L2224/18, H01L2224/26, H01L2224/34, H01L2224/42, H01L2224/50, H01L2224/63, H01L2224/71
    • H01L2224/732Location after the connecting process
    • H01L2224/73251Location after the connecting process on different surfaces
    • H01L2224/73265Layer and wire connectors
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2924/00Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
    • H01L2924/15Details of package parts other than the semiconductor or other solid state devices to be connected
    • H01L2924/151Die mounting substrate
    • H01L2924/1515Shape
    • H01L2924/15153Shape the die mounting substrate comprising a recess for hosting the device
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2924/00Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
    • H01L2924/15Details of package parts other than the semiconductor or other solid state devices to be connected
    • H01L2924/151Die mounting substrate
    • H01L2924/15165Monolayer substrate
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2924/00Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
    • H01L2924/15Details of package parts other than the semiconductor or other solid state devices to be connected
    • H01L2924/161Cap
    • H01L2924/1615Shape
    • H01L2924/16195Flat cap [not enclosing an internal cavity]

Landscapes

  • Light Receiving Elements (AREA)

Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【発明の詳細な説明】 〔産業上の利用分野〕 この発明は、光センサとその制御回路とを半導体素子に
形成した光半導体集積回路素子に関し、特に照射する光
を透過させるようにして半導体素子をパッケージに封止
する構造に係わる。
〔従来の技術〕
第2図は従来の技術例を示す断面図である。セラミック
等のパッケージ21に金シリコン共晶又は低融点ガラス
等の固着剤22を使用して半導体素子1が固着され、リ
ードフレーム23にアルミニウムのワイヤ24で接続さ
れている。パッケージ21の上部は接着剤25によって
接着されたカバーガラス26で覆われて、気密に封止さ
れている。
前記半導体素子1には図示しない光センサとこの光セン
サを制御する制御回路等が形成されている。照射する光
が光センサ以外の制御回路にも照射することのないよう
に、光センサ領域に対応した図示しない遮光パターンを
カバーガラス26の表面に形成する。
〔発明が解決しようとする課題〕
前記の従来の技術では、半導体素子1の持つ端子の数に
応じたワイヤ24とその配線工程が必要であり、ワイヤ
24のための空間とパッケージ21の厚さにより全体が
厚(なるという問題がある。
またカバーガラス26の表面の遮光パターンと半導体素
子1の受光面との間の隙間が大きいために照射する光の
方向により受光特性が変化する。更にパンケージ21及
び接着剤25とによる前記両者の水平方向の相対位置精
度の誤差により受光特性が変化するという問題がある。
この発明の目的は、パンケージを不要にし、配線が簡単
で全体を薄<シ、また受光特性を安定させることにある
〔課題を解決するための手段〕
この発明は、 (1)受光面の周辺に配vA導体による金属パッドを設
けた半導体素子と、透光領域の周辺に配線導体による金
属パッドを設けた透光基板とを対向させ、前記両金属パ
ッドをバンブ電極を介して接続し、前記半導体素子の周
辺の前記透光基板との隙間を封止樹脂で封止し、この封
止樹脂の外へ前記透光基板の前記配線導体を延設するも
のであり、(2)また、前記(1)において、透光基板
に遮光パターンを形成するものである。
〔作用〕
前記の手段(1)のものにおいては、半導体素子1と透
光基板3との間の隙間はおよそバンブ電極5の高さで決
まる。通常これは半田バンプで0.1mm以下、金、銅
ではそれ以下であるので、前記隙間は従来のワイヤ接続
と比べ極めて小さく全体が薄くなる。また多数のバンブ
電極5は同時に接続できて工程が短く、製造設備も簡便
であり、封止樹脂6によりパンケージングが不要になる
前記手段(2)のものにおいては、手段(1)のものに
加うるに、従来のようにパンケージ21と接着剤25を
介することなく、遮光パターン8を設けた透光基板3を
直接に半導体素子1に対向させるので、半田バンプの溶
融時の表面張力により相対位置が正確に保たれる。いわ
ゆるセルフアラインメント効果である。両者の隙間が極
めて小さいこととあいまって透光り領域8aは半導体素
子1の受光面に正確に対応し、光の方向による受光特性
の変化がほとんどない。
〔実施例〕
第1図は実施例を示す断面図であり、第2図と同一符号
を付けたものはおよそ同一機能を持つ。
半導体素子1の受光面の周辺には公知のウェハプロセス
におけるリトグラフィ技術によって、配線導体による多
数の金属バッド2が形成される。−方、ガラス又は透明
樹脂等からなる透光基板3の表面には前記と同様に配線
導体4aによる金属パッド4が形成される。この金属パ
ッド4の上には予め半田、金、銅等のバンブ電極5が形
成されている。両金属バッド2と4とが正しく対応する
ようにして半導体素子1と透光基板3とを対向させ、前
記バンブ電極5により両金属パッド2と4とを接続する
。この時半田等のバンブ電極5を溶融するが、溶融金属
の表面張力で上下の水平方向の相対位置がより正確に確
保される。セルフアラインメント効果である。なお半導
体素子1と透光基板3とには部品の状態で両者の位置決
めのための凹凸等を設けるとよい。またバンブ電極5は
金属パッド2の側に設けてもよい。
バンブ電極5によって半導体素子1と透光基板3とを接
続してから、半導体素子1の周辺であって透光基板との
隙間を封止樹脂6で封止する。半導体素子1は通常約0
.5mの厚さがあり、その面積が大きい場合又は他の図
示しない部材で裏打ちされてない等の場合には、前記封
止樹脂6は図示のように半導体素子1の裏面全体に及ぶ
とよい。
透光基板3の前記配線導体4aは封止樹脂6の外へ引き
出されるように延設されている。この配線導体4aは公
知の技術によりフレキシブル基板7の配線導体7aに半
田7bで接続される。
前述の透光基板3には、半導体素子1の受光面の図示し
ない光センサ領域に対応した遮光パターン8が印刷され
透光領域8aが形成されている。
この遮光パターン8は受光面側に設けてもよく、更に透
光基板に不透明な材料を使用してスリット等の透光領域
を設け、この透光領域とその周辺のみに透明なフィルム
を貼り付けてもよい。このような構造にすると前記不透
明な材料として金属等を用いて薄くすることができ、透
明なフィルムも前記スリット等の狭い部分に対応する強
度があればよいから薄くできて全体が更に薄くできる。
〔発明の効果〕
この発明は、(1)受光面の周辺に配線導体による金属
パッドを設けた半導体素子と、透光領域の周辺に配線導
体による金属パッドを設けた透光基板とを対向させ、前
記両金属パッドをバンブ電極を介して接続し、前記半導
体素子の周辺の前記透光基板との隙間を封止樹脂で封止
し、この封止樹脂の外へ前記透光基板の前記配線導体を
延設するようにしたので、半導体素子と透光基板との間
の隙間が小さくなり、従って全体が薄くできるという効
果があり、バンブ電極による接続と封止樹脂によりパッ
ケージが不要になるという効果がある。
また前記(1)に加え透光基板に遮光パターンを形成す
るものは、半導体素子と透光基板との間の隙間が小さく
、かつ直接に対向させる両者の相対位置精度がセルフア
ラインメント効果により良いので、遮光パターンが正し
く受光面に対向し、受光特性の変化がほとんどないとい
う効果がある。
スリット等の透光領域を持つ金属等で透光基板を薄く形
成し、薄い透明フィルムを接合させれば更に薄くできる
だけでなく、光の透過率も向上するという効果がある。
【図面の簡単な説明】
第1図は実施例の断面図、第2図は従来例の断面図であ
る。 1・・・半導体素子、2.4・・・金属パッド、3・・
・透光基板、5・・・バンブ電極、6・・・封止樹脂、
21・・・パッケージ。

Claims (1)

  1. 【特許請求の範囲】 1)受光面の周辺に配線導体による金属パッドを設けた
    半導体素子と、透光領域の周辺に配線導体による金属パ
    ッドを設けた透光基板とを対向させ、前記両金属パッド
    をバンプ電極を介して接続し、前記半導体素子の周辺の
    前記透光基板との隙間を封止樹脂で封止し、この封止樹
    脂の外へ前記透光基板の前記配線導体を延設することを
    特徴とする光半導体集積回路素子の封止構造。 2)特許請求の範囲第1項記載の光半導体集積回路素子
    の封止構造において、透光基板に遮光パターンを形成す
    ることを特徴とする光半導体集積回路素子の封止構造。
JP63176408A 1988-07-15 1988-07-15 光半導体集積回路素子の封止構造 Pending JPH0226081A (ja)

Priority Applications (1)

Application Number Priority Date Filing Date Title
JP63176408A JPH0226081A (ja) 1988-07-15 1988-07-15 光半導体集積回路素子の封止構造

Applications Claiming Priority (1)

Application Number Priority Date Filing Date Title
JP63176408A JPH0226081A (ja) 1988-07-15 1988-07-15 光半導体集積回路素子の封止構造

Publications (1)

Publication Number Publication Date
JPH0226081A true JPH0226081A (ja) 1990-01-29

Family

ID=16013154

Family Applications (1)

Application Number Title Priority Date Filing Date
JP63176408A Pending JPH0226081A (ja) 1988-07-15 1988-07-15 光半導体集積回路素子の封止構造

Country Status (1)

Country Link
JP (1) JPH0226081A (ja)

Cited By (2)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP2006128625A (ja) * 2004-09-30 2006-05-18 Oki Electric Ind Co Ltd 半導体装置及びその製造方法
JP2010283380A (ja) * 2003-10-01 2010-12-16 Optopac Inc 光検出用半導体装置の電子パッケージおよびそのパッケージング方法

Cited By (2)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP2010283380A (ja) * 2003-10-01 2010-12-16 Optopac Inc 光検出用半導体装置の電子パッケージおよびそのパッケージング方法
JP2006128625A (ja) * 2004-09-30 2006-05-18 Oki Electric Ind Co Ltd 半導体装置及びその製造方法

Similar Documents

Publication Publication Date Title
US7459330B2 (en) Manufacturing method of an acceleration sensing device
JP4471600B2 (ja) 回路装置
JPH0226081A (ja) 光半導体集積回路素子の封止構造
JPH02126685A (ja) 固体イメージセンサー
JPS62190776A (ja) 光電変換装置
JPH09199701A (ja) 固体撮像装置
JPS6360561A (ja) 固体撮像装置
US5087963A (en) Glass-sealed semiconductor device
JPH03209746A (ja) 半導体パッケージ
JP2682830B2 (ja) 固体撮像装置
JPS61281559A (ja) 光検出装置
TWI787999B (zh) 感測器封裝結構及其製造方法
JPS62131555A (ja) 半導体集積回路装置
JPH0786544A (ja) Ccd素子
JP2567886B2 (ja) 固体撮像装置の製造方法
JPH1126782A (ja) 半導体装置
JP3100560U (ja) 映像センサーのフリップチップパッケージ構造とその映像センサーモジュール
JPH04139737A (ja) 半導体チップの実装方法
JPS59161187A (ja) 固体撮像装置
KR200265306Y1 (ko) 멀티칩패키지
JPH0720927Y2 (ja) 固体撮像装置
JPH03142880A (ja) 半導体装置とそれを用いたイメージセンサ及びイメージセンサユニット
JPH04235476A (ja) 固体撮像装置
JPS59161078A (ja) 不透明基板への受光素子の装着構造
JPS63137442A (ja) 半導体装置