JPH021398A - メモリ付カード用の電子素子支持体とこれを利用したメモリ付カード - Google Patents
メモリ付カード用の電子素子支持体とこれを利用したメモリ付カードInfo
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Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
産業上の利用分野
本発明は、一般に、少なくとも1つの能動電子素子をキ
ャビティ内に有するメモリ付カードに関するものであり
、さらに詳細には、このタイプの素子の支持体に関する
。
ャビティ内に有するメモリ付カードに関するものであり
、さらに詳細には、このタイプの素子の支持体に関する
。
従来の技術
IDカードが多くの分野で使用されている。使用される
分野としては、特に、銀行用カードやクレジットカード
の分野がある。しかし、長年の間、このようなカードに
は、同定用数値と所有者番号の他には、磁気的読み出し
により同定が可能になる磁気記録のみがなされていた。
分野としては、特に、銀行用カードやクレジットカード
の分野がある。しかし、長年の間、このようなカードに
は、同定用数値と所有者番号の他には、磁気的読み出し
により同定が可能になる磁気記録のみがなされていた。
数年前から、このようなカードは所有者の同定以外の用
途に使用されるようになっており、特に前払いの用途や
不正行為に対する保護に用いられている。この目的で、
カードには能動電子素子である例えば電子メモリが取り
付けられ、場合によってはこの能動電子素子にマイクロ
プロセサが接続されている。この結果として、このカー
ドは特に銀行に関する用途に使用することができる。
途に使用されるようになっており、特に前払いの用途や
不正行為に対する保護に用いられている。この目的で、
カードには能動電子素子である例えば電子メモリが取り
付けられ、場合によってはこの能動電子素子にマイクロ
プロセサが接続されている。この結果として、このカー
ドは特に銀行に関する用途に使用することができる。
上記の技術により電子素子を搭載したクレジットカード
は多数の方法で製造することができる。
は多数の方法で製造することができる。
第1の方法によれば、カードの厚さ方向にキャビティを
設けてそこに電子素子を収容する。「積層(co−1a
mination) J法として知られる別の方法によ
れば、プラスチック材料である例えばポリエポキシ、ポ
リエチレン、塩化ポリビニルからなる薄い複数の層を素
子の周囲に積層させる。これら方法を実行するにあたっ
ては、カードの表面に堆積されたメタライズ層と電子素
子の端子を電気的に接続するためにさらに様々な操作が
実行される。
設けてそこに電子素子を収容する。「積層(co−1a
mination) J法として知られる別の方法によ
れば、プラスチック材料である例えばポリエポキシ、ポ
リエチレン、塩化ポリビニルからなる薄い複数の層を素
子の周囲に積層させる。これら方法を実行するにあたっ
ては、カードの表面に堆積されたメタライズ層と電子素
子の端子を電気的に接続するためにさらに様々な操作が
実行される。
カード内に設けられたキャビティに電子素子を収容し、
このカード上にメタライズ層を設け、このカードの端子
とメタライズ層の間の接続を実現するための方法の1つ
は、第1図に図示されているように、非導電性である例
えばポリエポキシからなるフィルム1を使用することで
ある。このフィルムは、一方の側にチップ(参照番号2
)の形態の電子素子を備え、他方の側にはメタライズ部
分のないスペース6と7によって相互に分離されたメタ
ライズ層3.4.5を備える。これらメタライズ層3.
4.5は穴8.9.10を介してフィルム1の他方の側
と連通しており、これら穴を通って導電ワイヤ11.1
2.13の端部が公知の任意の手段、例えば導電性接着
剤によって対応するメタライズ層に接続される。各導電
ワイヤの他端は、チップ2の出力端子14.15または
16に接続される。
このカード上にメタライズ層を設け、このカードの端子
とメタライズ層の間の接続を実現するための方法の1つ
は、第1図に図示されているように、非導電性である例
えばポリエポキシからなるフィルム1を使用することで
ある。このフィルムは、一方の側にチップ(参照番号2
)の形態の電子素子を備え、他方の側にはメタライズ部
分のないスペース6と7によって相互に分離されたメタ
ライズ層3.4.5を備える。これらメタライズ層3.
4.5は穴8.9.10を介してフィルム1の他方の側
と連通しており、これら穴を通って導電ワイヤ11.1
2.13の端部が公知の任意の手段、例えば導電性接着
剤によって対応するメタライズ層に接続される。各導電
ワイヤの他端は、チップ2の出力端子14.15または
16に接続される。
上記の操作が終了すると、チップ2を樹脂でコーティン
グし、この樹脂を熱で硬化させてチップを封止する。次
いでチップをカードの半ヤビティ内の所定の位置に収容
することができる。メタライズ層は、単に、チップを嵌
め込み、支持用フィルム1を、必要な大きさに切断した
後にカードに接合するだけでキャビティの縁部に配置す
ることができる。
グし、この樹脂を熱で硬化させてチップを封止する。次
いでチップをカードの半ヤビティ内の所定の位置に収容
することができる。メタライズ層は、単に、チップを嵌
め込み、支持用フィルム1を、必要な大きさに切断した
後にカードに接合するだけでキャビティの縁部に配置す
ることができる。
このタイプの方法では、チップ2がフレームであるフィ
ルム1に接合された構造が得られる。このフィルムには
複数のメタライズ領域を有する層が接着される。フィル
ムとメタライズ層とで形成されたこの接合体は比較的可
撓性があり、ポリエポキシ製のカードよりも可撓性があ
る。これに対して基体または基板が厚さ数百ミクロン(
例えば厚さ280ミクロン)のシリコンソケットすなわ
ちシリコン基板であるチップは固くて脆い。この結果、
特にIDカードを不注意に取り扱うときに応力が発生す
る。この応力によってシリコン基板が破損し、従ってチ
ップが破壊される。
ルム1に接合された構造が得られる。このフィルムには
複数のメタライズ領域を有する層が接着される。フィル
ムとメタライズ層とで形成されたこの接合体は比較的可
撓性があり、ポリエポキシ製のカードよりも可撓性があ
る。これに対して基体または基板が厚さ数百ミクロン(
例えば厚さ280ミクロン)のシリコンソケットすなわ
ちシリコン基板であるチップは固くて脆い。この結果、
特にIDカードを不注意に取り扱うときに応力が発生す
る。この応力によってシリコン基板が破損し、従ってチ
ップが破壊される。
この問題に対する1つの解決法はシリコン基板の摩さを
厚くすることであるが、この方法はカードの厚さによる
制約を受ける。さらに、厚さを厚くするとカード全体の
機械的強度は大きくなるが、チップ自体は衝撃に対して
弱いままである。
厚くすることであるが、この方法はカードの厚さによる
制約を受ける。さらに、厚さを厚くするとカード全体の
機械的強度は大きくなるが、チップ自体は衝撃に対して
弱いままである。
発明が解決しようとする課題
そこで、本発明の目的は、上記の問題点を解決して、電
子素子の最終的な厚さを厚くすることなく、この電子素
子が収容されているカードを乱暴に扱うことに特に起因
する機械的特性低下からこの電子素子を護る電子素子用
支持体を提供することである。
子素子の最終的な厚さを厚くすることなく、この電子素
子が収容されているカードを乱暴に扱うことに特に起因
する機械的特性低下からこの電子素子を護る電子素子用
支持体を提供することである。
課題を解決するための手段
従って、本発明によれば、電子素子を収容するキャビテ
ィを有するメモリ付カード用電子素子支持体であって、
一方の側が上記電子素子となる様々な素子を製造するた
めの基板として使用される薄い第1のシリコンソケット
と、シリコンよりも固い材料で製造されており、第1の
ソケットの他方の側に固定されていてこの第1のソケッ
トよりも厚い第2のソケットとを備えることを特徴とす
る電子素子支持体が提供される。
ィを有するメモリ付カード用電子素子支持体であって、
一方の側が上記電子素子となる様々な素子を製造するた
めの基板として使用される薄い第1のシリコンソケット
と、シリコンよりも固い材料で製造されており、第1の
ソケットの他方の側に固定されていてこの第1のソケッ
トよりも厚い第2のソケットとを備えることを特徴とす
る電子素子支持体が提供される。
本発明の他の特徴ならびに利点は、添付の図面を参照し
た以下の説明によってさらによく理解できよう。
た以下の説明によってさらによく理解できよう。
実施例
第1図は従来技術に対応するため、既に従来の技術の項
で説明した。
で説明した。
第2図に示した断面概略図には、シリコンソケットすな
わち基板を備える電子素子29が図示されている。この
基板をもとにして様々な層28が実現されて回路の異な
る複数の素子が得られる。
わち基板を備える電子素子29が図示されている。この
基板をもとにして様々な層28が実現されて回路の異な
る複数の素子が得られる。
従来技術によれば、ソケット23は厚さが300ミクロ
ンであり、このソケットは接合層22を介して支持用フ
ィルム21に固定されている。このフィルム21の電子
素子とは反対側にはメタライズ層20が設けられており
、このメタライズ層は第1図に参照番号3と4で示した
ように複数のコンタクト領域に分割されている。
ンであり、このソケットは接合層22を介して支持用フ
ィルム21に固定されている。このフィルム21の電子
素子とは反対側にはメタライズ層20が設けられており
、このメタライズ層は第1図に参照番号3と4で示した
ように複数のコンタクト領域に分割されている。
この従来の構造は、シリコン基板が接合層を介して可撓
性のあるフィルム21と直接に接触しているために脆い
。この結果として基板が破損し、従って電子素子が完全
に破壊される。この問題に対する明らかな解決法は基板
を厚くすることであるが、この方法は、電子素子とその
保護用カプセル25を合わせた厚さが支持用カードのキ
ャビティの深さである約600ミクロンを越えてはなら
ないという制約を受ける。
性のあるフィルム21と直接に接触しているために脆い
。この結果として基板が破損し、従って電子素子が完全
に破壊される。この問題に対する明らかな解決法は基板
を厚くすることであるが、この方法は、電子素子とその
保護用カプセル25を合わせた厚さが支持用カードのキ
ャビティの深さである約600ミクロンを越えてはなら
ないという制約を受ける。
そこで、本発明では、シリコン基板またはソケット23
の厚さを実質的に薄くし、その薄くなった分をシリコン
よりも機械的強度の大きな材料からなる第2のソケット
にすることを提案する。さらに詳しく説明すると、シリ
コンの厚さを50ミクロンにまで薄くし、ソケットの残
り (200〜250ミクロン)ヲ、チタン、コバルト
、バナジウム、セラミック、さらにはガラス繊維強化プ
ラスチックなどの材料で構成する。
の厚さを実質的に薄くし、その薄くなった分をシリコン
よりも機械的強度の大きな材料からなる第2のソケット
にすることを提案する。さらに詳しく説明すると、シリ
コンの厚さを50ミクロンにまで薄くし、ソケットの残
り (200〜250ミクロン)ヲ、チタン、コバルト
、バナジウム、セラミック、さらにはガラス繊維強化プ
ラスチックなどの材料で構成する。
この新しいソケ7)を製造するためには、50ミクロン
の厚さのシリコン基板をもとにして、その上に従来から
知られている任意の方法(例えば真空蒸着法)を利用し
て構造強化材料を堆積させる。
の厚さのシリコン基板をもとにして、その上に従来から
知られている任意の方法(例えば真空蒸着法)を利用し
て構造強化材料を堆積させる。
この新しい基板が、電子素子を得るためにシリコン層2
3に対して拡散および堆積操作を実行するのに使用され
る。次に、電子素子を、強化材料からなるソケット24
を用い、接合層22を介してフィルム21に固定する。
3に対して拡散および堆積操作を実行するのに使用され
る。次に、電子素子を、強化材料からなるソケット24
を用い、接合層22を介してフィルム21に固定する。
次に、シリコン側の電子素子の各出力端子を、フィルム
210穴32を介して導電ワイヤ26とハンダ27を用
いてメタライズ層20のコンタクト領域に接続する。次
の操作では、電子素子と導電ワイヤを(封脂25内に封
止して全体を保護する。この操作が終わると、(電子素
子と支持用フィルムとメタライズ層が封止されて形成さ
れた)このユニット全体をカードの専用キャビティ30
内の所定の位置に収容する。このキャビティは、カード
と一体になった底部31によって閉じられている。固い
材料からなるこの第2のソケット24は1、構造の厚さ
を厚くすることなくシリコン製の第1のソケット23を
保護するのに使用される。
210穴32を介して導電ワイヤ26とハンダ27を用
いてメタライズ層20のコンタクト領域に接続する。次
の操作では、電子素子と導電ワイヤを(封脂25内に封
止して全体を保護する。この操作が終わると、(電子素
子と支持用フィルムとメタライズ層が封止されて形成さ
れた)このユニット全体をカードの専用キャビティ30
内の所定の位置に収容する。このキャビティは、カード
と一体になった底部31によって閉じられている。固い
材料からなるこの第2のソケット24は1、構造の厚さ
を厚くすることなくシリコン製の第1のソケット23を
保護するのに使用される。
ここでは本発明を電子素子が支持用フィルムに固定され
た場合について説明したが、支持用フィルムを使用しな
い場合にも本発明を適用することができる。
た場合について説明したが、支持用フィルムを使用しな
い場合にも本発明を適用することができる。
第1図は、従来技術による電子素子の支持用フィルムと
この電子素子の電気的接続の斜視図である。 第2図は、本発明に従って内部に電子素子が収容された
キャビティを有するIDカードの部分断面図である。 25・・保護用カプセル(樹脂)、 27・・ハンダ、 29・・電子素子、30・
・キャビティ
この電子素子の電気的接続の斜視図である。 第2図は、本発明に従って内部に電子素子が収容された
キャビティを有するIDカードの部分断面図である。 25・・保護用カプセル(樹脂)、 27・・ハンダ、 29・・電子素子、30・
・キャビティ
Claims (9)
- (1)電子素子を収容するキャビティを有するメモリ付
カード用電子素子支持体であって、一方の側が上記電子
素子となる様々な素子を製造するための基板として使用
される薄い第1のシリコンソケットと、シリコンよりも
固い材料で製造されており、第1のソケットの他方の側
に固定されていてこの第1のソケットよりも厚い第2の
ソケットとを備え、この第2のソケットは、上記キャビ
ティを封止する素子として機能するフィルムに固定され
ていることを特徴とする電子素子支持体。 - (2)上記第2のソケットの材料がチタンであることを
特徴とする請求項1に記載の電子素子支持体。 - (3)上記第2のソケットの材料がコバルトであること
を特徴とする請求項1に記載の電子素子支持体。 - (4)上記第2のソケットの材料がバナジウムであるこ
とを特徴とする請求項1に記載の電子素子支持体。 - (5)上記第2のソケットの材料がセラミックであるこ
とを特徴とする請求項1に記載の電子素子支持体。 - (6)上記第2のソケットの材料がガラス繊維強化プラ
スチックであることを特徴とする請求項1に記載の電子
素子支持体。 - (7)上記第1のソケットの厚さが50〜100ミクロ
ンの範囲にあることを特徴とする請求項1に記載の電子
素子支持体。 - (8)上記第2のソケットの厚さが100〜300ミク
ロンの範囲にあることを特徴とする請求項1に記載の電
子素子支持体。 - (9)電子素子を収容するためのキャビティを有するメ
モリ付カードであって、上記電子素子が請求項1に記載
の電子素子支持体の上に搭載されていることを特徴とす
るメモリ付カード。
Applications Claiming Priority (2)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
FR8717385 | 1987-12-14 | ||
FR8717385A FR2624635B1 (fr) | 1987-12-14 | 1987-12-14 | Support de composant electronique pour carte memoire et produit ainsi obtenu |
Publications (2)
Publication Number | Publication Date |
---|---|
JPH021398A true JPH021398A (ja) | 1990-01-05 |
JP2761500B2 JP2761500B2 (ja) | 1998-06-04 |
Family
ID=9357822
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP63316073A Expired - Lifetime JP2761500B2 (ja) | 1987-12-14 | 1988-12-14 | メモリ付カード用の電子素子支持体とこれを利用したメモリ付カード |
Country Status (6)
Country | Link |
---|---|
US (1) | US4943464A (ja) |
EP (1) | EP0321340B1 (ja) |
JP (1) | JP2761500B2 (ja) |
KR (1) | KR890010740A (ja) |
DE (1) | DE3877544T2 (ja) |
FR (1) | FR2624635B1 (ja) |
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Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
USRE36356E (en) * | 1987-12-14 | 1999-10-26 | Sgs-Thomson Microelectronics S.A. | Electronic component support for memory card and product obtained thereby |
GB8901189D0 (en) * | 1989-01-19 | 1989-03-15 | Avery W & T Limited | Portable electronic token |
USRE35578E (en) * | 1988-12-12 | 1997-08-12 | Sgs-Thomson Microelectronics, Inc. | Method to install an electronic component and its electrical connections on a support, and product obtained thereby |
FR2664721B1 (fr) * | 1990-07-10 | 1992-09-25 | Gemplus Card Int | Carte a puce renforcee. |
JPH06312593A (ja) | 1993-04-28 | 1994-11-08 | Toshiba Corp | 外部記憶装置、外部記憶装置ユニットおよび外部記憶装置の製造方法 |
JPH0737049A (ja) * | 1993-07-23 | 1995-02-07 | Toshiba Corp | 外部記憶装置 |
US5581445A (en) * | 1994-02-14 | 1996-12-03 | Us3, Inc. | Plastic integrated circuit card with reinforcement structure for protecting integrated circuit module |
JP3383398B2 (ja) * | 1994-03-22 | 2003-03-04 | 株式会社東芝 | 半導体パッケージ |
FR2724477B1 (fr) * | 1994-09-13 | 1997-01-10 | Gemplus Card Int | Procede de fabrication de cartes sans contact |
JP3388921B2 (ja) * | 1994-11-29 | 2003-03-24 | 株式会社東芝 | 集積回路カードの製造方法 |
JP3660382B2 (ja) * | 1995-02-03 | 2005-06-15 | 株式会社東芝 | 情報記憶装置およびそれに用いるコネクタ部 |
US6471130B2 (en) * | 1995-02-03 | 2002-10-29 | Kabushiki Kaisha Toshiba | Information storage apparatus and information processing apparatus using the same |
USRE38997E1 (en) * | 1995-02-03 | 2006-02-28 | Kabushiki Kaisha Toshiba | Information storage and information processing system utilizing state-designating member provided on supporting card surface which produces write-permitting or write-inhibiting signal |
JPH0964240A (ja) | 1995-08-25 | 1997-03-07 | Toshiba Corp | 半導体装置および半導体装置の製造方法 |
US5892213A (en) * | 1995-09-21 | 1999-04-06 | Yamaichi Electronics Co., Ltd. | Memory card |
FR2741009B1 (fr) * | 1995-11-15 | 1997-12-12 | Solaic Sa | Carte a circuit integre et module a circuit integre |
JP2799310B2 (ja) * | 1996-04-02 | 1998-09-17 | 山一電機株式会社 | メモリーカード稼動電子機器におけるic保護装置 |
FR2747812B1 (fr) * | 1996-04-23 | 1998-05-22 | Solaic Sa | Carte a circuit integre sans contact avec antenne en polymere conducteur |
US5956601A (en) * | 1996-04-25 | 1999-09-21 | Kabushiki Kaisha Toshiba | Method of mounting a plurality of semiconductor devices in corresponding supporters |
US6022763A (en) * | 1996-05-10 | 2000-02-08 | Kabushiki Kaisha Toshiba | Substrate for semiconductor device, semiconductor device using the same, and method for manufacture thereof |
TW332334B (en) * | 1996-05-31 | 1998-05-21 | Toshiba Co Ltd | The semiconductor substrate and its producing method and semiconductor apparatus |
JPH09327990A (ja) * | 1996-06-11 | 1997-12-22 | Toshiba Corp | カード型記憶装置 |
JPH10302030A (ja) * | 1997-02-28 | 1998-11-13 | Toshiba Corp | 接続装置、および情報処理装置 |
JP2003346109A (ja) * | 2002-05-22 | 2003-12-05 | Toshiba Corp | Icカード及び半導体集積回路装置パッケージ |
EP1669394A1 (en) * | 2004-12-10 | 2006-06-14 | The Procter & Gamble Company | Superabsorbent polymer particles with improved surface cross-linking and hydrophilicity and method of making them |
EP2741241A1 (en) * | 2012-12-10 | 2014-06-11 | Oberthur Technologies | A Chip Module having a Protective Layer |
USD759022S1 (en) * | 2013-03-13 | 2016-06-14 | Nagrastar Llc | Smart card interface |
USD758372S1 (en) | 2013-03-13 | 2016-06-07 | Nagrastar Llc | Smart card interface |
USD864968S1 (en) * | 2015-04-30 | 2019-10-29 | Echostar Technologies L.L.C. | Smart card interface |
USD983261S1 (en) | 2019-12-20 | 2023-04-11 | Capital One Services, Llc | Vented laminated card |
Family Cites Families (6)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPS59229686A (ja) * | 1983-06-09 | 1984-12-24 | Toshiba Corp | Icカ−ド |
US4661653A (en) * | 1984-12-27 | 1987-04-28 | Seiichiro Aigo | Package assembly for semiconductor device |
FR2583574B1 (fr) * | 1985-06-14 | 1988-06-17 | Eurotechnique Sa | Micromodule a contacts enterres et carte contenant des circuits comportant un tel micromodule. |
DE3689094T2 (de) * | 1985-07-27 | 1994-03-10 | Dainippon Printing Co Ltd | IC-Karte. |
JP2502511B2 (ja) * | 1986-02-06 | 1996-05-29 | 日立マクセル株式会社 | 半導体装置の製造方法 |
FR2599165A1 (fr) * | 1986-05-21 | 1987-11-27 | Michot Gerard | Objet associe a un element electronique et procede d'obtention |
-
1987
- 1987-12-14 FR FR8717385A patent/FR2624635B1/fr not_active Expired - Fee Related
-
1988
- 1988-12-01 US US07/278,979 patent/US4943464A/en not_active Ceased
- 1988-12-13 KR KR1019880016580A patent/KR890010740A/ko not_active Application Discontinuation
- 1988-12-14 EP EP19880403177 patent/EP0321340B1/fr not_active Expired - Lifetime
- 1988-12-14 JP JP63316073A patent/JP2761500B2/ja not_active Expired - Lifetime
- 1988-12-14 DE DE8888403177T patent/DE3877544T2/de not_active Expired - Fee Related
Also Published As
Publication number | Publication date |
---|---|
FR2624635B1 (fr) | 1991-05-10 |
DE3877544T2 (de) | 1993-05-13 |
FR2624635A1 (fr) | 1989-06-16 |
EP0321340B1 (fr) | 1993-01-13 |
DE3877544D1 (de) | 1993-02-25 |
EP0321340A1 (fr) | 1989-06-21 |
JP2761500B2 (ja) | 1998-06-04 |
US4943464A (en) | 1990-07-24 |
KR890010740A (ko) | 1989-08-10 |
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