JPH02125615A - 半導体装置の形成方法 - Google Patents
半導体装置の形成方法Info
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- JPH02125615A JPH02125615A JP27977788A JP27977788A JPH02125615A JP H02125615 A JPH02125615 A JP H02125615A JP 27977788 A JP27977788 A JP 27977788A JP 27977788 A JP27977788 A JP 27977788A JP H02125615 A JPH02125615 A JP H02125615A
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Landscapes
- Electrodes Of Semiconductors (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
〔産業上の利用分野〕
本発明は半導体集積回路の電極の形成方法に関し、特に
埋込みコンタクトホールの形成方法に関する。
埋込みコンタクトホールの形成方法に関する。
従来、この種の埋込みコンタクトの形成方法としては、
第3図に示す様に、シリコン(Si)基板表面に形成さ
れた絶縁物からなるコンタクトホールヘタングステンを
選択的に成長させる方法がある。
第3図に示す様に、シリコン(Si)基板表面に形成さ
れた絶縁物からなるコンタクトホールヘタングステンを
選択的に成長させる方法がある。
上述した従来方法では、ジャーナル オブ エレクトロ
ケミカル ソサイアティ ソリッドステート サイエン
ス アンド テクノロジー(J。
ケミカル ソサイアティ ソリッドステート サイエン
ス アンド テクノロジー(J。
EIectrochem、Soc、:5QLIO−3T
ATE 5CIENCEAND TECHNOLOGY
)の1984年11月号第2702ページ〜第2708
ページに記載されている様に、選択成長の初期過程では 2WFs+38 i→2W+38iF4↑の反応により
Wの成長が生ずる結果、第3図に示す様に、WIJ’h
Si基板の深さ方向や絶縁膜下へ侵入した状態で形成さ
れるために、特にコンタクトホール下に浅いPN接合が
形成されている場合には、接合特性の劣化を生じさせる
欠点がある。
ATE 5CIENCEAND TECHNOLOGY
)の1984年11月号第2702ページ〜第2708
ページに記載されている様に、選択成長の初期過程では 2WFs+38 i→2W+38iF4↑の反応により
Wの成長が生ずる結果、第3図に示す様に、WIJ’h
Si基板の深さ方向や絶縁膜下へ侵入した状態で形成さ
れるために、特にコンタクトホール下に浅いPN接合が
形成されている場合には、接合特性の劣化を生じさせる
欠点がある。
〔課題を解決するための手段丁
本発明は、単結晶Si基板表面上に絶縁膜によって形成
されたコンタクトホールへ高融点金属を選択成長法によ
って埋込む方法において、絶縁膜によるコンタクトホー
ルを設ける工程と、選択成長法によりSiをコンタクト
ホール内へ選択的に成長させる工程と、高融点金属を選
択成長させることによりコンタクトホールを埋込む工程
とを含む特徴を有している。
されたコンタクトホールへ高融点金属を選択成長法によ
って埋込む方法において、絶縁膜によるコンタクトホー
ルを設ける工程と、選択成長法によりSiをコンタクト
ホール内へ選択的に成長させる工程と、高融点金属を選
択成長させることによりコンタクトホールを埋込む工程
とを含む特徴を有している。
次に、本発明について図面を参照して説明する。
第1図は本発明の第1の実施例の縦断面図である。(1
00)単結晶Si基板10上に0.5 μmのSiO+
膜12全12し通常のホトエツチング法によりコンタク
トホールを設け、次にAsイオン注入によりn型ドープ
層11を形成する。次に、Si選択エピタキシャル法に
よりSi選択成長層13を0.2μm成長させる。次に
、イオン注入法により5 x 1015cm−2のP又
はAsをSi選択成長層ヘドープさせる。次に500人
の多結晶SiをCVD法にて形成し、エッチバックを施
し、多結晶Si側壁14を形成する。次に、WF、とH
2との混合ガスを使用し、成長温度300℃でWの選択
成長を行って、W埋込み層15を形成する。
00)単結晶Si基板10上に0.5 μmのSiO+
膜12全12し通常のホトエツチング法によりコンタク
トホールを設け、次にAsイオン注入によりn型ドープ
層11を形成する。次に、Si選択エピタキシャル法に
よりSi選択成長層13を0.2μm成長させる。次に
、イオン注入法により5 x 1015cm−2のP又
はAsをSi選択成長層ヘドープさせる。次に500人
の多結晶SiをCVD法にて形成し、エッチバックを施
し、多結晶Si側壁14を形成する。次に、WF、とH
2との混合ガスを使用し、成長温度300℃でWの選択
成長を行って、W埋込み層15を形成する。
第2図に本発明の第2の実施例の縦断面図を示す。
(111)単結晶Si基板を用いて本発明による埋込み
コンタクトの形成方法を実施した場合である。
コンタクトの形成方法を実施した場合である。
第1の実施例と同様な方法でコンタクトホールを形成し
た後、Si選択成長により、Si選択成長層23を形成
する。第1の実施例と異なり、Si選択成長層23の端
部においてファセットが生じないために、多結晶Si側
壁の形成を省略しうる。
た後、Si選択成長により、Si選択成長層23を形成
する。第1の実施例と異なり、Si選択成長層23の端
部においてファセットが生じないために、多結晶Si側
壁の形成を省略しうる。
以後のW成長工程は第1の実施例と同様に実施される。
以上説明したように本発明のフンタクト埋込み方法では
、コンタクトホール内のSi表面にあらかじめ単結晶S
i成長層を設けることにより、従来例の欠点であるW層
のSi単結晶基板へのくい込み防止できる卓効がある。
、コンタクトホール内のSi表面にあらかじめ単結晶S
i成長層を設けることにより、従来例の欠点であるW層
のSi単結晶基板へのくい込み防止できる卓効がある。
この結果、接合深さが0.3μm以下の浅い接合を有し
た高密度集積回路の電極のコンタクトの高融点金属によ
る埋込みが実現できる なお、第1.第2の実施例で高融点金属としてWの場合
を示したが、W以外のMo、Ti、Ta、等の高融点金
属においても同様な卓効がある。また、実施例にて数値
を限定して説明を行ったが、これらの数値は本発明の適
用範囲を限定するものではない。
た高密度集積回路の電極のコンタクトの高融点金属によ
る埋込みが実現できる なお、第1.第2の実施例で高融点金属としてWの場合
を示したが、W以外のMo、Ti、Ta、等の高融点金
属においても同様な卓効がある。また、実施例にて数値
を限定して説明を行ったが、これらの数値は本発明の適
用範囲を限定するものではない。
第1図及び第2図は本発明の縦断面図、第3図は従来技
術の縦断面図である。 10.20.30・・・・・・単結晶Si基板、11゜
21・・・・・・n型ドープ層、12,22.32・・
・・・・5iOz膜、13.23・・・・・・Si選択
成長層、14・・・・・・多結晶Si側壁、15,25
.35・・・・・・W埋込み層。 代理人 弁理士 内 原 音 茅 ■ 茅 図
術の縦断面図である。 10.20.30・・・・・・単結晶Si基板、11゜
21・・・・・・n型ドープ層、12,22.32・・
・・・・5iOz膜、13.23・・・・・・Si選択
成長層、14・・・・・・多結晶Si側壁、15,25
.35・・・・・・W埋込み層。 代理人 弁理士 内 原 音 茅 ■ 茅 図
Claims (1)
- 単結晶半導体基板表面上に絶縁膜によって形成されたコ
ンタクトホールへ高融点金属を選択成長法によって埋込
む方法において、絶縁膜によるコンタクトホールを設け
る工程と、選択成長法によりシリコンをコンタクトホー
ル内へ選択的に成長させる工程と、高融点金属を選択成
長させることによりコンタクトホールを埋込む工程とを
含むことを特徴とする半導体装置の形成方法。
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP27977788A JPH02125615A (ja) | 1988-11-04 | 1988-11-04 | 半導体装置の形成方法 |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP27977788A JPH02125615A (ja) | 1988-11-04 | 1988-11-04 | 半導体装置の形成方法 |
Publications (1)
Publication Number | Publication Date |
---|---|
JPH02125615A true JPH02125615A (ja) | 1990-05-14 |
Family
ID=17615776
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP27977788A Pending JPH02125615A (ja) | 1988-11-04 | 1988-11-04 | 半導体装置の形成方法 |
Country Status (1)
Country | Link |
---|---|
JP (1) | JPH02125615A (ja) |
Cited By (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JP2005354029A (ja) * | 2004-06-09 | 2005-12-22 | Hynix Semiconductor Inc | 低いコンタクト抵抗を有する半導体素子及びその製造方法 |
-
1988
- 1988-11-04 JP JP27977788A patent/JPH02125615A/ja active Pending
Cited By (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JP2005354029A (ja) * | 2004-06-09 | 2005-12-22 | Hynix Semiconductor Inc | 低いコンタクト抵抗を有する半導体素子及びその製造方法 |
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