JPH02123774A - 超伝導素子用パッケージ - Google Patents
超伝導素子用パッケージInfo
- Publication number
- JPH02123774A JPH02123774A JP63276023A JP27602388A JPH02123774A JP H02123774 A JPH02123774 A JP H02123774A JP 63276023 A JP63276023 A JP 63276023A JP 27602388 A JP27602388 A JP 27602388A JP H02123774 A JPH02123774 A JP H02123774A
- Authority
- JP
- Japan
- Prior art keywords
- superconducting element
- film
- superconducting
- substrates
- insulating box
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Granted
Links
- 239000000758 substrate Substances 0.000 claims abstract description 40
- 239000004065 semiconductor Substances 0.000 claims abstract description 23
- 238000009413 insulation Methods 0.000 claims description 14
- 239000000919 ceramic Substances 0.000 description 24
- 239000010408 film Substances 0.000 description 16
- 239000007788 liquid Substances 0.000 description 7
- 229920001721 polyimide Polymers 0.000 description 7
- 239000010409 thin film Substances 0.000 description 4
- RYGMFSIKBFXOCR-UHFFFAOYSA-N Copper Chemical compound [Cu] RYGMFSIKBFXOCR-UHFFFAOYSA-N 0.000 description 3
- 229910052802 copper Inorganic materials 0.000 description 3
- 239000010949 copper Substances 0.000 description 3
- 238000004891 communication Methods 0.000 description 2
- 238000001816 cooling Methods 0.000 description 2
- 230000000694 effects Effects 0.000 description 2
- 238000000034 method Methods 0.000 description 2
- 241000255789 Bombyx mori Species 0.000 description 1
- 239000000853 adhesive Substances 0.000 description 1
- 230000001070 adhesive effect Effects 0.000 description 1
- 238000009833 condensation Methods 0.000 description 1
- 230000005494 condensation Effects 0.000 description 1
- 238000005516 engineering process Methods 0.000 description 1
- 229920006332 epoxy adhesive Polymers 0.000 description 1
- 238000005530 etching Methods 0.000 description 1
- 229910052734 helium Inorganic materials 0.000 description 1
- 239000001307 helium Substances 0.000 description 1
- SWQJXJOGLNCZEY-UHFFFAOYSA-N helium atom Chemical compound [He] SWQJXJOGLNCZEY-UHFFFAOYSA-N 0.000 description 1
- 238000010030 laminating Methods 0.000 description 1
- 230000000149 penetrating effect Effects 0.000 description 1
- 229910000679 solder Inorganic materials 0.000 description 1
Classifications
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L23/00—Details of semiconductor or other solid state devices
- H01L23/34—Arrangements for cooling, heating, ventilating or temperature compensation ; Temperature sensing arrangements
- H01L23/44—Arrangements for cooling, heating, ventilating or temperature compensation ; Temperature sensing arrangements the complete device being wholly immersed in a fluid other than air
- H01L23/445—Arrangements for cooling, heating, ventilating or temperature compensation ; Temperature sensing arrangements the complete device being wholly immersed in a fluid other than air the fluid being a liquefied gas, e.g. in a cryogenic vessel
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2224/00—Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
- H01L2224/01—Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
- H01L2224/42—Wire connectors; Manufacturing methods related thereto
- H01L2224/47—Structure, shape, material or disposition of the wire connectors after the connecting process
- H01L2224/48—Structure, shape, material or disposition of the wire connectors after the connecting process of an individual wire connector
- H01L2224/4805—Shape
- H01L2224/4809—Loop shape
- H01L2224/48091—Arched
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2224/00—Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
- H01L2224/01—Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
- H01L2224/42—Wire connectors; Manufacturing methods related thereto
- H01L2224/47—Structure, shape, material or disposition of the wire connectors after the connecting process
- H01L2224/48—Structure, shape, material or disposition of the wire connectors after the connecting process of an individual wire connector
- H01L2224/481—Disposition
- H01L2224/48151—Connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive
- H01L2224/48221—Connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive the body and the item being stacked
- H01L2224/48225—Connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive the body and the item being stacked the item being non-metallic, e.g. insulating substrate with or without metallisation
- H01L2224/48227—Connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive the body and the item being stacked the item being non-metallic, e.g. insulating substrate with or without metallisation connecting the wire to a bond pad of the item
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2924/00—Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
- H01L2924/30—Technical effects
- H01L2924/301—Electrical effects
- H01L2924/3011—Impedance
Landscapes
- Physics & Mathematics (AREA)
- Condensed Matter Physics & Semiconductors (AREA)
- General Physics & Mathematics (AREA)
- Engineering & Computer Science (AREA)
- Computer Hardware Design (AREA)
- Microelectronics & Electronic Packaging (AREA)
- Power Engineering (AREA)
- Containers, Films, And Cooling For Superconductive Devices (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
〔概要〕
寒剤で冷却することが必要な超伝導素子を実装するのに
好適なパッケージに関し、 超伝導素子の実装部分に対する半導体素子の実装部分か
らの熱流入を少なく、しかも、それ等の実装部分が至近
距離にあるようにし、高速性能を維持できるようにする
ことを目的とし、配線が形成されると共に超伝導素子が
実装される基板と、該基板の外方に設けられ且つ同じく
配線が形成されると共に半導体素子が実装される基板と
、それら基板間に在って配線を電気接続するフィルム・
ケーブルと、該フィルム・ケーブルが貫通し且つ前記超
伝導素子が実装される基板を覆う真空断熱筺体と を備えてなるよう構成する。
好適なパッケージに関し、 超伝導素子の実装部分に対する半導体素子の実装部分か
らの熱流入を少なく、しかも、それ等の実装部分が至近
距離にあるようにし、高速性能を維持できるようにする
ことを目的とし、配線が形成されると共に超伝導素子が
実装される基板と、該基板の外方に設けられ且つ同じく
配線が形成されると共に半導体素子が実装される基板と
、それら基板間に在って配線を電気接続するフィルム・
ケーブルと、該フィルム・ケーブルが貫通し且つ前記超
伝導素子が実装される基板を覆う真空断熱筺体と を備えてなるよう構成する。
本発明は、寒剤で冷却することが必要な超伝導素子を実
装するのに好適なパッケージに関する。
装するのに好適なパッケージに関する。
近年、例えばNbジョセフソン接合素子などの超伝導素
子を用いた集積回路装置が実現されつつある。
子を用いた集積回路装置が実現されつつある。
例えば、そのような超伝導素子を用いた論理回路は高速
で動作し、しかも、低消費電力である為、高速のプロセ
ッサを容易に実現することが可能である。
で動作し、しかも、低消費電力である為、高速のプロセ
ッサを容易に実現することが可能である。
このような高速のプロセッサが実現された場合、外部と
の信号の遺り取りについても高速性が要求され、これが
解決されなければ、プロセッサのみが高速化されても、
その利点を活かすことができない。
の信号の遺り取りについても高速性が要求され、これが
解決されなければ、プロセッサのみが高速化されても、
その利点を活かすことができない。
この問題を解決するには、超伝導素子を実装する為のパ
ッケージが重要な因子になる。
ッケージが重要な因子になる。
通常、超伝導素子を動作させるには、寒剤として液体ヘ
リウム(He)を用いることが多い。
リウム(He)を用いることが多い。
即ち、液体Heを収容したデューア瓶(Dewar
vessel)内に超伝導回路チップを浸漬し、同軸ケ
ーブルなどを利用し、室温雰囲気中にある他の機器と電
気的に接続するようにしている。
vessel)内に超伝導回路チップを浸漬し、同軸ケ
ーブルなどを利用し、室温雰囲気中にある他の機器と電
気的に接続するようにしている。
このような手段を採った場合、同軸ケーブルの長さとし
て、最短で1 〔m〕程度は必要であり、従って、伝播
遅延時間としては10(ns)程度になると見積もられ
、これでは、高速の、例えば1(ns)以下の超伝導回
路の運転は不可能である。
て、最短で1 〔m〕程度は必要であり、従って、伝播
遅延時間としては10(ns)程度になると見積もられ
、これでは、高速の、例えば1(ns)以下の超伝導回
路の運転は不可能である。
そこで、本発明者は、さきに超伝導回路を高速で運転す
ることを可能にする為のパッケージを提案した。
ることを可能にする為のパッケージを提案した。
第6図はそのパフケージを解説する為の要部切断側面図
を表している。
を表している。
図に於いて、1はセラミック基板、IAはセラミック基
板lに形成された貫通孔、2は上側真空断熱筺体、3は
下側真空断熱筺体、4は寒剤供給管、5は寒剤排出管、
6は超伝導素子、7は半導体素子、8はコネクタをそれ
ぞれ示している。
板lに形成された貫通孔、2は上側真空断熱筺体、3は
下側真空断熱筺体、4は寒剤供給管、5は寒剤排出管、
6は超伝導素子、7は半導体素子、8はコネクタをそれ
ぞれ示している。
図示の上側真空断熱筺体2或いは下側真空断熱筺体3は
デューア瓶構造になっていることは勿論である。
デューア瓶構造になっていることは勿論である。
このパッケージに依ると、超伝導素子6と外部の電子機
器の一部をなす室温動作の半導体素子7とは同一のセラ
ミック基板1上に近接して搭載され、そのセラミック基
+、!1に形成された配線に依って電気接続することが
可能であり、従って、伝播遅延時間に煩わされることな
く超伝導回路を高速運転できる。
器の一部をなす室温動作の半導体素子7とは同一のセラ
ミック基板1上に近接して搭載され、そのセラミック基
+、!1に形成された配線に依って電気接続することが
可能であり、従って、伝播遅延時間に煩わされることな
く超伝導回路を高速運転できる。
第6図に見られるパッケージを用いると、超伝導素子6
を良好な状態で高速運転できるが、液体He温度、即ち
、−269(’C)と室温とがセラミック基板1の横断
面を介して結ばれ、従って、室温側からの熱の流入はか
なりの量となる。その為、液体Heの消費量が多くなり
、それを供給する液化器として大型の冷凍機が必要であ
り、しかも、結露も多くなるから、それを除去する機構
も設けなければならない。
を良好な状態で高速運転できるが、液体He温度、即ち
、−269(’C)と室温とがセラミック基板1の横断
面を介して結ばれ、従って、室温側からの熱の流入はか
なりの量となる。その為、液体Heの消費量が多くなり
、それを供給する液化器として大型の冷凍機が必要であ
り、しかも、結露も多くなるから、それを除去する機構
も設けなければならない。
本発明は、超伝導素子の実装部分に対する半導体素子の
実装部分からの熱流入を少なく、しかも、それ等の実装
部分が至近距離にあるようにし、高速性能を維持できる
ようにする。
実装部分からの熱流入を少なく、しかも、それ等の実装
部分が至近距離にあるようにし、高速性能を維持できる
ようにする。
本発明に依る超伝導素子用パンケージに於いては、配線
が形成されると共に超伝導素子(例えば超伝導素子6)
が実装される基板(例えばセラミック基板12)と、該
基板の外方に設けられ且つ同じ(配線が形成されると共
に半導体素子(例えば半導体素子7)が実装される基板
(例えばセラミック基板11)と、それら基板間に在っ
て配線を電気接続するフィルム・ケーブル(例えばフィ
ルム・ケーフ゛ル13)と、言亥フィルム・ケーフ゛ル
が貫通し且つ前記超伝導素子が実装される基板を覆う真
空断熱筺体(例えば下側真空断熱筺体3と上側真空断熱
筺体2、或いは、下側真空断熱筺体3と真空断熱蓋板2
′)とを備えている。
が形成されると共に超伝導素子(例えば超伝導素子6)
が実装される基板(例えばセラミック基板12)と、該
基板の外方に設けられ且つ同じ(配線が形成されると共
に半導体素子(例えば半導体素子7)が実装される基板
(例えばセラミック基板11)と、それら基板間に在っ
て配線を電気接続するフィルム・ケーブル(例えばフィ
ルム・ケーフ゛ル13)と、言亥フィルム・ケーフ゛ル
が貫通し且つ前記超伝導素子が実装される基板を覆う真
空断熱筺体(例えば下側真空断熱筺体3と上側真空断熱
筺体2、或いは、下側真空断熱筺体3と真空断熱蓋板2
′)とを備えている。
前記手段を採ることに依り、下側真空断熱筺体及び上側
真空断熱筺体で覆われた領域と外部とは薄いフィルム・
ケーブルを介してのみ連絡されているので、半導体素子
が実装されている基板から前記領域内に流入する熱は少
なく、従って、寒剤の消費は少なくて済むので、寒剤が
液化Heなどである場合には液化器などが小型のもので
間に合うものである。
真空断熱筺体で覆われた領域と外部とは薄いフィルム・
ケーブルを介してのみ連絡されているので、半導体素子
が実装されている基板から前記領域内に流入する熱は少
なく、従って、寒剤の消費は少なくて済むので、寒剤が
液化Heなどである場合には液化器などが小型のもので
間に合うものである。
第1図は本発明一実施例の要部切断側面図、第2図はそ
の要部平面図をそれぞれ表し、第6図に於いて用いた記
号と同記号は同部分を示すか或いは同じ意味を持つもの
とする。
の要部平面図をそれぞれ表し、第6図に於いて用いた記
号と同記号は同部分を示すか或いは同じ意味を持つもの
とする。
図に於いて、3Aはセラミック基板を支持する為に下側
真空断熱筺体に形成された段部、11は半導体素子を実
装するセラミック基板、12は超伝導素子を実装するセ
ラミック基板、12Aはセラミック基板12に形成され
た貫通孔、工3はセラミック基板11と12を結ぶフィ
ルム・ケーブルをそれぞれ示している。
真空断熱筺体に形成された段部、11は半導体素子を実
装するセラミック基板、12は超伝導素子を実装するセ
ラミック基板、12Aはセラミック基板12に形成され
た貫通孔、工3はセラミック基板11と12を結ぶフィ
ルム・ケーブルをそれぞれ示している。
図から明らかなように、本実施例では、超伝導素子6が
実装されるセラミック基板1を覆う真空断熱筺体は第6
図に見られる従来例と同様、下側真空断熱筺体3と上側
真空断熱筺体2とに分割されていて、その間をフィルム
・ケーブル13が貫通するものであり、また、セラミッ
ク基板も11並びに12の二つに分けられていて、セラ
ミック基板11は室温状態で使われる半導体素子を実装
する部分であり、そして、セラミック基板12は液体H
e温度で使われる超伝導素子を実装する部分であって、
それ等の間はフィルム・ケーブル13で電気的に結合さ
れている。室温の半導体素子実装部分と液体He温度の
超伝導素子実装部分とを結んでいるのは薄いフィルム・
ケーブル13のみであるから、半導体装部分から超伝導
素子実装部分への熱の流入は少ない。
実装されるセラミック基板1を覆う真空断熱筺体は第6
図に見られる従来例と同様、下側真空断熱筺体3と上側
真空断熱筺体2とに分割されていて、その間をフィルム
・ケーブル13が貫通するものであり、また、セラミッ
ク基板も11並びに12の二つに分けられていて、セラ
ミック基板11は室温状態で使われる半導体素子を実装
する部分であり、そして、セラミック基板12は液体H
e温度で使われる超伝導素子を実装する部分であって、
それ等の間はフィルム・ケーブル13で電気的に結合さ
れている。室温の半導体素子実装部分と液体He温度の
超伝導素子実装部分とを結んでいるのは薄いフィルム・
ケーブル13のみであるから、半導体装部分から超伝導
素子実装部分への熱の流入は少ない。
第3図は第1図の一部を拡大して詳細に表した要部切断
側面図であり、第1図及び第2図に於いて用いた記号と
同記号は同部分を示すか或いは同じ意味を持つものとす
る。
側面図であり、第1図及び第2図に於いて用いた記号と
同記号は同部分を示すか或いは同じ意味を持つものとす
る。
図に於いて、13Aはポリイミド膜、13Bは信号線、
13Gはポリイミド膜、130は接地面、13Eはポリ
イミド膜、14は半田で接着した部分、15は接着剤を
それぞれ示している。
13Gはポリイミド膜、130は接地面、13Eはポリ
イミド膜、14は半田で接着した部分、15は接着剤を
それぞれ示している。
図から判るように、フィルム・ケーブル13はポリイミ
ド膜13A、信号線13B・・・・を積層して構成され
ている。
ド膜13A、信号線13B・・・・を積層して構成され
ている。
このフィルム・ケーブル13は基本的にはポリイミド膜
及び銅の薄板から構成されていて、信号線13Bは銅の
薄板をエツチングして形成するものであり、ストリップ
・ライン構造、コプレーナ構造など高速の信号を伝播さ
せるのに好都合な構成を採ることが可能であり、例えば 厚さ;35 〔μm〕 幅:150(μm〕 とし、そして、接地面13Dとの間にあるポリイミド膜
13Cの厚さを25 〔μm〕とすると特性インピーダ
ンス50 〔Ω〕を実現することができる。また、接地
面13Dはポリイミド膜を貫通するスルー・ホールを介
してセラミック基板11或いは12上に形成された配線
と半田接着部分14を介して接続される。接地面13D
を構成する銅の薄板に於ける厚さは適当で良いが、薄い
方が熱の流入を抑止する面で好ましく、例えば10(μ
m〕程度にすると良い、このような諸条件の下に於いて
は、フィルム・ケーブル13全体の厚さは約0.1
(n)程度となり、第6図について説明した従来例に於
けるセラミック基板1の厚さが約2 (1m)程度であ
ったのに比較すると約1/20であって単純には熱の流
入量も1/20となるから寒剤、即ち、液体Heの消費
は大幅に低減される。
及び銅の薄板から構成されていて、信号線13Bは銅の
薄板をエツチングして形成するものであり、ストリップ
・ライン構造、コプレーナ構造など高速の信号を伝播さ
せるのに好都合な構成を採ることが可能であり、例えば 厚さ;35 〔μm〕 幅:150(μm〕 とし、そして、接地面13Dとの間にあるポリイミド膜
13Cの厚さを25 〔μm〕とすると特性インピーダ
ンス50 〔Ω〕を実現することができる。また、接地
面13Dはポリイミド膜を貫通するスルー・ホールを介
してセラミック基板11或いは12上に形成された配線
と半田接着部分14を介して接続される。接地面13D
を構成する銅の薄板に於ける厚さは適当で良いが、薄い
方が熱の流入を抑止する面で好ましく、例えば10(μ
m〕程度にすると良い、このような諸条件の下に於いて
は、フィルム・ケーブル13全体の厚さは約0.1
(n)程度となり、第6図について説明した従来例に於
けるセラミック基板1の厚さが約2 (1m)程度であ
ったのに比較すると約1/20であって単純には熱の流
入量も1/20となるから寒剤、即ち、液体Heの消費
は大幅に低減される。
第4図は本発明に於ける他の実施例の要部切断側面図、
第5図は第4図の一部を拡大して詳細に表した要部切断
側面図であり、第1図乃至第3図及び第6図に於いて用
いた記号と同記号は同部分を示すか或いは同じ意味を持
つものとする。
第5図は第4図の一部を拡大して詳細に表した要部切断
側面図であり、第1図乃至第3図及び第6図に於いて用
いた記号と同記号は同部分を示すか或いは同じ意味を持
つものとする。
本実施例が第1図乃至第3図について説明した実施例と
相違する点は、真空断熱筺体が深く形成された下側真空
断熱筺体3並びにそれを覆う真空断熱蓋板2′からなっ
ていて、フィルム・ケーブル13は下側真空断熱筺体3
の側壁に設けられたスリットを貫通するように設けられ
ていることである。
相違する点は、真空断熱筺体が深く形成された下側真空
断熱筺体3並びにそれを覆う真空断熱蓋板2′からなっ
ていて、フィルム・ケーブル13は下側真空断熱筺体3
の側壁に設けられたスリットを貫通するように設けられ
ていることである。
フィルム・ケーブル13が貫通するスリットに於いて真
空を維持するには、エポキシ系の接着剤15を用いて下
側真空断熱筺体3とフィルム・ケーブル13とを一体的
に接着することが必要である。
空を維持するには、エポキシ系の接着剤15を用いて下
側真空断熱筺体3とフィルム・ケーブル13とを一体的
に接着することが必要である。
本実施例に依ると、下側真空断熱筺体3と真空断熱蓋板
2′との衝合部分は寒剤の表面よりも上方にすることが
可能であるから、その消費を更にに低減することが可能
である。
2′との衝合部分は寒剤の表面よりも上方にすることが
可能であるから、その消費を更にに低減することが可能
である。
本発明に依る超伝導素子用パッケージに於いては、例え
ば液体He温度に冷却された超伝導素子の実装部分と室
温の状態にある半導体素子の実装部分とは至近距離に在
って、且つ、薄いフィルム・ケーブルでのみ連絡されて
いる。
ば液体He温度に冷却された超伝導素子の実装部分と室
温の状態にある半導体素子の実装部分とは至近距離に在
って、且つ、薄いフィルム・ケーブルでのみ連絡されて
いる。
前記構成を採ることに依り、下側真空断熱筺体及び上側
真空断熱筺体で覆われた領域と外部とは薄いフィルム・
ケーブルを介してのみ連絡されているので、半導体素子
が実装されている基板から前記領域内に流入する熱は少
なく、従って、寒剤の消費は少なくて済むので、寒剤が
液化Heなどである場合には液化器などが小型のもので
間に合い、また、超伝導素子と半導体素子とは近接して
配置することができるから、信号の伝播遅延は無視して
良く、従って、超伝導素子の高速運転が可能である。
真空断熱筺体で覆われた領域と外部とは薄いフィルム・
ケーブルを介してのみ連絡されているので、半導体素子
が実装されている基板から前記領域内に流入する熱は少
なく、従って、寒剤の消費は少なくて済むので、寒剤が
液化Heなどである場合には液化器などが小型のもので
間に合い、また、超伝導素子と半導体素子とは近接して
配置することができるから、信号の伝播遅延は無視して
良く、従って、超伝導素子の高速運転が可能である。
第1図は本発明一実施例の要部切断側面図、第2図は第
1図に見られる実施例の要部平面図、第3図は第1図に
見られる実施例の一部を拡大且つ詳細にした要部切断側
面図、第4図は本発明に於ける他の実施例の要部切断側
面図、第5図は第4図に見られる実施例の一部を拡大且
つ詳細にした要部切断側面図、第6図は従来例の要部切
断側面図をそれぞれ表している。 図に於いて、1はセラミック基板、IAは貫通孔、2は
上側真空断熱筺体、3は下側真空断熱筺体、3Aはセラ
ミック基板を支持する為に下側真空断熱筺体に形成され
た段部、4は寒剤供給管、5は寒剤排出管、6は超伝導
素子、7は半導体素子、8はコネクタ、11は半導体素
子を実装するセラミック基板、12は超伝導素子を実装
するセラミック基板、12Aはセラミック基板12に形
成された貫通孔、13はセラミック基板11及び12を
結ぶフィルム・ケーブルをそれぞれ示している。 本発明一実施例の要部切断側面図 第 図 第1囚に見られる実施例の要部平面図 第2図 拡大且つ詳細にした蚕部切断側面図 第3図 本発明に於()る他の実施例の要部切断側面図第4図 従来例の要部切断側面図 第6図
1図に見られる実施例の要部平面図、第3図は第1図に
見られる実施例の一部を拡大且つ詳細にした要部切断側
面図、第4図は本発明に於ける他の実施例の要部切断側
面図、第5図は第4図に見られる実施例の一部を拡大且
つ詳細にした要部切断側面図、第6図は従来例の要部切
断側面図をそれぞれ表している。 図に於いて、1はセラミック基板、IAは貫通孔、2は
上側真空断熱筺体、3は下側真空断熱筺体、3Aはセラ
ミック基板を支持する為に下側真空断熱筺体に形成され
た段部、4は寒剤供給管、5は寒剤排出管、6は超伝導
素子、7は半導体素子、8はコネクタ、11は半導体素
子を実装するセラミック基板、12は超伝導素子を実装
するセラミック基板、12Aはセラミック基板12に形
成された貫通孔、13はセラミック基板11及び12を
結ぶフィルム・ケーブルをそれぞれ示している。 本発明一実施例の要部切断側面図 第 図 第1囚に見られる実施例の要部平面図 第2図 拡大且つ詳細にした蚕部切断側面図 第3図 本発明に於()る他の実施例の要部切断側面図第4図 従来例の要部切断側面図 第6図
Claims (1)
- 【特許請求の範囲】 配線が形成されると共に超伝導素子が実装される基板
と、 該基板の外方に設けられ且つ同じく配線が形成されると
共に半導体素子が実装される基板と、それら基板間に在
って配線を電気接続するフィルム・ケーブルと、 該フィルム・ケーブルが貫通し且つ前記超伝導素子が実
装される基板を覆う真空断熱筺体とを備えてなることを
特徴とする超伝導素子用パッケージ。
Priority Applications (4)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP63276023A JP2681288B2 (ja) | 1988-11-02 | 1988-11-02 | 超伝導素子用パッケージ |
US07/428,673 US4980754A (en) | 1988-11-02 | 1989-10-30 | Package for superconducting devices |
EP89311436A EP0367630B1 (en) | 1988-11-02 | 1989-11-02 | Package for electronic devices operating at different respective temperatures |
DE68925939T DE68925939T2 (de) | 1988-11-02 | 1989-11-02 | Packung für elektronische Anordnungen zum Betrieb bei verschiedenen jeweiligen Temperaturen |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP63276023A JP2681288B2 (ja) | 1988-11-02 | 1988-11-02 | 超伝導素子用パッケージ |
Publications (2)
Publication Number | Publication Date |
---|---|
JPH02123774A true JPH02123774A (ja) | 1990-05-11 |
JP2681288B2 JP2681288B2 (ja) | 1997-11-26 |
Family
ID=17563717
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP63276023A Expired - Lifetime JP2681288B2 (ja) | 1988-11-02 | 1988-11-02 | 超伝導素子用パッケージ |
Country Status (4)
Country | Link |
---|---|
US (1) | US4980754A (ja) |
EP (1) | EP0367630B1 (ja) |
JP (1) | JP2681288B2 (ja) |
DE (1) | DE68925939T2 (ja) |
Cited By (3)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
US5349291A (en) * | 1992-06-23 | 1994-09-20 | Fujitsu Limited | Superconducting magnetic sensor having a cryostat for improved sensitivity of magnetic detection |
US5861574A (en) * | 1993-04-14 | 1999-01-19 | Fujitsu Limited | Apparatus for mounting a superconducting element |
JP2004508732A (ja) * | 2000-09-07 | 2004-03-18 | イー・アイ・デュポン・ドウ・ヌムール・アンド・カンパニー | 極低温装置 |
Families Citing this family (27)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPH0710005B2 (ja) * | 1989-08-31 | 1995-02-01 | アメリカン テレフォン アンド テレグラフ カムパニー | 超伝導体相互接続装置 |
US5126830A (en) * | 1989-10-31 | 1992-06-30 | General Electric Company | Cryogenic semiconductor power devices |
US5247189A (en) * | 1989-11-15 | 1993-09-21 | Sumitomo Electric Industries, Ltd. | Superconducting device composed of oxide superconductor material |
US5121292A (en) * | 1990-01-23 | 1992-06-09 | International Business Machines Corporation | Field replaceable cryocooled computer logic unit |
US5212626A (en) * | 1990-11-09 | 1993-05-18 | International Business Machines Corporation | Electronic packaging and cooling system using superconductors for power distribution |
CA2088821C (en) * | 1992-02-05 | 1999-09-07 | Hironobu Ikeda | Cooling structure for integrated circuit |
US5474834A (en) * | 1992-03-09 | 1995-12-12 | Kyocera Corporation | Superconducting circuit sub-assembly having an oxygen shielding barrier layer |
US5436793A (en) * | 1993-03-31 | 1995-07-25 | Ncr Corporation | Apparatus for containing and cooling an integrated circuit device having a thermally insulative positioning member |
JPH06350146A (ja) * | 1993-06-14 | 1994-12-22 | Sharp Corp | 超電導装置 |
JP2953273B2 (ja) * | 1993-10-22 | 1999-09-27 | 住友電気工業株式会社 | 低温に冷却する素子の接続方法 |
US5448108A (en) * | 1993-11-02 | 1995-09-05 | Hughes Aircraft Company | Cooling of semiconductor power modules by flushing with dielectric liquid |
US5789704A (en) * | 1995-12-06 | 1998-08-04 | Sumitomo Wiring Systems, Ltd. | Container with heat removing features for containing an electronic contol unit |
US6188358B1 (en) * | 1997-10-20 | 2001-02-13 | Infrared Components Corporation | Antenna signal conduit for different temperature and pressure environments |
US6434000B1 (en) * | 1998-12-03 | 2002-08-13 | Iv Phoenix Group, Inc. | Environmental system for rugged disk drive |
US7335965B2 (en) | 1999-08-25 | 2008-02-26 | Micron Technology, Inc. | Packaging of electronic chips with air-bridge structures |
JP2001093821A (ja) * | 1999-09-24 | 2001-04-06 | Toshiba Corp | 製造装置組立部品、製造装置組立部品の製造方法、半導体製造装置及び電子ビーム露光装置 |
DE60036227T2 (de) * | 2000-01-31 | 2008-05-21 | Fujitsu Ltd., Kawasaki | Wärmeisolierte signalübertragungseinheit und supraleitende signalübertragungsvorrichtung |
US6744136B2 (en) * | 2001-10-29 | 2004-06-01 | International Rectifier Corporation | Sealed liquid cooled electronic device |
US7300821B2 (en) * | 2004-08-31 | 2007-11-27 | Micron Technology, Inc. | Integrated circuit cooling and insulating device and method |
US7202562B2 (en) * | 2004-12-02 | 2007-04-10 | Micron Technology, Inc. | Integrated circuit cooling system and method |
US20060274502A1 (en) * | 2005-06-01 | 2006-12-07 | Rapp Robert J | Electronic package whereby an electronic assembly is packaged within an enclosure that is designed to act as a heat pipe |
DE102014013958B4 (de) * | 2014-09-19 | 2017-06-08 | Audi Ag | Kühlanordnung für ein Kraftfahrzeugsteuergerät, Kraftfahrzeug und Kraftfahrzeugsteuergerät |
US9524470B1 (en) * | 2015-06-12 | 2016-12-20 | International Business Machines Corporation | Modular array of vertically integrated superconducting qubit devices for scalable quantum computing |
US9702906B2 (en) * | 2015-06-26 | 2017-07-11 | International Business Machines Corporation | Non-permanent termination structure for microprobe measurements |
US10390455B2 (en) * | 2017-03-27 | 2019-08-20 | Raytheon Company | Thermal isolation of cryo-cooled components from circuit boards or other structures |
US11159127B2 (en) | 2019-04-30 | 2021-10-26 | Quantum Opus, LLC | Noise suppressing interface circuit for device with control circuits in different noise environments |
US11917794B2 (en) * | 2020-10-30 | 2024-02-27 | Advanced Micro Devices, Inc. | Separating temperature domains in cooled systems |
Citations (2)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPS6262460U (ja) * | 1985-10-07 | 1987-04-17 | ||
JPS6262461U (ja) * | 1985-10-07 | 1987-04-17 |
Family Cites Families (6)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
US4245273A (en) * | 1979-06-29 | 1981-01-13 | International Business Machines Corporation | Package for mounting and interconnecting a plurality of large scale integrated semiconductor devices |
JPS59144190A (ja) * | 1983-02-08 | 1984-08-18 | Agency Of Ind Science & Technol | 超伝導回路用実装基板 |
EP0213421A3 (en) * | 1985-08-07 | 1989-02-22 | Honeywell Inc. | Infrared detector assembly having vacuum chambers |
DE3680774D1 (de) * | 1985-12-16 | 1991-09-12 | Hitachi Ltd | Integriertes halbleiterbauelement. |
US4734820A (en) * | 1987-04-16 | 1988-03-29 | Ncr Corporation | Cryogenic packaging scheme |
US4805420A (en) * | 1987-06-22 | 1989-02-21 | Ncr Corporation | Cryogenic vessel for cooling electronic components |
-
1988
- 1988-11-02 JP JP63276023A patent/JP2681288B2/ja not_active Expired - Lifetime
-
1989
- 1989-10-30 US US07/428,673 patent/US4980754A/en not_active Expired - Lifetime
- 1989-11-02 DE DE68925939T patent/DE68925939T2/de not_active Expired - Fee Related
- 1989-11-02 EP EP89311436A patent/EP0367630B1/en not_active Expired - Lifetime
Patent Citations (2)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPS6262460U (ja) * | 1985-10-07 | 1987-04-17 | ||
JPS6262461U (ja) * | 1985-10-07 | 1987-04-17 |
Cited By (3)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
US5349291A (en) * | 1992-06-23 | 1994-09-20 | Fujitsu Limited | Superconducting magnetic sensor having a cryostat for improved sensitivity of magnetic detection |
US5861574A (en) * | 1993-04-14 | 1999-01-19 | Fujitsu Limited | Apparatus for mounting a superconducting element |
JP2004508732A (ja) * | 2000-09-07 | 2004-03-18 | イー・アイ・デュポン・ドウ・ヌムール・アンド・カンパニー | 極低温装置 |
Also Published As
Publication number | Publication date |
---|---|
DE68925939T2 (de) | 1996-08-08 |
DE68925939D1 (de) | 1996-04-18 |
EP0367630B1 (en) | 1996-03-13 |
EP0367630A1 (en) | 1990-05-09 |
US4980754A (en) | 1990-12-25 |
JP2681288B2 (ja) | 1997-11-26 |
Similar Documents
Publication | Publication Date | Title |
---|---|---|
JPH02123774A (ja) | 超伝導素子用パッケージ | |
US10734696B2 (en) | Connecting electrical circuitry in a quantum computing system | |
EP0343400B1 (en) | Electronic package assembly with flexible carrier and method of making it | |
US6440770B1 (en) | Integrated circuit package | |
US4941067A (en) | Thermal shunt for electronic circuits | |
SE514426C2 (sv) | Anordning för chipmontering i kavitet i flerlagers mönsterkort | |
JPS5975687A (ja) | 低温で動作するサンプリング装置を用いた試験装置 | |
US7593235B2 (en) | Thermal conduit | |
JPH0391973A (ja) | 超伝導体相互接続装置 | |
US6031283A (en) | Integrated circuit package | |
US5966803A (en) | Ball grid array having no through holes or via interconnections | |
US4996588A (en) | Device for interconnection and protection of a bare microwave component chip | |
JPS61114562A (ja) | マイクロ波用チツプキヤリヤ | |
KR100771262B1 (ko) | 고전력 애플리케이션에 사용하기 위한 다중칩 모듈 | |
US11678433B2 (en) | Printed circuit board assembly for edge-coupling to an integrated circuit | |
JPH05335475A (ja) | 回路チップ実装装置 | |
JP3176381B2 (ja) | 多層フィルムケーブル及びこれを用いた超伝導素子搭載装置 | |
JPH11251516A (ja) | 半導体モジュール | |
JPH0513610A (ja) | 半導体集積回路チツプ実装用基板 | |
US20210398893A1 (en) | Quantum device | |
JPH0325420Y2 (ja) | ||
JP2649251B2 (ja) | 電子部品搭載用基板 | |
JP3176382B2 (ja) | 超伝導素子搭載装置用フィルムケーブル | |
KR100334230B1 (ko) | 반도체장치 | |
JPH04355979A (ja) | 超伝導素子搭載用回路基板及びその製造方法 |