JPH0196994A - 電子部品の表面実装方法 - Google Patents
電子部品の表面実装方法Info
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- JPH0196994A JPH0196994A JP25537187A JP25537187A JPH0196994A JP H0196994 A JPH0196994 A JP H0196994A JP 25537187 A JP25537187 A JP 25537187A JP 25537187 A JP25537187 A JP 25537187A JP H0196994 A JPH0196994 A JP H0196994A
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- Japan
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- solder
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- Pending
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Classifications
-
- H—ELECTRICITY
- H05—ELECTRIC TECHNIQUES NOT OTHERWISE PROVIDED FOR
- H05K—PRINTED CIRCUITS; CASINGS OR CONSTRUCTIONAL DETAILS OF ELECTRIC APPARATUS; MANUFACTURE OF ASSEMBLAGES OF ELECTRICAL COMPONENTS
- H05K3/00—Apparatus or processes for manufacturing printed circuits
- H05K3/30—Assembling printed circuits with electric components, e.g. with resistor
- H05K3/32—Assembling printed circuits with electric components, e.g. with resistor electrically connecting electric components or wires to printed circuits
- H05K3/34—Assembling printed circuits with electric components, e.g. with resistor electrically connecting electric components or wires to printed circuits by soldering
- H05K3/341—Surface mounted components
- H05K3/3421—Leaded components
-
- H—ELECTRICITY
- H05—ELECTRIC TECHNIQUES NOT OTHERWISE PROVIDED FOR
- H05K—PRINTED CIRCUITS; CASINGS OR CONSTRUCTIONAL DETAILS OF ELECTRIC APPARATUS; MANUFACTURE OF ASSEMBLAGES OF ELECTRICAL COMPONENTS
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- H05K3/34—Assembling printed circuits with electric components, e.g. with resistor electrically connecting electric components or wires to printed circuits by soldering
- H05K3/3457—Solder materials or compositions; Methods of application thereof
Landscapes
- Electric Connection Of Electric Components To Printed Circuits (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
〔産業上の利用分野〕
本発明は、例えば半導体装置等の電子部品を印刷配線板
上に実装する場合に使用する電子部品の表面実装方法に
関する。
上に実装する場合に使用する電子部品の表面実装方法に
関する。
従来、この種電子部品の表面実装方法は第2図(alお
よび(blに示す手順を経て行われている。すなわち、
先ず印刷配線板1のランド2上に半田ペースト3を塗布
し、次にこの半田ペースト3上に半導体装置4を同図(
a)に示すように載置し、これをリフロー(再溶融)に
よって同図(b)に示すように印刷配線板l上に実装す
るのである。
よび(blに示す手順を経て行われている。すなわち、
先ず印刷配線板1のランド2上に半田ペースト3を塗布
し、次にこの半田ペースト3上に半導体装置4を同図(
a)に示すように載置し、これをリフロー(再溶融)に
よって同図(b)に示すように印刷配線板l上に実装す
るのである。
ところで、従来の電子部品の表面実装方法においては、
印刷配線板1のランド2上に半田ペースト3を塗布する
作業を必要とするものであり、このため実装時には塗布
装置(図示せず)のみならず、印刷配線板1のランド2
以外の部分を覆うマスク(図示せず)を用意しなければ
ならず、この治具および装置の管理を煩雑にし、コスト
高になるという問題があった。
印刷配線板1のランド2上に半田ペースト3を塗布する
作業を必要とするものであり、このため実装時には塗布
装置(図示せず)のみならず、印刷配線板1のランド2
以外の部分を覆うマスク(図示せず)を用意しなければ
ならず、この治具および装置の管理を煩雑にし、コスト
高になるという問題があった。
本発明はこのような事情に鑑みなされたもので、印刷配
線板のランドに半田ペーストを塗布する場合に使用する
塗布装置およびマスクを不要にし、もってコストの低廉
化を図ることができる電子部品の表面実装方法を提供す
るものである。
線板のランドに半田ペーストを塗布する場合に使用する
塗布装置およびマスクを不要にし、もってコストの低廉
化を図ることができる電子部品の表面実装方法を提供す
るものである。
リフローによって印刷配線板のランド上に電子部品を実
装する方法であって、ランドに印刷配線板の形成時に半
田めっき処理を施すものである。
装する方法であって、ランドに印刷配線板の形成時に半
田めっき処理を施すものである。
本発明においては、電子部品を印刷配線板上に実装する
に際してランドへの半田ペースト塗布作業が不要になる
。
に際してランドへの半田ペースト塗布作業が不要になる
。
第1図(a)および(blは本発明に係る電子部品の表
面実装方法の手順を示す断面図で、同図において第2図
(a)および(b)と同一の部材については同一の符号
を付し、詳細な説明は省略する。同図において、符号1
1で示すものは錫成分が例えば50〜70%を含有する
半田めっき部で、前記ランド2上に設けられており、厚
さが10μm以上の寸法に設定されている。
面実装方法の手順を示す断面図で、同図において第2図
(a)および(b)と同一の部材については同一の符号
を付し、詳細な説明は省略する。同図において、符号1
1で示すものは錫成分が例えば50〜70%を含有する
半田めっき部で、前記ランド2上に設けられており、厚
さが10μm以上の寸法に設定されている。
次に、本発明による電子部品の表面実装方法について説
明する。
明する。
先ず、印刷配線板1のランド2上に半導体装置4を第1
図(a)に示すように載置する。このとき、ランド2上
には半田めっき処理によって10μmの厚さをもつ半田
めっき部11が形成されている。
図(a)に示すように載置する。このとき、ランド2上
には半田めっき処理によって10μmの厚さをもつ半田
めっき部11が形成されている。
次に、リフロー(再溶融)によって同図(b)に示すよ
うに印刷配線板1上に半導体装置4を実装する。
うに印刷配線板1上に半導体装置4を実装する。
すなわち、本発明においては、リフローによって印刷配
線板1のランド2上に半導体装置4を実装する以前の印
刷配線板1の形成時(銅めっき後)にランド2に厚づけ
の半田めっき処理を施すのである。
線板1のランド2上に半導体装置4を実装する以前の印
刷配線板1の形成時(銅めっき後)にランド2に厚づけ
の半田めっき処理を施すのである。
したがって、印刷配線板1上に半導体装置4を実装する
に際して従来必要としたランド2への半田ペース塗布作
業が不要になるから、実装時には塗布装置゛(図示せず
)やマスク(図示せず)が不要になる。
に際して従来必要としたランド2への半田ペース塗布作
業が不要になるから、実装時には塗布装置゛(図示せず
)やマスク(図示せず)が不要になる。
なお、本実施例においては、印刷配線板1上に半導体装
置4を実装する場合に適用する例を示したが、本発明は
これに限定適用されるものではなく、例えば抵抗素子等
の電子部品でもよく、他の電子部品を実装する場合でも
実施例と同様に適用することができる。
置4を実装する場合に適用する例を示したが、本発明は
これに限定適用されるものではなく、例えば抵抗素子等
の電子部品でもよく、他の電子部品を実装する場合でも
実施例と同様に適用することができる。
以上説明したように本発明によれば、リフローによって
印刷配線板のランド上に電子部品を実装する方法であっ
て、ランドに印刷配線板の形成時に半田めっき処理を施
すので、電子部品を印刷配線板上に実装するに際し従来
必要としたランドへのペースト塗布作業が不要になる。
印刷配線板のランド上に電子部品を実装する方法であっ
て、ランドに印刷配線板の形成時に半田めっき処理を施
すので、電子部品を印刷配線板上に実装するに際し従来
必要としたランドへのペースト塗布作業が不要になる。
したがって、実装時には塗布装置やマスクが不要になる
から、電子部品の実装コストの低廉化を図ることができ
る。
から、電子部品の実装コストの低廉化を図ることができ
る。
第1図fa)および(b)は本発明に係る電子部品の表
面実装方法の手順を示す断面図、第2図(alおよび(
b)は従来の電子部品の表面実装方法の手順を示す断面
図である。 1・・・・印刷配線板、2・・・・ランド、4・・・・
半導体装置、11・・・・半田めっき部。 代 理 人 大 岩 増 雄 第1図 1;印刷択綿裁 2、う゛7トー 4、半導イ本荻1 11゛半田め、き郭
面実装方法の手順を示す断面図、第2図(alおよび(
b)は従来の電子部品の表面実装方法の手順を示す断面
図である。 1・・・・印刷配線板、2・・・・ランド、4・・・・
半導体装置、11・・・・半田めっき部。 代 理 人 大 岩 増 雄 第1図 1;印刷択綿裁 2、う゛7トー 4、半導イ本荻1 11゛半田め、き郭
Claims (1)
- リフローによって印刷配線板のランド上に電子部品を
実装する方法であって、前記ランドに印刷配線板の形成
時に半田めっき処理を施すことを特徴とする電子部品の
表面実装方法。
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP25537187A JPH0196994A (ja) | 1987-10-09 | 1987-10-09 | 電子部品の表面実装方法 |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP25537187A JPH0196994A (ja) | 1987-10-09 | 1987-10-09 | 電子部品の表面実装方法 |
Publications (1)
Publication Number | Publication Date |
---|---|
JPH0196994A true JPH0196994A (ja) | 1989-04-14 |
Family
ID=17277840
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP25537187A Pending JPH0196994A (ja) | 1987-10-09 | 1987-10-09 | 電子部品の表面実装方法 |
Country Status (1)
Country | Link |
---|---|
JP (1) | JPH0196994A (ja) |
-
1987
- 1987-10-09 JP JP25537187A patent/JPH0196994A/ja active Pending
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