JPH0151839B2 - - Google Patents
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- JPH0151839B2 JPH0151839B2 JP53013505A JP1350578A JPH0151839B2 JP H0151839 B2 JPH0151839 B2 JP H0151839B2 JP 53013505 A JP53013505 A JP 53013505A JP 1350578 A JP1350578 A JP 1350578A JP H0151839 B2 JPH0151839 B2 JP H0151839B2
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- parallel
- circuit
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- 239000011159 matrix material Substances 0.000 claims description 24
- 238000006243 chemical reaction Methods 0.000 claims description 16
- 230000015654 memory Effects 0.000 claims description 12
- 230000007274 generation of a signal involved in cell-cell signaling Effects 0.000 claims description 2
- 230000002457 bidirectional effect Effects 0.000 description 6
- 230000006870 function Effects 0.000 description 6
- 239000004973 liquid crystal related substance Substances 0.000 description 4
- 238000000034 method Methods 0.000 description 4
- 238000010586 diagram Methods 0.000 description 3
- 238000012935 Averaging Methods 0.000 description 1
- 239000013256 coordination polymer Substances 0.000 description 1
- 230000000630 rising effect Effects 0.000 description 1
Landscapes
- Shift Register Type Memory (AREA)
- Liquid Crystal Display Device Control (AREA)
- Devices For Indicating Variable Information By Combining Individual Elements (AREA)
- Digital Computer Display Output (AREA)
Description
【発明の詳細な説明】
本発明は、マトリクスパネル駆動装置及びマト
リクス表示装置に係り、特に融通性を持たせたマ
トリクスパネル駆動装置及びマトリクス表示装置
に関する。
リクス表示装置に係り、特に融通性を持たせたマ
トリクスパネル駆動装置及びマトリクス表示装置
に関する。
液晶マトリクス・パネル上に文字、数字等を表
示する装置を第１図に示す。液晶マトリクス駆動
では、線順次走査方式が採用されており、また明
るさを均一にするために電圧平均化法という駆動
法が用いられている。第１図は、この駆動法を実
現するための構成を示したものである。パネル上
に文字、数字を表示するためには、パターン信号
発生回路５で発生したパターン信号を直・並列変
換回路４で並列信号に変換した後にラインメモリ
３を経て駆動回路２に加え、ここで駆動電圧を発
生させる。また、走査回路１で発生した走査信号
を駆動回路２に加えて、駆動電圧を発生させる。
このような装置において、走査回路１及び直・並
列変換回路４は、同一構成とすることができる。
この時の回路を第２図に示す。図に示すように回
路は、フリツプ・フロツプを多段（この例では４
ａ〜４ｅ）接続した構成となつている。各フリツ
プ・フロツプ４ａ〜４ｅの出力Ｑから走査信号及
び表示信号を得る。第３図は、直・並換回路４を
含むラインメモリ３、駆動回路２の回路構成を示
す。この時の動作を第４図に示す。パターン信号
SIGをフリツプ・フロツプ４ａのデータ入力端子
Ｄに加え、またシフトクロツク信号CPIをクロツ
ク端子CPに加えることによりパターン信号SIG
は、信号CPIに同期して取り込まれていく。ここ
で、１ライン分のパターン信号が取り込まれた後
にラインメモリ３にラツチ信号LAを加えるとそ
の時の各フリツプ・フロツプ４ａ〜４ｅの出力
S1〜S5の情報が記憶される。このように、ライ
ンメモリの内容は、一定時間で書き改められてい
く。この時、ラインメモリ３の出力L1〜L5にお
いてL5は時間t5の時のパターン信号SIGの状態を
示し以下L4、L3、L2、L1は、それぞれ時間t4、
t3、t2、t1での状態を示している。すなわち、パ
ターン信号SIGは、シフトクロツク信号CP1によ
り４ａ，４ｂ，…の順で右シフトされていくため
である。以上述べたように従来用いていた直・並
列変換回路４のシフト機能は１方向のみである。
ここで、駆動回路２の出力VY1〜VY5を信号電極
Y1〜Y5に接続し、決められたパターンをパネル
上に表示する場合、直・並列変換回路４のシフト
方向が１方向のために、パターン信号の入力順序
が限定される。
示する装置を第１図に示す。液晶マトリクス駆動
では、線順次走査方式が採用されており、また明
るさを均一にするために電圧平均化法という駆動
法が用いられている。第１図は、この駆動法を実
現するための構成を示したものである。パネル上
に文字、数字を表示するためには、パターン信号
発生回路５で発生したパターン信号を直・並列変
換回路４で並列信号に変換した後にラインメモリ
３を経て駆動回路２に加え、ここで駆動電圧を発
生させる。また、走査回路１で発生した走査信号
を駆動回路２に加えて、駆動電圧を発生させる。
このような装置において、走査回路１及び直・並
列変換回路４は、同一構成とすることができる。
この時の回路を第２図に示す。図に示すように回
路は、フリツプ・フロツプを多段（この例では４
ａ〜４ｅ）接続した構成となつている。各フリツ
プ・フロツプ４ａ〜４ｅの出力Ｑから走査信号及
び表示信号を得る。第３図は、直・並換回路４を
含むラインメモリ３、駆動回路２の回路構成を示
す。この時の動作を第４図に示す。パターン信号
SIGをフリツプ・フロツプ４ａのデータ入力端子
Ｄに加え、またシフトクロツク信号CPIをクロツ
ク端子CPに加えることによりパターン信号SIG
は、信号CPIに同期して取り込まれていく。ここ
で、１ライン分のパターン信号が取り込まれた後
にラインメモリ３にラツチ信号LAを加えるとそ
の時の各フリツプ・フロツプ４ａ〜４ｅの出力
S1〜S5の情報が記憶される。このように、ライ
ンメモリの内容は、一定時間で書き改められてい
く。この時、ラインメモリ３の出力L1〜L5にお
いてL5は時間t5の時のパターン信号SIGの状態を
示し以下L4、L3、L2、L1は、それぞれ時間t4、
t3、t2、t1での状態を示している。すなわち、パ
ターン信号SIGは、シフトクロツク信号CP1によ
り４ａ，４ｂ，…の順で右シフトされていくため
である。以上述べたように従来用いていた直・並
列変換回路４のシフト機能は１方向のみである。
ここで、駆動回路２の出力VY1〜VY5を信号電極
Y1〜Y5に接続し、決められたパターンをパネル
上に表示する場合、直・並列変換回路４のシフト
方向が１方向のために、パターン信号の入力順序
が限定される。
特開昭50−156396号公報第１図ｂ、特開昭52−
94797号公報第７図、特開昭52−115198号公報第
１図ｂ、第２図等で知られる様な走査電極及び／
または信号電極の引出し電極がパネルの両側に設
けられる場合等パネルに対して、駆動装置の配置
位置が種々になる場合に、この様な問題が生じ
る。第１１図に、信号電極の引出し電極がパネル
の両側に設けられる例を示す。第１１図に於い
て、２−１，２−２は駆動回路、３−１，３−２
はラインメモリ、４−１，４−２はシフト機能が
一方向の直・並列変換回路である。駆動回路２−
１の出力VY1，VY2，VY3はそれぞれ信号電極Y2，
Y4，Y6に接続され、駆動回路２−２の出力VY1，
VY2，VY3はそれぞれ信号電極Y5，Y3，Y1に接続
される。この様に、パターン信号の入力順序が、
パネルの右から左へのものと、パネルの左から右
へのものとの２種類が有り、パターン信号が右か
ら左へ入力されるだけのものや、左から右へ入力
されるだけのものは第１１図の様な接続関係のも
のには適用できない。したがつて、パターン信号
の入力順序が限定される。また、逆に、パターン
信号の入力順序が決まつているとき、駆動回路２
の出力端子とパネル電極への接続の順序が限定さ
れる。
94797号公報第７図、特開昭52−115198号公報第
１図ｂ、第２図等で知られる様な走査電極及び／
または信号電極の引出し電極がパネルの両側に設
けられる場合等パネルに対して、駆動装置の配置
位置が種々になる場合に、この様な問題が生じ
る。第１１図に、信号電極の引出し電極がパネル
の両側に設けられる例を示す。第１１図に於い
て、２−１，２−２は駆動回路、３−１，３−２
はラインメモリ、４−１，４−２はシフト機能が
一方向の直・並列変換回路である。駆動回路２−
１の出力VY1，VY2，VY3はそれぞれ信号電極Y2，
Y4，Y6に接続され、駆動回路２−２の出力VY1，
VY2，VY3はそれぞれ信号電極Y5，Y3，Y1に接続
される。この様に、パターン信号の入力順序が、
パネルの右から左へのものと、パネルの左から右
へのものとの２種類が有り、パターン信号が右か
ら左へ入力されるだけのものや、左から右へ入力
されるだけのものは第１１図の様な接続関係のも
のには適用できない。したがつて、パターン信号
の入力順序が限定される。また、逆に、パターン
信号の入力順序が決まつているとき、駆動回路２
の出力端子とパネル電極への接続の順序が限定さ
れる。
仮に、第１１図に於いて、総てのパターン信号
の入力順号がパネルの左から右へとなつている場
合、駆動回路２−１の出力VY3は信号電極Y2へ接
続され、駆動回路２−１の出力VY2は信号電極Y4
へ接続され、かつ駆動回路２−１の出力VY1は信
号電極Y6へ接続される必要があり、接続線が交
差しなければならない。つまり、駆動回路の出力
端子とパネル電極の接続の順序が限定される。
の入力順号がパネルの左から右へとなつている場
合、駆動回路２−１の出力VY3は信号電極Y2へ接
続され、駆動回路２−１の出力VY2は信号電極Y4
へ接続され、かつ駆動回路２−１の出力VY1は信
号電極Y6へ接続される必要があり、接続線が交
差しなければならない。つまり、駆動回路の出力
端子とパネル電極の接続の順序が限定される。
本発明の目的は、パターン信号の入力順序及び
駆動回路の出力端子とパネル電極への接続順序が
限定されない融通性のあるマトリツクスパネル駆
動装置及びマトリツクス表示装置を提供するにあ
る。
駆動回路の出力端子とパネル電極への接続順序が
限定されない融通性のあるマトリツクスパネル駆
動装置及びマトリツクス表示装置を提供するにあ
る。
本発明の特徴とするところは、直・並列変換回
路において、シフト機能を双方向性とすることに
ある。すなわち、従来用いていた１方向性フリツ
プ・フロツプに右シフト、左シフトが可能な双方
向性を持たせ、これらフリツプ・フロツプを直列
に接続して、両端どちらか一方のフリツプ・フロ
ツプからパターン信号の入力が可能ならしめる構
成とする。
路において、シフト機能を双方向性とすることに
ある。すなわち、従来用いていた１方向性フリツ
プ・フロツプに右シフト、左シフトが可能な双方
向性を持たせ、これらフリツプ・フロツプを直列
に接続して、両端どちらか一方のフリツプ・フロ
ツプからパターン信号の入力が可能ならしめる構
成とする。
以下、本発明の実施例を図に従つて説明する。
第５図に、本発明による回路構成を示す。駆動回
路２及びラインメモリ３の構成は、従来の方式と
同一である。一方、直・並列変換回路７には、双
方向性のシフト機能を有するフリツプ・フロツプ
７ａ〜７ｅを多段接続したものである。このフリ
ツプ・フロツプ７ａの端子とそれに対応した信号
の内容を第６図に示す。第６図で、SR，SLは右
シフト、左シフトの時のデータ入力端子であり、
Ｓ入力により右シフト、左シフトの切り換えを行
う。また、シフトクロツクCP1と出力の関係を第
７図に示す。第７図で、シフト切換え信号SLEが
“１”レベルでは、右シフトを行う。すなわち、
クロツク信号CP1の立上りで信号DRの情報が出
力Ｑに現われる。さらに信号SLEが“０”レベル
では、左シフトとなる。この時、信号DLの状態
が出力Ｑに現われる。このように、右シフト、左
シフトが可能なフリツプ・フロツプ７ａ〜７ｅを
用いて直・並列変換回路７を構成している。この
とき、各フリツプ・フロツプ７ａ〜７ｅの出力を
前後のフリツプ・フロツプのSR及びSLに入力さ
せる。また、右シフトの場合には、パターン信号
をフリツプ・フロツプ７ａのSR入力に加え、ま
た、左シフトの場合には、フリツプ・フロツプ７
ｅのSL入力にパターン信号を加える。この時、
右シフト、左シフトの切換えは、信号SLEを
“１”又は“０”にするかにより決める。第５図
の回路のタイムチヤートを第８図、第９図に示
す。第８は、右シフトの場合である。このため、
シフトの切換信号SLEを“１”レベルにし、パタ
ーン信号を、フリツプ・フロツプ７ａのSRに入
力する。一方、第９図は、左シフトの場合であ
る。このため、信号SLEを“０”レベルにし、パ
ターン信号をフリツプ・フロツプ７ｅのSLに入
力する。このように、直・並列変換回路７のシフ
ト機能に双方向第１１図を示す場合等、マトリク
スパネルに対して、駆動装置の配置位置が種々に
なる場合で、パターン信号の入力順序が逆になつ
ても、シフト方向を可変するのみでよい。すなわ
ち、駆動回路２の出力とパネルの間の接続をかえ
る必要がない。このことから、汎用性のある駆動
装置を構成することができる。
第５図に、本発明による回路構成を示す。駆動回
路２及びラインメモリ３の構成は、従来の方式と
同一である。一方、直・並列変換回路７には、双
方向性のシフト機能を有するフリツプ・フロツプ
７ａ〜７ｅを多段接続したものである。このフリ
ツプ・フロツプ７ａの端子とそれに対応した信号
の内容を第６図に示す。第６図で、SR，SLは右
シフト、左シフトの時のデータ入力端子であり、
Ｓ入力により右シフト、左シフトの切り換えを行
う。また、シフトクロツクCP1と出力の関係を第
７図に示す。第７図で、シフト切換え信号SLEが
“１”レベルでは、右シフトを行う。すなわち、
クロツク信号CP1の立上りで信号DRの情報が出
力Ｑに現われる。さらに信号SLEが“０”レベル
では、左シフトとなる。この時、信号DLの状態
が出力Ｑに現われる。このように、右シフト、左
シフトが可能なフリツプ・フロツプ７ａ〜７ｅを
用いて直・並列変換回路７を構成している。この
とき、各フリツプ・フロツプ７ａ〜７ｅの出力を
前後のフリツプ・フロツプのSR及びSLに入力さ
せる。また、右シフトの場合には、パターン信号
をフリツプ・フロツプ７ａのSR入力に加え、ま
た、左シフトの場合には、フリツプ・フロツプ７
ｅのSL入力にパターン信号を加える。この時、
右シフト、左シフトの切換えは、信号SLEを
“１”又は“０”にするかにより決める。第５図
の回路のタイムチヤートを第８図、第９図に示
す。第８は、右シフトの場合である。このため、
シフトの切換信号SLEを“１”レベルにし、パタ
ーン信号を、フリツプ・フロツプ７ａのSRに入
力する。一方、第９図は、左シフトの場合であ
る。このため、信号SLEを“０”レベルにし、パ
ターン信号をフリツプ・フロツプ７ｅのSLに入
力する。このように、直・並列変換回路７のシフ
ト機能に双方向第１１図を示す場合等、マトリク
スパネルに対して、駆動装置の配置位置が種々に
なる場合で、パターン信号の入力順序が逆になつ
ても、シフト方向を可変するのみでよい。すなわ
ち、駆動回路２の出力とパネルの間の接続をかえ
る必要がない。このことから、汎用性のある駆動
装置を構成することができる。
第５図に示した回路において駆動回路２、ライ
ンメモリ３及び直・並列変換回路７を一体化する
ことが考えられる。すなわち、これらを集積化し
て１チツプにまとめることは、低価格化、小形化
にとつてベターである。このことから、上記した
３回路を１チツプ化してマトリクス駆動した場合
の構成を第１０図に示す。第１０図で、１チツプ
駆動回路８は、複数ラインを駆動でき、これらが
直列に接続されている。この結果、小形から大形
デイスプレイまで、駆動装置をコンパクトにまと
めることができる。
ンメモリ３及び直・並列変換回路７を一体化する
ことが考えられる。すなわち、これらを集積化し
て１チツプにまとめることは、低価格化、小形化
にとつてベターである。このことから、上記した
３回路を１チツプ化してマトリクス駆動した場合
の構成を第１０図に示す。第１０図で、１チツプ
駆動回路８は、複数ラインを駆動でき、これらが
直列に接続されている。この結果、小形から大形
デイスプレイまで、駆動装置をコンパクトにまと
めることができる。
本発明によれば、パターン信号の入力順序が逆
になつても駆動回路の出力とパネル電極の接続を
変更する必要がない。また、駆動回路とパネル電
極との接続を逆にする必要がない。このことか
ら、パターン信号の入力順序及び駆動回路とパネ
ル電極との接続順序が限定されない融通性のある
マトリクスパネル駆動装置及びそれを用いたマト
リクス表示装置とすることができる。
になつても駆動回路の出力とパネル電極の接続を
変更する必要がない。また、駆動回路とパネル電
極との接続を逆にする必要がない。このことか
ら、パターン信号の入力順序及び駆動回路とパネ
ル電極との接続順序が限定されない融通性のある
マトリクスパネル駆動装置及びそれを用いたマト
リクス表示装置とすることができる。
さらに、パターン信号の入力順序が逆になる場
合、具体的には画面を分割して上下２個の駆動回
路を使用する場合、従来の直・並列変換回路を使
用すると、駆動回路とパネル電極とを接続する信
号線が交差する部分が生ずる。本発明の双方向の
直・並列変換回路を使用すると、駆動回路とパネ
ル電極とを接続する信号線が交差することが無く
なり、配線の信頼性の低下を防止できる。
合、具体的には画面を分割して上下２個の駆動回
路を使用する場合、従来の直・並列変換回路を使
用すると、駆動回路とパネル電極とを接続する信
号線が交差する部分が生ずる。本発明の双方向の
直・並列変換回路を使用すると、駆動回路とパネ
ル電極とを接続する信号線が交差することが無く
なり、配線の信頼性の低下を防止できる。
第１図及び第１１図は、液晶マトリクス・パネ
ルを線順次走査する場合の回路のブロツク図、第
２図は、走査回路及び直・並列変換回路の構成
図、第３図は、信号側の回路構成、第４図は、第
３図に示した回路の動作を示すタイムチヤート、
第５図は本発明による信号側の回路構成、第６
図、第７図は、双方向性機能を有するフリツプ・
フロツプと動作図、第８図、第９図は、第５図に
示す回路の動作を示すタイムチヤート、第１０図
は本発明の応用例である。 ４…直・並列変換回路、６…液晶マトリクス・
パネル、７ａ〜７ｅ…双方向性フリツプ・フロツ
プ。
ルを線順次走査する場合の回路のブロツク図、第
２図は、走査回路及び直・並列変換回路の構成
図、第３図は、信号側の回路構成、第４図は、第
３図に示した回路の動作を示すタイムチヤート、
第５図は本発明による信号側の回路構成、第６
図、第７図は、双方向性機能を有するフリツプ・
フロツプと動作図、第８図、第９図は、第５図に
示す回路の動作を示すタイムチヤート、第１０図
は本発明の応用例である。 ４…直・並列変換回路、６…液晶マトリクス・
パネル、７ａ〜７ｅ…双方向性フリツプ・フロツ
プ。
Claims (1)
- 【特許請求の範囲】 １ 入力されるパターン信号をシフトクロツク信
号に同期してシフトさせることによつて並列の信
号に変換する直・並列変換回路、 該並列の信号を一定時間記憶するラインメモ
リ、 該ラインメモリの並列出力信号に基づいて、マ
トリクスパネルのパネル電極への並列の駆動出力
信号を発生する駆動回路、 を具備するマトリクスパネル駆動装置において、 該直・並列変換回路は、双方向のシフトが可能
な複数のフリツプフロツプを多段接続し、両端ど
ちらか一方のフリツプフロツプから上記パターン
信号の入力を可能ならしめた直・並列変換回路で
あることを特徴とするマトリクスパネル駆動装
置。 ２ 少なくともマトリクスパネルと、 パターン信号を発生するパターン信号発生回
路、 入力される上記パターン信号をシフトクロツク
信号に同期してシフトさせることによつて並列の
信号に変換する直・並列変換回路、 該並列の信号を一定時間記憶するラインメモ
リ、 該ラインメモリの並列出力信号に基づいてマト
リクスパネルのパネル電極への並列の駆動出力信
号を発生する駆動回路、 を具備し、上記マトリクスパネルを線順次走査す
るマトリクスパネル駆動装置とから構成されるマ
トリクス表示装置に於いて、 上記マトリクスパネル駆動装置は、双方向のシ
フトが可能な複数のフリツプフロツプを多段接続
し、両端どちらか一方のフリツプフロツプから上
記パターン信号の入力を可能ならしめた直・並列
変換回路を複数個直列に接続したものを具備する
ことを特徴とするマトリクス表示装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP1350578A JPS54107221A (en) | 1978-02-10 | 1978-02-10 | Series-parallel converter circuit for liquid crystal driving unit |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP1350578A JPS54107221A (en) | 1978-02-10 | 1978-02-10 | Series-parallel converter circuit for liquid crystal driving unit |
Related Child Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP2222470A Division JPH06100894B2 (ja) | 1990-08-27 | 1990-08-27 | 液晶マトリクスパネル表示駆動装置 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS54107221A JPS54107221A (en) | 1979-08-22 |
| JPH0151839B2 true JPH0151839B2 (ja) | 1989-11-06 |
Family
ID=11834984
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP1350578A Granted JPS54107221A (en) | 1978-02-10 | 1978-02-10 | Series-parallel converter circuit for liquid crystal driving unit |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS54107221A (ja) |
Families Citing this family (4)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS5875195A (ja) * | 1981-10-29 | 1983-05-06 | 株式会社東芝 | 表示装置 |
| JPH0654416B2 (ja) * | 1983-12-23 | 1994-07-20 | 株式会社日立製作所 | 液晶駆動装置とそれを用いた液晶表示装置 |
| JPH01170988A (ja) * | 1987-12-25 | 1989-07-06 | Matsushita Electric Ind Co Ltd | 表示装置 |
| JPH06100894B2 (ja) * | 1990-08-27 | 1994-12-12 | 株式会社日立製作所 | 液晶マトリクスパネル表示駆動装置 |
-
1978
- 1978-02-10 JP JP1350578A patent/JPS54107221A/ja active Granted
Also Published As
| Publication number | Publication date |
|---|---|
| JPS54107221A (en) | 1979-08-22 |
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