JPS6027998B2 - 液晶表示装置 - Google Patents
液晶表示装置Info
- Publication number
- JPS6027998B2 JPS6027998B2 JP53140991A JP14099178A JPS6027998B2 JP S6027998 B2 JPS6027998 B2 JP S6027998B2 JP 53140991 A JP53140991 A JP 53140991A JP 14099178 A JP14099178 A JP 14099178A JP S6027998 B2 JPS6027998 B2 JP S6027998B2
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- JP
- Japan
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- signal
- circuit
- scanning
- liquid crystal
- serial
- Prior art date
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- Control Of Indicators Other Than Cathode Ray Tubes (AREA)
- Liquid Crystal (AREA)
- Liquid Crystal Display Device Control (AREA)
Description
【発明の詳細な説明】
本発明は、液晶表示装置に係り、特にマトリクス駆動回
路の標準化をはかってなる液晶表示装置に関する。
路の標準化をはかってなる液晶表示装置に関する。
液晶マトリクスパネルは、第１図に示したようにそれぞ
れのガラス基板１に形成した電極を交差させ画素をマト
リクス状に配列した形状となっている。
れのガラス基板１に形成した電極を交差させ画素をマト
リクス状に配列した形状となっている。
ここで、一方の電極群２を走査電極、他方の電極群３を
信号電極とする。このような形状をした液晶マトリクス
パネルを駆動して画素を選択し、画素を表示するには第
２図に示した駆動法が好んで用いられている。上段のＡ
は走査電圧、下段のＢは信号電圧であり、Ｋは全選択状
態、Ｌ，Ｍは半選択状態、Ｎは非選択状態を示す。即ち
、第２図は走査、信号電極に加える電圧の状態図を示し
たもので４状態がある。この駆動法は、電圧平均化法と
呼ばれ、液晶駆動には最適の駆動法である。走査電極に
加える走査電圧は、選択電圧Ｖｓ，および非選択電圧Ｖ
Ｎｓ，でＶ。、０、（１−１／ａ）Ｖｏ、１／２・Ｖｏ
の各電圧レベルを有する。また、信号電極に加える信号
電圧は、選択電圧Ｖｓ２および非選択電圧ＶＮｓ２で、
Ｖ。、０、（１一２／ａ）Ｖｏ、２／ａＶｏの各電圧レ
ベルを有する。以上示した電圧を走査、信号電極に適宜
加えて液晶マトリクス駆動を行う。なお、定数ａは最適
駆動ができるように設定する。第３図は、液晶マトリク
スパネルを第２図に示した駆動法に基ずき時分割駆動す
る時の駆動装置の構成を示したものである。
信号電極とする。このような形状をした液晶マトリクス
パネルを駆動して画素を選択し、画素を表示するには第
２図に示した駆動法が好んで用いられている。上段のＡ
は走査電圧、下段のＢは信号電圧であり、Ｋは全選択状
態、Ｌ，Ｍは半選択状態、Ｎは非選択状態を示す。即ち
、第２図は走査、信号電極に加える電圧の状態図を示し
たもので４状態がある。この駆動法は、電圧平均化法と
呼ばれ、液晶駆動には最適の駆動法である。走査電極に
加える走査電圧は、選択電圧Ｖｓ，および非選択電圧Ｖ
Ｎｓ，でＶ。、０、（１−１／ａ）Ｖｏ、１／２・Ｖｏ
の各電圧レベルを有する。また、信号電極に加える信号
電圧は、選択電圧Ｖｓ２および非選択電圧ＶＮｓ２で、
Ｖ。、０、（１一２／ａ）Ｖｏ、２／ａＶｏの各電圧レ
ベルを有する。以上示した電圧を走査、信号電極に適宜
加えて液晶マトリクス駆動を行う。なお、定数ａは最適
駆動ができるように設定する。第３図は、液晶マトリク
スパネルを第２図に示した駆動法に基ずき時分割駆動す
る時の駆動装置の構成を示したものである。
液晶パネル５の走査電極２には、選択電圧Ｖ８，又は非
選択電圧ＶＮｓ，を発生する走査側駆動電圧発生回路７
が接続されている。
選択電圧ＶＮｓ，を発生する走査側駆動電圧発生回路７
が接続されている。
また、走査回路６は、各電極を順次走査する走査信号を
発生する。一方、信号側は、外部回路から直列信号の状
態で入力される表示信号を１ライン分の並列信号に変換
する直列−並列変換回路１０と、この信号を走査時間だ
け保持するラインメモリ９およびラインメモリ９の出力
状態に応じて選択電圧Ｖｓ２又は非選択電圧ＶＮｓ２を
発生する信号側駆動電圧発生回路８で構成されている。
一方、出願人は、走査側駆動電圧発生回路７と信号側駆
動電圧発生回路８の回路構成を同一にできる回路方式を
提案した（侍願昭５１一１１２９９４号）。
発生する。一方、信号側は、外部回路から直列信号の状
態で入力される表示信号を１ライン分の並列信号に変換
する直列−並列変換回路１０と、この信号を走査時間だ
け保持するラインメモリ９およびラインメモリ９の出力
状態に応じて選択電圧Ｖｓ２又は非選択電圧ＶＮｓ２を
発生する信号側駆動電圧発生回路８で構成されている。
一方、出願人は、走査側駆動電圧発生回路７と信号側駆
動電圧発生回路８の回路構成を同一にできる回路方式を
提案した（侍願昭５１一１１２９９４号）。
ところで、表示装置を小形化、軽量化にするには、第３
図に示した駆動回路を集積化することが必須条件である
。
図に示した駆動回路を集積化することが必須条件である
。
この時、走査および信号側の駆動回路を共通化して、同
じ種類のＩＣで駆動できるようにする必要がある。しか
しながら、従来は、走査、信号両駆動電圧発生回路７，
８を除いて同一構成とすることができず、集積化の弊害
となっていた。本発明の目的は、液晶マトリクス駆動回
路の走査側および信号側の駆動回路を同じ構成とし、回
路の集積化を容易ならしめた液晶表示装置を提供するも
のである。
じ種類のＩＣで駆動できるようにする必要がある。しか
しながら、従来は、走査、信号両駆動電圧発生回路７，
８を除いて同一構成とすることができず、集積化の弊害
となっていた。本発明の目的は、液晶マトリクス駆動回
路の走査側および信号側の駆動回路を同じ構成とし、回
路の集積化を容易ならしめた液晶表示装置を提供するも
のである。
本発明の特徴とするところを要約すれば、走査および信
号側駆動電圧発生回路に加える信号を発生する部分を同
一構成にしたものである。
号側駆動電圧発生回路に加える信号を発生する部分を同
一構成にしたものである。
これにより、走査側、信号側の駆動回路を共通化したこ
とである。すなわち、表示信号を発生する走査回路と直
列−並列変換回路を同一の回路で構成し、また従釆のラ
インメモリには入力信号を一時保持する機能と入力信号
を直接出力する機能とを具備させたものである。もう１
つの特徴は、前記した回路を液晶マトリクス駆動に最適
なように集積回路化したものである。
とである。すなわち、表示信号を発生する走査回路と直
列−並列変換回路を同一の回路で構成し、また従釆のラ
インメモリには入力信号を一時保持する機能と入力信号
を直接出力する機能とを具備させたものである。もう１
つの特徴は、前記した回路を液晶マトリクス駆動に最適
なように集積回路化したものである。
第４図に本発明の実施例を示す。
図に示した回路は、最終的に駆動電圧出力端子１２から
走査亀圧、信号電圧を得るものである。第４図に示した
回路を駆動回路と称する。外部データ入力端子１４に直
列信号の状態で入力される外部データ信号は、直列−並
列変換回路１１Ｃにより並列信号に変換される。この直
列−並列変換回路１１Ｃは、第５図に示した回路１７で
構成されている。このような機能を持つ回路をＤフリッ
プ・フロップと称することになる。第５ａ図に示したＤ
フリップ・フロップ１７の機能を第５図ｂ図に示す。図
で×は１又は０、Ｑｏは入力条件が設定される前の状態
を示す。クロック信号ＣＰをクロック入力端子１７Ｂ、
データ信号Ｄをデータ入力端子１７Ａに加えた時の出力
端子１７Ｃの状態Ｑが図で説明されている。クロツク信
号ＣＰが１又は０の定常状態では、出力Ｑの状態は不変
である。また、クロック信号ＣＰの立上りではその時の
データ信号の状態が出力Ｑに現われ、その状態が保持さ
れる。直列−並列変換回路１１ＣはこのようなＤフリッ
プ・フロップ１７を直列接続したものである。尚、図で
、１４はデータ入力端子、１５はデータ出力端子、１４
Ａはデータ出力端子である。一方、ラインメモリ１１Ｂ
は、第６図に示した回路で構成されている。このような
機能を持った回路をＴフリップ・フロップと称すること
にする。第６図ａに示したＴフリップ・フロップ１６の
機能を第６図ｂに示す。
走査亀圧、信号電圧を得るものである。第４図に示した
回路を駆動回路と称する。外部データ入力端子１４に直
列信号の状態で入力される外部データ信号は、直列−並
列変換回路１１Ｃにより並列信号に変換される。この直
列−並列変換回路１１Ｃは、第５図に示した回路１７で
構成されている。このような機能を持つ回路をＤフリッ
プ・フロップと称することになる。第５ａ図に示したＤ
フリップ・フロップ１７の機能を第５図ｂ図に示す。図
で×は１又は０、Ｑｏは入力条件が設定される前の状態
を示す。クロック信号ＣＰをクロック入力端子１７Ｂ、
データ信号Ｄをデータ入力端子１７Ａに加えた時の出力
端子１７Ｃの状態Ｑが図で説明されている。クロツク信
号ＣＰが１又は０の定常状態では、出力Ｑの状態は不変
である。また、クロック信号ＣＰの立上りではその時の
データ信号の状態が出力Ｑに現われ、その状態が保持さ
れる。直列−並列変換回路１１ＣはこのようなＤフリッ
プ・フロップ１７を直列接続したものである。尚、図で
、１４はデータ入力端子、１５はデータ出力端子、１４
Ａはデータ出力端子である。一方、ラインメモリ１１Ｂ
は、第６図に示した回路で構成されている。このような
機能を持った回路をＴフリップ・フロップと称すること
にする。第６図ａに示したＴフリップ・フロップ１６の
機能を第６図ｂに示す。
トリガ入力端子２川こトリガ信号Ｔ、またデータ入力端
子２１にデータ信号Ｄを加えた時の出力Ｑの状態を第６
ｂに示す。トリガ信号Ｔが１の状態では、出力Ｑの状態
は不変である。また、０では、出力Ｑはデータ信号Ｄと
同じ状態となる。さらに、トリガ信号Ｔの立上りでその
時のデータ信号Ｄの状態が保持されて、出力Ｑに現われ
る。このような機能を持つＴフリップ・フロップでライ
ンメモリ１１Ｂを構成する。この時、Ｔフリツプ・フロ
ツプへのデータ信号Ｄは、直列−並列変換回路のＤフリ
ップ・フロップの出力Ｑより供給される。尚、端子１３
は外部トリガ入力端子を示している。一方、駆動電圧発
生回路１１Ａでは、Ｔフリップ・フロップ１６の出力Ｑ
の状態に応じて選択電圧又は非選択電圧を発生し、駆動
電圧出力端子１２に出力する。
子２１にデータ信号Ｄを加えた時の出力Ｑの状態を第６
ｂに示す。トリガ信号Ｔが１の状態では、出力Ｑの状態
は不変である。また、０では、出力Ｑはデータ信号Ｄと
同じ状態となる。さらに、トリガ信号Ｔの立上りでその
時のデータ信号Ｄの状態が保持されて、出力Ｑに現われ
る。このような機能を持つＴフリップ・フロップでライ
ンメモリ１１Ｂを構成する。この時、Ｔフリツプ・フロ
ツプへのデータ信号Ｄは、直列−並列変換回路のＤフリ
ップ・フロップの出力Ｑより供給される。尚、端子１３
は外部トリガ入力端子を示している。一方、駆動電圧発
生回路１１Ａでは、Ｔフリップ・フロップ１６の出力Ｑ
の状態に応じて選択電圧又は非選択電圧を発生し、駆動
電圧出力端子１２に出力する。
次に、第４図で示した回路でマトリクス駆動する時の動
作をタイムチャート図で示す。
作をタイムチャート図で示す。
第７図は、第４図の回路を走査側に使用した時の図を示
したものである。すべてのＴフリツプ・フロツプにトリ
ガ信号を供ｖ給する外部トリガ入力端子１３に信号ＣＬ
を加え、また、第１段目のＤフリップ・フロップに直列
データ信号を供Ｖ給する外部データ入力端子１４に信号
ＤＬＩを加える。また、全てのＤフリップ・フロップに
クロツク信号を供給する外部のクロック入力端子１５に
信号ＬＳＴを加える。この結果、Ｔフリツプ・フロツプ
のトリガ信号は、常に１であるため出力信号ＤＩ〜○６
は、Ｄフリップ・フロップの出力Ｑと同じに変化し、こ
れにより走査信号が得られる。第８図は、第４図の回路
を信号側に使用した時の動作をタイムチャート図で示し
たものである。
したものである。すべてのＴフリツプ・フロツプにトリ
ガ信号を供ｖ給する外部トリガ入力端子１３に信号ＣＬ
を加え、また、第１段目のＤフリップ・フロップに直列
データ信号を供Ｖ給する外部データ入力端子１４に信号
ＤＬＩを加える。また、全てのＤフリップ・フロップに
クロツク信号を供給する外部のクロック入力端子１５に
信号ＬＳＴを加える。この結果、Ｔフリツプ・フロツプ
のトリガ信号は、常に１であるため出力信号ＤＩ〜○６
は、Ｄフリップ・フロップの出力Ｑと同じに変化し、こ
れにより走査信号が得られる。第８図は、第４図の回路
を信号側に使用した時の動作をタイムチャート図で示し
たものである。
外部トリガ入力端子１４に直列信号の状態の直列データ
信号ＤＬ２を加え、また外部クロック入力端子にはクロ
ック信号ＣＰＩを加える。一方、外部トリガ入力端子１
３には、走査側の時と異なり信号ＬＳＴを加える。この
結果、直列データ信号ＤＬ２は、クロツク信号の立上り
に同期してシフトされる。そして、１ライン分のシフト
が完了すると信号ＬＳＴの立上りで各Ｄフリップ・フロ
ップの出力Ｑは、Ｔフリツブ・フロツプに保持される。
これにより、クロツク信号ＣＰＩの立上りでシフトされ
取り込まれた信号ＤＩ〜Ｄ６は図に示したように次のＬ
ＳＴの立上り時まで保持される。以上述べたように第４
図に示した回路は外部制御信号により走査側および信号
側共通に使用できる。
信号ＤＬ２を加え、また外部クロック入力端子にはクロ
ック信号ＣＰＩを加える。一方、外部トリガ入力端子１
３には、走査側の時と異なり信号ＬＳＴを加える。この
結果、直列データ信号ＤＬ２は、クロツク信号の立上り
に同期してシフトされる。そして、１ライン分のシフト
が完了すると信号ＬＳＴの立上りで各Ｄフリップ・フロ
ップの出力Ｑは、Ｔフリツブ・フロツプに保持される。
これにより、クロツク信号ＣＰＩの立上りでシフトされ
取り込まれた信号ＤＩ〜Ｄ６は図に示したように次のＬ
ＳＴの立上り時まで保持される。以上述べたように第４
図に示した回路は外部制御信号により走査側および信号
側共通に使用できる。
これにより、第４図に示した回路を集積化した集積回路
の構成を第９図に示す。集積回路の外部端子としては、
駆動電圧出力端子１２、外部トリガ入力端子１３、外部
データ入力端子１４、外部クロック入力端子１５、直流
電圧入力端子１８、電源端子１９、データ出力端子２０
である。なお、直流電圧入力端子１８には駆動電圧の電
圧レベルを設定するための直流電圧を加える。また、集
積回路を複数段接続してマトリクス駆動する時は、デー
タ出力端子２０を、次段の集積回路の外部データ入力端
子を接続する。本発明は、第２図に示した駆動波形に限
定されることなく、第１０図で示した駆動波でも実施す
ることができる。
の構成を第９図に示す。集積回路の外部端子としては、
駆動電圧出力端子１２、外部トリガ入力端子１３、外部
データ入力端子１４、外部クロック入力端子１５、直流
電圧入力端子１８、電源端子１９、データ出力端子２０
である。なお、直流電圧入力端子１８には駆動電圧の電
圧レベルを設定するための直流電圧を加える。また、集
積回路を複数段接続してマトリクス駆動する時は、デー
タ出力端子２０を、次段の集積回路の外部データ入力端
子を接続する。本発明は、第２図に示した駆動波形に限
定されることなく、第１０図で示した駆動波でも実施す
ることができる。
図でＡは選択状態、Ｂは半選択状態、Ｃは半選択状態、
Ｄは非選択状態を示す。更に、Ｖｘは走査電圧、ＶＹは
信号電圧を示している。また、第４図に示した回路で、
直列−並列変換回路の構成を双方向性のシフトレジスタ
で構成すれば、融通性のある駆動装置とすることができ
る。本発明によれば、液晶マトＩＪクス駆動を行うため
の走査側および信号側回路の構成を同一とすることがで
き回路を標準化できる。
Ｄは非選択状態を示す。更に、Ｖｘは走査電圧、ＶＹは
信号電圧を示している。また、第４図に示した回路で、
直列−並列変換回路の構成を双方向性のシフトレジスタ
で構成すれば、融通性のある駆動装置とすることができ
る。本発明によれば、液晶マトＩＪクス駆動を行うため
の走査側および信号側回路の構成を同一とすることがで
き回路を標準化できる。
これにより、表示規模に関係なく単一機能を持った回路
を複数組み合わせることでマトリクス駆動ができる。ま
た、回路の集積化に際しては、一種類の回路を開発すれ
ばよい。さらに集積回路をＣ−ＭＯＳで構成すると、低
消費電力で小形化の表示装置とすることができる。
を複数組み合わせることでマトリクス駆動ができる。ま
た、回路の集積化に際しては、一種類の回路を開発すれ
ばよい。さらに集積回路をＣ−ＭＯＳで構成すると、低
消費電力で小形化の表示装置とすることができる。
第１図は、液晶マトリクスパネル図、第２図は、マトリ
クス駆動波形図、第３図は、既知の液晶マトリクスパ駆
動回路例図、第４図は、本発明の実施例図、第５図ａ，
ｂは、Ｄフリップ・フロップの動作図、第６図ａ，ｂは
Ｔフリップ・フロップの動作図、第７図は、第４図の回
路を走査側に使用した時の動作のタイムチャート図、第
８図は、第４図の回路を信号側に使用した時の動作のタ
イムチャート図、第９図は、第４図の回路を集積化した
集積回路のピン配置図、第１０図は、応用例で述べたマ
トリクス駆動波形図である。 ２・・・・・・走査電極、３・・・・・・信号電極、４
・・・・・・画素、１０，１１Ｃ・・・・・・直列−並
列変換回路、９，１１Ｂ・・・・・・ラインメモリ、１
１Ａ・・・・・・駆動電圧発生回路、２１・・・・・・
集積回路、１３・・・・・・外部トリガ入力端子、１４
・・・・・・外部データ入力端子、１４Ａ，２０・・・
・・・データ出力端子、１５・・・・・・外部クロック
入力端子、１８・・・・・・直流電圧入力端子。 多′図第２図第３図 第４図 第５図 奉る図 第７図 多８図 弟？図 弟 ／ｏ 図
クス駆動波形図、第３図は、既知の液晶マトリクスパ駆
動回路例図、第４図は、本発明の実施例図、第５図ａ，
ｂは、Ｄフリップ・フロップの動作図、第６図ａ，ｂは
Ｔフリップ・フロップの動作図、第７図は、第４図の回
路を走査側に使用した時の動作のタイムチャート図、第
８図は、第４図の回路を信号側に使用した時の動作のタ
イムチャート図、第９図は、第４図の回路を集積化した
集積回路のピン配置図、第１０図は、応用例で述べたマ
トリクス駆動波形図である。 ２・・・・・・走査電極、３・・・・・・信号電極、４
・・・・・・画素、１０，１１Ｃ・・・・・・直列−並
列変換回路、９，１１Ｂ・・・・・・ラインメモリ、１
１Ａ・・・・・・駆動電圧発生回路、２１・・・・・・
集積回路、１３・・・・・・外部トリガ入力端子、１４
・・・・・・外部データ入力端子、１４Ａ，２０・・・
・・・データ出力端子、１５・・・・・・外部クロック
入力端子、１８・・・・・・直流電圧入力端子。 多′図第２図第３図 第４図 第５図 奉る図 第７図 多８図 弟？図 弟 ／ｏ 図
Claims (1)
- １ 対向面に複数の走査電極と複数の信号電極とが対向
する様に形成される一対の基板間に液晶が保持され、上
記走査電極と上記信号電極との対向部分及びそれらの間
に位置する液晶によつて複数個の画素が形成される液晶
パネルと、一定の周期で上記走査電極の少なくとも一つ
を順次選択する走査電圧を上記複数の走査電極に印加す
る走査側駆動回路と、表示信号に基づいた信号電圧を上
記順次走査に同期して上期複数の信号電極に印加する信
号側駆動回路とを具備する液晶表示装置に於いて、上記
走査側駆動回路は、直列データ信号を順次シフトする少
なくとも一つの直−並列変換回路と、外部トリガー信号
により上記直−並列変換回路の出力を保持する少なくと
も一つのラインメモリと、該ラインメモリの出力状態に
応じて上記走査電圧を出力する少なくとも一つの走査側
駆動電圧発生回路とにより構成し、かつ、上記信号側駆
動回路は、直列データ信号を順次シフトする少なくとも
一つの他の直−並列変換回路と、外部トリガー信号によ
り上記他の直−並列変換回路の出力を保持する少なくと
も一つの他のラインメモリと、該他のラインメモリの出
力状態に応じて上記信号電圧を出力する少なくとも一つ
の信号側駆動電圧発生回路とにより構成することを特徴
とする液晶表示装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP53140991A JPS6027998B2 (ja) | 1978-11-17 | 1978-11-17 | 液晶表示装置 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP53140991A JPS6027998B2 (ja) | 1978-11-17 | 1978-11-17 | 液晶表示装置 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS5567793A JPS5567793A (en) | 1980-05-22 |
| JPS6027998B2 true JPS6027998B2 (ja) | 1985-07-02 |
Family
ID=15281598
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP53140991A Expired JPS6027998B2 (ja) | 1978-11-17 | 1978-11-17 | 液晶表示装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS6027998B2 (ja) |
Families Citing this family (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US4706355A (en) * | 1984-12-11 | 1987-11-17 | Q-Dot Corporation | Method of making an internally grooved and expanded tubular heat exchanger apparatus |
Citations (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS5263014A (en) * | 1975-11-19 | 1977-05-25 | Hitachi Ltd | Driving system of multiple matrix liquid crystal panel |
| JPS5366332A (en) * | 1977-07-25 | 1978-06-13 | Hitachi Ltd | Liquid crystal driving system |
-
1978
- 1978-11-17 JP JP53140991A patent/JPS6027998B2/ja not_active Expired
Patent Citations (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS5263014A (en) * | 1975-11-19 | 1977-05-25 | Hitachi Ltd | Driving system of multiple matrix liquid crystal panel |
| JPS5366332A (en) * | 1977-07-25 | 1978-06-13 | Hitachi Ltd | Liquid crystal driving system |
Also Published As
| Publication number | Publication date |
|---|---|
| JPS5567793A (en) | 1980-05-22 |
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