JPH0131300B2 - - Google Patents
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- JPH0131300B2 JPH0131300B2 JP59266573A JP26657384A JPH0131300B2 JP H0131300 B2 JPH0131300 B2 JP H0131300B2 JP 59266573 A JP59266573 A JP 59266573A JP 26657384 A JP26657384 A JP 26657384A JP H0131300 B2 JPH0131300 B2 JP H0131300B2
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Classifications
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- G—PHYSICS
- G11—INFORMATION STORAGE
- G11C—STATIC STORES
- G11C11/00—Digital stores characterised by the use of particular electric or magnetic storage elements; Storage elements therefor
- G11C11/21—Digital stores characterised by the use of particular electric or magnetic storage elements; Storage elements therefor using electric elements
-
- G—PHYSICS
- G11—INFORMATION STORAGE
- G11C—STATIC STORES
- G11C5/00—Details of stores covered by group G11C11/00
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- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L23/00—Details of semiconductor or other solid state devices
- H01L23/48—Arrangements for conducting electric current to or from the solid state body in operation, e.g. leads, terminal arrangements ; Selection of materials therefor
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L25/00—Assemblies consisting of a plurality of individual semiconductor or other solid state devices ; Multistep manufacturing processes thereof
- H01L25/03—Assemblies consisting of a plurality of individual semiconductor or other solid state devices ; Multistep manufacturing processes thereof all the devices being of a type provided for in the same subgroup of groups H01L27/00 - H01L33/00, or in a single subclass of H10K, H10N, e.g. assemblies of rectifier diodes
- H01L25/10—Assemblies consisting of a plurality of individual semiconductor or other solid state devices ; Multistep manufacturing processes thereof all the devices being of a type provided for in the same subgroup of groups H01L27/00 - H01L33/00, or in a single subclass of H10K, H10N, e.g. assemblies of rectifier diodes the devices having separate containers
- H01L25/105—Assemblies consisting of a plurality of individual semiconductor or other solid state devices ; Multistep manufacturing processes thereof all the devices being of a type provided for in the same subgroup of groups H01L27/00 - H01L33/00, or in a single subclass of H10K, H10N, e.g. assemblies of rectifier diodes the devices having separate containers the devices being of a type provided for in group H01L27/00
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2225/00—Details relating to assemblies covered by the group H01L25/00 but not provided for in its subgroups
- H01L2225/03—All the devices being of a type provided for in the same subgroup of groups H01L27/00 - H01L33/648 and H10K99/00
- H01L2225/10—All the devices being of a type provided for in the same subgroup of groups H01L27/00 - H01L33/648 and H10K99/00 the devices having separate containers
- H01L2225/1005—All the devices being of a type provided for in the same subgroup of groups H01L27/00 - H01L33/648 and H10K99/00 the devices having separate containers the devices being of a type provided for in group H01L27/00
- H01L2225/1011—All the devices being of a type provided for in the same subgroup of groups H01L27/00 - H01L33/648 and H10K99/00 the devices having separate containers the devices being of a type provided for in group H01L27/00 the containers being in a stacked arrangement
- H01L2225/1017—All the devices being of a type provided for in the same subgroup of groups H01L27/00 - H01L33/648 and H10K99/00 the devices having separate containers the devices being of a type provided for in group H01L27/00 the containers being in a stacked arrangement the lowermost container comprising a device support
- H01L2225/1029—All the devices being of a type provided for in the same subgroup of groups H01L27/00 - H01L33/648 and H10K99/00 the devices having separate containers the devices being of a type provided for in group H01L27/00 the containers being in a stacked arrangement the lowermost container comprising a device support the support being a lead frame
-
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- H01L2924/00—Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
- H01L2924/0001—Technical content checked by a classifier
- H01L2924/0002—Not covered by any one of groups H01L24/00, H01L24/00 and H01L2224/00
Description
[産業上の利用分野]
本発明は半導体メモリに関し、さらに詳しく言
えば、工業規格品のアレイチツプを用いて構成さ
れるアレイモジユールに関する。 [従来技術] 集積化された半導体メモリチツプは、家庭用の
パーソナルコンピユータから大規模なメインフレ
ームシステムに至るデータ処理システムにおいて
広範囲にわたつて使用されている。集積化された
半導体メモリチツプ(以下メモリチツプまたは単
にチツプともいう)はパツケージ化された半導体
メモリアレイを含み、複数の入出力ピンを具備し
ている。現在世界中の多くの供給業者により読
取/書込メモリチツプが利用可能となつている。
同じ記憶容量を有するメモリチツプのパツケージ
の寸法及びピンの割当ては規格化されているの
で、同じ記憶容量を有するメモリチツプは供給業
者に関係なく交換可能である。 よく使用されるメモリチツプは64KのDRAM
(ダイナミツクランダムアクセスメモリ)である。
64KのDRAMはおよそ65000ビツトのデータを記
憶し、これはデユアルインライン(dual−in−
line)式のプラスチツクパツケージ、セラミツク
パツケージ等で使用できる。64KのDRAMのピ
ンの割当ての工業規格を下記の第1表に示す。工
業規格の64KDRAMのピン数は16で、チツプの
左上隅から反時計回りの方向で番号が付いてい
る。
えば、工業規格品のアレイチツプを用いて構成さ
れるアレイモジユールに関する。 [従来技術] 集積化された半導体メモリチツプは、家庭用の
パーソナルコンピユータから大規模なメインフレ
ームシステムに至るデータ処理システムにおいて
広範囲にわたつて使用されている。集積化された
半導体メモリチツプ(以下メモリチツプまたは単
にチツプともいう)はパツケージ化された半導体
メモリアレイを含み、複数の入出力ピンを具備し
ている。現在世界中の多くの供給業者により読
取/書込メモリチツプが利用可能となつている。
同じ記憶容量を有するメモリチツプのパツケージ
の寸法及びピンの割当ては規格化されているの
で、同じ記憶容量を有するメモリチツプは供給業
者に関係なく交換可能である。 よく使用されるメモリチツプは64KのDRAM
(ダイナミツクランダムアクセスメモリ)である。
64KのDRAMはおよそ65000ビツトのデータを記
憶し、これはデユアルインライン(dual−in−
line)式のプラスチツクパツケージ、セラミツク
パツケージ等で使用できる。64KのDRAMのピ
ンの割当ての工業規格を下記の第1表に示す。工
業規格の64KDRAMのピン数は16で、チツプの
左上隅から反時計回りの方向で番号が付いてい
る。
【表】
所与のプリント回路基板上でメモリチツプの実
装密度を倍にするためメモリチツプは重ねて使用
されることがある。2つのメモリチツプの対応す
るアドレスピン、電源ピン、及びデータピンは並
列的であるから、それらは物理的に重ね合わすこ
とができる。下段のチツプはプリント回路基板ま
たは他の第2レベルのパツケージに取り付けられ
る。上段または下段のチツプの一方を選択するた
め各チツプに対して別々のチツプ選択ピンの場所
を設けなればならない。こうした多段式メモリモ
ジユールが使用されると、1プリント回路基板面
積当りの記憶容量は倍になる。この利益をもたら
すため、これまで多段式メモリモジユールには下
記の2つのアプローチが採られてきた。 (イ) プリント回路基板上の着地点(フツトプリン
ト)の数を増やす: チツプ選択経路はプリント回路基板上で重ね
合わされたチツプ1段ごとに必要なので上段の
チツプ選択ピン及び下段のチツプ選択ピンはプ
リント回路基板上の2つの異なる場所に導引か
れる。例えば、18ピンのソケツトが上段のチツ
プのチツプ選択ピン及び下段のチツプのチツプ
選択ピンのために2つの異なるワイヤリング経
路を提供し、その18ピンのソケツトに16ピンの
64KDRAM(工業規格品)が取り付けられる。
こうしたアプローチは16ピンのチツプを2段に
するために18ピンのフツトプリント
(footprint)が必要であるから、明らかにその
分だけプリント回路基板の空間が浪費される。
その上、16ピンから18ピンへのワイヤリング経
路を供給するため、多段式のDRAMを取り付
けるには普通はコネクタが必要である。コネク
タはプリント回路基板の空間を浪費するだけで
なく、コストもかかり多段式モジユールの信頼
性をも悪くするので、チツプを多段にしたこと
から得られた利益を相殺してしまう。 (ロ) カスタマイズされたピンの割当てを使用す
る: ピンの割当ては規格のものから多段式のもの
に変更できる。たとえば、工業規格品の
64KDRAMのピン割当ての場合、ピン1は接
続されていないピン(不使用ピン)でありピン
4は行アドレス選択/チツプ選択ピンである。
一方、ピン1が行アドレス選択/チツプ選択ピ
ンでありピン4が不使用ピンであるようなカス
タム64KDRAMを入手することもできる。そ
うしてこれらの規格品とカスタム品を重ね合わ
すことができる。このアプローチならプリント
回路基板は16ピンのフツトプリントにするこ
とが可能であるが、カスタム仕様のチツプはす
ぐ入手できるというものではないので規格品に
比べてずつと高価である。したがつてこの場合
もチツプを多段にしたことから得られる利益を
相殺してしまう。 すなわち、(イ)及び(ロ)のアプローチは、メモリチ
ツプの実装密度を倍にする多段メモリモジユール
を構成するために、プリント回路基板のフツトプ
リントの数が増えるとか、ソケツト等のコネクタ
を使用しなければならないとか、カスタマイズさ
れたピン割当てを必要とするといつた犠牲を必ず
伴う。 [発明が解決しようとする問題点] 以上説明したように従来の多段式モジユールは
(イ)及び(ロ)に示す如く、メモリチツプを多段にした
ことから得られる利点を十分に活かしきつていな
い。 したがつて本発明の目的はメモリチツプ一般的
にはアレイチツプを経済的かつ容易に多段構成で
きるようにすることである。 [問題点を解決するための手段] 前記目的を達成するため、本発明のアレイモジ
ユールは、各々がチツプ選択ピン及び不使用ピン
を含む複数のピンを有し、前記チツプ選択ピン以
外の対応するピンどうしが電気的に接触しかつ第
1のアレイチツプの前記チツプ選択ピンが第2の
アレイチツプの対応するピンに電気的に接触しな
いように構成された前記第1及び第2のアレイチ
ツプと、前記第1のアレイチツプの前記チツプ選
択ピンと前記不使用ピンとを電気的に接続せしめ
るジヤンパー手段と、を具備することを特徴とす
る。 [実施例] 実施例によれば、不使用ピン及びチツプ選択ピ
ンを含む工業用規格のチツプを2段に重ねてメモ
リモジユールの実装密度を倍にすることができ
る。そのため、まず、上段のチツプの不使用ピン
とチツプ選択ピンを電気的にジヤンパーさせる。
2つのチツプが重ね合わされたときに上段のチツ
プのチツプ選択ピンが下段のチツプのチツプ選択
ピンに接触しないよう、上段のチツプのチツプ選
択ピンは折り曲げられるかまたはその端が除去さ
れる。 チツプ選択ピンを除き、上段チツプの各ピンと
下段チツプの対応する各ピンとが接触するように
して2つのチツプが重ね合わされる。下段チツプ
はプリント回路基板上に取り付けてもよし、他の
第2レベルのパツケージ上に取り付けてもよい。
以上のようにして多段式メモリモジユールでは、
工業規格品の不使用ピン位置が上段のチツプ選択
ピン位置になる。下段のチツプ選択ピン位置は工
業規格品のチツプ選択ピン位置である。 64KDRAMの場合でいうと、上段チツプのピ
ン1(不使用ピン)及びピン4(行アドレス選択
ピン)がジヤンパーされ、ピン4は折り曲げられ
るかまたはその端が切り取られる。ピン4以外の
対応するピンが全て接触するようにしてチツプが
重ね合わせられる。チツプが重ね合わせられる
と、ピン1は上段チツプ選択ピンになりピン4は
下段チツプ選択ピンになる。 以下、図面を参照して実施例を説明する。 第2図は本発明に従つて構成されるメモリモジ
ユールの上段チツプを示す図である。上段チツプ
20はピン1ないしピン16を含む。第2図はチ
ツプの例として64KのDRAMを示してある。ピ
ン番号は切れ目21を基準に前記第1表のように
付けられている。工業規格のピン割当ての場合、
ピン1は不使用ピン、ピン4はチツプを選択する
行アドレス選択ピンである。本発明に従つてピン
1とピン4は電気的にジヤンパーされる。第2図
に示すようにジヤンパーはU字形の金属帯板22
(以下単にU字板ともいう)である。U字板22
はその両端にそれぞれ開孔を有する。U字板22
はこれらの各々の開孔にピン1及びピン4がそれ
ぞれ嵌挿されるように形成されている。U字板2
2がピン1及びピン4に嵌挿された後、チツプが
重ね合わされたときに上段チツプのピン4が下段
チツプのピン4に接触しないようにするため、及
びU字板22を保持するため、第2図に示すよう
に、ピン4はチツプ本体側に折り曲げられる。ブ
リキ板のピン及びはんだとの整合性を提供するよ
うU字板22は好適にはブリキ板金で構成され
る。 金属帯板22の形はU字以外に、C(半円)、V
等他の形でもよい。金属帯板22は開孔を含んで
いなくともよく、金属帯板22の両端をピン1及
びピン4に当接させピン4を折り曲げることによ
つて金属帯板22を保持することもできる。ま
た、はんだ付けの前に接着剤で金属帯板22をチ
ツプに保持してもよい。 ピン4を折り曲げる代わりにその端部を切り取
ることによつて、対応するピン4どうしの接触を
避けることもできる。この場合は接着剤で金属帯
板22を保持できる。導線をピン2に巻き付け、
チツプ20の上側または下側を通してピン4に巻
き付けることによつて所望のジヤンパーを提供す
るやり方もある。 第1図は2つのチツプが重ね合わせられて構成
されたメモリモジユール30を示す図である。メ
モリモジユール30は128Kビツトの記憶容量を
有する。行アドレス選択ピン4以外の対応する全
てのピンどうしが接触するように2つのチツプが
重ね合わされている。メモリモジユール30は通
常の方法でデイツプ式またはフロー式によりはん
だ付を行うことができる。前述のように、金属帯
板22に開孔を設けないでピン1及びピン4に当
接させる場合は、初めの高温のはんだ付け工程で
金属帯板22をピン1及びピン4にはんだ付けし
てもよい。そうして次に上段チツプ20と下段チ
ツプ25を重ね合わせて低温のはんだ付け工程で
これらのチツプをはんだ付けすれば、金属帯板2
2は影響を受けない。 チツプ20とチツプ25との取付けは、はんだ
付けでなく、電気的なコネクタで行つてもよい。
上段チツプのピン1及びピン4を電気的に接続す
るため、ジヤンパーをコネクタの中に組み込んで
おくこともできる。これによれば実装密度及び信
頼性が多少落ちるかもしれないが、チツプは簡単
に動かすことができるようになる。 第3図は本発明に従つて構成されたメモリモジ
ユール30のピンの割当てを示す図である。ピン
1が上段チツプ行アドレス選択(チツプ選択)ピ
ンになりピン14が下段チツプ行アドレス選択
(チツプ選択)ピンになる以外は、メモリモジユ
ール30のピン割当ては工業規格品の
64KDRAMのピン割当てと同じである。メモリ
モジユール30には不使用のピン位置はない。
別々の信号線を上段チツプアドレス選択ピン位置
1及び下段チツプアドレス選択ピン位置4に経路
指定しながら、通常の方法でメモリモジユール3
0はプリント回路基板または他の第2レベルパツ
ケージに取り付けることができる。 以上からわかるように、本発明は工業規格のピ
ン割当てで不使用ピンを含むチツプであればどん
なチツプにも適用できる。たとえば、不使用ピン
を含む18ピンの1メガビツトDRAM、読取
り/書込メモリチツプ、または読取り専用メモリ
チツプにも本発明が適用できる。こうして多段式
のスタテイツクRAM、ROM、PROM及び
EPROMを構成することができる。工業規格のピ
ン割当てでチツプ選択ピン及び不使用ピンを含む
限りは、プログラマブルロジツクアレイのような
他のアレイチツプでも本発明に従つて重ね合わす
ことができる。 さらに、チツプ選択ピン及び不使用ピンを含む
重ね合わせるチツプの互いのピン位置が同じであ
る限りは、それらのチツプは同種のものでなくて
もよい。したがつて、例えば、1つのROMと1
つのPROMとを重ね合わすことが可能である。
さらに、これらの条件を満たすならば重ね合わせ
るチツプのピン数が違つていても本発明は適用で
きる。 以上の説明において、原則的には、“チツプ”
という単語は複数の入出力ピンを具備しプラスチ
ツク、セラミツク、または他の材料で封止された
1つのアレイを含む1以上の半導体物質のことを
言い、“モジユール”という単語はそれらのチツ
プが多段に構成されたもののことを言うことが理
解されるであろう。 [発明の効果] これまでに説明した如く本発明によれば、例え
ば16ピンの64KDRAMの例でいうと、同じ16ピ
ンのフツトプリントの回路基板上にそれらを多段
構成でき、しかもコネクタは不要である。さら
に、多段構成にするための各工程は通常の工程で
あり余分な工程はほとんどないので、低価格で信
頼性の高い多段メモリモジユールを構成すること
ができる。
装密度を倍にするためメモリチツプは重ねて使用
されることがある。2つのメモリチツプの対応す
るアドレスピン、電源ピン、及びデータピンは並
列的であるから、それらは物理的に重ね合わすこ
とができる。下段のチツプはプリント回路基板ま
たは他の第2レベルのパツケージに取り付けられ
る。上段または下段のチツプの一方を選択するた
め各チツプに対して別々のチツプ選択ピンの場所
を設けなればならない。こうした多段式メモリモ
ジユールが使用されると、1プリント回路基板面
積当りの記憶容量は倍になる。この利益をもたら
すため、これまで多段式メモリモジユールには下
記の2つのアプローチが採られてきた。 (イ) プリント回路基板上の着地点(フツトプリン
ト)の数を増やす: チツプ選択経路はプリント回路基板上で重ね
合わされたチツプ1段ごとに必要なので上段の
チツプ選択ピン及び下段のチツプ選択ピンはプ
リント回路基板上の2つの異なる場所に導引か
れる。例えば、18ピンのソケツトが上段のチツ
プのチツプ選択ピン及び下段のチツプのチツプ
選択ピンのために2つの異なるワイヤリング経
路を提供し、その18ピンのソケツトに16ピンの
64KDRAM(工業規格品)が取り付けられる。
こうしたアプローチは16ピンのチツプを2段に
するために18ピンのフツトプリント
(footprint)が必要であるから、明らかにその
分だけプリント回路基板の空間が浪費される。
その上、16ピンから18ピンへのワイヤリング経
路を供給するため、多段式のDRAMを取り付
けるには普通はコネクタが必要である。コネク
タはプリント回路基板の空間を浪費するだけで
なく、コストもかかり多段式モジユールの信頼
性をも悪くするので、チツプを多段にしたこと
から得られた利益を相殺してしまう。 (ロ) カスタマイズされたピンの割当てを使用す
る: ピンの割当ては規格のものから多段式のもの
に変更できる。たとえば、工業規格品の
64KDRAMのピン割当ての場合、ピン1は接
続されていないピン(不使用ピン)でありピン
4は行アドレス選択/チツプ選択ピンである。
一方、ピン1が行アドレス選択/チツプ選択ピ
ンでありピン4が不使用ピンであるようなカス
タム64KDRAMを入手することもできる。そ
うしてこれらの規格品とカスタム品を重ね合わ
すことができる。このアプローチならプリント
回路基板は16ピンのフツトプリントにするこ
とが可能であるが、カスタム仕様のチツプはす
ぐ入手できるというものではないので規格品に
比べてずつと高価である。したがつてこの場合
もチツプを多段にしたことから得られる利益を
相殺してしまう。 すなわち、(イ)及び(ロ)のアプローチは、メモリチ
ツプの実装密度を倍にする多段メモリモジユール
を構成するために、プリント回路基板のフツトプ
リントの数が増えるとか、ソケツト等のコネクタ
を使用しなければならないとか、カスタマイズさ
れたピン割当てを必要とするといつた犠牲を必ず
伴う。 [発明が解決しようとする問題点] 以上説明したように従来の多段式モジユールは
(イ)及び(ロ)に示す如く、メモリチツプを多段にした
ことから得られる利点を十分に活かしきつていな
い。 したがつて本発明の目的はメモリチツプ一般的
にはアレイチツプを経済的かつ容易に多段構成で
きるようにすることである。 [問題点を解決するための手段] 前記目的を達成するため、本発明のアレイモジ
ユールは、各々がチツプ選択ピン及び不使用ピン
を含む複数のピンを有し、前記チツプ選択ピン以
外の対応するピンどうしが電気的に接触しかつ第
1のアレイチツプの前記チツプ選択ピンが第2の
アレイチツプの対応するピンに電気的に接触しな
いように構成された前記第1及び第2のアレイチ
ツプと、前記第1のアレイチツプの前記チツプ選
択ピンと前記不使用ピンとを電気的に接続せしめ
るジヤンパー手段と、を具備することを特徴とす
る。 [実施例] 実施例によれば、不使用ピン及びチツプ選択ピ
ンを含む工業用規格のチツプを2段に重ねてメモ
リモジユールの実装密度を倍にすることができ
る。そのため、まず、上段のチツプの不使用ピン
とチツプ選択ピンを電気的にジヤンパーさせる。
2つのチツプが重ね合わされたときに上段のチツ
プのチツプ選択ピンが下段のチツプのチツプ選択
ピンに接触しないよう、上段のチツプのチツプ選
択ピンは折り曲げられるかまたはその端が除去さ
れる。 チツプ選択ピンを除き、上段チツプの各ピンと
下段チツプの対応する各ピンとが接触するように
して2つのチツプが重ね合わされる。下段チツプ
はプリント回路基板上に取り付けてもよし、他の
第2レベルのパツケージ上に取り付けてもよい。
以上のようにして多段式メモリモジユールでは、
工業規格品の不使用ピン位置が上段のチツプ選択
ピン位置になる。下段のチツプ選択ピン位置は工
業規格品のチツプ選択ピン位置である。 64KDRAMの場合でいうと、上段チツプのピ
ン1(不使用ピン)及びピン4(行アドレス選択
ピン)がジヤンパーされ、ピン4は折り曲げられ
るかまたはその端が切り取られる。ピン4以外の
対応するピンが全て接触するようにしてチツプが
重ね合わせられる。チツプが重ね合わせられる
と、ピン1は上段チツプ選択ピンになりピン4は
下段チツプ選択ピンになる。 以下、図面を参照して実施例を説明する。 第2図は本発明に従つて構成されるメモリモジ
ユールの上段チツプを示す図である。上段チツプ
20はピン1ないしピン16を含む。第2図はチ
ツプの例として64KのDRAMを示してある。ピ
ン番号は切れ目21を基準に前記第1表のように
付けられている。工業規格のピン割当ての場合、
ピン1は不使用ピン、ピン4はチツプを選択する
行アドレス選択ピンである。本発明に従つてピン
1とピン4は電気的にジヤンパーされる。第2図
に示すようにジヤンパーはU字形の金属帯板22
(以下単にU字板ともいう)である。U字板22
はその両端にそれぞれ開孔を有する。U字板22
はこれらの各々の開孔にピン1及びピン4がそれ
ぞれ嵌挿されるように形成されている。U字板2
2がピン1及びピン4に嵌挿された後、チツプが
重ね合わされたときに上段チツプのピン4が下段
チツプのピン4に接触しないようにするため、及
びU字板22を保持するため、第2図に示すよう
に、ピン4はチツプ本体側に折り曲げられる。ブ
リキ板のピン及びはんだとの整合性を提供するよ
うU字板22は好適にはブリキ板金で構成され
る。 金属帯板22の形はU字以外に、C(半円)、V
等他の形でもよい。金属帯板22は開孔を含んで
いなくともよく、金属帯板22の両端をピン1及
びピン4に当接させピン4を折り曲げることによ
つて金属帯板22を保持することもできる。ま
た、はんだ付けの前に接着剤で金属帯板22をチ
ツプに保持してもよい。 ピン4を折り曲げる代わりにその端部を切り取
ることによつて、対応するピン4どうしの接触を
避けることもできる。この場合は接着剤で金属帯
板22を保持できる。導線をピン2に巻き付け、
チツプ20の上側または下側を通してピン4に巻
き付けることによつて所望のジヤンパーを提供す
るやり方もある。 第1図は2つのチツプが重ね合わせられて構成
されたメモリモジユール30を示す図である。メ
モリモジユール30は128Kビツトの記憶容量を
有する。行アドレス選択ピン4以外の対応する全
てのピンどうしが接触するように2つのチツプが
重ね合わされている。メモリモジユール30は通
常の方法でデイツプ式またはフロー式によりはん
だ付を行うことができる。前述のように、金属帯
板22に開孔を設けないでピン1及びピン4に当
接させる場合は、初めの高温のはんだ付け工程で
金属帯板22をピン1及びピン4にはんだ付けし
てもよい。そうして次に上段チツプ20と下段チ
ツプ25を重ね合わせて低温のはんだ付け工程で
これらのチツプをはんだ付けすれば、金属帯板2
2は影響を受けない。 チツプ20とチツプ25との取付けは、はんだ
付けでなく、電気的なコネクタで行つてもよい。
上段チツプのピン1及びピン4を電気的に接続す
るため、ジヤンパーをコネクタの中に組み込んで
おくこともできる。これによれば実装密度及び信
頼性が多少落ちるかもしれないが、チツプは簡単
に動かすことができるようになる。 第3図は本発明に従つて構成されたメモリモジ
ユール30のピンの割当てを示す図である。ピン
1が上段チツプ行アドレス選択(チツプ選択)ピ
ンになりピン14が下段チツプ行アドレス選択
(チツプ選択)ピンになる以外は、メモリモジユ
ール30のピン割当ては工業規格品の
64KDRAMのピン割当てと同じである。メモリ
モジユール30には不使用のピン位置はない。
別々の信号線を上段チツプアドレス選択ピン位置
1及び下段チツプアドレス選択ピン位置4に経路
指定しながら、通常の方法でメモリモジユール3
0はプリント回路基板または他の第2レベルパツ
ケージに取り付けることができる。 以上からわかるように、本発明は工業規格のピ
ン割当てで不使用ピンを含むチツプであればどん
なチツプにも適用できる。たとえば、不使用ピン
を含む18ピンの1メガビツトDRAM、読取
り/書込メモリチツプ、または読取り専用メモリ
チツプにも本発明が適用できる。こうして多段式
のスタテイツクRAM、ROM、PROM及び
EPROMを構成することができる。工業規格のピ
ン割当てでチツプ選択ピン及び不使用ピンを含む
限りは、プログラマブルロジツクアレイのような
他のアレイチツプでも本発明に従つて重ね合わす
ことができる。 さらに、チツプ選択ピン及び不使用ピンを含む
重ね合わせるチツプの互いのピン位置が同じであ
る限りは、それらのチツプは同種のものでなくて
もよい。したがつて、例えば、1つのROMと1
つのPROMとを重ね合わすことが可能である。
さらに、これらの条件を満たすならば重ね合わせ
るチツプのピン数が違つていても本発明は適用で
きる。 以上の説明において、原則的には、“チツプ”
という単語は複数の入出力ピンを具備しプラスチ
ツク、セラミツク、または他の材料で封止された
1つのアレイを含む1以上の半導体物質のことを
言い、“モジユール”という単語はそれらのチツ
プが多段に構成されたもののことを言うことが理
解されるであろう。 [発明の効果] これまでに説明した如く本発明によれば、例え
ば16ピンの64KDRAMの例でいうと、同じ16ピ
ンのフツトプリントの回路基板上にそれらを多段
構成でき、しかもコネクタは不要である。さら
に、多段構成にするための各工程は通常の工程で
あり余分な工程はほとんどないので、低価格で信
頼性の高い多段メモリモジユールを構成すること
ができる。
第1図は本発明に従つて多段構成されたメモリ
モジユールの実施例を示す図、第2図は第1図の
メモリモジユールを構成する上段のメモリチツプ
を示す図、第3図は第1図のメモリモジユールの
ピン割当てを示す図である。
モジユールの実施例を示す図、第2図は第1図の
メモリモジユールを構成する上段のメモリチツプ
を示す図、第3図は第1図のメモリモジユールの
ピン割当てを示す図である。
Claims (1)
- 【特許請求の範囲】 1 各々がチツプ選択ピン及び不使用ピンを含む
複数のピンを有し、前記チツプ選択ピン以外の対
応するピンどうしが電気的に接触しかつ第1のア
レイチツプの前記チツプ選択ピンが第2のアレイ
チツプの対応するピンに電気的に接触しないよう
に構成された前記第1及び第2のアレイチツプ
と、 前記第1のアレイチツプの前記チツプ選択ピン
と前記不使用ピンとを電気的に接続せしめるジヤ
ンパー手段と、 を具備することを特徴とするアレイモジユール。
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---|---|---|---|
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---|---|
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SG (1) | SG62489G (ja) |
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