JPH01296361A - メモリカード - Google Patents
メモリカードInfo
- Publication number
- JPH01296361A JPH01296361A JP63127330A JP12733088A JPH01296361A JP H01296361 A JPH01296361 A JP H01296361A JP 63127330 A JP63127330 A JP 63127330A JP 12733088 A JP12733088 A JP 12733088A JP H01296361 A JPH01296361 A JP H01296361A
- Authority
- JP
- Japan
- Prior art keywords
- data
- rom
- software
- ram
- memory card
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Pending
Links
- 238000010586 diagram Methods 0.000 description 10
- 230000006870 function Effects 0.000 description 4
- 230000000694 effects Effects 0.000 description 3
- 241001445982 Lithophragma glabrum Species 0.000 description 1
- 239000003795 chemical substances by application Substances 0.000 description 1
- 239000004065 semiconductor Substances 0.000 description 1
- 239000004575 stone Substances 0.000 description 1
Classifications
-
- G—PHYSICS
- G06—COMPUTING; CALCULATING OR COUNTING
- G06F—ELECTRIC DIGITAL DATA PROCESSING
- G06F21/00—Security arrangements for protecting computers, components thereof, programs or data against unauthorised activity
- G06F21/70—Protecting specific internal or peripheral components, in which the protection of a component leads to protection of the entire computer
- G06F21/78—Protecting specific internal or peripheral components, in which the protection of a component leads to protection of the entire computer to assure secure storage of data
- G06F21/79—Protecting specific internal or peripheral components, in which the protection of a component leads to protection of the entire computer to assure secure storage of data in semiconductor storage media, e.g. directly-addressable memories
-
- G—PHYSICS
- G11—INFORMATION STORAGE
- G11C—STATIC STORES
- G11C7/00—Arrangements for writing information into, or reading information out from, a digital store
- G11C7/24—Memory cell safety or protection circuits, e.g. arrangements for preventing inadvertent reading or writing; Status cells; Test cells
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
〔産業上の利用分野〕
この発明は、データやソフトウェアを記憶するＲＡＭや
ＲＯＭを内蔵するメモリカードに関するものである。
ＲＯＭを内蔵するメモリカードに関するものである。
ソフトウェア提供者にとって、不法コピ一対策は大きな
課題である。すなわち、フロッピィディスクでのソフト
ウェアの提供では、アクセススピードが遅＜ ＲＡＭデ
ィスクやハードディスクへのコピーが必要である事と、
アクセス信穎性が低くバックアップコピーが必要である
事などの理由により、ソフトウェア提供者は積極的な不
法コピーの防止対策を善良なユーザに懸念して実施でき
ていないのが現状である。
課題である。すなわち、フロッピィディスクでのソフト
ウェアの提供では、アクセススピードが遅＜ ＲＡＭデ
ィスクやハードディスクへのコピーが必要である事と、
アクセス信穎性が低くバックアップコピーが必要である
事などの理由により、ソフトウェア提供者は積極的な不
法コピーの防止対策を善良なユーザに懸念して実施でき
ていないのが現状である。
ところで、半導体記憶ＩＣであるＲＡＭやＲＯＭを内蔵
するメモリカードは、アクセススピードがハードディス
クに比較しても非常に早く、またアクセス信頬性も非常
に高く、ソフトウェアを記憶するメモリカードに積極的
な不法コピー防止対策を実施しても善良なユーザに不都
合が発生しないものと考えられる。従つて、不法コピー
の容易なフロッピィディスクに代わって、不法コピー防
止対策の実施しやすいメモリカードの特徴を前面に出し
て、メモリカードの普及の大きな足ががりにすることが
可能である。
するメモリカードは、アクセススピードがハードディス
クに比較しても非常に早く、またアクセス信頬性も非常
に高く、ソフトウェアを記憶するメモリカードに積極的
な不法コピー防止対策を実施しても善良なユーザに不都
合が発生しないものと考えられる。従つて、不法コピー
の容易なフロッピィディスクに代わって、不法コピー防
止対策の実施しやすいメモリカードの特徴を前面に出し
て、メモリカードの普及の大きな足ががりにすることが
可能である。
第４図は、従来のフロッピィディスクで提供されている
ソフトウェアの保護システム構成図であ。
ソフトウェアの保護システム構成図であ。
す、図中、１はパソコン（パーソナルコンピュータ）、
２は暗号化またはスクランブルされたソフトウェアを記
憶するフロッピィディスク、３はパソコン１とフロッピ
ィディスク２との間のデータの送受を可能とする信号系
、４はプロテクト・ボックス又はロックスターなどの商
品名で呼ばれているソフトウェア保護装置、５は保護装
置４を容易にパソコンｌに設置できるＲ５−２３２Ｃ４
’セントロニクスなどの入出力信号系である。この場合
のソフトウェアの稼動は、保護装置４が接続されている
場合のみ可能であり、もし稼動中に保護装置４が切り離
されるとパソコン１により検出されソフトウェアの実行
は中断される。
２は暗号化またはスクランブルされたソフトウェアを記
憶するフロッピィディスク、３はパソコン１とフロッピ
ィディスク２との間のデータの送受を可能とする信号系
、４はプロテクト・ボックス又はロックスターなどの商
品名で呼ばれているソフトウェア保護装置、５は保護装
置４を容易にパソコンｌに設置できるＲ５−２３２Ｃ４
’セントロニクスなどの入出力信号系である。この場合
のソフトウェアの稼動は、保護装置４が接続されている
場合のみ可能であり、もし稼動中に保護装置４が切り離
されるとパソコン１により検出されソフトウェアの実行
は中断される。
また、第５図は、社団法人・日本電子工業振興協会パー
ソナルコンピュータ業務委員会の作成のｒＩＣメモリカ
ードガイドライン」にも記載されているメモリカード（
ＲＯＭカード）の内部基本回路構成図であり、図中、６
はインターフェース・コネクタ、７はチップセレクト回
路、８はメモリチップ、９は制御線、１０は上位のアド
レス線、１１は下位のアドレス線、１２はデータ線、１
３は電源線である。各々の機能や動作については上記文
献に記載してあり周知のことであるので省略する。
ソナルコンピュータ業務委員会の作成のｒＩＣメモリカ
ードガイドライン」にも記載されているメモリカード（
ＲＯＭカード）の内部基本回路構成図であり、図中、６
はインターフェース・コネクタ、７はチップセレクト回
路、８はメモリチップ、９は制御線、１０は上位のアド
レス線、１１は下位のアドレス線、１２はデータ線、１
３は電源線である。各々の機能や動作については上記文
献に記載してあり周知のことであるので省略する。
次の第６図は、第５図の回路のうち、本発明に関係する
部分に限定して書き改めたものであり、図中、同一符号
は第５図と同一、又は相当部分を示す、すなわち、７は
７４ＨＣ１３８などで構成されるチップセレクト回路、
１０は上位アドレス１５線（Ａ１５）、１１はアドレス
０（Ａｌｌ）からアドレス１４（Ａｌｌ）までの下位ア
ドレス線、１２は８ビツト（ｎｏ〜Ｄ？）のデータ線で
ある。
部分に限定して書き改めたものであり、図中、同一符号
は第５図と同一、又は相当部分を示す、すなわち、７は
７４ＨＣ１３８などで構成されるチップセレクト回路、
１０は上位アドレス１５線（Ａ１５）、１１はアドレス
０（Ａｌｌ）からアドレス１４（Ａｌｌ）までの下位ア
ドレス線、１２は８ビツト（ｎｏ〜Ｄ？）のデータ線で
ある。
そして、８１．８２は各々２７Ｇ２５６などの３２にバ
イトの記憶容量を持ちデータやソフトウェアを記憶する
ＲＯＭ、９１．９２は各々メモリカード選択制御！＆１
ｌ（ＣＢ）とデータ読み出し制御線（ＯＢ） 、９３．
９４は各々ＲＯＭ８１．８２を選択する制御線（Ｓｌ）
、（３２）である、この図では、メモリチップが２個で
あるが、この数が増加すると、チップ選択線９３．９４
の数が増え、結局、上位アドレス線１０が増えることで
基本的なメモリカードの書き込み／読み出し動作に変わ
りはない。
イトの記憶容量を持ちデータやソフトウェアを記憶する
ＲＯＭ、９１．９２は各々メモリカード選択制御！＆１
ｌ（ＣＢ）とデータ読み出し制御線（ＯＢ） 、９３．
９４は各々ＲＯＭ８１．８２を選択する制御線（Ｓｌ）
、（３２）である、この図では、メモリチップが２個で
あるが、この数が増加すると、チップ選択線９３．９４
の数が増え、結局、上位アドレス線１０が増えることで
基本的なメモリカードの書き込み／読み出し動作に変わ
りはない。
従来のメモリカードは上述したように構成されているの
で、内部に記憶されているソフトウェアを、容易に外部
から読み出したり、他のフロッピィディスクなどの記憶
媒体に容易にコピーすることができ、また、コピー防止
を実施しようとしても回路構成上値しいという問題点が
あった。
で、内部に記憶されているソフトウェアを、容易に外部
から読み出したり、他のフロッピィディスクなどの記憶
媒体に容易にコピーすることができ、また、コピー防止
を実施しようとしても回路構成上値しいという問題点が
あった。
この発明は上記のような問題点を解消するためになされ
たもので、メモリカードの内部回路に簡単な回路を追加
することによってソフトウェアのコピーを防止できるメ
モリカードを得ることを目的とする。
たもので、メモリカードの内部回路に簡単な回路を追加
することによってソフトウェアのコピーを防止できるメ
モリカードを得ることを目的とする。
この発明に係るメモリカードは、ソフトウェアの保護用
のデータ等が予め書き込まれた別のＲＯＭ８４と、この
ＲＯＭ８４と同じチップ選択信号で動作しユーザが任意
にデータを書き込み可能なＲＡＭ８３と、このＲＯＭ８
４とＲＡＭ８３との各出力の排他的論理和をとりこのＲ
ＯＭ８４に予め書き込まれたデータを判断するための加
工データを出力するデータ加工回路１５とを備えたこと
を特徴とするものである。
のデータ等が予め書き込まれた別のＲＯＭ８４と、この
ＲＯＭ８４と同じチップ選択信号で動作しユーザが任意
にデータを書き込み可能なＲＡＭ８３と、このＲＯＭ８
４とＲＡＭ８３との各出力の排他的論理和をとりこのＲ
ＯＭ８４に予め書き込まれたデータを判断するための加
工データを出力するデータ加工回路１５とを備えたこと
を特徴とするものである。
別のＲＯＭ８４にはソフトウェアの保護用のデータ等が
予め書き込まれている。ＲＡＭ８３は、このＲＯＭ８４
と同じチップ選択信号で動作し、ユーザからのデータを
書き込む、データ加工回路１５は、このＲＯＭ８４の出
力とＲＡＭ８３の出力との排他的論理和をとり、加工デ
ータを出力する。この加工データにより、このＲＯＭ８
４に予め書き込まれたデータを知ることができる。
予め書き込まれている。ＲＡＭ８３は、このＲＯＭ８４
と同じチップ選択信号で動作し、ユーザからのデータを
書き込む、データ加工回路１５は、このＲＯＭ８４の出
力とＲＡＭ８３の出力との排他的論理和をとり、加工デ
ータを出力する。この加工データにより、このＲＯＭ８
４に予め書き込まれたデータを知ることができる。
第１図はこの発明の一実施例に係るメモリカードの構成
を示すブロック図である。第１図において、第５図に示
す構成要素に対応するものには同−の符号を付し、その
説明を省略する。第１図において、８４はソフトウェア
の保護用のデータなどが予め書き込まれた別のＲＯＭ、
８３はこのＲＯＭ８４と同じチップ選択信号で動作しユ
ーザが任意にデータを書き込み可能なＲＡＭ、１５はＲ
ＯＭ８４とＲＡＭ８３との各出力の排他的論理和をとり
ＲＯＭ８４に予め書き込まれたデータを判断するための
加工データを出力するデータ加工回路、１４はＲＡＭ８
３とＲＯＭ８４とデータ加工回路１５とを有するプロテ
クト集積回路である。
を示すブロック図である。第１図において、第５図に示
す構成要素に対応するものには同−の符号を付し、その
説明を省略する。第１図において、８４はソフトウェア
の保護用のデータなどが予め書き込まれた別のＲＯＭ、
８３はこのＲＯＭ８４と同じチップ選択信号で動作しユ
ーザが任意にデータを書き込み可能なＲＡＭ、１５はＲ
ＯＭ８４とＲＡＭ８３との各出力の排他的論理和をとり
ＲＯＭ８４に予め書き込まれたデータを判断するための
加工データを出力するデータ加工回路、１４はＲＡＭ８
３とＲＯＭ８４とデータ加工回路１５とを有するプロテ
クト集積回路である。
９５はチップセレクト回路７からのチップ選択信号をＲ
ＡＭ８３およびＲＯＭ８４に伝えるためのチップ選択線
、９６はＲＡＭ８３に対するデータ書き込み制御線（Ｗ
Ｅ）、１０１はメモリチップが増加した分のチップ選択
線９５に流れるチップ選択信号を生成するためのより上
位のアドレス１６線（Ａ１６）である。ＲＯＭ８１．８
２にはスクランブルされたソフトウェアなどが記憶され
ている。ＲＡＭ８３およびＲＯＭ８４は９、チップ選択
線９５と下位アドレス線１１とデータ読み出し制御線９
２（ＯＥ）とを共通とし、ＲＡＭ８３へのデータ書き込
み制′ａ線９６（ＷＥ）のみが異なる。即ち、メモリカ
ードへのより上位アドレスＡ１６（１０１）が有意の状
態において、メモリカードへの書き込み動作の場合にＲ
ＡＭ８３にのみデータの書き込みが行われ、メモリカー
ドからの読み出し動作の場合にＲＡＭ８３およびＲＯＭ
８４の両方からデータの読み出しが行われる。
ＡＭ８３およびＲＯＭ８４に伝えるためのチップ選択線
、９６はＲＡＭ８３に対するデータ書き込み制御線（Ｗ
Ｅ）、１０１はメモリチップが増加した分のチップ選択
線９５に流れるチップ選択信号を生成するためのより上
位のアドレス１６線（Ａ１６）である。ＲＯＭ８１．８
２にはスクランブルされたソフトウェアなどが記憶され
ている。ＲＡＭ８３およびＲＯＭ８４は９、チップ選択
線９５と下位アドレス線１１とデータ読み出し制御線９
２（ＯＥ）とを共通とし、ＲＡＭ８３へのデータ書き込
み制′ａ線９６（ＷＥ）のみが異なる。即ち、メモリカ
ードへのより上位アドレスＡ１６（１０１）が有意の状
態において、メモリカードへの書き込み動作の場合にＲ
ＡＭ８３にのみデータの書き込みが行われ、メモリカー
ドからの読み出し動作の場合にＲＡＭ８３およびＲＯＭ
８４の両方からデータの読み出しが行われる。
第２図は第１図のデータ加工回路１５の詳細構成を示す
。第２図において、ラインはデータ線Ｄ０〜Ｄ、（第１
図のデータ線１２）のうちの１つの信号線を示す。また
、１６はＲＡＭ８３の出力とＲＯＭＢ ４の出力との排
他的論理和をとる排他的論理和回路、１７はデータ読み
出し制御線９２に流れるデータ読み出し制御信号が無意
の時に入力信号の状態が出力側に表れる出力制御機能付
きの第１のバッファ回路、１８は上記データ読み出し制
御信号が有意の時に入力信号の状態が出力側に表れる出
力制御機能付きの第２のバッファ回路である。バッファ
回路１７．１８はそれぞれ上記と逆の条件の時、ハイイ
ンピーダンスとなる。
。第２図において、ラインはデータ線Ｄ０〜Ｄ、（第１
図のデータ線１２）のうちの１つの信号線を示す。また
、１６はＲＡＭ８３の出力とＲＯＭＢ ４の出力との排
他的論理和をとる排他的論理和回路、１７はデータ読み
出し制御線９２に流れるデータ読み出し制御信号が無意
の時に入力信号の状態が出力側に表れる出力制御機能付
きの第１のバッファ回路、１８は上記データ読み出し制
御信号が有意の時に入力信号の状態が出力側に表れる出
力制御機能付きの第２のバッファ回路である。バッファ
回路１７．１８はそれぞれ上記と逆の条件の時、ハイイ
ンピーダンスとなる。
第１のバッファ回路１７はデータ線１２のデータをＲＡ
Ｍ８３へ書き込む時に導通状態になり、第２のバッファ
回路１８は２つのメモリチップであるＲＡＭ８３および
ＲＯＭ８４からデータを読み出しデータ線１２にデータ
を出力する時に導通状態になる。また、排他的論理和回
路１６は第３図に示すような真理値を持ち、出力の論理
「０」と論理「１」との状態から入力の状態を判別する
にはＲＡＭ８３とＲＯＭ８４との１回の組合せ動作が必
要である。即ち、ＲＡＭ８３への論理ｒＯＪ又は論理ｒ
ｌＪのデータ書き込み動作と、ＲＡＭ８３およびＲＯＭ
８４からの論理「０」又は論理「１」のデータ読み出し
動作時のデータ加工回路１５で加工された論理「０」又
は論理「１」の出力データの判定とからＲＯＭ８４の論
理「０」又は論理「１」のデータを判断することができ
る。
Ｍ８３へ書き込む時に導通状態になり、第２のバッファ
回路１８は２つのメモリチップであるＲＡＭ８３および
ＲＯＭ８４からデータを読み出しデータ線１２にデータ
を出力する時に導通状態になる。また、排他的論理和回
路１６は第３図に示すような真理値を持ち、出力の論理
「０」と論理「１」との状態から入力の状態を判別する
にはＲＡＭ８３とＲＯＭ８４との１回の組合せ動作が必
要である。即ち、ＲＡＭ８３への論理ｒＯＪ又は論理ｒ
ｌＪのデータ書き込み動作と、ＲＡＭ８３およびＲＯＭ
８４からの論理「０」又は論理「１」のデータ読み出し
動作時のデータ加工回路１５で加工された論理「０」又
は論理「１」の出力データの判定とからＲＯＭ８４の論
理「０」又は論理「１」のデータを判断することができ
る。
このようにしてデータ線１２のデータが８ビツトデータ
の時、２”＝２５６通りの論理「０」。
の時、２”＝２５６通りの論理「０」。
「１」の組合せデータを最大２５６回、ＲＡＭ８３へ書
き込み、そしてＲＡＭ８３およびＲＯＭ８４からデータ
を読み出しその値が論理「０」となった時点で、ＲＯＭ
８４中の１つのアドレスに於けるデータを知ることがで
きる。仮にＲＯＭ８４の中に、スクランブルされたソフ
トウェアを解読するための電子キーとしてのデータを２
５６バイト準備しておくと、この値を知らないユーザが
これらのデータを知るためには２５６バイト×２５６回
／バイト＝６４に回の書き込みと読み出しの動作が必要
であるのに対して、この値を知るソフトウェア提供者は
２５６回の書き込みと読み出しの動作で終了する。ソフ
トウェア提供者は、ソフトウェアの種類毎、バージョン
毎、！ｉ人するユーザ毎にこれらの２５６バイトの内容
を変更する。すなわち、メモリカード内のスクランブル
されたソフトウェアは、各メモリカード毎に内容が違い
、容易にＲＯＭ８４中のデータを知ることができないば
かりでなく、スクランブルされたＲＯＭ８１．８２中の
ソフトウェアを解読して、フロッピィディスクやハード
ディスクにコピーして実行することはできない。
き込み、そしてＲＡＭ８３およびＲＯＭ８４からデータ
を読み出しその値が論理「０」となった時点で、ＲＯＭ
８４中の１つのアドレスに於けるデータを知ることがで
きる。仮にＲＯＭ８４の中に、スクランブルされたソフ
トウェアを解読するための電子キーとしてのデータを２
５６バイト準備しておくと、この値を知らないユーザが
これらのデータを知るためには２５６バイト×２５６回
／バイト＝６４に回の書き込みと読み出しの動作が必要
であるのに対して、この値を知るソフトウェア提供者は
２５６回の書き込みと読み出しの動作で終了する。ソフ
トウェア提供者は、ソフトウェアの種類毎、バージョン
毎、！ｉ人するユーザ毎にこれらの２５６バイトの内容
を変更する。すなわち、メモリカード内のスクランブル
されたソフトウェアは、各メモリカード毎に内容が違い
、容易にＲＯＭ８４中のデータを知ることができないば
かりでなく、スクランブルされたＲＯＭ８１．８２中の
ソフトウェアを解読して、フロッピィディスクやハード
ディスクにコピーして実行することはできない。
上記実施例によれば、予め記憶されたソフトウェアを保
護するためのプロテクト・ボックスをＩＣ化してメモリ
カード中に収納するとともに、このプロテクトＩＣの内
容を外部から容易に読み出すことができないようになっ
ているので、ソフトウェアのコピーを防止することがで
きる。
護するためのプロテクト・ボックスをＩＣ化してメモリ
カード中に収納するとともに、このプロテクトＩＣの内
容を外部から容易に読み出すことができないようになっ
ているので、ソフトウェアのコピーを防止することがで
きる。
なお、上記実施例ではメモリチップ８１．８２がＲＯＭ
の場合を説明したが、データ書き込み可能なＲＡＭであ
ってもよく、上記実施例と同様の効果を奏する。また、
上記実施例では、プロチク）ＩＣ１４を各々の構成部分
がディスクリートなｔＣで構成しているように説明した
が、１つのモノリシックのＩＣ又はゲートアレイのよう
なもので構成してもよい、このようにすれば、メモリカ
ードを解体しても直接的にメモリチップのＲＯＭ８４の
出力データを検証できないので効果は大きい、また、上
記実施例では、メモリチップのＲＡＭ８３およびＲＯＭ
８４のデータ幅を８ビツト、またデータ加工回路１５中
の排他的論理和回路１６への入力を８ビツトで説明した
が、１６ビツト更に３２ビツトにすることによってソフ
トウェアの解読のテストケースは何倍もの回数に増加し
、ソフトウェア保護の効果は大きくなる。
の場合を説明したが、データ書き込み可能なＲＡＭであ
ってもよく、上記実施例と同様の効果を奏する。また、
上記実施例では、プロチク）ＩＣ１４を各々の構成部分
がディスクリートなｔＣで構成しているように説明した
が、１つのモノリシックのＩＣ又はゲートアレイのよう
なもので構成してもよい、このようにすれば、メモリカ
ードを解体しても直接的にメモリチップのＲＯＭ８４の
出力データを検証できないので効果は大きい、また、上
記実施例では、メモリチップのＲＡＭ８３およびＲＯＭ
８４のデータ幅を８ビツト、またデータ加工回路１５中
の排他的論理和回路１６への入力を８ビツトで説明した
が、１６ビツト更に３２ビツトにすることによってソフ
トウェアの解読のテストケースは何倍もの回数に増加し
、ソフトウェア保護の効果は大きくなる。
以上のように本発明によれば、ソフトウェアの保護用の
データなどが予め書き込まれた別のＲＯＭと、この別の
ＲＯＭと同じチップ選択信号で動作しユーザが任意にデ
ータを書き込み可能なＲＡＭと、上記ＲＯＭと上記ＲＡ
Ｍとの各出力の排他的論理和をとり上記ＲＯＭに予め書
き込まれたデータを判断するための加工データを出力す
るデータ加工回路とを設けて構成したので、例えばパー
ソナルコンピュータに特別の装置を付加することなしで
簡単な回路によってソフトウェアのコピーを防止でき、
したがって安価なソフトウェア保護機能を有したメモリ
カードを提供できるという効果が得られる。
データなどが予め書き込まれた別のＲＯＭと、この別の
ＲＯＭと同じチップ選択信号で動作しユーザが任意にデ
ータを書き込み可能なＲＡＭと、上記ＲＯＭと上記ＲＡ
Ｍとの各出力の排他的論理和をとり上記ＲＯＭに予め書
き込まれたデータを判断するための加工データを出力す
るデータ加工回路とを設けて構成したので、例えばパー
ソナルコンピュータに特別の装置を付加することなしで
簡単な回路によってソフトウェアのコピーを防止でき、
したがって安価なソフトウェア保護機能を有したメモリ
カードを提供できるという効果が得られる。
第１図はこの発明の一実施例に係るメモリカードの構成
を示すブロック図、第２図は第１図のデータ加工回路の
詳細回路図、第３図は第２図の排他的論理和回路の真理
値を示す図、第４図は従来のフロッピィディスクでのソ
フトウェア保護システムの構成を示すブロック図、第５
図は従来のメモリカードの概略構成を示すブロック図、
第６図は第５図のメモリチップの詳細構成を示すブロッ
ク図である。 １５・・・データ加工回路、８１．８２・・・ＲＯＭ、
８３・・・ＲＡＭ、８４・・・別のＲＯＭ。 代理人 大 岩 増 雄（ばか２名）弔５図
を示すブロック図、第２図は第１図のデータ加工回路の
詳細回路図、第３図は第２図の排他的論理和回路の真理
値を示す図、第４図は従来のフロッピィディスクでのソ
フトウェア保護システムの構成を示すブロック図、第５
図は従来のメモリカードの概略構成を示すブロック図、
第６図は第５図のメモリチップの詳細構成を示すブロッ
ク図である。 １５・・・データ加工回路、８１．８２・・・ＲＯＭ、
８３・・・ＲＡＭ、８４・・・別のＲＯＭ。 代理人 大 岩 増 雄（ばか２名）弔５図
Claims (1)
- データやソフトウェアを記憶するＲＯＭなどを内蔵する
メモリカードにおいて、上記ソフトウェアの保護用のデ
ータなどが予め書き込まれた上記ＲＯＭとは別のＲＯＭ
と、このＲＯＭと同じチップ選択信号で動作しユーザが
任意にデータを書き込み可能なＲＡＭと、このＲＯＭと
上記ＲＡＭとの各出力の排他的論理和をとりこのＲＯＭ
に予め書き込まれたデータを判断するための加工データ
を出力するデータ加工回路とを設けたことを特徴とする
メモリカード。
Priority Applications (2)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP63127330A JPH01296361A (ja) | 1988-05-25 | 1988-05-25 | メモリカード |
| US07/322,993 US5131091A (en) | 1988-05-25 | 1989-03-14 | Memory card including copy protection |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP63127330A JPH01296361A (ja) | 1988-05-25 | 1988-05-25 | メモリカード |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH01296361A true JPH01296361A (ja) | 1989-11-29 |
Family
ID=14957257
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP63127330A Pending JPH01296361A (ja) | 1988-05-25 | 1988-05-25 | メモリカード |
Country Status (2)
| Country | Link |
|---|---|
| US (1) | US5131091A (ja) |
| JP (1) | JPH01296361A (ja) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH0681050U (ja) * | 1992-10-12 | 1994-11-15 | 英治 藤井 | コピー防止機能付きｉｃメモリカード |
Families Citing this family (37)
| Publication number | Priority date | Publication date | Assignee | Title |
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