JPH01174071A - 画像信号の同期パルス分離回路 - Google Patents

画像信号の同期パルス分離回路

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JPH01174071A
JPH01174071A JP32995587A JP32995587A JPH01174071A JP H01174071 A JPH01174071 A JP H01174071A JP 32995587 A JP32995587 A JP 32995587A JP 32995587 A JP32995587 A JP 32995587A JP H01174071 A JPH01174071 A JP H01174071A
Authority
JP
Japan
Prior art keywords
pulse
synchronizing
image signal
voltage comparator
picture signal
Prior art date
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Pending
Application number
JP32995587A
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English (en)
Inventor
Keijiro Nishimura
西村 啓二朗
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
NEC Corp
Original Assignee
NEC Corp
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Publication date
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Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【発明の詳細な説明】 〔産業上の利用分野〕 本発明は画像信号のクランパ回路における同期パルス分
離回路に係シ、特に保護回路を有する画像信号の同期パ
ルス分離回路に関するものである。
〔従来の技術〕
従来の画像信号の同期パルス分離回路の一例を第2図に
示し説明する。
図において、21は画像信号が入力される画像信号入力
端子である。22は蓄電器、23は整流器で、これらは
ダイオードクランパを構成している。24は電圧比較器
、25は基準電圧入力端子、26は同期パルスが出力さ
れる出力端子である。
そして、従来の画像信号の同期パルス分離回路はこの第
2図に示すように、画像信号入力端子21に入力された
画像信号は蓄電器22と整流器23から構成されるダイ
オードクランパで画像信号の同期パルス先端が一定の直
流電位に固定され、その同期パルスの中心の直流電位が
基準電圧入力端子25に与えられた電圧比較器24に入
力され、同期パルスが出力端子26よシ出力される。。
〔発明が解決しようとする問題点〕
上述した従来の画像信号の同期パルス分離回路は、保護
回路がないので、白色体音やパルス性の雑音が重畳した
画像信号が入力されると、雑音によシ画像信号の同期パ
ルス分離回路が誤動作し、その画像信号の同期パルス分
離回路の出力に同期パルス以外の雑音が出力されるとい
う問題点があった。
〔問題点を解決するための手段〕
本発明の画像信号の同期パルス分離回路は、ダイオード
クランパと電圧比較器で構成される画像信号の同期パル
ス分離回路において、上記電圧比較器の出力を画像信号
の同期パルス幅より短かい時間内に複数回サンプリング
を行なえるような周期でサンプリングを行う手段と、こ
の手段によって複数回連続して同期パルスと同一のレベ
ルが検出される際パルスを出力する手段とを備えてなる
ものである。
〔作用〕
本発明においては、ダイオードクランパと電圧比較器で
分離した同期パルスを複数回サンプリングして、それら
がすべて低レベルである場合のみ同期パルスとして出力
する。
〔実施例〕
以下、図面に基づき本発明の実施例を詳細に説明する。
第1図は本発明による画像信号の同期パルス分離回路の
一実施例を示す回路図である。
図において、1は画像信号が入力される画像信号入力端
子である。2は蓄電器、3は整流器で、これらはダイオ
ードクランパを構成している。そして、このダイオード
クランパの出力は電圧比較器4の一方の入力に接続され
、その電圧比較器4の他方の入力は基準電圧入力端子5
に接続されダイオードクランパでクランプされた画像信
号の同期信号の中央の直流電位が与えられるように構成
されている。
6.7,8.9はD型7リツグ70ツブ、10はサンプ
リングする周波数を有するクロックパルス入力端子(サ
ンプリングパルス入力端子)で、これらは電圧比較器4
の出力を画像信号の同期パルス幅より短かい時間内に複
数回サンプリングを行なえるような周期でサンプリング
を行う手段を構成している0そして、このD型フリップ
フロップ6〜9はここでは4段のシフトレジスタを構成
している011は4つのDW7!Jツブ70ツブ6〜9
の各出力を入力とするオアゲートで、とのオアゲート1
1は上記サンプリングを行う手段で複数回連続して同期
パルスと同一のレベルが検出された際パルスを出力する
手段を構成している。12はパルスが出力される出力端
子である。
つぎにこの第1図に示す実施例の動作を説明する。
まず、画像信号入力端子1に入力された画像信号は蓄電
器2と整流器3よシ構成されるダイオードクランパで同
期信号の先端が一定の直流電位に固定される。そして、
電圧比較器4により画像信号の同期信号が分離される。
つぎに、この電圧比較器4によって分離された同期信号
はD型フリップフロップに入力され、サンプリングパル
ス入力端子10から入力されるパルスの繰シ返し周波数
でサンプリングされD型7リツプフロツプ6〜9によっ
て構成される4段のシフトレジスタに記憶される。そし
て、この4段のシフトレジスタの記憶内容がすべて低レ
ベルのときオアゲート11の出力は低レベルとなり パ
ルスが出力される。
〔発明の効果〕
以上説明したように本発明は、ダイオードクランパと電
圧比較器で分離した同期パルスを複数回サンプリングし
て、それらがすべて低レベルである場合のみ同期パルス
として出力することにより、同期パルス以外の部分で白
色雑音やパルス性雑音が原因で画像信号同期分離回路か
らパルスが出力されるのを防止することができる効果が
ある。
【図面の簡単な説明】
第1図は本発明による画像信号の同期ノくルス分離回路
の一実施例を示す回路図、第2図は従来の画像信号の同
期パルス分離回路の一例を示す回路図である。 1@・・・画像信号入力端子、2・・・・蓄電器、3・
・・・整流器、4・・Φ・電圧比較器、5・・・・基準
電圧入力端子、6〜9・・拳・D型クリップフロップ、
10・・・Oサンプリングパルス入力端子、11・・・
・オアゲート、12・・・・出力端子。

Claims (1)

    【特許請求の範囲】
  1. ダイオードクランパと電圧比較器で構成される画像信号
    の同期パルス分離回路において、前記電圧比較器の出力
    を画像信号の同期パルス幅より短かい時間内に複数回サ
    ンプリングを行なえるような周期でサンプリングを行う
    手段と、この手段によつて複数回連続して同期パルスと
    同一のレベルが検出された際パルスを出力する手段とを
    備えてなることを特徴とする画像信号の同期パルス分離
    回路。
JP32995587A 1987-12-28 1987-12-28 画像信号の同期パルス分離回路 Pending JPH01174071A (ja)

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JP32995587A JPH01174071A (ja) 1987-12-28 1987-12-28 画像信号の同期パルス分離回路

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JPH01174071A true JPH01174071A (ja) 1989-07-10

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Application Number Title Priority Date Filing Date
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JP (1) JPH01174071A (ja)

Cited By (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
US5436667A (en) * 1992-09-17 1995-07-25 Thomson Consumer Electronics, Inc. Multi-input television receiver with combined clamping and synchronizing signal separation circuit

Cited By (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
US5436667A (en) * 1992-09-17 1995-07-25 Thomson Consumer Electronics, Inc. Multi-input television receiver with combined clamping and synchronizing signal separation circuit

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