JPH011162A - デジタル信号再生装置 - Google Patents

デジタル信号再生装置

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Publication number
JPH011162A
JPH011162A JP62-155863A JP15586387A JPH011162A JP H011162 A JPH011162 A JP H011162A JP 15586387 A JP15586387 A JP 15586387A JP H011162 A JPH011162 A JP H011162A
Authority
JP
Japan
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data
signal
digital
latch
clock
Prior art date
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Pending
Application number
JP62-155863A
Other languages
English (en)
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JPS641162A (en
Inventor
知則 藤本
Original Assignee
松下電器産業株式会社
Filing date
Publication date
Application filed by 松下電器産業株式会社 filed Critical 松下電器産業株式会社
Priority to JP62-155863A priority Critical patent/JPH011162A/ja
Publication of JPS641162A publication Critical patent/JPS641162A/ja
Publication of JPH011162A publication Critical patent/JPH011162A/ja
Pending legal-status Critical Current

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Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【発明の詳細な説明】 産業上の利用分野 本発明は、ディジタルオーディオテープレコーダ(以下
DATという)の録音再生時のサンプリング周波数を変
換するための機能を備えるデジタル信号再生装置に関す
るものである。
従来の技術 従来のDATとしての再生装置は、例えば、エレクトロ
ニクスライフ1987年3月号に示されている。第3図
は従来のDAT再生装置を示すものであり、9はディジ
タル信号をアナログ信号に変換するD/ム変換器、11
はアナログ信号をディジタル信号に量子化するム/D変
換器、10はディジタル信号の処理を行なう信号処理L
SIである。
以上のように構成された従来のDAT再生装置において
以下その動作について説明する。DムTの記録フォーマ
ットとしては、32KH2,44,IKHz 、 48
 KHzの3つのサンプリング周波数のモードが用意さ
れており、これらの周波数フォーマットで記録すること
が可能である。アナログデータの記録時には、アナログ
データの録音入力をム/D変換器11でディジタルデー
タに変換されて、信号処理LS110に入力され、信号
処理LS110でI)ATの記録フォーマットにされて
、磁気テープへの記録信号として出力される。次にディ
ジタル記録の場合、他機器より入力されたディジタル信
号を前記ディジタル信号のサンプリング周波数に同期さ
せて、信号処理LS110はデータを取り込み、前記サ
ンプリング周波数のフォーマットにして、磁気テープへ
の記録信号として出力される。また、DATの再生時に
は、信号処理LSIは磁気テープからの再生信号をディ
ジタル処理して、オーディオサンプリングデータをD/
ム変換器9に出力し、D/ム変換器9でアナログオーデ
ィオデータに変換して、再生出力する〇発明が解決しよ
うとする問題点 しかしながら上記のような構成では、アナログ記録は制
限なくできるが、ディジタル記録においては信号処理L
SIは、DATのフォーマットより、32 KHz 、
44. I KHz、 48KHz03つのサンプリン
グ周波数のディジタルデータしか直接記録し、再生する
ことができないという問題点を有していた。
本発明は、かかる点に鑑み、既存のDAT装置に少ない
外付は回路を追加するだけで、前記3つのサンプリング
周波数以外のサンプリング周波数(但し48KH2より
小さい)のディジタルデータを直接記録し、記録時のサ
ンプリング周波数で再生することができるデジタル信号
再生装置を提供することを目的とする。
問題点を解決するための手段 本発明は、シリアルなディジタルデータ入力をnビット
のパラレルデータに変換するシリアルパラレル変換器と
、初期化信号とカウントクロックを入力とするm進カウ
ンタと、前記m進カウンタのキャリー出力でマスクした
クロックで前記nビットのデータをラッチし、出力する
第1のラッチと、前記第1のラッチの出力をサンプリン
グ周波数のクロックでラッチし出力する第2のラッチと
、前記第2のラッチのnビットのデータをシリアルデー
タに変換するパラレルシリアル変換器を備えたデジタル
信号再生装置を特徴とするものである。
作用 本発明は、前記した構成により、既存のDAT装置でデ
ィジタル記録したテープを再生してディジタルアウトさ
れたデータを正しいサンプリング周波数に変換して出力
することができ、48KH2より低い任意のサンプリン
グ周波数のディジタルデータを直接記録して、任意のサ
ンプリング周波数で再生が行なえる。
実施例 第1図は本発明の一実施例におけるデジタル信号再生装
置を用いたシステム構成を示したブロック図である。
第1図において、1はディジタルオーディオテープレコ
ーダであるDAT装置、2はディジタル出力データより
オーディオサンプリングデータを抽出するオーディオ信
号変換器、3はシリアルデータをパラレルデ、−夕に変
換するS/P変換器、4はmクロックに一度キヤリーを
出力するm進カウンタ、6は第1のラッチ、6は第2の
ラッチ、7はパラレルデータをシリアルデータに変換す
るP/S変換器、8はディジタルフィルタ、9はD/ム
変換器である。
以上のように構成された本実施例のデジタル信号摂生装
置について以下その動作を説明する。す′ンプリング周
波数として3 s KHzのディジタルデータがDIN
としてDATlに入力されて、CLKlとして36 K
HzがDATlに入力される。DAT   1はDIN
を48 KHzのサンプリング周波数で取り込み、磁気
テープに記録する。そのタイミングチャートは第2図に
示したとおりであり、33.33Hzのシリンダ回転同
期信号(周期がシリンダの一回転時間)の立上りエツジ
で、36KHzと48KHzの同期合わせを行ない記録
していく。前記方法で記録したデータを再生時には、D
ATlが4BKH1のサンプリング周波数としてDOu
tに出力したデータより、オーディオ信号変換器2はオ
ーディオサンプリングデータを抽出して出力し、S/P
変換器3は48 KHzの32倍の周波数であるCuI
2をシフトクロックとして前記オーディオサンプリング
データを取り込み、32ビツトのデータとして第1のラ
ッチ5に出力する。第2図に示したように、36 KH
zのCLKlと48KHzのCuI2はCuI2が4ク
ロツクごとに位相が一致するので、この時のオーディオ
サンプリングデータは信頼性がなく、データとして取り
込まないようにする必要がある。従って第1図のように
4進カウンタ4を設けて、カウンタを第2図のシリンダ
回転同期信号の立上りエツジで初期化し、て、CuI2
をカウントクロックとしてカウントしていき、4カウン
トに1回キャリー信号としてCoutを出力し、そのO
outとCLK3’i半転したクロックのANDゲート
の出力であるLCI、Kを、第2図に示したようなタイ
ミングで生成して第1のラッチ6は、S/P変換器の出
力をLCLKでラッチして、第2のラッチに出力し、そ
のデータを第2のラッチ6は、CLKlを反転した周波
数3 eKHzの信号CI、に、*の立上りエツジでラ
ッチし、その出力をP/S変換器7は、CuI4の32
倍の周波数のシフトクロックでシリアルデータに変換レ
ディジタルフィルタ8に入力し、ディジタルフィルタ8
はD/ム変換器9に入力し、D/ム変換器9はLch 
、Rch のアナログオーディオデータとして出力する
以上のように本実施例によれば、既存のDAT装置で、
他機器より出力された3 6 KHzのサンプリング周
波数のディジタルデータを入力として、48 KHzの
サンプリング周波数になおして記録し再生時には、既存
のDムτ装置で48 KHzサンプリング周波数で再生
されたDout信号を使って、38 KHzの正しいサ
ンプリング周波数に変換して、オーディオデータを再生
することができるので、−度アナログに変換しなくてよ
く音質の劣化がなくなる。
なお本実施例において再生サンプリング周波数を36 
KHzとしたが、4sKHzより低いサンプリング周波
数のデータならば、音質の劣下なしで再生できることは
いうまでもない。
発明の詳細 な説明したように本発明によれば、他機器より出力され
た4 6 KHzより低い任意のサンプリング周波数の
ディジタルデータを直接DATで録音し、再生時1)O
utよりデータを取り出し、元のサンプリング周波数に
変換してデータを再生することができるので、音質の低
下なしで再生することができ、その実用的効果はきわめ
て大きい。
【図面の簡単な説明】
第1図は本発明における一実施例のデジタル信号再生装
置を示すブロック図、第2図は第1図の信号のタイミン
グを示したタイミングチャート図、第3図は従来のデジ
タル信号再生装置を説明するためのブロック図である。 3・・・・・・S/P変換器、4・・・・・・4進カウ
ンタ、6・・・・・・第1のラッチ、6・・・・・・第
2のラッチ、7・・・・・・P/S変換器。 代理人の氏名 弁理士 中 尾 敏 男 ほか1名−ν

Claims (1)

    【特許請求の範囲】
  1. シリアルなディジタルデータ入力を第1のクロックの周
    期で取り込みnビット(n≧1)のパラレルデータに変
    換して出力するシリアルパラレル変換器と、初期化のた
    めの信号と第2のクロックをカウントクロックとして入
    力し、キャリー信号を出力するm進カウンタ(m≧1)
    と、第3のクロックを前記キャリー出力でマスクしたク
    ロックで、前記nビットのパラレルデータを取り込み、
    nビットのデータを出力する第1のラッチと、前記第1
    のラッチのnビットの出力を第4のクロックで取り込み
    nビットのデータを出力する第2のラッチと、前記第2
    のラッチのnビットの出力データを入力として、第5の
    クロックの周期で、nビットのデータをシリアルデータ
    に変換するパラレルシリアル変換器とを備えたことを特
    徴とするデジタル信号再生装置。
JP62-155863A 1987-06-23 デジタル信号再生装置 Pending JPH011162A (ja)

Priority Applications (1)

Application Number Priority Date Filing Date Title
JP62-155863A JPH011162A (ja) 1987-06-23 デジタル信号再生装置

Applications Claiming Priority (1)

Application Number Priority Date Filing Date Title
JP62-155863A JPH011162A (ja) 1987-06-23 デジタル信号再生装置

Publications (2)

Publication Number Publication Date
JPS641162A JPS641162A (en) 1989-01-05
JPH011162A true JPH011162A (ja) 1989-01-05

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