JP6853064B2 - 増幅回路 - Google Patents
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Description
2 信号入力部
3 抵抗(第1抵抗)
4 積分器
4a 入力部
4d 演算増幅器
4e コンデンサ
4h 出力部
5 第1増幅器
5c 抵抗(第2抵抗)
5d 抵抗(第3抵抗)
5e 演算増幅器
6 第2増幅器
7 抵抗(第4抵抗)
8 信号出力部
11,12 増幅器
Si 入力信号
So 出力信号
Claims (1)
- 入力信号が入力される信号入力部に一端が接続された第1抵抗と、
コンデンサが反転入力端子と出力端子との間に接続された演算増幅器を有すると共に入力部に前記第1抵抗の他端が接続されて、当該入力部に入力される信号を積分して出力部から出力する積分器と、
反転入力端子が第2抵抗を介して前記信号入力部に接続されると共に第3抵抗を介して出力端子に接続され、かつ非反転入力端子が前記積分器の出力部に接続された演算増幅器を有する第1増幅器と、
1つまたは直列接続された2つ以上の増幅器で構成されて、前記第1増幅器から出力される信号を非反転増幅して信号出力部に出力信号として出力する第2増幅器と、
前記信号出力部と前記積分器の前記入力部との間に接続された第4抵抗とを備え、
前記第1抵抗および前記第4抵抗の各抵抗値は、当該第4抵抗の抵抗値を当該第1抵抗の抵抗値で除算して得られる値が前記第1増幅器および前記第2増幅器の各増幅率の乗算値と同等となるように規定されている増幅回路。
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