JP6611079B2 - ガラス板 - Google Patents

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Description

本発明は、ガラス板に関し、具体的には、半導体パッケージの製造工程で加工基板の支持に用いるガラス板に関する。
携帯電話、ノート型パーソナルコンピュータ、PDA(Personal Data Assistance)等の携帯型電子機器には、小型化及び軽量化が要求されている。これに伴い、これらの電子機器に用いられる半導体チップの実装スペースも厳しく制限されており、半導体チップの高密度な実装が課題になっている。そこで、近年では、三次元実装技術、すなわち半導体チップ同士を積層し、各半導体チップ間を配線接続することにより、半導体パッケージの高密度実装を図っている。
また、従来のウエハレベルパッケージ(WLP)は、バンプをウエハの状態で形成した後、ダイシングで個片化することにより作製されている。しかし、従来のWLPは、ピン数を増加させ難いことに加えて、半導体チップの裏面が露出した状態で実装されるため、半導体チップの欠け等が発生し易いという問題があった。
そこで、新たなWLPとして、fan out型のWLPが提案されている。fan out型のWLPは、ピン数を増加させることが可能であり、また半導体チップの端部を保護することにより、半導体チップの欠け等を防止することができる。
fan out型のWLPでは、複数の半導体チップを樹脂の封止材でモールドして、加工基板を形成した後に、加工基板の一方の表面に配線する工程、半田バンプを形成する工程等を有する。
これらの工程は、約200〜300℃の熱処理を伴うため、封止材が変形して、加工基板が寸法変化する虞がある。加工基板が寸法変化すると、加工基板の一方の表面に対して、高密度に配線することが困難になり、また半田バンプを正確に形成することも困難になる。
加工基板の寸法変化を抑制するために、支持板としてガラス板を用いることが有効である。ガラス板は、表面を平滑化し易く、且つ剛性を有する。よって、ガラス板を用いると、加工基板を強固、且つ正確に支持することが可能になる。またガラス板は、紫外光等の光を透過し易い。よって、ガラス板を用いると、接着層等を設けることにより加工基板とガラス板を容易に固定することができる。また剥離層等を設けることにより加工基板とガラス板を容易に分離することもできる。
加工基板の支持に用いるガラス板は、加工基板と同様にして、略真円状のウエハ形状を有している。しかし、ガラス板と加工基板の形状が略真円状であると、ガラス板と加工基板の位置合わせが困難になり、結果として、加工基板の配線精度を高めることが困難になる。
また、ガラス板は、脆性を有するため、破損し易い性質を有する。加工基板の搬送時又は加工処理時に、ガラス板が破損してしまうと、小さなガラス片等により高価な加工基板が汚染されて、加工基板を良品として採取できなくなる。
本発明は、上記事情に鑑みなされたものであり、その技術的課題は、加工基板との位置合わせが容易であり、且つ加工基板の搬送時又は加工処理時に破損し難いガラス板を創案することにより、半導体パッケージの高密度化に寄与することである。
本発明者等は、種々の実験を繰り返した結果、ガラス板に位置合わせ部を形成すると共に、その位置合わせ部を面取りすることにより、上記技術的課題を解決し得ることを見出し、本発明として、提案するものである。すなわち、本発明のガラス板は、外形が外形部と位置合わせ部で構成されるガラス板であって、位置合わせ部の表面と端面とが交差する端縁領域の全部又は一部が面取りされていることを特徴とする。ここで、「位置合わせ部」には、加工基板との位置合わせに寄与する部分のみならず、ガラス板自体の位置合わせに寄与する部分を含む。「外形部」は、位置合わせ部以外の外形領域を占める領域を指す。
本発明のガラス板は、位置合わせ部を有する。これにより、ガラス板の位置合わせ部に位置決めピン等の位置決め部材を当接させて、ガラス板を位置固定し易くなる。結果として、ガラス板と加工基板の位置合わせが容易になる。特に、加工基板にも位置合わせ部を形成して、位置決め部材を当接させると、ガラス板と加工基板の位置合わせが更に容易になる。
しかし、ガラス板の位置合わせ部に位置決め部材を当接すると、位置合わせ部に応力が集中し易くなり、位置合わせ部を起点にして、ガラス板が破損し易くなる。特に、ガラス板が外力により湾曲した時に、その傾向が顕著になる。そこで、本発明のガラス板は、位置合わせ部の表面と端面とが交差する端縁領域の全部又は一部が面取りされている。これにより、位置合わせ部を起点にした破損を有効に回避することができる。なお、ガラス板に位置合わせ部を形成すると、位置合わせ部に応力が集中するため、位置合わせ部以外の外形領域を占める外形部に応力が集中し難くなり、外形部を起点にした破損を有効に回避することができる。
図1は、本発明のガラス板の一例を示す上方概念図である。図1(a)に示すように、ガラス板1の外形は、略真円のウエハ状である。また、ガラス板1の外形は、位置合わせ部2と位置合わせ部2以外の外形領域を占める外形部3とで構成されている。位置合わせ部2は、ノッチ形状、つまり窪みを有する形状を有している。ノッチ形状の深部4は、平面視で丸みを帯びた略円形状になっており、位置合わせ部2と外形部3の境界も丸みを帯びた略円形状になっている。図1(b)に示すように、ガラス板5の外形は、略真円のウエハ状である。また、ガラス板5の外形は、位置合わせ部6と位置合わせ部6以外の外形領域を占める外形部7とで構成されている。ガラス板5の位置合わせ部6は、ノッチ形状を有しており、ノッチ形状の深部8は略V溝形状になっている。なお、図1(c)に示すように、ガラス板9の外形は、ウエハ状であり、また位置合わせ部10と位置合わせ部10以外の外形領域を占める外形部11とで構成されている。ガラス板9の位置合わせ部10は、オリフラ形状を有している。
第二に、本発明のガラス板は、位置合わせ部の表面方向の面取り幅が50〜900μmであることが好ましい。
第三に、本発明のガラス板は、位置合わせ部の板厚方向の面取り幅が板厚の5〜80%であることが好ましい。
図2は、図1(a)のA−A’方向の断面概念図である。図2に示すように、ガラス板20の表面21、22と端面23が交差する端縁領域に面取り面24、25を有している。ガラス板20の表面21、22方向の面取り幅Xは例えば50〜900μmになっており、ガラス板20の板厚方向の面取り幅Y+Y’は例えば板厚tの20〜80%になっている。そして、端面23と面取り面24、25は、それぞれ連続的に丸みを帯びた状態で連結しており、表面21、22と面取り面24、25は、それぞれ連続的に丸みを帯びた状態で連結している。
なお、図2に示す面取り面24、25は、位置合わせ部の表面方向の面取り幅が略同等であり、板厚方向の面取り幅も略同等であるが、両者の面取り幅を相違させてもよい。また面取り面の形成を表面21、22の一方側のみとしてもよい。
図3は、本発明のガラス板の一例を示す断面概念図であり、位置合わせ部の面取り形状の変形態様を示す断面概念図である。図3(a)、(b)に示すガラス板には、位置合わせ部の表面と端面が交差する端縁領域の一方にのみ面取り面が形成されている。図3(c)に示すガラス板には、位置合わせ部の表面と端面が交差する端縁領域の一方にのみ面取り面が形成されており、この面取り面が位置合わせ部の端面全体を占有している。
第四に、本発明のガラス板は、位置合わせ部の表面と端面とが交差する端縁領域に面取り面を有すると共に、面取り面の平均表面粗さRaが0.20μm以下であることが好ましい。ここで、「平均表面粗さ」は、JIS B0601:2001で測定した値を指す。
第五に、本発明のガラス板は、位置合わせ部の表面と端面とが交差する端縁領域に面取り面を有すると共に、面取り面と端面が連続的に丸みを帯びた状態で連結していること、つまり面取り面と端面が連続的な曲面で接続されていることが好ましい。
第六に、本発明のガラス板は、位置合わせ部の形状がノッチ形状であることが好ましい。
第七に、本発明のガラス板は、外形部の全部又は一部が面取りされており、外形部の表面方向の面取り幅が50〜900μmであることが好ましい。
第八に、本発明のガラス板は、外形がウエハ形状であることが好ましい。
第九に、本発明のガラス板は、全体板厚偏差が2.0μm未満であることが好ましい。全体板厚偏差を小さくすると、加工処理の精度を高め易くなる。特に配線精度を高めることができるため、高密度の配線が可能になる。またガラス板の面内強度が向上して、ガラス板及び積層体が破損し難くなる。更にガラス板の再利用回数(耐用数)を増やすことができる。ここで、「全体板厚偏差」は、ガラス板全体の最大板厚と最小板厚の差であり、例えばコベルコ科研社製のSBW−331ML/dにより測定可能である。
第十に、本発明のガラス板は、オーバーフローダウンドロー法により成形されてなることが好ましい。
第十一に、本発明のガラス板は、半導体パッケージの製造工程で加工基板の支持に用いることが好ましい。
第十二に、本発明の積層体は、少なくとも加工基板と加工基板を支持するためのガラス板とを備える積層体であって、ガラス板が上記のガラス板であることが好ましい。
図4は、本発明の積層体31を位置決め部材32、33、34で位置固定した状態の一例を示す概念斜視図である。図4では、積層体31は、加工基板35と加工基板35を支持するためのガラス板36とを備えている。加工基板35とガラス板36は、加工基板35の寸法変化を防止するために貼着されている。加工基板35は位置合わせ部37を有しており、ガラス板36も位置合わせ部38を有している。位置決め部材32は、加工基板35の位置合わせ部37とガラス板36の位置合わせ部38に当接している。これにより、加工基板35とガラス板36が位置合わせされている。また、位置決め部材33、34は、加工基板35の外形部39とガラス板36の外形部40に当接している。そして、加工基板35とガラス板36は、位置決め部材33、34によって、位置固定されている。なお、加工基板35とガラス板36の間には、図示しない剥離層と接着層が配置されている。接着層は加工基板35と接触しており、剥離層はガラス板36と接触している。なお、図4では、加工基板35の位置合わせ部37とガラス板36の位置合わせ部38を位置決め部材32に当接させているが、位置決め部材33、34と当接する領域にも位置合わせ部を形成してもよい。この場合、加工基板35とガラス板36の位置合わせを確実に行うことができる。
第十三に、本発明の半導体パッケージの製造方法は、少なくとも加工基板と加工基板を支持するためのガラス板とを備える積層体を用意する工程と、加工基板に対して、加工処理を行う工程と、を有すると共に、ガラス板が上記のガラス板であることが好ましい。
第十四に、本発明の半導体パッケージの製造方法は、加工処理が、加工基板の一方の表面に配線する工程を含むことが好ましい。
第十五に、本発明の半導体パッケージの製造方法は、加工処理が、加工基板の一方の表面に半田バンプを形成する工程を含むことが好ましい。
第十六に、本発明の半導体パッケージは、上記の半導体パッケージの製造方法により作製されたことが好ましい。
第十七に、本発明の電子機器は、半導体パッケージを備える電子機器であって、半導体パッケージが、上記の半導体パッケージであることが好ましい。
本発明のガラス板の一例を示す上方概念図である。 図1(a)のA−A’方向の断面概念図である。 本発明のガラス板の位置合わせ部の面取り形状の変形態様を示す断面概念図である。 本発明の積層体を位置決め部材で位置固定した状態の一例を示す概念斜視図である。 fan out型のWLPの製造工程を示す概念断面図である。
本発明のガラス板は位置合わせ部を有するが、その形状は限定されない。例えば、ノッチ形状、オリフラ形状等を採択することができる。その中でも、位置決め部材を固定し易くする観点から、ノッチ形状が好ましく、ノッチ形状の深部は平面視で略円形状又は略V溝形状であることがより好ましい。また、位置合わせ部は単数のみならず、複数であってもよい。位置合わせ部が単数であれば、位置合わせ部の形成が容易になる。位置合わせ部が複数であれば、ガラス板の位置合わせを確実に行うことができる。
面取り加工は、加工性の観点から、研磨加工で行うことが好ましく、好ましくは#500以上、#800以上、#1200以上の研磨粗さで研磨加工することが更に好ましい。なお、面取り加工は、研磨加工以外でも、ケミカルエッチング等で行ってもよい。
本発明のガラス板は、位置合わせ部の表面と端面とが交差する端縁領域の全部又は一部が面取りされており、位置合わせ部の表面と端面とが交差する端縁領域の50%以上が面取りされていることが好ましく、位置合わせ部の表面と端面とが交差する端縁領域の90%以上が面取りされていることがより好ましく、位置合わせ部の表面と端面とが交差する端縁領域の全部が面取りされていることが更に好ましい。位置合わせ部において面取りされている領域が大きい程、位置合わせ部を起点にした破損の確率を低減することができる。
本発明のガラス板において、位置合わせ部の面取り形状は、特に限定されないが、後述の面取り形状であることが好ましい。なお、本発明では、位置合わせ部の全部又は一部がR面取りされている態様、つまり位置合わせ部の端面全体が略半円状に面取りされている態様を完全に排除しないが、この場合、R面取りの頂部の一点に応力が集中し易くなり、位置合わせ部を起点にした破損の確率を低減し難くなる。
位置合わせ部の表面方向の面取り幅は、好ましくは50〜900μm、200〜800μm、300〜700μm、400〜650μm、特に500〜600μmである。位置合わせ部の表面方向の面取り幅が小さ過ぎると、位置合わせ部を起点にして、ガラス板が破損し易くなる。一方、位置合わせ部の表面方向の面取り幅が大き過ぎると、面取り効率が低下して、ガラス板の製造コストが高騰し易くなる。
位置合わせ部の板厚方向の面取り幅は、好ましくは板厚の5〜80%、20〜75%、30〜70%、35〜65%、特に40〜60%である。位置合わせ部の板厚方向の面取り幅が小さ過ぎると、位置合わせ部を起点にして、ガラス板が破損し易くなる。一方、位置合わせ部の板厚方向の面取り幅が大き過ぎると、外力が位置合わせ部の端面に集中し易くなり、位置合わせ部の端面を起点にして、ガラス板が破損し易くなる。
本発明のガラス板において、位置合わせ部の表面と端面とが交差する端縁領域に面取り面を有することが好ましく、その面取り面の平均表面粗さRaは、好ましくは0.20μm以下、0.10μm未満、0.08μm以下、0.06μm以下、特に0.04μm以下である。面取り面の平均表面粗さRaが大き過ぎると、ガラス板の四点曲げ試験での破壊強度が低下し易くなるため、ガラス板が位置合わせ部を起点にして破損し易くなる。面取り面の最大表面粗さRzは、好ましくは0.25μm以下、0.13μm未満、0.10μm以下、0.08μm以下、特に0.06μm以下である。面取り面の最大表面粗さRzが大き過ぎると、ガラス板の四点曲げ試験での破壊強度が低下し易くなるため、ガラス板が位置合わせ部を起点にして破損し易くなる。なお、面取り面に対して鏡面研磨処理、エッチング処理等を行うと、面取り面の表面粗さを低下させることができる。
本発明のガラス板において、位置合わせ部の表面と端面とが交差する端縁領域に面取り面を有すると共に、更に面取り面と端面が連続的に丸みを帯びた状態で連結していることが好ましく、面取り面と表面が連続的に丸みを帯びた状態で連結していることも好ましい。これにより、位置合わせ部を起点にした破損の確率を効果的に低減することができる。
本発明のガラス板において、位置合わせ部以外の外形領域を占める外形部の表面と端面とが交差する端縁領域の全部又は一部が面取りされていることが好ましく、外形部の表面と端面とが交差する端縁領域の50%以上が面取りされていることがより好ましく、外形部の表面と端面とが交差する端縁領域の90%以上が面取りされていることが更に好ましく、外形部の表面と端面とが交差する端縁領域の全部が面取りされていることが特に好ましい。外形部において面取りされている領域が大きい程、外形部を起点にした破損の確率を低減することができる。
外形部の表面方向の面取り幅は、好ましくは50〜900μm、200〜800μm、300〜700μm、400〜650μm、特に500〜600μmである。外形部の表面方向の面取り幅が小さ過ぎると、外形部を起点にして、ガラス板が破損し易くなる。一方、外形部の表面方向の面取り幅が大き過ぎると、面取り効率が低下して、ガラス板の製造コストが高騰し易くなる。
外形部の板厚方向の面取り幅は、好ましくは板厚の5〜80%、20〜75%、30〜70%、35〜65%、特に40〜60%である。外形部の板厚方向の面取り幅が小さ過ぎると、外形部を起点にして、ガラス板が破損し易くなる。一方、外形部の板厚方向の面取り幅が大き過ぎると、外力が外形部の端面に集中し易くなり、外形部の端面を起点にして、ガラス板が破損し易くなる。
本発明のガラス板において、外形部の表面と端面とが交差する端縁領域に面取り面を有することが好ましく、その面取り面の平均表面粗さRaは、好ましくは0.20μm以下、0.10μm未満、0.08μm以下、0.06μm以下、特に0.04μm以下である。面取り面の平均表面粗さRaが大き過ぎると、ガラス板の四点曲げ試験での破壊強度が低下し易くなるため、ガラス板が外形部を起点にして破損し易くなる。面取り面の最大表面粗さRzは、好ましくは0.25μm以下、0.13μm未満、0.10μm以下、0.08μm以下、特に0.06μm以下である。面取り面の最大表面粗さRzが大き過ぎると、ガラス板の四点曲げ試験での破壊強度が低下し易くなるため、ガラス板が外形部を起点にして破損し易くなる。なお、面取り面に対して鏡面研磨処理、エッチング処理等を行うと、面取り面の表面粗さを低下させることができる。
本発明のガラス板において、外形部の表面と端面とが交差する端縁領域に面取り面を有すると共に、更に面取り面と端面が連続的に丸みを帯びた状態で連結していることが好ましく、面取り面と表面が連続的に丸みを帯びた状態で連結していることも好ましい。これにより、外形部を起点にした破損の確率を効果的に低減することができる。
位置合わせ部を起点にした破損の確率を低減する観点から、位置合わせ部と外形部の境界は、連続的に丸みを帯びた状態で連結していることが好ましい。
本発明のガラス板において、全体板厚偏差は、好ましくは2μm未満、1.5μm以下、1μm以下、1μm未満、0.8μm以下、0.1〜0.9μm、特に0.2〜0.7μmである。全体板厚偏差が小さい程、加工処理の精度を高め易くなる。特に配線精度を高めることができるため、高密度の配線が可能になる。またガラス板の強度が向上して、ガラス板及び積層体が破損し難くなる。更にガラス板の再利用回数(耐用数)を増やすことができる。
反り量は、好ましくは60μm以下、55μm以下、50μm以下、1〜45μm、特に5〜40μmである。反り量が小さい程、加工処理の精度を高め易くなる。特に配線精度を高めることができるため、高密度の配線が可能になる。更にガラス板の再利用回数(耐用数)を増やすことができる。なお、「反り量」は、ガラス板全体における最高位点と最小二乗焦点面との間の最大距離の絶対値と最低位点と最小二乗焦点面との絶対値との合計を指し、例えばコベルコ科研社製のSBW−331ML/dにより測定可能である。
表面の算術平均粗さRaは、好ましくは10nm以下、5nm以下、2nm以下、1nm以下、特に0.5nm以下である。表面の算術平均粗さRaが小さい程、加工処理の精度を高め易くなる。特に配線精度を高めることができるため、高密度の配線が可能になる。またガラス板の強度が向上して、ガラス板及び積層体が破損し難くなる。更にガラス板の再利用回数(支持回数)を増やすことができる。なお、「算術平均粗さRa」は、原子間力顕微鏡(AFM)により測定可能である。
本発明のガラス板は、表面の全部又は一部が研磨面であることが好ましく、面積比で表面の50%以上が研磨面であることがより好ましく、表面の70%以上が研磨面であることが更に好ましく、表面の90%以上が研磨面であることが特に好ましい。このようにすれば、全体板厚偏差を低減し易くなり、また反り量も低減し易くなる。
研磨処理の方法としては、種々の方法を採用することができるが、ガラス板の両面を一対の研磨パッドで挟み込み、ガラス板と一対の研磨パッドを共に回転させながら、ガラス板を研磨処理する方法が好ましい。更に一対の研磨パッドは外径が異なることが好ましく、研磨の際に間欠的にガラス板の一部が研磨パッドから食み出すように研磨処理することが好ましい。これにより、全体板厚偏差を低減し易くなり、また反り量も低減し易くなる。なお、研磨処理において、研磨深さは特に限定されないが、研磨深さは、好ましくは50μm以下、30μm以下、20μm以下、特に10μm以下である。研磨深さが小さい程、ガラス板の生産性が向上する。
本発明のガラス板は、ウエハ状(略真円状)が好ましく、その直径は100mm以上500mm以下、特に150mm以上450mm以下が好ましい。このようにすれば、半導体パッケージの製造工程に適用し易くなる。
本発明のガラス板において、板厚は、好ましくは2.0mm未満、1.5mm以下、1.2mm以下、1.1mm以下、1.0mm以下、特に0.9mm以下である。板厚が薄くなる程、積層体の質量が軽くなるため、ハンドリング性が向上する。一方、板厚が薄過ぎると、ガラス板自体の強度が低下して、支持板としての機能を果たし難くなる。よって、板厚は、好ましくは0.1mm以上、0.2mm以上、0.3mm以上、0.4mm以上、0.5mm以上、0.6mm以上、特に0.7mm超である。
本発明のガラス板は、以下の特性を有することが好ましい。
本発明のガラス板において、30〜380℃の温度範囲における平均熱膨張係数は0×10−7/℃以上、且つ165×10−7/℃以下が好ましい。これにより、加工基板とガラス板の熱膨張係数を整合させ易くなる。そして、両者の熱膨張係数が整合すると、加工処理時に加工基板の寸法変化(特に、反り変形)を抑制し易くなる。結果として、加工基板の一方の表面に対して、高密度に配線することが可能になり、また半田バンプを正確に形成することも可能になる。なお、「30〜380℃の温度範囲における平均熱膨張係数」は、ディラトメーターで測定可能である。
30〜380℃の温度範囲における平均熱膨張係数は、加工基板内で半導体チップの割合が少なく、封止材の割合が多い場合は、上昇させることが好ましく、逆に、加工基板内で半導体チップの割合が多く、封止材の割合が少ない場合は、低下させることが好ましい。
30〜380℃の温度範囲における平均熱膨張係数を0×10−7/℃以上、且つ50×10−7/℃未満とする場合、ガラス板は、ガラス組成として、質量%で、SiO 55〜75%、Al 15〜30%、LiO 0.1〜6%、NaO+KO 0〜8%、MgO+CaO+SrO+BaO 0〜10%を含有することが好ましく、或いはSiO 55〜75%、Al 10〜30%、LiO+NaO+KO 0〜0.3%、MgO+CaO+SrO+BaO 5〜20%を含有することも好ましい。30〜380℃の温度範囲における平均熱膨張係数を50×10−7/℃以上、且つ75×10−7/℃未満とする場合、ガラス板は、ガラス組成として、質量%で、SiO 55〜70%、Al 3〜15%、B 5〜20%、MgO 0〜5%、CaO 0〜10%、SrO 0〜5%、BaO 0〜5%、ZnO 0〜5%、NaO 5〜15%、KO 0〜10%を含有することが好ましい。30〜380℃の温度範囲における平均熱膨張係数を75×10−7/℃以上、且つ85×10−7/℃以下とする場合、ガラス板は、ガラス組成として、質量%で、SiO 60〜75%、Al 5〜15%、B 5〜20%、MgO 0〜5%、CaO 0〜10%、SrO 0〜5%、BaO 0〜5%、ZnO 0〜5%、NaO 7〜16%、KO 0〜8%を含有することが好ましい。30〜380℃の温度範囲における平均熱膨張係数を85×10−7/℃超、且つ120×10−7/℃以下とする場合、ガラス板は、ガラス組成として、質量%で、SiO 55〜70%、Al 3〜13%、B 2〜8%、MgO 0〜5%、CaO 0〜10%、SrO 0〜5%、BaO 0〜5%、ZnO 0〜5%、NaO 10〜21%、KO 0〜5%を含有することが好ましい。30〜380℃の温度範囲における平均熱膨張係数を120×10−7/℃超、且つ165×10−7/℃以下とする場合、ガラス板は、ガラス組成として、質量%で、SiO 53〜65%、Al 3〜13%、B 0〜5%、MgO 0.1〜6%、CaO 0〜10%、SrO 0〜5%、BaO 0〜5%、ZnO 0〜5%、NaO+KO 20〜40%、NaO 12〜21%、KO 7〜21%を含有することが好ましい。このようにすれば、熱膨張係数を所望の範囲に規制し易くなると共に、耐失透性が向上するため、全体板厚偏差が小さいガラス板を成形し易くなる。なお、ガラス板と加工基板の熱膨張係数差は、加工基板の寸法変化を抑制するために、可及的に小さいことが好ましく、例えば、±20×10−7/℃以下、±10×10−7/℃以下、特に±5×10−7/℃以下が好ましい。
ヤング率は、好ましくは65GPa以上、67GPa以上、68GPa以上、69GPa以上、70GPa以上、71GPa以上、72GPa以上、特に73GPa以上である。ヤング率が低過ぎると、積層体の剛性を維持し難くなり、加工基板の変形、反り、破損が発生し易くなる。
液相温度は、好ましくは1150℃未満、1120℃以下、1100℃以下、1080℃以下、1050℃以下、1010℃以下、980℃以下、960℃以下、950℃以下、特に940℃以下である。このようにすれば、ダウンドロー法、特にオーバーフローダウンドロー法でガラス板を成形し易くなるため、板厚が小さいガラス板を作製し易くなると共に、成形後の板厚偏差を低減することができる。更に、ガラス板の製造工程時に、失透結晶が発生して、ガラス板の生産性が低下する事態を防止し易くなる。ここで、「液相温度」は、標準篩30メッシュ(500μm)を通過し、50メッシュ(300μm)に残るガラス粉末を白金ボートに入れた後、温度勾配炉中に24時間保持して、結晶が析出する温度を測定することにより算出可能である。
液相温度における粘度は、好ましくは104.6dPa・s以上、105.0dPa・s以上、105.2dPa・s以上、105.4dPa・s以上、105.6dPa・s以上、特に105.8dPa・s以上である。このようにすれば、ダウンドロー法、特にオーバーフローダウンドロー法でガラス板を成形し易くなるため、板厚が小さいガラス板を作製し易くなると共に、成形後の板厚偏差を低減することができる。更に、ガラス板の製造工程時に、失透結晶が発生して、ガラス板の生産性が低下する事態を防止し易くなる。ここで、「液相温度における粘度」は、白金球引き上げ法で測定可能である。なお、液相温度における粘度は、成形性の指標であり、液相温度における粘度が高い程、成形性が向上する。
102.5dPa・sにおける温度は、好ましくは1580℃以下、1500℃以下、1450℃以下、1400℃以下、1350℃以下、特に1200〜1300℃である。102.5dPa・sにおける温度が高くなると、溶融性が低下して、ガラス板の製造コストが高騰する。ここで、「102.5dPa・sにおける温度」は、白金球引き上げ法で測定可能である。なお、102.5dPa・sにおける温度は、溶融温度に相当し、この温度が低い程、溶融性が向上する。
本発明のガラス板において、板厚方向、波長300nmにおける紫外線透過率は、好ましくは40%以上、50%以上、60%以上、70%以上、特に80%以上である。紫外線透過率が低過ぎると、紫外光の照射により、接着層により加工基板とガラス板を接着し難くなることに加えて、剥離層により加工基板からガラス板を剥離し難くなる。なお、「板厚方向、波長300nmにおける紫外線透過率」は、例えば、ダブルビーム型分光光度計を用いて、波長300nmの分光透過率を測定することで評価可能である。
本発明のガラス板は、ダウンドロー法、特にオーバーフローダウンドロー法で成形されてなることが好ましい。オーバーフローダウンドロー法は、耐熱性の樋状構造物の両側から溶融ガラスを溢れさせて、溢れた溶融ガラスを樋状構造物の下頂端で合流させながら、下方に延伸成形してガラス原板を成形する方法である。オーバーフローダウンドロー法では、ガラス板の表面となるべき面は樋状耐火物に接触せず、自由表面の状態で成形される。このため、板厚が小さいガラス板を作製し易くなると共に、全体板厚偏差を低減することができ、結果として、ガラス板の製造コストを低廉化することができる。
ガラス原板の成形方法として、オーバーフローダウンドロー法以外にも、例えば、スロットダウン法、リドロー法、フロート法、ロールアウト法等を採択することもできる。
本発明のガラス板は、表面に研磨面を有し、オーバーフローダウンドロー法で成形されてなることが好ましい。このようにすれば、研磨処理前の全体板厚偏差が小さくなるため、研磨処理により全体板厚偏差を可及的に低減することが可能になる。例えば、全体板厚偏差を1.0μm以下に低減することが可能になる。
本発明のガラス板は、反り量を低減する観点から、化学強化処理がなされていないことが好ましい。一方、機械的強度の観点から、化学強化処理がなされていることが好ましい。つまり反り量を低減する観点から、表面に圧縮応力層を有しないことが好ましく、機械的強度の観点から、表面に圧縮応力層を有することが好ましい。
本発明の積層体は、少なくとも加工基板と加工基板を支持するためのガラス板とを備える積層体であって、ガラス板が上記のガラス板であることを特徴とする。ここで、本発明の積層体の技術的特徴(好適な構成、効果)は、本発明のガラス板の技術的特徴と重複する。よって、本明細書では、その重複部分について、詳細な記載を省略する。
本発明の積層体は、加工基板とガラス板の間に、接着層を有することが好ましい。接着層は、樹脂であることが好ましく、例えば、熱硬化性樹脂、光硬化性樹脂(特に紫外線硬化樹脂)等が好ましい。また半導体パッケージの製造工程における熱処理に耐える耐熱性を有するものが好ましい。これにより、半導体パッケージの製造工程で接着層が融解し難くなり、加工処理の精度を高めることができる。
接着層は、例えば、各種印刷法、インクジェット法、スピンコート法、ロールコート法等により形成することができる。
本発明の積層体は、更に加工基板とガラス板の間に、より具体的には加工基板と接着層の間に、剥離層を有すること、或いはガラス板と接着層の間に、剥離層を有することが好ましい。このようにすれば、加工基板に対して、所定の加工処理を行った後に、加工基板をガラス板から剥離し易くなる。加工基板の剥離は、生産性の観点から、レーザー光等の照射光により行うことが好ましい。
剥離層は、レーザー光等の照射光により「層内剥離」又は「界面剥離」が生じる材料で構成される。つまり一定の強度の光を照射すると、原子又は分子における原子間又は分子間の結合力が消失又は減少して、アブレーション(ablation)等を生じ、剥離を生じさせる材料で構成される。例えば、剥離層は、非晶質シリコン(a−Si)以外にも、酸化ケイ素、ケイ酸化合物、窒化ケイ素、窒化アルミ、窒化チタン等が使用可能である。また、剥離層は、プラズマCVD、ゾル−ゲル法によるスピンコート等により形成することができる。なお、照射光の照射により、剥離層に含まれる成分が気体となって放出されて分離に至る場合と、剥離層が光を吸収して気体になり、その蒸気が放出されて分離に至る場合とがある。
本発明の積層体において、ガラス板は、加工基板よりも大きいことが好ましい。これにより、加工基板とガラス板を支持する際に、両者の中心位置が僅かに離間した場合でも、ガラス板から加工基板の縁部が食み出し難くなる。
本発明の半導体パッケージの製造方法は、少なくとも加工基板と加工基板を支持するためのガラス板とを備える積層体を用意する工程と、加工基板に対して、加工処理を行う工程と、を有すると共に、ガラス板が上記のガラス板であることを特徴とする。ここで、本発明の半導体パッケージの製造方法の技術的特徴(好適な構成、効果)は、本発明のガラス板及び積層体の技術的特徴と重複する。よって、本明細書では、その重複部分について、詳細な記載を省略する。
本発明の半導体パッケージの製造方法は、少なくとも加工基板と加工基板を支持するためのガラス板とを備える積層体を用意する工程を有する。少なくとも加工基板と加工基板を支持するためのガラス板とを備える積層体は、上記の材料構成を有している。
本発明の半導体パッケージの製造方法は、更に積層体を搬送する工程を有することが好ましい。これにより、加工処理の処理効率を高めることができる。なお、「積層体を搬送する工程」と「加工基板に対して、加工処理を行う工程」とは、別途に行う必要はなく、同時であってもよい。
本発明の半導体パッケージの製造方法において、加工処理は、加工基板の一方の表面に配線する処理、或いは加工基板の一方の表面に半田バンプを形成する処理が好ましい。本発明の半導体パッケージの製造方法では、これらの処理時に加工基板が寸法変化し難いため、これらの工程を適正に行うことができる。
加工処理として、上記以外にも、加工基板の一方の表面(通常、ガラス板とは反対側の表面)を機械的に研磨する処理、加工基板の一方の表面(通常、ガラス板とは反対側の表面)をドライエッチングする処理、加工基板の一方の表面(通常、ガラス板とは反対側の表面)をウェットエッチングする処理の何れかであってもよい。なお、本発明の半導体パッケージの製造方法では、加工基板に反りが発生し難いと共に、積層体の剛性を維持することができる。結果として、上記加工処理を適正に行うことができる。
本発明の半導体パッケージは、上記の半導体パッケージの製造方法により作製されたことを特徴とする。ここで、本発明の半導体パッケージの技術的特徴(好適な構成、効果)は、本発明のガラス板、積層体及び半導体パッケージの製造方法の技術的特徴と重複する。よって、本明細書では、その重複部分について、詳細な記載を省略する。
本発明の電子機器は、半導体パッケージを備える電子機器であって、半導体パッケージが、上記の半導体パッケージであることを特徴とする。ここで、本発明の電子機器の技術的特徴(好適な構成、効果)は、本発明のガラス板、積層体、半導体パッケージの製造方法、半導体パッケージの技術的特徴と重複する。よって、本明細書では、その重複部分について、詳細な記載を省略する。
図面を参酌しながら、本発明の半導体パッケージの製造方法を更に説明する。
図5は、fan out型のWLPの製造工程を示す概念断面図である。図5(a)は、支持部材40の一方の表面上に接着層41を形成した状態を示している。必要に応じて、支持部材40と接着層41の間に剥離層を形成してもよい。次に、図5(b)に示すように、接着層41の上に複数の半導体チップ42を貼付する。その際、半導体チップ42のアクティブ側の面を接着層41に接触させる。次に、図5(c)に示すように、半導体チップ42を樹脂の封止材43でモールドする。封止材43は、圧縮成形後の寸法変化、配線を成形する際の寸法変化が少ない材料が使用される。続いて、図5(d)、(e)に示すように、支持部材40から半導体チップ42がモールドされた加工基板44を分離した後、接着層45を介して、ガラス板46と接着固定させる。その際、加工基板44の表面の内、半導体チップ42が埋め込まれた側の表面とは反対側の表面がガラス板46側に配置される。このようにして、積層体47を得ることができる。なお、必要に応じて、接着層45とガラス板46の間に剥離層を形成してもよい。更に、得られた積層体47を搬送した後に、図5(f)に示すように、加工基板44の半導体チップ42が埋め込まれた側の表面に配線48を形成した後、複数の半田バンプ49を形成する。最後に、ガラス板46から加工基板44を分離した後に、加工基板44を半導体チップ42毎に切断し、後のパッケージング工程に供される(図5(g))。
以下、本発明を実施例に基づいて説明する。なお、以下の実施例は単なる例示である。本発明は、以下の実施例に何ら限定されない。
ガラス組成として、質量%で、SiO 65.5%、Al 8%、B 9%、NaO 13.1%、CaO 3%、ZnO 1%、SnO 0.3%、Sb 0.1%になるように、ガラス原料を調合した後、ガラス溶融炉に投入して1500〜1600℃で溶融し、次いで溶融ガラスをオーバーフローダウンドロー成形装置に供給して、板厚が1.0mmになるように成形し、更に所定サイズに切断、アニール処理した。
次に、得られたガラス板をφ300mmの真円状になるまで外周加工した後、半円形状の窪み、つまりノッチ形状を有する位置合わせ部(深さ1.1mm)を形成すると共に、その位置合わせ部を面取り加工した。面取り加工の際に、位置合わせ部の板厚方向の面取り幅は板厚の50%とした上で、位置合わせ部の表面方向の面取り幅が異なるガラス板を作製した。また、ガラス板の位置合わせ部と外形部の境界について連続的に丸みを帯びた状態に加工した。なお、面取り加工に用いた研磨パッドはウレタン製であり、面取り面は#800の研磨粗さとなっている。
続いて、外形加工後のガラス板の表面を研磨装置で研磨処理することにより、ガラス板の全体板厚偏差を1.0μm未満まで低減した。具体的には、ガラス板の両表面を外径が相違する一対の研磨パットで挟み込み、ガラス板と一対の研磨パッドを共に回転させながらガラス板の両表面を研磨処理した。研磨処理の際、時折、ガラス板の一部が研磨パッドから食み出すように制御した。なお、研磨パッドはウレタン製、研磨処理の際に使用した研磨スラリーの平均粒径は2.5μm、研磨速度は15m/分であった。
最後に、表面方向の面取り幅が異なる各ガラス板について、島津製作所社製精密万能試験機オートグラフAG−ISを用いて、四点曲げ試験を各10回行った。その結果を表1に示す。なお、四点曲げ試験の条件は、加圧冶具幅25mm、支持冶具幅50mm、クロスヘッド下降速度5mm/minとし、位置合わせ部を加圧冶具間に配置した。
Figure 0006611079
表1から分かるように、位置合わせ部を面取りすると、破壊強度が高くなった。そして、位置合わせ部の表面方向の面取り幅を大きくすると、破壊強度が高くなった。
まず、表2に記載の試料No.1〜7のガラス組成になるように、ガラス原料を調合した後、ガラス溶融炉に投入して1500〜1600℃で溶融し、次いで溶融ガラスをオーバーフローダウンドロー成形装置に供給し、板厚が0.8mmになるようにそれぞれ成形した。その後、[実施例1]と同様にして、外周加工を行うと共に、半円形状の窪みを有する位置合わせ部を形成した。次に、位置合わせ部と外形部を面取り加工した。面取り加工の際に、板厚方向の面取り幅を板厚の50%とした上で、表面方向の面取り幅を600μmとした。また、ガラス板の位置合わせ部と外形部の境界について連続的に丸みを帯びた状態に加工した。なお、面取り加工に用いた研磨パッドはウレタン製であり、面取り面は#800の研磨粗さとなっている。得られた各ガラス板について、30〜380℃の温度範囲における平均熱膨張係数α30〜380、密度ρ、歪点Ps、アニール点Ta、軟化点Ts、高温粘度104.0dPa・sにおける温度、高温粘度103.0dPa・sにおける温度、高温粘度102.5dPa・sにおける温度、高温粘度102.0dPa・sにおける温度、液相温度TL及びヤング率Eを評価した。なお、外形加工後のガラス板について、コベルコ科研社製のSBW−331ML/dにより全体板厚偏差と反り量を測定したところ、全体板厚偏差がそれぞれ3μmであり、反り量がそれぞれ70μmであった。
Figure 0006611079
30〜380℃の温度範囲における平均熱膨張係数α30〜380は、ディラトメーターで測定した値である。
密度ρは、周知のアルキメデス法によって測定した値である。
歪点Ps、アニール点Ta、軟化点Tsは、ASTM C336の方法に基づいて測定した値である。
高温粘度104.0dPa・s、103.0dPa・s、102.5dPa・sにおける温度は、白金球引き上げ法で測定した値である。
液相温度TLは、標準篩30メッシュ(500μm)を通過し、50メッシュ(300μm)に残るガラス粉末を白金ボートに入れて、温度勾配炉中に24時間保持した後、結晶が析出する温度を顕微鏡観察にて測定した値である。
ヤング率Eは、共振法により測定した値を指す。
続いて、外形加工後のガラス板の表面を研磨装置により研磨処理した。具体的には、ガラス板の両表面を外径が相違する一対の研磨パットで挟み込み、ガラス板と一対の研磨パッドを共に回転させながらガラス板の両表面を研磨処理した。研磨処理の際、時折、ガラス板の一部が研磨パッドから食み出すように制御した。なお、研磨パッドはウレタン製、研磨処理の際に使用した研磨スラリーの平均粒径は2.5μm、研磨速度は15m/分であった。得られた各研磨処理済みガラス板について、コベルコ科研社製のSBW−331ML/dにより全体板厚偏差と反り量を測定した。その結果、全体板厚偏差がそれぞれ0.45μmであり、反り量がそれぞれ35μmであった。
[実施例1]で得られた試料No.2に係るガラス板の位置合わせ部と位置合わせ部以外の領域(外形部)について、面取り面を含む端面全体を鏡面研磨処理した後、[実施例1]と同様の方法によりガラス板の表面を研磨装置で研磨処理した。なお、鏡面研磨処理に用いた研磨パッドはウレタン製であり、鏡面研磨処理された表面は#3000の研磨粗さとなっている。比較対象として、面取り面を含む端面全体を#1500の研磨パッドで研磨処理したものも作製した。
続いて、得られたガラス板について、JIS B0601:2001に準拠した方法により、面取り面を含む端面の表面粗さを測定すると共に、島津製作所社製精密万能試験機オートグラフAG−ISを用いて、四点曲げ試験を各10回行った。その結果を表3に示す。なお、四点曲げ試験の条件は、加圧冶具幅25mm、支持冶具幅50mm、クロスヘッド下降速度5mm/minとし、位置合わせ部を加圧冶具間に配置した。
Figure 0006611079
表3から明らかなように、面取り面を含む端面全体を鏡面研磨処理すると、四点曲げ試験の破壊強度が向上した。
1、5、9、20、36、46 ガラス板
2、6、10、38 位置合わせ部
3、7、11、40 外形部
4、8 ノッチ形状の深部
21、22 表面
23 端面
24、25 面取り面
31、47 積層体
32、33、34 位置決め部材
35、44 加工基板
37 加工基板の位置合わせ部
39 加工基板の外形部
40 支持部材
41、45 接着層
42 半導体チップ
43 封止材
48 配線
49 半田バンプ

Claims (15)

  1. 外形が外形部と位置合わせ部で構成されるガラス板であって、
    位置合わせ部の表面と端面とが交差する端縁領域の全部又は一部が面取りされていることを特徴とすることを特徴とするガラス板。
  2. 位置合わせ部の表面方向の面取り幅が50〜900μmであることを特徴とする請求項1に記載のガラス板。
  3. 位置合わせ部の板厚方向の面取り幅が板厚の5〜80%であることを特徴とする請求項1又は2に記載のガラス板。
  4. 位置合わせ部の表面と端面とが交差する端縁領域に面取り面を有すると共に、面取り面の平均表面粗さRaが0.20μm以下であることを特徴とする請求項1〜3の何れかに記載のガラス板。
  5. 位置合わせ部の表面と端面とが交差する端縁領域に面取り面を有すると共に、面取り面と端面が連続的に丸みを帯びた状態で連結していることを特徴とする請求項1〜4の何れかに記載のガラス板。
  6. 位置合わせ部の形状がノッチ形状であることを特徴とする請求項1〜5の何れかに記載のガラス板。
  7. 外形部の全部又は一部が面取りされており、外形部の表面方向の面取り幅が50〜900μmである請求項1〜6の何れかに記載のガラス板。
  8. 外形がウエハ形状であることを特徴とする請求項1〜7の何れかに記載のガラス板。
  9. 全体板厚偏差が2.0μm未満であることを特徴とする請求項1〜8の何れかに記載のガラス板。
  10. オーバーフローダウンドロー法により成形されてなることを特徴とする請求項1〜9の何れかに記載のガラス板。
  11. 半導体パッケージの製造工程で加工基板の支持に用いることを特徴とする請求項1〜10の何れかに記載のガラス板。
  12. 少なくとも加工基板と加工基板を支持するためのガラス板とを備える積層体であって、ガラス板が請求項1〜11の何れかに記載のガラス板であることを特徴とする積層体。
  13. 少なくとも加工基板と加工基板を支持するためのガラス板とを備える積層体を用意する工程と、
    加工基板に対して、加工処理を行う工程と、を有すると共に、ガラス板が請求項1〜12の何れかに記載のガラス板であることを特徴とする半導体パッケージの製造方法。
  14. 加工処理が、加工基板の一方の表面に配線する工程を含むことを特徴とする請求項13に記載の半導体パッケージの製造方法。
  15. 加工処理が、加工基板の一方の表面に半田バンプを形成する工程を含むことを特徴とする請求項13又は14に記載の半導体パッケージの製造方法。
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Families Citing this family (14)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
WO2016047210A1 (ja) * 2014-09-25 2016-03-31 日本電気硝子株式会社 支持ガラス基板及びこれを用いた積層体
JP6664658B2 (ja) * 2016-03-02 2020-03-13 日本電気硝子株式会社 板ガラスの製造方法
EP3589588A1 (en) * 2017-02-28 2020-01-08 Corning Incorporated Glass article with reduced thickness variation, method for making and apparatus therefor
WO2018207794A1 (ja) * 2017-05-12 2018-11-15 Agc株式会社 ガラス基板、およびガラス基板の製造方法
US11584673B2 (en) * 2017-07-31 2023-02-21 Corning Incorporated Laminate article having a non-glass core and glass envelope and methods thereof
JP7276644B2 (ja) * 2017-08-31 2023-05-18 日本電気硝子株式会社 支持ガラス基板及びこれを用いた積層基板
JP7011062B2 (ja) 2017-10-27 2022-01-26 ショット アクチエンゲゼルシャフト 平面ガラスを製造する装置および方法
CN111741933B (zh) * 2018-02-20 2023-05-16 日本电气硝子株式会社 玻璃
JP7346431B2 (ja) 2018-05-15 2023-09-19 ショット グラス テクノロジーズ (スゾウ) カンパニー リミテッド 特別な面取り部の形状および高強度を有する超薄ガラス
JP7549322B2 (ja) 2020-04-01 2024-09-11 株式会社ノベルクリスタルテクノロジー 半導体基板及びその製造方法
JP2023127000A (ja) * 2020-08-06 2023-09-13 Agc株式会社 積層体の製造方法、積層体および半導体パッケージの製造方法
US11664050B2 (en) * 2021-10-05 2023-05-30 Western Digital Technologies, Inc. Tuned edge profile of a disk substrate for use in magnetic recording media
TWI832451B (zh) * 2022-09-28 2024-02-11 中國砂輪企業股份有限公司 晶圓定位機構以及包含其的晶圓定位治具
WO2024195503A1 (ja) * 2023-03-17 2024-09-26 日本碍子株式会社 仮固定基板および仮固定基板の製造方法

Family Cites Families (9)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP3459058B2 (ja) * 1998-05-18 2003-10-20 株式会社東京精密 ウェーハ面取り方法
JP4109371B2 (ja) * 1999-01-28 2008-07-02 Sumco Techxiv株式会社 半導体ウェハ
JP2000254845A (ja) * 1999-03-10 2000-09-19 Nippei Toyama Corp ウエーハのノッチ溝の面取り方法及びウエーハ
JP2009016771A (ja) * 2007-06-08 2009-01-22 Hoya Candeo Optronics株式会社 ウエハ支持ガラス
JP2009099681A (ja) * 2007-10-15 2009-05-07 Shinko Electric Ind Co Ltd 基板の個片化方法
JP2012111661A (ja) * 2010-11-24 2012-06-14 Nippon Electric Glass Co Ltd ガラス基板およびその製造方法
JP5926527B2 (ja) * 2011-10-17 2016-05-25 信越化学工業株式会社 透明soiウェーハの製造方法
US9894781B2 (en) 2012-06-06 2018-02-13 Apple Inc. Notched display layers
JP6003604B2 (ja) * 2012-12-10 2016-10-05 旭硝子株式会社 積層板の加工方法、加工された積層板

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