JP6584875B2 - スイッチトキャパシタ電源回路 - Google Patents
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Description
図1は、第1の実施形態のスイッチトキャパシタ電源回路の構成を示す図であり、キャパシタとスイッチング素子で構成されるコア部(以降、スイッチトキャパシタ電源回路部という)の一つの実施形態の構成を示す図である。本実施形態のスイッチトキャパシタ電源回路部10は、入力端子1を有する。入力端子1には、直流の入力電圧Vinが印加される。第1の接続ノード3と第2の接続ノード4の間には、キャパシタC3が接続される。第1の接続ノード3と入力端子1間には、スイッチング素子S8が接続される。入力端子1と第2の接続ノード4間には、スイッチング素子S9が接続される。
図3は、第2の実施形態のスイッチトキャパシタ電源回路部10の構成を示す図である。既述した実施形態に対応する構成には同一の符号を付している。本実施形態は、変換倍率(Vout/Vin)を1/2にする実施形態を示す。
Vin−V4=V7−Vin ・・・ (1)
ここで、V4は第2の接続ノード4の電圧、V7は、第5の接続ノード7の電圧を示す。
V4―Vout=Vout−0 ・・・ (2)
Vout−0=V7−Vout ・・・ (3)
図6は、第3の実施形態のスイッチトキャパシタ電源回路の構成を示す図で有る。既述した実施形態に対応する構成には同一の符号を付している。本実施形態は、入力端子1に供給される直流の入力電圧Vinが供給されるスイッチトキャパシタ電源回路部10を備える。スイッチトキャパシタ電源回路部10は、例えば、既述した図1に示す第1の実施形態の構成を備える。
図7は、第4の実施形態のスイッチトキャパシタ電源回路の構成を示す図である。既述の実施形態に対応する構成には同一符号を付している。本実施形態は、比較回路11の出力信号requestが供給されるクロック管理回路20を備える。クロック管理回路20には、クロック信号CLKが供給される。クロック管理回路20は、クロック信号CLKが供給された時にだけ比較回路11の出力信号requestに応答してクロック出力信号clk_swを出力する。クロック管理回路20は、例えば、クロック信号CLKと比較回路11の出力信号requestが供給されるAND回路(図示せず)を有する。
図8は、第5の実施形態のスイッチトキャパシタ電源回路の構成を示す図である。既述の実施形態に対応する構成には同一符号を付している。本実施形態は、直流の入力電圧Vinが供給されるADコンバータ30を有する。ADコンバータ30は、直流の入力電圧Vinをデジタル値に変換して変換倍率選択回路31に供給する。
図9は、第6の実施形態のスイッチトキャパシタ電源回路の構成を示す図である。既述の実施形態に対応する構成には同一符号を付している。本実施形態は、比較回路11からの出力信号requestが供給される滞在時間算出回路40を有する。
図11は、第7の実施形態のスイッチトキャパシタ電源回路の構成を示す図である。既述の実施形態に対応する構成には同一符号を付している。本実施形態は、比較回路11の出力信号requestが供給されるVref制御回路50を有する。Vref制御回路50は、参照電圧Vrefを制御する制御信号Vref_codeを出力する。制御信号Vref_codeは、DAコンバータ51に供給される。DAコンバータ51は、制御信号Vref_codeに応じた参照電圧Vrefを比較回路11に供給する。
図13は、第8の実施形態のスイッチトキャパシタ電源回路の構成を示す図である。既述の実施形態に対応する構成には同一符号を付している。本実施形態は、クロック管理回路20のクロック出力信号clk_swが供給される周波数計数回路60を有する。周波数計数回路60は、クロック管理回路20のクロック出力信号clk_swの周波数fをカウントして、所定の閾値周波数fthと比較し、その比較結果に応じて制御信号frequency_fを変換倍率選択回路31に供給する。クロック出力信号clk_swは、出力電圧Voutと参照電圧Vrefとの比較を行う比較回路11の出力信号requestに応じて出力される。従って、クロック出力信号clk_swの周波数fは、例えば、単位時間内に出力電圧Voutが参照電圧Vrefよりも低くなった回数を示す。
図15は、第9の実施形態のスイッチトキャパシタ電源回路の構成を示す図である。既述の実施形態に対応する構成には同一符号を付している。本実施形態は、第1のスイッチトキャパシタ電源回路部100と第2のスイッチトキャパシタ電源回路部101を有する。夫々のスイッチトキャパシタ電源回路部(100、101)は、既述した図1の実施形態のスイッチトキャパシタ電源回路部10により構成することが出来る。
図16は、第10の実施形態のスイッチトキャパシタ電源回路の構成を示す図である。既述の実施形態に対応する構成には同一符号を付している。本実施形態は、比較回路11の出力信号requestがHレベルの滞在時間Dを算出する滞在時間算出回路40を有する。出力信号requestは、例えば、出力電圧Voutが参照電圧Vrefよりも低い場合にHレベルとなる。滞在時間算出回路40は、算出結果を滞在信号duration_Dとして有限オートマトン70に供給する。
図18は、第11の実施形態のスイッチトキャパシタ電源回路の構成を示す図である。既述の実施形態に対応する構成には同一符号を付している。本実施形態は、スイッチトキャパシタ電源回路部10の出力を受けるスイッチ回路201を有する。スイッチ回路201は、制御回路200からの切替信号switchに応答して第1の入力ノード210の接続先を切替え、スイッチトキャパシタ電源回路部10の出力電圧Voutの供給先を第1の出力ノード211と第2の出力ノード221の間で切替えて供給する。第1の出力ノード211は、第1の出力端子121に接続され、第2の出力ノード221は第2の出力端子122に接続される。第1の出力端子121から第1の出力電圧Vout1が第1の負荷(図示せず)に供給され、第2の出力端子122から第2の出力電圧Vout2が第2の負荷(図示せず)に供給される。
図19は、第12の実施形態のスイッチトキャパシタ電源回路の構成を示す図である。既述の実施形態に対応する構成には同一符号を付している。本実施形態は、第1のスイッチトキャパシタ電源回路部100と第2のスイッチトキャパシタ電源回路部101を有する。第1のスイッチトキャパシタ電源回路部100と第2のスイッチトキャパシタ電源回路部101の出力は、スイッチ回路201に供給される。スイッチ回路201は、制御回路200からの切替信号switchに応じて、第1の入力ノード210と第2の入力ノード220の接続先を、第1の出力ノード211と第2の出力ノード221の間で切替える。
図20は、第13の実施形態のスイッチトキャパシタ電源回路の構成を示す図である。既述の実施形態に対応する構成には同一符号を付している。本実施形態は、第1の出力端子121の出力電圧Vout1と第1の参照電圧Vref1を比較する第1の比較回路111と、第2の出力端子122の出力電圧Vout2と第2の参照電圧Vref2を比較する第2の比較回路112を有する。第1の比較回路111は、例えば、第1の出力電圧Vout1が第1の参照電圧Vref1よりも低くなるとHレベルの出力信号request1を出力する。第2の比較回路112は、例えば、第2の出力電圧Vout2が第2の参照電圧Vref2よりも低くなるとHレベルの出力信号request2を出力する。第1の比較回路111の出力信号request1と第2の比較回路112の出力信号request2は制御回路12に供給される。
図21は、第14の実施形態のスイッチトキャパシタ電源回路の構成を示す図である。既述の実施形態に対応する構成には同一符号を付している。本実施形態は、第1の比較回路111の出力信号request1と、第2の比較回路112の出力信号request2が供給されるクロック管理回路300を有する。クロック管理回路300には、クロック信号CLKが供給され、クロック管理回路300は、クロック信号CLKが供給された期間のみ動作する。
Claims (14)
- 入力電圧が印加される入力端子と、
出力電圧を出力する出力端子と、
第1の接続ノードと、
第2の接続ノードと、
第3の接続ノードと、
第4の接続ノードと、
第5の接続ノードと、
第6の接続ノードと、
前記第3の接続ノードと前記第4の接続ノード間に接続される第1のキャパシタと、
前記第5の接続ノードと前記第6の接続ノード間に接続される第2のキャパシタと、
前記第1の接続ノードと前記第2の接続ノード間に接続される第3のキャパシタと、
前記第4の接続ノードと接地間に接続される第1のスイッチング素子と、
前記出力端子と前記第6の接続ノード間に接続される第2のスイッチング素子と、
前記第6の接続ノードと前記接地間に接続される第3のスイッチング素子と、
前記出力端子と前記第3の接続ノード間に接続される第4のスイッチング素子と、
前記出力端子と前記第5の接続ノード間に接続される第5のスイッチング素子と、
前記出力端子と前記第4の接続ノード間に接続される第6のスイッチング素子と、
前記第1の接続ノードと前記第5の接続ノード間に接続される第7のスイッチング素子と、
前記入力端子と前記第1の接続ノード間に接続される第8のスイッチング素子と、
前記入力端子と前記第2の接続ノード間に接続される第9のスイッチング素子と、
前記第2の接続ノードと前記第3の接続ノード間に接続される第10のスイッチング素子と、
を有するスイッチトキャパシタ電源回路部と、
前記入力電圧を所定の変換倍率で変換して前記出力電圧を出力する為に、前記スイッチング素子の内の選択したスイッチング素子を前記所定の変換倍率を維持する間オン状態、またはオフ状態にする第1の駆動信号と、前記スイッチング素子の内で選択されなかったスイッチング素子を所定の周期でオン/オフさせる相補的な第1の位相と第2の位相を有する2相のゲート信号で構成される第2の駆動信号を供給する制御回路と
を具備し、
前記制御回路は、前記所定の変換倍率を維持する間、
前記第8のスイッチング素子を前記第2の駆動信号の前記第1の位相のゲート信号でオンさせ、
前記第7のスイッチング素子を前記第2の駆動信号の前記第2の位相のゲート信号でオンさせる
ことを特徴とするスイッチトキャパシタ電源回路。 - 前記スイッチトキャパシタ電源回路部は、前記第3の接続ノードと前記第5の接続ノード間に接続される第11のスイッチング素子を更に有することを特徴とする請求項1に記載のスイッチトキャパシタ電源回路。
- 前記スイッチトキャパシタ電源回路部は、
前記入力端子と前記第6の接続ノード間に接続される第12のスイッチング素子と、
前記入力端子と前記第4の接続ノード間に接続される第13のスイッチング素子と、
を更に有することを特徴とする請求項2に記載のスイッチトキャパシタ電源回路。 - 複数のキャパシタを備え、前記複数のキャパシタ間の接続構成を切替えて前記複数のキャパシタの充放電を行うことで入力電圧を所定の変換倍率で変換した電圧を出力電圧として出力端子に供給するスイッチトキャパシタ電源回路部と、
前記出力電圧に応じて前記複数のキャパシタ間の接続構成を切替えて前記変換倍率を変更させる制御信号を前記スイッチトキャパシタ電源回路部に供給する制御回路と、
を具備し、
前記スイッチトキャパシタ電源回路部は、
前記入力電圧が印加される入力端子と、
前記出力電圧を出力する出力端子と、
第1の接続ノードと、
第2の接続ノードと、
第3の接続ノードと、
第4の接続ノードと、
第5の接続ノードと、
第6の接続ノードと、
前記第3の接続ノードと前記第4の接続ノード間に接続される第1のキャパシタと、
前記第5の接続ノードと前記第6の接続ノード間に接続される第2のキャパシタと、
前記第1の接続ノードと前記第2の接続ノード間に接続される第3のキャパシタと、
前記第4の接続ノードと接地間に接続される第1のスイッチング素子と、
前記出力端子と前記第6の接続ノード間に接続される第2のスイッチング素子と、
前記第6の接続ノードと前記接地間に接続される第3のスイッチング素子と、
前記出力端子と前記第3の接続ノード間に接続される第4のスイッチング素子と、
前記出力端子と前記第5の接続ノード間に接続される第5のスイッチング素子と、
前記出力端子と前記第4の接続ノード間に接続される第6のスイッチング素子と、
前記第1の接続ノードと前記第5の接続ノード間に接続される第7のスイッチング素子と、
前記入力端子と前記第1の接続ノード間に接続される第8のスイッチング素子と、
前記入力端子と前記第2の接続ノード間に接続される第9のスイッチング素子と、
前記第2の接続ノードと前記第3の接続ノード間に接続される第10のスイッチング素子と、
前記第3の接続ノードと前記第5の接続ノード間に接続される第11のスイッチング素子と、
前記入力端子と前記第6の接続ノード間に接続される第12のスイッチング素子と、
前記入力端子と前記第4の接続ノード間に接続される第13のスイッチング素子と、
を有することを特徴とするスイッチトキャパシタ電源回路。 - 前記制御回路は、前記複数のキャパシタ間に接続される複数のスイッチング素子の内で前記所定の変換倍率を維持する期間の間オン状態にするスイッチング素子の組み合わせを前記入力電圧に応じて変更して、前記変換倍率を変更することを特徴とする請求項4に記載のスイッチトキャパシタ電源回路。
- 前記スイッチトキャパシタ電源回路部の出力電圧を第1の出力端子と第2の出力端子に切替えて供給するスイッチ回路を具備することを特徴とする請求項4または5に記載のスイッチトキャパシタ電源回路。
- 前記第1の出力端子の電圧と第1の参照電圧を比較する第1の比較回路と、
前記第2の出力端子の電圧と第2の参照電圧を比較する第2の比較回路と、
を具備し、
前記制御回路は、
前記第1の出力端子の電圧が前記第1の参照電圧よりも低下した場合に前記第1の比較回路が出力する出力信号に応じて、前記スイッチトキャパシタ電源回路部の出力電圧が第1の出力端子に供給される時の前記スイッチトキャパシタ電源回路部の変換倍率を前記スイッチトキャパシタ電源回路部の出力電圧を上昇させる変換倍率に変更し、
前記第2の出力端子の電圧が前記第2の参照電圧よりも低下した場合に前記第2の比較回路が出力する出力信号に応じて、前記スイッチトキャパシタ電源回路部の出力電圧が前記第2の出力端子に供給される時の前記スイッチトキャパシタ電源回路部の変換倍率を前記スイッチトキャパシタ電源回路部の出力電圧を上昇させる変換倍率に変更することを特徴とする請求項6に記載のスイッチトキャパシタ電源回路。 - 複数のキャパシタを有し、前記複数のキャパシタ間の接続構成を切替えて前記複数のキャパシタを充放電させて入力電圧を第1の変換倍率で変換した第1の出力電圧を出力する第1のスイッチトキャパシタ電源回路部と、
複数のキャパシタを有し、前記複数のキャパシタ間の接続構成を切替えて前記複数のキャパシタを充放電させて前記入力電圧を第2の変換倍率で変換した第2の出力電圧を出力する第2のスイッチトキャパシタ電源回路部と、
前記第1のスイッチトキャパシタ電源回路部を駆動する第1の駆動信号と前記第2のスイッチトキャパシタ電源回路部を駆動する第2の駆動信号を供給する制御回路と、
を具備し、
前記第1のスイッチトキャパシタ電源回路部は、
前記入力電圧が印加される入力端子と、
前記第1の出力電圧を出力する出力端子と、
第1の接続ノードと、
第2の接続ノードと、
第3の接続ノードと、
第4の接続ノードと、
第5の接続ノードと、
第6の接続ノードと、
前記第3の接続ノードと前記第4の接続ノード間に接続される第1のキャパシタと、
前記第5の接続ノードと前記第6の接続ノード間に接続される第2のキャパシタと、
前記第1の接続ノードと前記第2の接続ノード間に接続される第3のキャパシタと、
前記第4の接続ノードと接地間に接続される第1のスイッチング素子と、
前記出力端子と前記第6の接続ノード間に接続される第2のスイッチング素子と、
前記第6の接続ノードと前記接地間に接続される第3のスイッチング素子と、
前記出力端子と前記第3の接続ノード間に接続される第4のスイッチング素子と、
前記出力端子と前記第5の接続ノード間に接続される第5のスイッチング素子と、
前記出力端子と前記第4の接続ノード間に接続される第6のスイッチング素子と、
前記第1の接続ノードと前記第5の接続ノード間に接続される第7のスイッチング素子と、
前記入力端子と前記第1の接続ノード間に接続される第8のスイッチング素子と、
前記入力端子と前記第2の接続ノード間に接続される第9のスイッチング素子と、
前記第2の接続ノードと前記第3の接続ノード間に接続される第10のスイッチング素子と、
前記第3の接続ノードと前記第5の接続ノード間に接続される第11のスイッチング素子と、
前記入力端子と前記第6の接続ノード間に接続される第12のスイッチング素子と、
前記入力端子と前記第4の接続ノード間に接続される第13のスイッチング素子と、
を有することを特徴とするスイッチトキャパシタ電源回路。 - 前記第1のスイッチトキャパシタ電源回路部の出力電圧と前記第2のスイッチトキャパシタ電源回路部の出力電圧は、共通の出力端子に供給されることを特徴とする請求項8に記載のスイッチトキャパシタ電源回路。
- 前記出力端子の電圧を所定の参照電圧と比較する比較回路を備え、前記比較回路の出力信号に応じて前記第1のスイッチトキャパシタ電源回路部と前記第2のスイッチトキャパシタ電源回路部の両方を動作させるか、または一方の動作を停止させることを特徴とする請求項9に記載のスイッチトキャパシタ電源回路。
- 前記比較回路の出力信号に応答して、前記出力端子の電圧が前記所定の参照電圧よりも低い滞在時間を算出する滞在時間算出回路と、
前記比較回路の出力信号に応答して、前記出力端子の電圧が前記所定の参照電圧より低くなる回数を示すクロック信号を出力するクロック信号出力回路とを備え、
前記制御回路は、
前記第1のスイッチトキャパシタ電源回路部、または、前記第2のスイッチトキャパシタ電源回路部の一方が動作する状態において、前記出力端子の電圧が前記所定の参照電圧よりも低い滞在時間が所定の閾値滞在時間よりも長くなった時に前記第1のスイッチトキャパシタ電源回路部と前記第2のスイッチトキャパシタ電源回路部の両方が動作する状態に移行させ、
前記第1のスイッチトキャパシタ電源回路部と前記第2のスイッチトキャパシタ電源回路部の両方が動作する状態において、前記出力端子の電圧が前記所定の参照電圧よりも低くなる単位時間当たりの回数を示す前記クロック信号の周波数が所定の閾値周波数よりも低くなった時に前記第1のスイッチトキャパシタ電源回路部と前記第2のスイッチトキャパシタ電源回路部の一方の動作が停止する動作状態に移行させる
ことを特徴とする請求項10に記載のスイッチトキャパシタ電源回路。 - 前記第1のスイッチトキャパシタ電源回路部の第1の出力電圧が供給される第1の入力ノードと、
前記第2のスイッチトキャパシタ電源回路部の第2の出力電圧が供給される第2の入力ノードと、
第1の出力端子と、
第2の出力端子と、
前記第1の入力ノードと前記第2の入力ノードの接続先を、前記第1の出力端子と前記第2の出力端子との間で切替えて接続するスイッチ回路と、
を具備することを特徴とする請求項8に記載のスイッチトキャパシタ電源回路。 - 入力電圧が印加される入力端子と、
出力電圧を出力する出力端子と、
第1の接続ノードと、
第2の接続ノードと、
第3の接続ノードと、
第4の接続ノードと、
第5の接続ノードと、
第6の接続ノードと、
前記第3の接続ノードと前記第4の接続ノード間に接続される第1のキャパシタと、
前記第5の接続ノードと前記第6の接続ノード間に接続される第2のキャパシタと、
前記第1の接続ノードと前記第2の接続ノード間に接続される第3のキャパシタと、
前記第4の接続ノードと接地間に接続される第1のスイッチング素子と、
前記出力端子と前記第6の接続ノード間に接続される第2のスイッチング素子と、
前記第6の接続ノードと前記接地間に接続される第3のスイッチング素子と、
前記出力端子と前記第3の接続ノード間に接続される第4のスイッチング素子と、
前記出力端子と前記第5の接続ノード間に接続される第5のスイッチング素子と、
前記出力端子と前記第4の接続ノード間に接続される第6のスイッチング素子と、
前記第1の接続ノードと前記第5の接続ノード間に接続される第7のスイッチング素子と、
前記入力端子と前記第1の接続ノード間に接続される第8のスイッチング素子と、
前記入力端子と前記第2の接続ノード間に接続される第9のスイッチング素子と、
前記第2の接続ノードと前記第3の接続ノード間に接続される第10のスイッチング素子と、
前記第3の接続ノードと前記第5の接続ノード間に接続される第11のスイッチング素子と
を有するスイッチトキャパシタ電源回路部を具備することを特徴とするスイッチトキャパシタ電源回路。 - 前記スイッチトキャパシタ電源回路部は、
前記入力端子と前記第6の接続ノード間に接続される第12のスイッチング素子と、
前記入力端子と前記第4の接続ノード間に接続される第13のスイッチング素子と、
を更に有することを特徴とする請求項13に記載のスイッチトキャパシタ電源回路。
Priority Applications (2)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP2015172909A JP6584875B2 (ja) | 2015-09-02 | 2015-09-02 | スイッチトキャパシタ電源回路 |
US15/060,749 US9973080B2 (en) | 2015-09-02 | 2016-03-04 | Switched capacitor power supply circuit |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP2015172909A JP6584875B2 (ja) | 2015-09-02 | 2015-09-02 | スイッチトキャパシタ電源回路 |
Publications (2)
Publication Number | Publication Date |
---|---|
JP2017050995A JP2017050995A (ja) | 2017-03-09 |
JP6584875B2 true JP6584875B2 (ja) | 2019-10-02 |
Family
ID=58096109
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP2015172909A Active JP6584875B2 (ja) | 2015-09-02 | 2015-09-02 | スイッチトキャパシタ電源回路 |
Country Status (2)
Country | Link |
---|---|
US (1) | US9973080B2 (ja) |
JP (1) | JP6584875B2 (ja) |
Families Citing this family (9)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
WO2018023695A1 (en) * | 2016-08-05 | 2018-02-08 | The University Of Hong Kong | High-efficiency switched-capacitor power supplies and methods |
EP3396834B1 (en) * | 2017-04-28 | 2023-03-22 | Nxp B.V. | Switched capacitor power converter |
KR102388940B1 (ko) * | 2017-05-22 | 2022-04-22 | 삼성전자 주식회사 | 전압 변환 회로, 이를 포함하는 전자 장치 및 전압 변환 방법 |
US9973081B1 (en) * | 2017-08-17 | 2018-05-15 | Qualcomm Incorporated | Low-power low-duty-cycle switched-capacitor voltage divider |
US10790740B2 (en) * | 2018-05-02 | 2020-09-29 | Analog Devices Global Unlimited Company | Techniques for switch capacitor regulator power savings |
JP7082562B2 (ja) * | 2018-11-21 | 2022-06-08 | ルネサスエレクトロニクス株式会社 | 制御システム、半導体装置及び半導体装置の製造方法 |
US10756622B2 (en) * | 2018-12-24 | 2020-08-25 | Apple Inc | Power management system switched capacitor voltage regulator with integrated passive device |
KR102581100B1 (ko) * | 2019-03-07 | 2023-09-20 | 삼성전기주식회사 | 차지 펌프 기반의 네가티브 전압 회로 |
KR102355293B1 (ko) * | 2019-09-27 | 2022-01-25 | 주식회사 실리콘마이터스 | 스위치-커패시터 컨버터 |
Family Cites Families (16)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JP3403006B2 (ja) * | 1997-06-24 | 2003-05-06 | 株式会社東芝 | 半導体集積回路装置 |
US6055168A (en) * | 1998-03-04 | 2000-04-25 | National Semiconductor Corporation | Capacitor DC-DC converter with PFM and gain hopping |
US6198645B1 (en) * | 1998-07-02 | 2001-03-06 | National Semiconductor Corporation | Buck and boost switched capacitor gain stage with optional shared rest state |
US6169673B1 (en) * | 1999-01-27 | 2001-01-02 | National Semiconductor Corporation | Switched capacitor circuit having voltage management and method |
US6215288B1 (en) | 2000-02-25 | 2001-04-10 | Cadence Design Systems, Inc. | Ultra-low power switching regulator method and apparatus |
US6563235B1 (en) * | 2000-10-03 | 2003-05-13 | National Semiconductor Corporation | Switched capacitor array circuit for use in DC-DC converter and method |
US6753623B2 (en) * | 2000-12-05 | 2004-06-22 | National Semiconductor Corporation | Switched capacitor array circuits having universal rest state and method |
US6937517B2 (en) * | 2002-07-18 | 2005-08-30 | Micron Technology, Inc. | Clock regulation scheme for varying loads |
GB0416881D0 (en) * | 2004-07-29 | 2004-09-01 | Koninkl Philips Electronics Nv | Apparatus comprising a charge pump and LCD driver comprising such an apparatus |
WO2006102927A1 (en) * | 2005-04-01 | 2006-10-05 | Freescale Semiconductor, Inc. | Charge pump and control scheme |
JP2007166864A (ja) * | 2005-12-16 | 2007-06-28 | Arueido Kk | チャージポンプ回路制御装置、及びチャージポンプ回路制御方法 |
US9118238B2 (en) | 2007-11-21 | 2015-08-25 | O2Micro, Inc. | Charge pump systems with adjustable frequency control |
JP4788826B2 (ja) * | 2010-01-22 | 2011-10-05 | カシオ計算機株式会社 | 電源装置 |
JP5648198B2 (ja) | 2010-04-01 | 2015-01-07 | パナソニック株式会社 | スイッチトキャパシタ装置 |
US8514628B2 (en) * | 2011-09-22 | 2013-08-20 | Sandisk Technologies Inc. | Dynamic switching approach to reduce area and power consumption of high voltage charge pumps |
US8797770B2 (en) * | 2011-12-06 | 2014-08-05 | Conexant Systems, Inc. | System and method for capacitive DC-DC converter with variable input and output voltages |
-
2015
- 2015-09-02 JP JP2015172909A patent/JP6584875B2/ja active Active
-
2016
- 2016-03-04 US US15/060,749 patent/US9973080B2/en active Active
Also Published As
Publication number | Publication date |
---|---|
US9973080B2 (en) | 2018-05-15 |
JP2017050995A (ja) | 2017-03-09 |
US20170063222A1 (en) | 2017-03-02 |
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A621 | Written request for application examination |
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A711 | Notification of change in applicant |
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A711 | Notification of change in applicant |
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|
A977 | Report on retrieval |
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|
A521 | Written amendment |
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|
A131 | Notification of reasons for refusal |
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|
A521 | Written amendment |
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|
TRDD | Decision of grant or rejection written | ||
A01 | Written decision to grant a patent or to grant a registration (utility model) |
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|
A61 | First payment of annual fees (during grant procedure) |
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|
R150 | Certificate of patent or registration of utility model |
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