JP6307829B2 - 回路装置及び電子機器 - Google Patents
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Description
図1に、回路装置の構成例を示す。回路装置200は、ブリッジ回路210、レジスター部235、制御回路240、遅延部250、プリドライバー部260を含む。なお、以下では回路装置200をモーター駆動装置に適用する場合を例に説明するが、本実施形態の回路装置200は、ブリッジ回路210で外部回路を駆動する装置であれば適用可能である。
次に、具体的なブリッジ回路210の構成における遅延時間TD1〜TD4の設定手法について説明する。
次に、遅延回路251〜254の詳細について説明する。
図11に、回路装置200の詳細な構成例を示す。また図12に、回路装置200の詳細な構成例における動作説明図を示す。
図13に、本実施形態の回路装置200が適用された電子機器の構成例を示す。電子機器は、処理部300、記憶部310、操作部320、入出力部330、回路装置200、これらの各部を接続するバス340、モーター280を含む。回路装置200は、例えば集積回路装置により実現できる。以下ではモーター駆動によりヘッドや紙送りを制御するプリンターを例にとり説明するが、本実施形態はこれに限定されず、種々の電子機器に適用可能である。
230 基準電圧生成回路、235 レジスター部、236 期間設定レジスター、
237 遅延設定レジスター、238 上限設定レジスター、240 制御回路、
250 遅延部、251〜254 第1〜第4の遅延回路、
260 プリドライバー部、261〜264 第1〜第4のプリドライバー、
270 クロック生成回路、280 モーター、290 センス抵抗、
300 処理部、310 記憶部、320 操作部、330 入出力部、340 バス、
CLK クロック信号、D1〜D4 ダイオード、
FF1〜FF4 第1〜第4のフリップフロップ回路、
G1〜G4 第1〜第4の駆動信号、Id 駆動電流、Imax 上限、
OR1 論理和回路、OUT1,OUT2 端子、
Q1〜Q4 第1〜第4のトランジスター、QF1〜QF4 遅延パルス信号、
RNF 端子、S1〜S4 第1〜第4の駆動パルス信号、
SD1〜SD4 遅延された第1〜第4の駆動パルス信号、
SEL セレクト信号、SEL1 セレクター、TC チャージ期間、
TD ディケイ期間、TD1〜TD4 第1〜第4の遅延時間
Claims (7)
- 第1の電源電位と前記第1の電源電位より低電位の第2の電源電位との間に直列に接続されたP型の第1のハイサイドトランジスターとN型の第1のローサイドトランジスターと、前記第1の電源電位と前記第2の電源電位との間に直列に接続されたP型の第2のハイサイドトランジスターとN型の第2のローサイドトランジスターと、を有するHブリッジ回路と、
前記第1のハイサイドトランジスターをオン・オフ制御する第1の駆動パルス信号を出力し、前記第1のローサイドトランジスターをオン・オフ制御する第2の駆動パルス信号を出力し、前記第2のハイサイドトランジスターをオン・オフ制御する第3の駆動パルス信号を出力し、前記第2のローサイドトランジスターをオン・オフ制御する第4の駆動パルス信号を出力する制御回路と、
前記第1の駆動パルス信号を第1の遅延時間情報に基づいて第1の遅延時間遅延させる第1の遅延回路と、
前記第2の駆動パルス信号を第2の遅延時間情報に基づいて第2の遅延時間遅延させる第2の遅延回路と、
前記第3の駆動パルス信号を第3の遅延時間情報に基づいて第3の遅延時間遅延させる第3の遅延回路と、
前記第4の駆動パルス信号を第4の遅延時間情報に基づいて第4の遅延時間遅延させる第4の遅延回路と、
遅延された前記第1の駆動パルス信号に基づいて、前記第1のハイサイドトランジスターを駆動する第1のプリドライバーと、
遅延された前記第2の駆動パルス信号に基づいて、前記第1のローサイドトランジスターを駆動する第2のプリドライバーと、
遅延された前記第3の駆動パルス信号に基づいて、前記第2のハイサイドトランジスターを駆動する第3のプリドライバーと、
遅延された前記第4の駆動パルス信号に基づいて、前記第2のローサイドトランジスターを駆動する第4のプリドライバーと、
前記第1の遅延時間情報、前記第2の遅延時間情報、前記第3の遅延時間情報及び前記第4の遅延時間情報が保存される遅延設定レジスターと、
を含み、
前記遅延設定レジスターには、
前記第2のハイサイドトランジスターをオフからオンにする際の前記第3の遅延時間よりも前記第1のローサイドトランジスターをオフからオンにする際の前記第2の遅延時間が長くなるように、前記第3の遅延時間情報と前記第2の遅延時間情報が設定され、
前記第1のハイサイドトランジスターをオフからオンにする際の前記第1の遅延時間よりも前記第2のローサイドトランジスターをオフからオンにする際の前記第4の遅延時間が長くなるように、前記第1の遅延時間情報と前記第4の遅延時間情報が設定され、
前記第1の遅延時間より前記第2の遅延時間が長くなるように、前記第1の遅延時間情報と前記第2の遅延時間情報が設定され、
前記第3の遅延時間より前記第4の遅延時間が長くなるように、前記第3の遅延時間情報と前記第4の遅延時間情報が設定されることを特徴とする回路装置。 - 請求項1において、
前記遅延設定レジスターには、
前記第1〜第4の遅延時間情報として第1〜第4のクロック数が設定され、
前記第1〜第4の遅延回路は、
前記第1〜第4のクロック数だけ、前記第1〜第4のトランジスターをオフからオンにする際の前記第1〜第4の駆動パルス信号を遅延させることを特徴とする回路装置。 - 請求項2において、
前記第1〜第4の遅延回路のうち第iの遅延回路(iは4以下の自然数)は、
前記第1〜第4の駆動パルス信号のうち第iの駆動パルス信号をそれぞれ1クロック〜kクロック(kは2以上の自然数)だけ遅延した第1〜第kの遅延パルス信号を出力する、カスケード接続された第1〜第kのフリップフロップ回路と、
前記第1〜第4の遅延時間情報のうち第iの遅延時間情報に対応する遅延パルス信号を、前記第1〜第kの遅延パルス信号から選択するセレクターと、
前記第1〜第4のトランジスターのうち第iのトランジスターをオフからオンにする場合のエッジとして、前記セレクターが選択した遅延パルス信号のエッジを出力する論理回路と、
を有することを特徴とする回路装置。 - 請求項3において、
前記第1、第3のプリドライバーは、
入力信号を正転論理で出力するレベルシフターであり、
前記第2、第4のプリドライバーは、
入力信号を反転論理で出力するレベルシフターであることを特徴とする回路装置。 - 第1の電源電位と前記第1の電源電位より低電位の第2の電源電位との間に直列に接続されたP型の第1のハイサイドトランジスターとN型の第1のローサイドトランジスターと、前記第1の電源電位と前記第2の電源電位との間に直列に接続されたP型の第2のハイサイドトランジスターとN型の第2のローサイドトランジスターと、を有するHブリッジ回路と、
前記第1のハイサイドトランジスターをオン・オフ制御する第1の駆動パルス信号を出力し、前記第1のローサイドトランジスターをオン・オフ制御する第2の駆動パルス信号を出力し、前記第2のハイサイドトランジスターをオン・オフ制御する第3の駆動パルス信号を出力し、前記第2のローサイドトランジスターをオン・オフ制御する第4の駆動パルス信号を出力する制御回路と、
前記第1の駆動パルス信号を第1の遅延時間遅延させる第1の遅延回路と、
前記第2の駆動パルス信号を第2の遅延時間遅延させる第2の遅延回路と、
前記第3の駆動パルス信号を第3の遅延時間遅延させる第3の遅延回路と、
前記第4の駆動パルス信号を第4の遅延時間遅延させる第4の遅延回路と、
遅延された前記第1の駆動パルス信号に基づいて、前記第1のハイサイドトランジスターを駆動する第1のプリドライバーと、
遅延された前記第2の駆動パルス信号に基づいて、前記第1のローサイドトランジスターを駆動する第2のプリドライバーと、
遅延された前記第3の駆動パルス信号に基づいて、前記第2のハイサイドトランジスターを駆動する第3のプリドライバーと、
遅延された前記第4の駆動パルス信号に基づいて、前記第2のローサイドトランジスターを駆動する第4のプリドライバーと、
を含み、
前記第2のハイサイドトランジスターをオフからオンにする際の前記第3の遅延時間よりも前記第1のローサイドトランジスターをオフからオンにする際の前記第2の遅延時間が長く、
前記第1のハイサイドトランジスターをオフからオンにする際の前記第1の遅延時間よりも前記第2のローサイドトランジスターをオフからオンにする際の前記第4の遅延時間が長く、
前記第1の遅延時間より前記第2の遅延時間が長く、
前記第3の遅延時間より前記第4の遅延時間が長いことを特徴とする回路装置。 - 第1の電源電位と前記第1の電源電位より低電位の第2の電源電位との間に直列に接続されたP型の第1のハイサイドトランジスターとN型の第1のローサイドトランジスターと、前記第1の電源電位と前記第2の電源電位との間に直列に接続されたP型の第2のハイサイドトランジスターとN型の第2のローサイドトランジスターと、を有するHブリッジ回路を駆動する回路装置であって、
前記第1のハイサイドトランジスターをオン・オフ制御する第1の駆動パルス信号を出力し、前記第1のローサイドトランジスターをオン・オフ制御する第2の駆動パルス信号を出力し、前記第2のハイサイドトランジスターをオン・オフ制御する第3の駆動パルス信号を出力し、前記第2のローサイドトランジスターをオン・オフ制御する第4の駆動パルス信号を出力する制御回路と、
前記第1の駆動パルス信号を第1の遅延時間遅延させる第1の遅延回路と、
前記第2の駆動パルス信号を第2の遅延時間遅延させる第2の遅延回路と、
前記第3の駆動パルス信号を第3の遅延時間遅延させる第3の遅延回路と、
前記第4の駆動パルス信号を第4の遅延時間遅延させる第4の遅延回路と、
遅延された前記第1の駆動パルス信号に基づいて、前記第1のハイサイドトランジスターを駆動する第1のプリドライバーと、
遅延された前記第2の駆動パルス信号に基づいて、前記第1のローサイドトランジスターを駆動する第2のプリドライバーと、
遅延された前記第3の駆動パルス信号に基づいて、前記第2のハイサイドトランジスターを駆動する第3のプリドライバーと、
遅延された前記第4の駆動パルス信号に基づいて、前記第2のローサイドトランジスターを駆動する第4のプリドライバーと、
を含み、
前記第2のハイサイドトランジスターをオフからオンにする際の前記第3の遅延時間よりも前記第1のローサイドトランジスターをオフからオンにする際の前記第2の遅延時間が長く、
前記第1のハイサイドトランジスターをオフからオンにする際の前記第1の遅延時間よりも前記第2のローサイドトランジスターをオフからオンにする際の前記第4の遅延時間が長く、
前記第1の遅延時間より前記第2の遅延時間が長く、
前記第3の遅延時間より前記第4の遅延時間が長いことを特徴とする回路装置。 - モーターと、
前記モーターを駆動する請求項1乃至5のいずれかに記載された回路装置と、
を含むことを特徴とする電子機器。
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