JP6119059B2 - 半導体ウエハを処理するための方法 - Google Patents

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Description

本発明は、半導体ウエハを処理するための方法に関する。
パワー半導体コンポーネントは、コンポーネントの整流接合、例えばpn接合又はショットキー接合が阻止状態にある場合に、通常、逆電圧となるドリフトゾーンを有する。ドリフトゾーンは、パワー半導体コンポーネントの所望の電圧阻止能力に見合った厚さを有する。即ち、パワー半導体コンポーネントは、電圧阻止能力が高ければ高いほど、ドリフトゾーンの厚さは厚くなり、そのドーピングは低くなる。低いスイッチング発振の点から、ドリフトゾーンのドーピングプロファイルの垂直方向での変化が有益である。詳細には、整流接合の真下の深さ位置で極大値となり、フィールドストップ層へ向かってドーピング濃度が連続的に低下していくプロファイルが、最も望ましい。
しかしながら、所定のドーピングプロファイルを有する厚いドリフトゾーンを低コストで生成することは難しい。電気活性ドーパントを厚い半導体材料に注入又は拡散することは、必要とされる注入深さや拡散深さからみて、ほとんど実行不可能である。厚いドリフトゾーンをエピタキシャルに成長させることは、時間がかかるうえ、高い阻止電圧のパワー半導体コンポーネントに求められるドーパント濃度を、エピタキシャルプロセス制御によって、達成することが困難である。nドープドリフトゾーンの場合には、放射線誘起ドナーを使用することが考えられる。ウエハに高エネルギ粒子、例えば陽子を照射した後、後続の熱プロセスにより、ドナーが、注入の損傷濃度プロファイルにあわせて生成される。単一の注入に対して、このプロファイルは、ブラッグピークへ向けて注入の連続的な増加を示す。従って、従来の注入技術では、様々な注入深さのブラッグピークが必要となり、それは、高エネルギ粒子を多様な注入エネルギで注入しなければならないことを意味する。その結果、多数の後続ステップを要する望ましくないプロセスとなって、著しく、プロセス時間が掛り、誤差の蓋然性が高まることとなる。
米国特許出願公開第2011/042791A1号明細書
従って、高阻止電圧のパワー半導体コンポーネント(特に、ドーピング濃度がドリフトゾーンで極大値となるパワー半導体コンポーネント)の製造に使用できる改善された方法が求められている。の製造のために、
第1の態様は、半導体ウエハを処理するための方法に関する。その方法において、第1の面及び第1の面の裏側に第2の面を有する磁気チョクラルスキー半導体ウエハが提供される。第1の面は、第1の垂直方向において、第2の面から離れて配置される。半導体ウエハに結晶欠陥を形成するために、第1の粒子が第2の面を介して半導体ウエハに注入される。結晶欠陥は、第1の深さで欠陥濃度が最大になる。半導体ウエハは、第1の熱プロセスにおいて加熱されて、放射線誘起ドナーが形成される。第1の熱プロセスの後で、半導体ウエハのnドープ半導体領域が、第2の面と第1の深さとの間に配置されるように、且つnドープ半導体領域が、第1の垂直方向において、第1の深さと第2の面との間に正味ドーピング濃度の極大値を有し、第1の深さと第1の極大値との間に正味ドーピング濃度の極小値を有するように、粒子を注入する際の注入エネルギ及び注入ドーズが選択される。
第2の態様は、半導体ウエハを処理するための方法に関する。その方法において、第1の面及び第1の面の裏側に第2の面を有する半導体ウエハが提供される。第1の面は、第1の垂直方向において、第2の面から離れて配置される。半導体ウエハに結晶欠陥を形成するために、第1の粒子が第2の面を介して半導体ウエハに注入される。結晶欠陥は、第1の深さで欠陥濃度が最大になる。半導体コンポーネントウエハは、第1の熱プロセスにおいて加熱されて、放射線誘起ドナーが形成される。第1の熱プロセスの前又は後に、放射線誘起ドナーの形成を抑制するための第2の粒子が、半導体ウエハに導入される。第1の熱プロセスの後で、半導体ウエハのnドープ半導体領域が、第2の面と第1の深さとの間に配置されるように、且つnドープ半導体領域が、第1の垂直方向において、第1の深さと第2の面との間に正味ドーピング濃度の極大値を有し、第1の深さと第1の極大値との間に正味ドーピング濃度の極小値を有するように、第1の深さ、照射ドーズ、及び抑制的な第2の粒子の濃度プロファイルが選択される。
その他の特徴及び利点は、以下の詳細な説明と添付の図面とから、理解されよう。
本発明の例示的な実施形態が、図に関連して以下でより詳細に説明される。
半導体ウエハの断面図を示す。 図1Aの半導体ウエハの拡大断面Aを示す。 注入が完了した後で、且つ後続の第1の熱プロセス前の、図1Bにおけるウエハの結晶損傷濃度を示す図である。 異なるウエハ型用の、第1の熱プロセスが完成した後の図1Bにおけるウエハのドーピングプロファイルを示す図である。 異なる照射ドーズ用の、FZ又は従来のCZウエハのドーピングプロファイルを示す図である。 異なる照射ドーズ用の、MCZウエハのドーピングプロファイルを示す図である。 第2の面に隣接する目標領域に抑制的な第2の粒子が導入された半導体ウエハを示し、抑制的な第2の粒子は、放射線誘起ドナーの形成を抑制する。 水素原子が、抑制的な第2の粒子として目標領域に拡散される半導体ウエハを示す。 プラズマ堆積プロセスにおける窒化物層の堆積中に、水素原子が、抑制的な第2の粒子として目標領域に拡散される半導体ウエハを示す。 水素カチオンが目標領域に注入される半導体ウエハを示す。 水素カチオンが、第2の面に隣接するpドープ層に注入される半導体ウエハを示す。 半導体に拡散された抑制的な第2の粒子の濃度を示す図である。 半導体に注入された抑制的な第2の粒子の濃度を示す図である。 第1の粒子及び抑制的な第2の粒子が注入された半導体ウエハの合計ドナー濃度を示す図である。 一定のpドーピングを有する、提供された半導体ウエハの正味ドーピング濃度を示す図である。 第1の粒子及び抑制的な第2の粒子が注入された図14のpドープ半導体ウエハの合計ドナー濃度を示す図である。 露出領域を有する半導体ウエハを示す。 図16の半導体ウエハの酸素濃度を示す図である。 説明される方法の1つに従って処理された半導体ウエハから製造された半導体コンポーネントを示す。 図18の半導体コンポーネントのドーピング濃度を示す図である。 図18及び19に示されている例に基づいて正味ドーピング濃度を更に低減するための方法を示す。
図において、別段の指示がない限り、同一の参照符号は、同じ意味を備えた同一のウエハ領域又はコンポーネント領域を示す。
図1Aは、半導体ウエハ100の断面図を概略的に示す。半導体ウエハ100は、FZウェハ、CZウエハ又はMCZウエハであっても良い。
一般に、半導体コンポーネントの実現のために典型的に使用される半導体単結晶、例えばシリコン単結晶を生成するための周知の方法は、いわゆるフロートゾーン法(FZ法)及びチョクラルスキー法(CZ法)である。それらの方法の1つを用いて製造された単結晶半導体インゴットから切り出されたディスク状半導体ウエハが、半導体コンポーネントの製造用の基部を形成する。FZ法と比較して、CZは、よりコスト効率が良いが、しかし製造方法故に、単結晶が、典型的には数1017原子/cm〜数1018原子/cmの範囲の高酸素濃度を有するという欠点がある。
半導体ウエハを製造し処理するための方法の間に行われる熱プロセスは、ウエハに高濃度で存在する酸素が、いわゆる酸素析出物を形成するという効果がある。これらは、半導体結晶における酸素凝集体又は酸素欠損凝集体を意味すると理解されるべきである。これらの析出物は、とりわけ、コンポーネントを製造する方法の間に、ウエハ内に移動し得る重金属原子用のゲッタリングセンタとして働く。しかしながら、かかる析出物が、半導体コンポーネントの活性コンポーネントゾーンに存在する場合に、それらは、自由電荷キャリア用の再結合中心として働くという事実によって、且つ荷電キャリアペア用の生成中心として働くという事実によって、コンポーネント特性の障害につながり、それは、コンポーネントの逆作動中に流れる漏れ電流の増加につながる。
上記の理由で、従来のCZウエハは、数百ボルトの絶縁耐力を有するパワーコンポーネントの実現のためには限られた適合性があるだけである。更なる処理なしでは、従来のCZウエハは、更なる(酸素欠乏)半導体層が、複雑な、従ってコストがかかるエピタキシー法によって適用される半導体基板としてのみ前記コンポーネントに適しており、それらの半導体層では、逆電圧を取るパワーコンポーネントの領域、例えばMOSFETのドリフトゾーン、又はIGBT若しくはダイオードのn型ベースが実現される。
上記のような「磁気チョクラルスキーウエハ」は、従来のCZウエハと比較して、(非従来的な)磁気CZウエハが切り出される元となるインゴットの結晶成長中に外部磁界を印加することによって達成できる非常に低い酸素濃度を有する或る種のCZウエハである。かかる(非従来的な)CZウエハはまた、磁気チョクラルスキーウエハ又は簡潔に「MCZウエハ」と呼ばれる。非常に低い酸素濃度の結果は、従来のCZウエハと比較して、非常に低い酸素析出物濃度である。本発明の観点では、ウエハは、それが、ウエハの至る所で4×1017原子/cm未満の最高格子間酸素濃度(「Oiレベル」)を有する場合に、「MCZウエハ」と見なされる。本文献に引用される格子間酸素用の全ての値は、標準新ASTM(ASTM F 121、1980−1983)に従って赤外線分光法ベースの測定用に規定される。例えば、半導体ウエハ100の半導体材料は、シリコンである。
半導体ウエハ100は、第1の面101と、第1の面101の裏側の第2の面102とを有する平坦なディスクであり、これらの面は、両方とも平面で、互いに平行に走っていても良い。第1の面101は、第1の面101と垂直に走る第1の垂直方向v1において、第2の面102から離れて配置される。この点において、第1の垂直方向v1が、軸だけではなく、同様に方位も含むことに留意されたい。それは、第2の面102が、第1の垂直方向v1ではなく、反対方向において第1の面101から離れて配置されることを意味する。
第1の垂直方向v1において、半導体ウエハ100は、例えば少なくとも400μmの厚さt100を有する。しかしながら、400μm未満の厚さt100が同様に用いられても良い。
第1の粒子10は、それが、第2の面102を通して半導体ウエハ100に入り、且つ半導体ウエハ100において結晶欠陥をもたらすように、第2の面102に注入される。注入は、例えば空孔、二重空孔、又は空孔/酸素複合体のような結晶欠陥を半導体ウエハ100にもたらすが、結晶欠陥が、第2の面102に対して第1の垂直方向v1において測定されることになる第1の深さd1において最高欠陥濃度(即ち注入のブラッグピーク)を有するように、実行される。第1の深さd1が、第1の粒子10のエネルギに依存するので、所望の第1の深さd1(図1Bを参照)は、第1の粒子10のエネルギを適切に調整することによって達成され得る。適切な第1の粒子10は、とりわけ陽子である。
任意選択的に、第1の深さd1は、少なくとも40μm若しくは少なくとも80μm、及び/又は半導体ウエハ100が第1の垂直方向v1に有する厚さt100の少なくとも5%若しくは少なくとも10%であっても良い。
同様に図1Aに示されているように、注入は、第2の面102全体にわたっても良い。代替として、半導体ウエハ100の一部だけが、本明細書で説明されるように処理されても良い。
図2は、注入が完成した後、且つ後続の第1の熱プロセス前のウエハ100の結晶損傷濃度を示す。
半導体ウエハ100が、400℃〜570℃、特に470℃〜510℃の温度に加熱される第1の熱プロセスの後で、放射線誘起ドナーが生成される。例えば、第1の熱プロセスは、少なくとも1時間又は少なくとも3時間続いても良い。更に、第1の熱プロセスは、10時間以下又は20時間以下続いても良い。上記の意味で、「放射線誘起ドナー」、例えば陽子誘起ドナーは、半導体ウエハ100に注入された粒子、及び水素誘起複合体に帰着する後続の熱プロセスによって引き起こされた半導体結晶損傷の結果として発生するドナーである。即ち、「放射線誘起ドナー」は、非置換ドナーである。
放射線誘起ドナーの濃度プロファイルが、異なるウエハ型用に図3に示されている。図は、半導体ウエハ100がMCZウエハである場合に生じる第1の効果を示すためだけの性質である。この第1の効果は、第2の面102に隣接し、且つウエハ100の表面の方へのOiレベルの著しい低下に起因する、より低い酸素濃度の領域110の出現にある。高いOiレベルを備えた半導体領域では、低いOiレベルを備えた半導体領域におけるよりも多くの放射線誘起ドナーが生成されるという点で、Oiレベルは、後続の熱プロセスにおいて生成される放射線誘起ドナーの形成に影響する。MCZウエハとは対照的に、FZ又はCZウエハの場合には、より低い酸素濃度の際立った対応領域は、実質的に存在しない。
図4及び5に示されている、本発明の発明者らによって発見された第2の効果によれば、半導体ウエハ100の照射面(ここでは第2の面102)を介して、十分に高い注入ドーズを有する第1の粒子10を半導体ウエハ100に注入し、続いて第1の熱プロセスにおいて半導体ウエハ100を加熱することは、ドナー濃度が極小値MIN’を有するドーピングプロファイルをもたらす。極小値MIN’は、照射面(ここでは第2の面102)と第1の深さd1との間に配置される。図4は、注入ドーズが、FZにおける放射線誘起ドナーの濃度プロファイルにどのように影響するかを示す。濃度プロファイルpa1が、注入された第1の粒子10の、例えば1・1014粒子/cm未満の比較的低い照射ドーズに関するのに対して、濃度プロファイルpa2は、注入された第1の粒子10の、例えば少なくとも1・1014粒子/cm又は少なくとも4・1014粒子/cmのより高い照射ドーズに関する。プロファイルpa1及びpa2を比較すると、上記の第2の効果が明らかになる。即ち、十分に高い照射ドーズ(プロファイルpa2)の場合に、放射線誘起ドナーの濃度は、照射された第2の面102と第1の深さd1との間に配置される極小値MIN’を有する。対照的に、照射ドーズが低すぎる(プロファイルpa1)場合には、かかる極小値は存在しない。
同じ効果は、図5に示されているMCZウエハの場合に生じる。濃度プロファイルpb1が、注入された第1の粒子10の、例えば1・1014粒子/cmの比較的低い照射ドーズに関するのに対して、濃度プロファイルpb2は、注入された第1の粒子10の、例えば少なくとも1・1014粒子/cm又は少なくとも4・1014粒子/cmのより高い照射ドーズに関する。ちょうど図4のプロファイルpa2のように、同様にプロファイルpb2は、照射された第2の面102と第1の深さd1との間に配置された極小値MIN’を有する。しかしながら、図5がMCZウエハに関連するので、同様に「第1の効果」(第2の面102に隣接する、より低い酸素濃度の領域110)が生じる。その結果、第1及び第2の効果は、濃度プロファイルpb2が、極大値MAX’を有し、極小値MIN’が、極大値MAX’と第1の深さd1との間に配置されるように、重なる。
しかしながら、極大値MAX’を有する放射線誘起ドナーの濃度プロファイルはまた、より低い酸素濃度の領域110が人為的に生成されるならば、FZ又は従来のCZウエハの場合にも達成することができる。その目的で、放射線誘起ドナーの形成に対して抑制的に働く第2の粒子11が、第1の熱プロセスの前又は後に半導体ウエハ100に導入されても良い(図6を参照)。もちろん、かかる抑制的な第2の粒子11は、極大値MAX’の形成を増幅させるために、同じ目的及び同じ方法で用いられても良い。図6において、抑制的な第2の粒子11が導入される目標領域は、110’で示されている。第1の熱ステップ中に、目標領域110’は、上記のより低い酸素濃度の領域110に実質的に変換される。
いずれにせよ、抑制的な第2の粒子11は、第2の面102を通して半導体ウエハ100に第1の粒子を注入する前又は後に、半導体ウエハ100に導入されても良い。第1の熱プロセスの最初又は後に、即ち放射線誘起ドナーを生成する前又は後に、抑制的な第2の粒子11の濃度プロファイルが存在する。第1の深さd1、照射ドーズ、及び抑制的な第2の粒子11の濃度プロファイルは、次のように選択される。即ち、放射線誘起ドナーの濃度プロファイルが、放射線誘起ドナーが生成される第1の熱プロセスの終わりに、第1の深さd1より浅い第2の深さd2の位置で極小値MIN’及び第2の深さd2より浅い第3の深さd3の位置で極大値MAX’を有するように、選択される。これは、図4及び5の両方に示されている。
抑制的な第2の粒子11は、例えば水素原子又は水素カチオンからなるか又はそれを含んでも良い。例えば、水素は、第2の面102を介して半導体ウエハ100に拡散されても良い。任意選択的に、拡散は、水素プラズマにおいて半導体ウエハ100を処理することによって行われても良い(図7を参照)。
半導体ウエハ100に水素を導入するための更なる方法は、堆積プロセスにおいて、少なくとも1つの水素含有前駆物質12、例えばSiH及び/又はNHが用いられる場合に、窒化物層120が第2の面102に生成されるプラズマ堆積プロセスである(図8を参照)。
図9に更に示されているように、第2の面102を介して半導体ウエハ100に、陽子のような水素カチオン11を注入すること、及び続いて、例えば350℃〜550℃の温度に半導体ウエハ100を加熱することによって、第2の熱プロセス中に、注入された水素を拡散させることがまた可能である。第2の熱プロセスは、例えば少なくとも30分且つ/又は例えば10時間以下続いても良い。
半導体ウエハ100に水素を導入する更なる方法が、第2の面102と第1の深さd1との間に配置されるpドープ半導体領域130に水素11カチオンを注入すること、及び続いて、例えば350℃〜550℃の温度に半導体ウエハ100を加熱することによって、第3の熱プロセス中に、注入された水素11を拡散させることである(図10を参照)。第3の熱プロセスは、例えば少なくとも30分且つ/又は例えば10時間以下続いても良い。第3の熱プロセスの後で、元々pドープされた半導体領域130において、アクセプタ濃度Nは、元々pドープされた半導体領域130がpドープされたままであるように、ドナー濃度Nより著しく高い。
図11は、抑制的な第2の粒子11が半導体ウエハ100に拡散された後且つ第2の熱プロセス前の濃度プロファイルpc1(破線)と、第2の熱プロセス後のプロファイルpc2(実線)を概略的に示す。図11は、図7及び8に関連して説明された拡散プロセスに関する。
従って、図12は、抑制的な第2の粒子11が半導体ウエハ100に注入された後且つ第2の熱プロセス前の濃度プロファイルpd1(破線)と、第3の熱プロセス後のプロファイルpd2(実線)を概略的に示す。図12は、図9及び10に関連して説明された拡散プロセスに関する。
抑制的な第2の粒子11を半導体ウエハ100に導入するための説明された方法は、任意の方法で互いに且つまた更なる方法と組み合わされても良い。
上記の例は、放射線誘起ドナーによってのみもたらされる或るドナープロファイルを生成するための方法に関する。任意選択的に、かかるドナープロファイルは、他のプロファイルと重ね合わされても良い。例えば、図13に示されているように、説明された方法の初めに、特に第1の粒子10を注入する前に用いられる、提供された半導体ウエハ100は、ドリフトゾーンの所望の抵抗が半導体ウエハ100から生成されるように調整するために、n導電型の一定の基本ドーピング(一定の正味ドーピング濃度N0であり、ドーピングプロファイルe1を参照されたい)を有しても良い。かかる一定の基本ドーピングは、特にn導電型であっても良いが、注入された第1の粒子10及び抑制的な粒子11に起因する放射線誘起ドナーによってもたらされるドーピングプロファイルe2のオフセットN0をもたらす。かかる基本ドーピングは、インゴット(そこからウエハが切り出される)の製造中に、電気活性置換ドーパントを溶融物に追加することによって、達成されても良い。結果としてのドナー濃度プロファイルe3は、ドーピングプロファイルe1及びe2の重ね合わせである。
同じ方法で、提供された半導体ウエハ100は、p導電型の一定の基本ドーピング(一定の正味ドーピング濃度N0であり、図14におけるプロファイルe1を参照されたい)を有しても良い。再び、結果としてのドナー濃度プロファイルe3は、ドーピングプロファイルe1及びe2の重ね合わせである(図15を参照)。任意選択的に、正味ドーピング濃度N0は、結果としてのドナー濃度e3が、第1の垂直方向v1における各深さでゼロを超えるように、調整されても良い。
提供された半導体ウエハの一定の基本ドーピングを達成するための更なる方法は、インゴットの製造中に、インゴット(そこから半導体ウエハ100が切り出される)の格子間酸素(「Oiレベル」)の(ほぼ一定の)濃度を適切に調整することである。何故なら、ドナー濃度の達成されたオフセットが高ければ高いほど、Oiレベルが高いからである。
半導体ウエハ100の半導体材料がシリコンを含む場合に、更なる方法は、Si30同位体が中性子吸収によってリンに変換される「中性子変換ドーピング」によってnドーピングリンを生成するために、半導体ウエハ100に中性子を照射することである。
ここで図16及び17を参照すると、本発明に関連して用いられる半導体ウエハ100は、露出層115(「露出ゾーン」としても知られている)及び非露出層114を任意選択的に有しても良い。非露出層114と比較すると、露出層115は、より低い酸素濃度を有する。図16は、半導体ウエハ100の一部を示し、図17は、垂直方向v1における格子間酸素の濃度を示す。非露出層114は、第1の面101から、第1の面101と平行に走り、且つ格子間酸素の第1の最高濃度C1を有する第1の平面Eにまで及ぶ。露出層115は、第2の面102から第1の平面Eにまで及び、且つ第1の最高格子間酸素濃度C1より低い、格子間酸素の第2の最高濃度C2を有する。任意選択的に、第1の最高濃度C1は、第2の格子間酸素濃度C2の少なくとも2倍であっても良い。
例えば、かかる露出層115は、(特許文献1)に説明されている、露出ゾーンを生成するための方法の1つを用いて生成されても良い。
極大値MAXが、露出領域115に配置されることを保証するために、第2の面102と第1の平面Eとの間の距離d0は、第3の深さd3より大きくても良い。任意選択的に、距離d0はまた、第2の深さd2より、又は第1の深さd1より大きくても良い。
上記の方法のそれぞれを用いて製造されたドーピングプロファイルを有し、且つ極小値MIN及び極大値MAXの両方を有する半導体ウエハ100又は半導体ウエハ100の一部は、ドリフトゾーンを備えたパワー半導体コンポーネントの製造用に用いられても良い。特に、完成した半導体コンポーネントのドリフトゾーンは、説明された方法の1つを用いて達成されたドーピングプロファイルの極大値MAX及び極小値MINの両方を含む半導体ウエハ100の連続セクションを含んでも良い。
かかるドーピングプロファイルの任意選択的な特性は、図13に関連して既に説明されたドーピングプロファイルe3に基づいて典型的に説明される。第1の選択肢によれば、第1の深さd1は、少なくとも80μmであっても良い。第2の選択肢によれば、第2の深さd2と第3の深さd3との間の差d23は、少なくとも25μmであっても良い。第3の選択肢によれば、第2の深さd2は、少なくとも50μmであっても良い。第4の選択肢によれば、第3の深さd3は、少なくとも10μmであっても良い。第5の選択肢によれば、極小値MINにおけるドーピング濃度N1は、5・1012cm−3と2・1013cm−3との間であっても良い。第6の選択肢によれば、極大値MAXにおけるドーピング濃度N2は、3・1013cm−3と2・1014cm−3との間、好ましくは4・1013cm−3と1・1014cm−3との間であっても良い。次に、第7の選択肢によれば、ドナー濃度プロファイルは、第2の深さd2における第1の正味ドーピング濃度CMAX、及び第3の深さd3における第2の正味ドーピング濃度CMINを有しても良い。比率CMAX÷CMINは、例えば、少なくとも1.5又は少なくとも2.0であっても良い。代替又は追加として、比率CMAX÷CMINは、例えば、20.0以下又は6.0以下であっても良い。
図18は、上記の方法の1つに従って処理されたMCZ半導体ウエハ100から製造された垂直パワー半導体コンポーネント100’を示す。図19は、パワー半導体コンポーネント100’の正味ドーピングプロファイルの絶対値│N−N│を示す。Nは、合計ドナー濃度であり、Nは、合計アクセプタ濃度である。半導体コンポーネント100’は、約3MeVのエネルギを有する第1の粒子10として陽子を、第2の面102を介して半導体ウエハ100に注入することによって製造された。注入ドーズは、1.7・1014陽子/cmだった。注入に続いて、半導体ウエハ100は、490℃の温度で5時間アニールされた。
半導体コンポーネント100’は、半導体ウエハ100の一部だけを含む。第1の面101において、表面部116は、例えば、研削及び/又は研磨によって除去された。表面部116の除去は、第1の熱プロセスの前、第1の熱プロセスと第2の熱プロセスとの間、第2の熱プロセスと第3の熱プロセスとの間、又は第3の熱プロセスの後に行われても良い(それらのプロセスが用いられる限り)。
本実施形態と異なり、同様に第2の面102における更なるセクションが、除去されても良い。その結果、半導体の最終的な第1の面101’及び任意選択的に最終的な第2の面102’が残る。第2の面102における更なるセクションが除去されない場合に、最終的な第2の面102’は、元々の第2の面102と同一である。
深さd111において、半導体コンポーネント100’は、整流接合111、ここでは多量にpドープ(p+)された半導体領域117と弱くnドープ(n−)されたドリフト領域118との間に形成されたpn接合を有する。代替として、整流接合111は、d111=0の場合にはショットキー接合であっても良く、ショットキー金属電極が、最終的な第2の面102’に配置されることになり、ドリフト領域118は、ショットキー金属電極に隣接することになろう。半導体コンポーネント100’は、ドリフト領域118に隣接する多量にnドープ(n+)されたフィールドストップ領域119を更に有する。図19から分かるように、フィールドストップ領域119は、第1の深さd1における最高結晶欠陥濃度によってもたらされた放射線誘起ドナーに戻るドーピングピークの残部であっても良い。しかしながら、極小値の位置が最終的な第1の面101’になるように、そのピークを完全に除去することも可能であろう。
ここで、第2の深さd2における正味ドーピング濃度NMINを更に低減するための方法が、図18及び19に示された例に基づいて図20〜22に関連して示される。抑制的な第2の粒子11の使用に対する追加又は代替として、抑制的な第3の粒子13が、第1の面101、最終的な第1の面101’又は任意の中間面を介して、半導体ウエハ100又はそこからの残部に導入されても良い。抑制的な粒子13は、上記の抑制的な粒子11と同じ方法で、放射線誘起ドナー形成に対して抑制的に働く。抑制的な第3の粒子13は、抑制的な第2の粒子11に関連して言及された粒子の種類の1つであっても良く、又はそれらは、上記の前駆物質12と同じ種類の前駆物質から生成されても良い。更に、抑制的な第3の粒子13又はそれらの前駆物質は、第2の粒子11及び前駆物質12用にそれぞれ説明された方法の1つで導入されても良い。
いずれにせよ、抑制的な第3の粒子13の導入は、第1の熱プロセスの前又は後に行われても良い。図21において、抑制的な第3の粒子13が導入される目標領域は、110’’で示されている。第1の熱ステップ中に、目標領域110’’における抑制的な第3の粒子13は、抑制的な第2の粒子11用に説明された原理に基づいて、放射線誘起ドナーの形成を減らすように働く。
図21は、第3の粒子13を半導体ウエハ100に注入することによって抑制的な第3の粒子13が生成された後、且つ第2の熱プロセス前の濃度プロファイルpe1(破線)と、第2の熱プロセス後のプロファイルpe2(実線)と、を概略的に示す。第3の粒子13の注入は、半導体ウエハ100の表面から離れて配置される、第3の粒子13の最高濃度を可能にする。これは、第2の深さd2より大きな深さに配置される、多量にnドープされたフィールドストップゾーン(図20及び22におけるn+)の場合に、望ましくなり得る。この場合に、第3の粒子13を半導体ウエハ100の中へと拡散させることは、拡散深さと共に減少する第3の粒子13の濃度に帰着することになろう。即ち、第3の粒子13の逓減的な影響は、第2の深さd2における所望の極小値MINの領域においてではなく、所望のフィールドストップゾーンの領域において実質的に発生することになろう。しかしながら、フィールドストップゾーンはまた、第3の粒子13の最高濃度がフィールドストップゾーン内に「隠される」ように、第2の深さd2を含んでも良い。フィールドストップゾーンが、第3の粒子から実質的にもたらされること、即ち、フィールドストップゾーンが、第3の粒子13の最高濃度に起因する正味ドーピング濃度によって実質的に定義されることもまたあり得る。
注入された第3の粒子13の最高濃度が、ほぼ第2の深さd2に位置する場合に、極小値MIN(図22を参照)における正味ドーピング濃度NMINは、図19の極小値MINにおける正味ドーピング濃度NMINと比較して、低減される。比較を容易にするために、図22はまた、図19の正味ドーピング濃度(点曲線)を示す。
図18及び20に示された半導体コンポーネント100’は、ダイオードであるにもかかわらず、本明細書で説明される半導体ウエハ100を処理するための方法はまた、他のパワー半導体コンポーネント、例えばIGBT、MOSFET、サイリスタ等の製造にも用いられ得る。
任意選択的に、半導体コンポーネント100’は、ドリフト領域118と最終的な第1の面101’との間で互いに離れて配置された2以上のフィールドストップ領域を有しても良い。それらのフィールドストップ領域の1つは、上記の残部であっても良く、更なるフィールドストップ領域は、元々の第1の面101を通して、最終的な第1の面101’を通して、又は半導体材料が元々の第1の面101において除去される場合に存在する任意の中間の第1の面を通して、置換電気活性ドーパントを半導体に注入することによって、且つ続いて半導体ウエハ100をアニールすることによって、生成されても良い。注入及び後続の熱アニールプロセスの結果として達成されるかかるフィールドストップ領域の正味ドーピング濃度プロファイルは、フィールドストップゾーンの最高ドーピング濃度の位置と、注入されたドーパントが半導体ウエハ100に入った半導体ウエハ面との間の距離の約10%の半値全幅を有しても良い。
本発明は、処理される半導体ウエハ100の半導体材料としてのシリコン用に説明されたが、任意の他の周知の半導体材料、例えば炭化ケイ素、ガリウムヒ素、又は窒化ガリウムが、同様に用いられても良い。
更に、上記のドーピングプロファイルは、それらがドナー濃度Nに関連する限りにおいて、処理されたウエハから製造された半導体コンポーネント100’の少なくとも後々のドリフト領域118において、正味ドーピング濃度N−Nを表し得ることに留意されたい。この場合に、後でドリフト領域を形成する領域である半導体ウエハ100の領域において、アクセプタ濃度Nは、ほぼゼロである。
本発明は、とりわけ、半導体ウエハを処理するための方法に関する。第1の態様が、特に磁気チョクラルスキー半導体ウエハを処理するための方法に関するのに対して、第2の態様は、任意の種類のウエハを処理するための方法に関する。放射線誘起ドナーの形成に対して抑制的に働く第2の粒子11を半導体ウエハ100に導入するステップは、第1の態様による方法においては任意選択であり、第2の態様による方法においては必須である。方法が、そのステップを用いる限り、次の特徴及び/又は方法ステップ(S1)、(S2)、(S3)、(S4)が、第1及び第2のステップの両方による方法において、単独で又は互いとの任意の組み合わせにおいて適用可能である。
(S1)第2の粒子11は、第1の粒子10を半導体ウエハに照射する前に導入されても良い。
(S2)第2の粒子11は、第1の粒子10を半導体ウエハに照射した後で、半導体ウエハ100に導入されても良い。
(S3)第2の粒子11は、水素からなるか又は水素を含んでも良い。その場合に、次の特徴及び/又は方法ステップ(S3−1)、(S3−2)が、単独で又は互いとの任意の組み合わせにおいて適用可能である。
(S3−1)水素は、第2の面102を介して、半導体ウエハ100に拡散されるか若しくは注入されても良く、又は窒化物層120が第2の面102上に堆積されるプラズマ堆積プロセス中に半導体ウエハ100に導入されても良い。
(S3−2)水素は、pドープ半導体領域が、第2の面102と第1の深さd1との間に配置される半導体ウエハ100のpドープ半導体領域130に注入され、続いて第3の熱プロセスにおいて拡散されても良い。
(S4)放射線誘起ドナーの形成に対して抑制的に働く第3の粒子13が、半導体ウエハ100に導入されても良い。その場合に、次の特徴及び/又は方法ステップ(S4−1)、(S4−2)、(S4−3)、(S4−4)は、単独で又は互いとの任意の組み合わせにおいて適用可能である。
(S4−1)第3の粒子13は、水素からなるか又は水素を含んでも良い。
(S4−2)第3の粒子13は、第2の面102と裏側の、半導体ウエハ100の面を介して、半導体ウエハ100に導入されても良い。
(S4−3)第3の粒子13は、第1の熱プロセスの前に半導体ウエハ100に導入されても良い。
(S4−4)導入された第3の粒子13は、第2の深さd2の位置で最高濃度を有しても良い。
更に、第1及び第2の態様の両方による方法において、次の特徴及び/又は方法ステップ(e)、(f)、(g)、(h)、(i)、(j)、(k)、(l)が、単独で又は互いとの任意の組み合わせにおいて適用可能である。
(S5)提供された半導体ウエハ100は、第1の面101から第1の面101と平行な第1の平面Eにまでわたり、且つ格子間酸素の第1の最高濃度C1を有する非露出層114と、第2の面102から第1の平面Eにまでわたり、且つ格子間酸素の第2の最高濃度C2を有する露出層115と、の両方を含んでも良く、第1の最高濃度C1は、第2の最高濃度C2の少なくとも2倍である。その場合に、次の特徴及び/又は方法ステップ(S5−1)、(S5−2)は、単独で又は互いとの任意の組み合わせにおいて適用可能である。
(S5−1)第1の平面Eと第2の面102との間の距離d0は、第2の深さd2及び第3の深さd3の両方より大きくても良い。
(S5−2)第1の平面Eと第2の面102との間の距離d0は、第1の深さd1より大きくても良い。
(S6)第1の粒子10は、陽子であっても良い。
(S7)第1の深さd1は、
少なくとも40μm若しくは少なくとも80μmでも良く、且つ/又は
半導体ウエハ100が、第1の垂直方向v1に有する厚さt100の少なくとも5%若しくは少なくとも10%でも良い。
(S8)半導体ウエハ100は、少なくとも400μmの厚さt100を有しても良い。
(S9)第2の粒子11の照射ドーズは、少なくとも1・1014cm−2又は少なくとも4・1014cm−2であっても良い。
(S10)第2の深さd2と第3の深さd3との間の差d23は、少なくとも25μmであっても良い。
(S11)正味ドーピング濃度│N−N│は、第2の深さd2における第1の正味ドーピング濃度CMAX及び第3の深さd3における第2の正味ドーピング濃度CMINを有しても良く、第1の正味ドーピング濃度CMAXと第2の正味ドーピング濃度CMINとの間の比率CMAX÷CMINは、
少なくとも1.5若しくは少なくとも2.0、且つ/又は
20.0以下若しくは6.0以下の少なくとも1つであっても良い。
(S12)提供された半導体ウエハ100は、第1の粒子10を注入する前に、一定のpドーピング又は一定のnドーピングを有しても良い。
「第1の」、「第2の」などの用語は、様々な要素、領域、セクションを示すために用いられ、且つまた限定するようには意図されていない。同様の用語は、説明の全体を通して同様の要素を指す。
本明細書で用いられているように、用語「有する」、「含む(containing)」、「含む(including)」、「含む(comprising)」などは、言明された要素又は特徴の存在を示すが、しかし追加の要素も特徴も排除しないオープンエンド用語である。冠詞「a」、「an」及び「the」は、文脈が明白に別段の指示をしていない限り、単数形と同様に複数形も含むように意図されている。
特に別段の言及がない限り、本明細書で説明される様々な実施形態の特徴が、互いに組み合わされても良いことを理解されたい。
本明細書において、特定の実施形態が示され説明されたが、様々な代替の及び/又は等価な実装形態が、本発明の範囲から逸脱せずに、示され説明された特定の実施形態の代わりに用いられても良いことが、当業者によって理解されよう。本出願は、本明細書で論じられる特定の実施形態のどんな適応形態も変形形態もカバーするように意図されている。従って、本発明が、請求項及びそれらの均等物によってのみ限定されることが意図されている。
10 第1の粒子
11 第2の粒子
12 水素含有前駆物質
13 第3の粒子
100 半導体ウエハ
100’ パワー半導体コンポーネント
101 第1の面
101’ 最終的な第1の面
102 第2の面
102’ 最終的な第2の面
110 より低い酸素濃度の領域
110’、110’’ 目標領域
111 整流接合
114 非露出層
115 露出層
116 表面部
117 pドープ半導体領域
118 ドリフト領域
119 フィールドストップ領域
120 窒化物層
130 pドープ半導体領域
C1 第1の最高濃度
C2 第2の最高濃度
MAX 第1の正味ドーピング濃度
MIN 第2の正味ドーピング濃度
d0 距離
d1 第1の深さ
d2 第2の深さ
d3 第3の深さ
d111 深さ
d23 差
E 第1の平面
e1、e2、e3 ドーピングプロファイル
MAX、MAX’ 極大値
MIN、MIN’ 極小値
合計アクセプタ濃度
0 正味ドーピング濃度
合計ドナー濃度
0 一定の正味ドーピング濃度
1、N2 ドーピング濃度
pa1、pa2、pb1、pb2、pc1、pc2、pd1、pd2 濃度プロファイル
t100 厚さ
v1 第1の垂直方向

Claims (25)

  1. 第1の面及び前記第1の面の裏側に第2の面を有する磁気チョクラルスキー半導体ウエハであって、前記第1の面が、第1の垂直方向において、前記第2の面から離れて配置されている半導体ウエハを用意することと、
    前記第2の面を介して半導体ウエハに粒子を注入して、第1の深さで欠陥濃度が最大になる結晶欠陥を半導体ウエハに形成することと、
    第1の熱プロセスにおいて半導体ウエハを加熱して、放射線誘起ドナーを形成することと、
    を含む、半導体ウエハを処理するための方法であって、
    前記粒子を注入する際の注入エネルギ及び注入ドーズを選択することにより、前記放射線誘起ドナー生成後の半導体ウエハのnドープ半導体領域が、前記第2の面と前記第1の深さとの間に配置されるとともに、前記nドープ半導体領域が、前記第1の垂直方向において、前記第1の深さと前記第2の面との間に正味ドーピング濃度の極大値を有し、前記第1の深さと前記正味ドーピング濃度の極大値における深さとの間に前記正味ドーピング濃度の極小値を有するようにした法。
  2. 前記第1の熱プロセスの前又は後に、放射線誘起ドナーの形成を抑制するための第2の粒子をMCZ半導体ウエハに導入することを更に含む、請求項1に記載の方法。
  3. 第1の面及び前記第1の面の裏側に第2の面を有する半導体ウエハであって、前記第1の面が、第1の垂直方向において、前記第2の面から離れて配置されている半導体ウエハを用意することと、
    前記第2の面を介して半導体ウエハに第1の粒子を注入して、第1の深さで欠陥濃度が最大になる結晶欠陥を半導体ウエハに形成することと、
    第1の熱プロセスにおいて半導体ウエハを加熱して、放射線誘起ドナーを形成することと、
    前記第1の熱プロセスの前に、放射線誘起ドナーの形成を抑制するための第2の粒子を半導体ウエハに導入することと、
    を含む、半導体ウエハを処理するための方法であって、
    前記第1の深さ、照射ドーズ及び前記第2の粒子の濃度プロファイルを選択することにより、前記放射線誘起ドナー生成後の半導体ウエハのnドープ半導体領域が、前記第2の面と前記第1の深さとの間に配置されるとともに、前記nドープ半導体領域が、前記第1の垂直方向において、前記第1の深さと前記第2の面との間に正味ドーピング濃度の極大値を有し、前記第1の深さと前記正味ドーピング濃度の極大値における深さとの間に前記正味ドーピング濃度の極小値を有するようにした法。
  4. 前記半導体ウエハが、
    チョクラルスキーウエハと、
    磁気チョクラルスキーウエハと、
    フロートゾーンウエハと、
    からなる群から選択される、請求項3に記載の方法。
  5. 前記第1の粒子を前記半導体ウエハに照射するより前に、前記第2の粒子が導入される、請求項3に記載の方法。
  6. 前記第1の粒子を前記半導体ウエハに照射した後で、前記第2の粒子が導入される、請求項3に記載の方法。
  7. 前記第2の粒子が水素を含む、請求項3に記載の方法。
  8. 前記水素が、前記第2の面を介して前記半導体ウエハに拡散又は注入される、請求項7に記載の方法。
  9. 窒化物層が前記第2の面に堆積されるプラズマ堆積プロセス中に、前記水素が前記半導体ウエハに導入される、請求項7に記載の方法。
  10. 前記半導体ウエハのpドープ半導体領域に前記水素を注入することであって、前記pドープ半導体領域が、前記第2の面と前記第1の深さとの間に配置されることと、
    第3の熱プロセスにおいて、前記注入された前記水素を拡散させることと、
    を更に含む、請求項7に記載の方法。
  11. 放射線誘起ドナーの形成を抑制するための第3の粒子を前記半導体ウエハに導入することを更に含む、請求項3に記載の方法。
  12. 前記第3の粒子が水素を含む、請求項11に記載の方法。
  13. 前記第3の粒子が、前記第2の面の裏側の前記半導体ウエハの面を介して、前記半導体ウエハに導入される、請求項11に記載の方法。
  14. 前記第3の粒子が、前記第1の熱プロセスの前に、前記半導体ウエハに導入される、請求項11に記載の方法。
  15. 前記導入された第3の粒子は、第2の深さの位置で濃度が最大になる、請求項11に記載の方法。
  16. 前記半導体ウエハが、
    前記第1の面から前記第1の面と平行な第1の平面にまでわたり、且つ格子間酸素の第1の最大濃度を有する非露出層と、
    前記第2の面から前記第1の平面にまでわたり、且つ格子間酸素の第2の最大濃度を有する露出層と、
    を含み、
    前記第1の最大濃度が、前記第2の最大濃度の少なくとも2倍である、請求項3に記載の方法。
  17. 前記第1の平面と前記第2の面との間の距離が、第2の深さ及び第3の深さの両方より大きい、請求項16に記載の方法。
  18. 前記第1の平面と前記第2の面との間の距離が、前記第1の深さより大きい、請求項16に記載の方法。
  19. 前記第1の粒子が陽子である、請求項3に記載の方法。
  20. 前記第1の深さが、
    少なくとも40μm又は少なくとも80μmと、
    前記半導体ウエハが前記第1の垂直方向に有する厚さの少なくとも5%又は少なくとも10%と、
    の少なくとも1つである、請求項3に記載の方法。
  21. 前記半導体ウエハが、少なくとも400μmの厚さを有する、請求項3に記載の方法。
  22. 前記照射ドーズが、少なくとも1・1014cm−2又は少なくとも4・1014cm−2である、請求項3に記載の方法。
  23. 第2の深さと第3の深さとの間の差が、少なくとも25μmである、請求項3に記載の方法。
  24. 前記正味ドーピング濃度が、第2の深さにおける第1の正味ドーピング濃度及び第3の深さにおける第2の正味ドーピング濃度を有し、前記第1の正味ドーピング濃度と前記第2の正味ドーピング濃度との間の比率が、
    少なくとも1.5又は少なくとも2.0と、
    20.0以下又は6.0以下と、
    の少なくとも1つである、請求項3に記載の方法。
  25. 前記半導体ウエハが、前記第1の粒子を注入する前に、一定のpドーピング又は一定のn−ドーピングを有する、請求項3に記載の方法。
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Families Citing this family (18)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
FR3009380B1 (fr) * 2013-08-02 2015-07-31 Commissariat Energie Atomique Procede de localisation d'une plaquette dans son lingot
FR3030888A1 (fr) * 2014-12-22 2016-06-24 Commissariat Energie Atomique Plaquette de silicium monolithique type p/type n
WO2016204227A1 (ja) 2015-06-17 2016-12-22 富士電機株式会社 半導体装置および半導体装置の製造方法
JP6428945B2 (ja) 2015-09-16 2018-11-28 富士電機株式会社 半導体装置および半導体装置の製造方法
DE112016001611B4 (de) 2015-09-16 2022-06-30 Fuji Electric Co., Ltd. Halbleitervorrichtung und Verfahren zum Herstellen einer Halbleitervorrichtung
US10468148B2 (en) * 2017-04-24 2019-11-05 Infineon Technologies Ag Apparatus and method for neutron transmutation doping of semiconductor wafers
EP3422418B1 (en) * 2017-06-27 2022-09-28 Infineon Technologies Austria AG Method of manufacturing a superjunction semiconductor device
WO2019017034A1 (ja) * 2017-07-19 2019-01-24 三菱電機株式会社 半導体装置の製造方法および半導体装置
US10193000B1 (en) * 2017-07-31 2019-01-29 Ixys, Llc Fast recovery inverse diode
DE102017119571B4 (de) 2017-08-25 2024-03-14 Infineon Technologies Ag Ionenimplantationsverfahren und ionenimplantationsvorrichtung
JP6835291B2 (ja) 2018-03-19 2021-02-24 富士電機株式会社 半導体装置および半導体装置の製造方法
DE102018114436A1 (de) 2018-06-15 2019-12-19 Infineon Technologies Ag Halbleitervorrichtung und Verfahren zum Herstellen einer Halbleitervorrichtung
JP7067636B2 (ja) 2018-10-18 2022-05-16 富士電機株式会社 半導体装置および製造方法
WO2020100995A1 (ja) 2018-11-16 2020-05-22 富士電機株式会社 半導体装置および製造方法
CN112204710B (zh) 2018-12-28 2024-07-09 富士电机株式会社 半导体装置及制造方法
EP3929336A4 (en) * 2019-02-22 2022-09-14 Mitsubishi Chemical Corporation GAN CRYSTAL AND SUBSTRATE
DE112020001029T5 (de) 2019-10-11 2021-11-25 Fuji Electric Co., Ltd. Halbleitervorrichtung und herstellungsverfahren einer halbleitervorrichtung
DE112020001040T5 (de) 2019-10-17 2021-12-23 Fuji Electric Co., Ltd. Halbleitervorrichtung und herstellungsverfahren einer halbleitervorrichtung

Family Cites Families (22)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPH05308076A (ja) 1992-03-03 1993-11-19 Fujitsu Ltd シリコンウエーハの酸素析出方法
JPH0738102A (ja) 1993-07-20 1995-02-07 Fuji Electric Co Ltd 高耐圧半導体装置の製造方法
JPH0766197A (ja) 1993-08-25 1995-03-10 Sony Corp 半導体装置の製造方法
JPH09121052A (ja) 1995-08-21 1997-05-06 Fuji Electric Co Ltd 半導体装置およびその製造方法
JPH09260639A (ja) 1996-03-27 1997-10-03 Hitachi Ltd シリコン半導体装置の製造方法
JPH11145147A (ja) 1997-11-11 1999-05-28 Nec Corp 半導体装置および半導体装置の製造方法
US7589348B2 (en) * 2005-03-14 2009-09-15 Borealis Technical Limited Thermal tunneling gap diode with integrated spacers and vacuum seal
DE102005026408B3 (de) 2005-06-08 2007-02-01 Infineon Technologies Ag Verfahren zur Herstellung einer Stoppzone in einem Halbleiterkörper und Halbleiterbauelement mit einer Stoppzone
US7855401B2 (en) * 2005-06-29 2010-12-21 Cree, Inc. Passivation of wide band-gap based semiconductor devices with hydrogen-free sputtered nitrides
CN101305470B (zh) 2005-11-14 2010-12-08 富士电机系统株式会社 半导体器件及其制造方法
EP2058846B1 (de) 2006-01-20 2011-08-31 Infineon Technologies Austria AG Verfahren zur Herstellung einer n-dotierten Zone in einem Halbleiterwafer und Halbleiterbauelement
JP5162964B2 (ja) 2006-05-29 2013-03-13 富士電機株式会社 半導体装置及び半導体電力変換装置
JP5320679B2 (ja) 2007-02-28 2013-10-23 富士電機株式会社 半導体装置およびその製造方法
US7833886B2 (en) * 2007-05-14 2010-11-16 Infineon Technologies Ag Method of producing a semiconductor element in a substrate
US7879699B2 (en) * 2007-09-28 2011-02-01 Infineon Technologies Ag Wafer and a method for manufacturing a wafer
JP5203667B2 (ja) 2007-10-16 2013-06-05 トヨタ自動車株式会社 半導体装置の製造方法
JP5365009B2 (ja) 2008-01-23 2013-12-11 富士電機株式会社 半導体装置およびその製造方法
JP5374883B2 (ja) 2008-02-08 2013-12-25 富士電機株式会社 半導体装置およびその製造方法
US7842590B2 (en) 2008-04-28 2010-11-30 Infineon Technologies Austria Ag Method for manufacturing a semiconductor substrate including laser annealing
JP2010222241A (ja) 2009-02-25 2010-10-07 Sumco Corp Igbt用シリコン単結晶ウェーハ及びigbt用シリコン単結晶ウェーハの製造方法
EP2654084B1 (en) 2010-12-17 2019-09-25 Fuji Electric Co. Ltd. Method of manufacturing a semiconductor device
WO2013100155A1 (ja) 2011-12-28 2013-07-04 富士電機株式会社 半導体装置および半導体装置の製造方法

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