JP5998025B2 - 半導体集積回路およびその動作方法 - Google Patents
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Description
まず、本願において開示される代表的な実施の形態についてその概要を説明する。代表的な実施の形態の概要説明で括弧を付して参照する図面の参照符号は、それが付された構成要素の概念に含まれるものを例示するに過ぎない。
次に、実施の形態について更に詳述する。尚、発明を実施するための最良の形態を説明するための全図において、前記の図と同一の機能を有する部品には同一の符号を付して、その繰り返しの説明は省略する。
《多機能携帯電話のためのワイヤレス電力伝送システムの構成》
図1は、実施の形態1によるバッテリ充電制御動作を実行する半導体集積回路212が搭載された多機能携帯電話のためのワイヤレス電力伝送システムの構成を示す図である。
図1に示したように、ワイヤレス電力伝送システムの送信側の送電回路1にはACアダプタ10を介してAC電源が供給される。送電回路1は、マイクロコントローラユニット(MCU)11と送電制御回路12とによって構成され、マイクロコントローラユニット(MCU)11は認証処理機能111と暗号処理機能112とを有し、送電制御回路12は整流回路121とRFドライバ122を含み、RFドライバ122は送電側アンテナコイル13と接続される。
図1に示したように、ワイヤレス電力伝送システムの受信側の受電回路2は受電制御回路21とマイクロコントローラユニット(MCU)22とによって構成され、マイクロコントローラユニット(MCU)22は認証処理機能221と暗号処理機能222を有し、受電制御回路21は整流回路211とバッテリ充電制御のための半導体集積回路212とを含むものである。
図2は、図1に示した実施の形態1によるバッテリ充電制御のための半導体集積回路212の構成を示す図である。
図3は、図2に示した実施の形態1によるバッテリ充電制御のための半導体集積回路212の外部端子の機能を示す図である。
図4は、図2に示した実施の形態1によるバッテリ充電制御のための半導体集積回路212の受電側システム3への給電と2次電池26の充電のための基本的な構成を示す図である。
図5は、図4に示した実施の形態1によるバッテリ充電制御のための半導体集積回路212の受電側システム3への給電と2次電池26の充電のための詳細な構成を示す図である。
供給端子T1に供給されるDC電源電圧VINが低レベルである場合には、差動増幅器212411の第1反転入力端子−に供給される第2オフセット電圧Voffsetと基準電圧VREF_Uとの合計電圧Voffset+VREF_Uよりも差動増幅器212411の第2反転入力端子−の入力電圧検出出力電圧VIN_DIVの電圧が低レベルとなる。その結果、差動増幅器212411の非反転入力端子+の電圧レベルである抵抗R_limitの電流制限検出電圧V_limitと第1オフセット電圧Voffsetの合計電圧Voffset+V_limitが、差動増幅器212411の第2反転入力端子−の低レベルの入力電圧検出出力電圧VIN_DIVに一致するように制御される。すなわち、低レベルの入力電圧検出出力電圧VIN_DIVに応答した差動増幅器212411によるPチャネルMOSトランジスタMP2のドレイン電流の制御によって、スイッチSW2を構成するPチャネルMOSトランジスタPath_SWとしてのPチャネルMOSトランジスタMP1のソース・ドレイン経路に流れる合計電流の最大値が低レベルに調整される。尚、このPチャネルMOSトランジスタMP1のソース・ドレイン経路に流れる合計電流は、システム給電電流とバッテリ充電電流との合計電流である。その結果、供給端子T1に供給されるDC電源電圧VINが低レベルでワイヤレス給電の給電電力が小さく2次電池26の充電電流等の負荷電流が大きい場合において、降圧DC−DCコンバータ2121が停止する可能性を軽減することが可能となる。
供給端子T1に供給されるDC電源電圧VINが高レベルである場合には、差動増幅器212411の第1反転入力端子−に供給される第2オフセット電圧Voffsetと基準電圧VREF_Uとの合計電圧Voffset+VREF_Uよりも差動増幅器212411の第2反転入力端子−の入力電圧検出出力電圧VIN_DIVの電圧が高レベルとなる。その結果、差動増幅器212411の非反転入力端子+の電圧レベルである抵抗R_limitの電流制限検出電圧V_limitと第1オフセット電圧Voffsetの合計電圧が、差動増幅器212411の第1反転入力端子−に供給される第2オフセット電圧Voffsetと基準電圧VREF_Uとの合計電圧に一致するように制御される。すなわち、基準電圧である合計電圧Voffset+VREF_Uに応答した差動増幅器212411によるPチャネルMOSトランジスタMP2のドレイン電流の制御によって、スイッチSW2を構成するPチャネルMOSトランジスタPath_SWとしてのPチャネルMOSトランジスタMP1のソース・ドレイン経路に流れる合計電流の最大値が適正レベルに調整される。尚、PチャネルMOSトランジスタMP1のソース・ドレイン経路に流れる合計電流は、システム給電電流とバッテリ充電電流の合計電流である。その結果、供給端子T1に供給されるDC電源電圧VINが高レベルでワイヤレス給電の給電電力が大きく2次電池26の充電電流等の負荷電流が大きい場合において、降圧DC−DCコンバータ2121の消費電流が過大となることを防止することが可能となる。
図6は、図4と図5とに示した実施の形態1による電流制限回路21241の電流制限動作の特性を示す図である。
図7は、図4と図5に示した実施の形態1による電流制限回路21241の電流制限動作の特性によって実現されるスイッチSW2の合計電流I_limitの特性を示す図である。
図8は、供給端子T1のDC電源電圧VINのレベルに応答した電流制限動作を実行する電流制限回路21241をバッテリ充電制御の半導体集積回路212が具備しない場合における半導体集積回路212の動作を示す図である。
図9は、図4と図5とに示した実施の形態1による供給端子T1のDC電源電圧VINのレベルに応答した電流制限動作を実行する電流制限回路21241をバッテリ充電制御の半導体集積回路212が具備する場合における半導体集積回路212の動作を示す図である。
図10は、ワイヤレス給電によって中間レベルまたは高レベルのDC電源電圧VINが供給端子T1に供給される状態でスイッチSW2のPチャネルMOSトランジスタMP1の電流制限電流を抵抗RICHGによって調整される最大バッテリ電流よりも高く設定した場合の半導体集積回路212の動作を示す図である。
図11は、ワイヤレス給電によって中間レベルまたは高レベルのDC電源電圧VINが供給端子T1に供給される状態で抵抗RICHGによって調整される最大バッテリ電流をスイッチSW2のPチャネルMOSトランジスタMP1の電流制限電流よりも高く設定した場合の半導体集積回路212の動作を示す図である。
2…受電回路
3…受電側システム
10…ACアダプタ
11…マイクロコントローラユニット(MCU)
111…認証処理機能
112…暗号処理機能
12…送電制御回路
121…整流回路
122…RFドライバ
13…送電側アンテナコイル
21…受電制御回路
211…整流回路
22…マイクロコントローラユニット(MCU)
221…認証処理機能
222…暗号処理機能
23…USB接続インターフェース
24…AC電源接続インターフェース
25…受電側アンテナコイル
26…2次電池
212…半導体集積回路
T1〜T10…端子
D1、D2…ショットキーダイオード
2121…降圧DC−DCコンバータ
2122…リニア・レギュレータ
2123…USB種別検出回路
2124…入力電圧選択回路
2125…外部インターフェース
2126…内蔵レギュレータ
2127…ゲート駆動制御回路
SW1、SW2、SW3、SW4…スイッチ
Mp1、Mp2、Mp3…PチャネルMOSトランジスタ
Mn1、Mn2、Mn3…NチャネルMOSトランジスタ
L1…インダクター
C1…容量
21211…PWM制御回路
21212…ハイサイドスイッチ
21213…サイドスイッチ
21241…電流制限回路
21242…入力電圧検出回路
21243…ローパスフィルタ
212411…差動増幅器
212412…オフセット電圧回路
212413…電圧制御回路
Claims (14)
- 半導体集積回路は、入力端子と、DC−DCコンバータと、出力端子と、電源スイッチトランジスタと、電流制限回路と、入力電圧検出回路とを具備して、
前記入力端子には、RF受信信号の整流・平滑によって生成されるDC入力電圧が供給可能とされ、
前記DC−DCコンバータは、前記入力端子に供給される前記DC入力電圧から、所望の電圧レベルを有するDC出力電圧をコンバータ出力端子から生成可能とされ、
前記出力端子は、前記DC出力電圧を使用して外部のバッテリの充電もしくは外部の受電側システムの給電が可能とされ、
前記電源スイッチトランジスタは、前記出力端子と前記DC−DCコンバータの前記コンバータ出力端子との間の電気的導通を可能として、
前記電流制限回路は、前記コンバータ出力端子から前記出力端子に流れる前記電源スイッチトランジスタの負荷電流の電流制限を実行して、
前記入力電圧検出回路は、前記入力端子に供給される前記DC入力電圧のレベル検出によって入力電圧検出信号を生成して、当該入力電圧検出信号を前記電流制限回路に供給して、
前記電流制限回路は前記入力電圧検出回路から供給される前記入力電圧検出信号に応答して、前記電源スイッチトランジスタの前記電流制限による最大電流の値を制御して、
前記入力端子に供給される前記DC入力電圧が高レベルである場合には、前記電流制限回路は前記入力電圧検出信号に応答して前記電源スイッチトランジスタの前記電流制限による最大電流の前記値を大きい電流に制御して、
前記入力端子に供給される前記DC入力電圧が前記高レベルよりも低い低レベルである場合には、前記電流制限回路は前記入力電圧検出信号に応答して前記電源スイッチトランジスタの前記電流制限による最大電流の前記値を前記大きい電流よりも小さい電流に制御して、
前記電源スイッチトランジスタは、ソースとドレインが前記コンバータ出力端子と前記出力端子にそれぞれ接続されたPチャネルMOSトランジスタであり、
前記電源スイッチトランジスタの前記PチャネルMOSトランジスタのゲートが前記電流制限回路によって制御され、
前記電流制限回路は、制御PチャネルMOSトランジスタと検出抵抗と差動増幅器とを含み、
前記制御PチャネルMOSトランジスタのソースとドレインとは、前記コンバータ出力端子と前記検出抵抗の一端にそれぞれ接続され、前記検出抵抗の他端は接地電位に接続され、
前記差動増幅器の第1反転入力端子と第2反転入力端子と非反転入力端子には、基準電圧と前記入力電圧検出信号と前記検出抵抗の前記一端の検出電圧とがそれぞれ供給され、
前記PチャネルMOSトランジスタの前記ゲートと前記制御PチャネルMOSトランジスタのゲートとは、前記差動増幅器の出力信号により制御され、
前記差動増幅器は前記第1反転入力端子の前記基準電圧と前記第2反転入力端子の前記入力電圧検出信号のうちの低レベルの電圧レベルを選択して、当該選択された低レベルの電圧レベルに非反転入力端子の前記検出電圧が一致するように前記差動増幅器の前記出力信号が前記制御PチャネルMOSトランジスタのドレイン電流を制御する
半導体集積回路。 - 請求項1において、
前記第1反転入力端子の前記基準電圧が前記第2反転入力端子の前記入力電圧検出信号より低レベルである場合には、前記基準電圧に前記検出電圧が一致するように前記制御PチャネルMOSトランジスタのドレイン電流が制御され、
前記第2反転入力端子の前記入力電圧検出信号が前記第1反転入力端子の前記基準電圧より低レベルである場合には、前記入力電圧検出信号に前記検出電圧が一致するように前記制御PチャネルMOSトランジスタのドレイン電流が制御される
半導体集積回路。 - 請求項2において、
前記電流制限回路は、第1オフセット電圧と第2オフセット電圧とを生成するオフセット電圧回路を更に含み、
前記第1オフセット電圧と前記検出電圧の第1合計電圧が前記差動増幅器の前記非反転入力端子に供給され、前記第2オフセット電圧と前記基準電圧の第2合計電圧が前記差動増幅器の前記第1反転入力端子に供給される
半導体集積回路。 - 請求項3において、
前記電流制限回路は、電圧比較増幅器と比較制御トランジスタとを有する電圧制御回路を更に含み、
前記電圧比較増幅器の第1入力端子と第2入力端子とは、前記電源スイッチトランジスタの前記PチャネルMOSトランジスタの前記ドレインと前記制御PチャネルMOSトランジスタの前記ドレインとにそれぞれ接続され、
前記電圧比較増幅器の出力端子は前記比較制御トランジスタの制御入力端子に接続され、前記比較制御トランジスタの出力電流経路は前記制御PチャネルMOSトランジスタの前記ドレインと前記検出抵抗の前記一端との間に接続された
半導体集積回路。 - 請求項4において、
前記入力電圧検出回路は、第1分圧抵抗と、第2分圧抵抗とを含み、
前記第1分圧抵抗の一端には前記入力端子に供給される前記DC入力電圧が供給され、前記第1分圧抵抗の他端は前記第2分圧抵抗の一端に接続され、前記第2分圧抵抗の他端は接地電位に接続され、
前記入力電圧検出回路の前記第1分圧抵抗の前記他端と前記第2分圧抵抗の前記一端との接続ノードから、前記入力電圧検出信号が生成される
半導体集積回路。 - 請求項5において、
前記半導体集積回路は、抵抗素子と容量素子とを含むローパスフィルタを更に具備して、
前記入力電圧検出回路から生成される前記入力電圧検出信号が前記ローパスフィルタの入力端子に供給され、前記ローパスフィルタの出力端子に伝達される前記入力電圧検出信号が前記電流制限回路の前記第2反転入力端子に供給される
半導体集積回路。 - 請求項6において、
前記入力端子には、NFC通信によるRF信号とワイヤレス給電によるRF信号とが時分割で供給可能とされる
半導体集積回路。 - 請求項7において、
前記半導体集積回路は、前記入力端子と前記出力端子との間に接続された前記DC−DCコンバータと並列に接続されたリニア・レギュレータを更に具備して、
前記リニア・レギュレータは、前記入力端子の前記DC入力電圧の供給に応答して即座動作するものであり、
前記DC−DCコンバータは、前記リニア・レギュレータよりも高い電力効率を有するスイッチングレギュレータとして動作する
半導体集積回路。 - 請求項8において、
前記入力端子に第1ショットキーダイオードを介して前記DC入力電圧と第2ショットキーダイオードを介してAC電源接続インターフェースのAC−DC変換電圧とが供給可能なように、前記入力端子が構成された
半導体集積回路。 - 請求項9において、
前記半導体集積回路は、他の入力端子とスイッチとを更に具備して、
前記他の入力端子にUSB接続インターフェースのUSB電源電圧が供給可能なように、前記他の入力端子が構成され、
前記スイッチの一端と他端とは、前記他の入力端子と前記出力端子とにそれぞれ接続された
半導体集積回路。 - 入力端子と、DC−DCコンバータと、出力端子と、電源スイッチトランジスタと、電流制限回路と、入力電圧検出回路とを具備する半導体集積回路の動作方法であって、
前記入力端子には、RF受信信号の整流・平滑によって生成されるDC入力電圧が供給可能とされ、
前記DC−DCコンバータは、前記入力端子に供給される前記DC入力電圧から、所望の電圧レベルを有するDC出力電圧をコンバータ出力端子から生成可能とされ、
前記出力端子は、前記DC出力電圧を使用して外部のバッテリの充電もしくは外部の受電側システムの給電が可能とされ、
前記電源スイッチトランジスタは、前記出力端子と前記DC−DCコンバータの前記コンバータ出力端子との間の電気的導通を可能として、
前記電流制限回路は、前記コンバータ出力端子から前記出力端子に流れる前記電源スイッチトランジスタの負荷電流の電流制限を実行して、
前記入力電圧検出回路は、前記入力端子に供給される前記DC入力電圧のレベル検出によって入力電圧検出信号を生成して、当該入力電圧検出信号を前記電流制限回路に供給して、
前記電流制限回路は前記入力電圧検出回路から供給される前記入力電圧検出信号に応答して、前記電源スイッチトランジスタの前記電流制限による最大電流の値を制御して、
前記入力端子に供給される前記DC入力電圧が高レベルである場合には、前記電流制限回路は前記入力電圧検出信号に応答して前記電源スイッチトランジスタの前記電流制限による最大電流の前記値を大きい電流に制御して、
前記入力端子に供給される前記DC入力電圧が前記高レベルよりも低い低レベルである場合には、前記電流制限回路は前記入力電圧検出信号に応答して前記電源スイッチトランジスタの前記電流制限による最大電流の前記値を前記大きい電流よりも小さい電流に制御して、
前記電源スイッチトランジスタは、ソースとドレインが前記コンバータ出力端子と前記出力端子にそれぞれ接続されたPチャネルMOSトランジスタであり、
前記電源スイッチトランジスタの前記PチャネルMOSトランジスタのゲートが前記電流制限回路によって制御され、
前記電流制限回路は、制御PチャネルMOSトランジスタと検出抵抗と差動増幅器とを含み、
前記制御PチャネルMOSトランジスタのソースとドレインとは、前記コンバータ出力端子と前記検出抵抗の一端にそれぞれ接続され、前記検出抵抗の他端は接地電位に接続され、
前記差動増幅器の第1反転入力端子と第2反転入力端子と非反転入力端子には、基準電圧と前記入力電圧検出信号と前記検出抵抗の前記一端の検出電圧とがそれぞれ供給され、
前記PチャネルMOSトランジスタの前記ゲートと前記制御PチャネルMOSトランジスタのゲートとは、前記差動増幅器の出力信号により制御され、
前記差動増幅器は前記第1反転入力端子の前記基準電圧と前記第2反転入力端子の前記入力電圧検出信号のうちの低レベルの電圧レベルを選択して、当該選択された低レベルの電圧レベルに非反転入力端子の前記検出電圧が一致するように前記差動増幅器の前記出力信号が前記制御PチャネルMOSトランジスタのドレイン電流を制御する
半導体集積回路の動作方法。 - 請求項11において、
前記第1反転入力端子の前記基準電圧が前記第2反転入力端子の前記入力電圧検出信号より低レベルである場合には、前記基準電圧に前記検出電圧が一致するように前記制御PチャネルMOSトランジスタのドレイン電流が制御され、
前記第2反転入力端子の前記入力電圧検出信号が前記第1反転入力端子の前記基準電圧より低レベルである場合には、前記入力電圧検出信号に前記検出電圧が一致するように前記制御PチャネルMOSトランジスタのドレイン電流が制御される
半導体集積回路の動作方法。 - 請求項12において、
前記電流制限回路は、第1オフセット電圧と第2オフセット電圧とを生成するオフセット電圧回路を更に含み、
前記第1オフセット電圧と前記検出電圧の第1合計電圧が前記差動増幅器の前記非反転入力端子に供給され、前記第2オフセット電圧と前記基準電圧の第2合計電圧が前記差動増幅器の前記第1反転入力端子に供給される
半導体集積回路の動作方法。 - 請求項13おいて、
前記電流制限回路は、電圧比較増幅器と比較制御トランジスタとを有する電圧制御回路を更に含み、
前記電圧比較増幅器の第1入力端子と第2入力端子とは、前記電源スイッチトランジスタの前記PチャネルMOSトランジスタの前記ドレインと前記制御PチャネルMOSトランジスタの前記ドレインとにそれぞれ接続され、
前記電圧比較増幅器の出力端子は前記比較制御トランジスタの制御入力端子に接続され、前記比較制御トランジスタの出力電流経路は前記制御PチャネルMOSトランジスタの前記ドレインと前記検出抵抗の前記一端との間に接続された
半導体集積回路の動作方法。
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