JP5778477B2 - 車載器用リセット回路 - Google Patents
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(1) 第1制御部と、
前記第1制御部との間で信号の入出力が可能な第2制御部と、
前記第2制御部に対するリセット処理の実行を命令するリセット信号を前記第1制御部に出力する電源回路と、
を備え、
前記第1制御部は、
前記電源回路からの前記リセット信号がない場合、前記第2制御部から入力する、通信異常の有無を示す制御信号に基づいて、前記リセット信号を前記第2制御部に出力し、
前記電源回路からの前記リセット信号がある場合、前記リセット信号を前記第2制御部に出力するとともに、前記第2制御部が当該リセット信号に基づくリセット処理を実行している期間、前記制御信号に基づく前記リセット信号の出力制御を停止する、
こと。
まず、バッテリからの給電を開始して、CPUA21及びCPUB22の駆動を開始する際の電子回路によるリセット制御について図2、図3及び図4(a)〜図4(e)を参照して説明する。図2は、本発明の実施形態の車載器用リセット回路を適用した電子回路における、バッテリからの電力供給開始時のリセット制御を説明するシーケンス図である。図3は、バッテリからの電力供給開始時のリセット制御におけるCPUAの処理の流れを示すフローチャートである。図4は、リセット制御に用いる信号のタイムチャートであり、図4(a)は電源ICAが出力するRESET1のタイムチャート、図4(b)は電源ICBが出力するRESET2のタイムチャート、図4(c)はRS−FFに入力するRのタイムチャート、図4(d)はRS−FFに入力するSのタイムチャート、図4(e)はRS−FFから出力するQのタイムチャートである。尚、CPUA21及びCPUB22の駆動開始前には、RS−FF32はR、S、Qいずれも「L」を情報として記憶している。尚、以後、RS−FF32のR、S、Qそれぞれの「H」または「L」を表す際、(R,S,Q)=(X,X,X)として表記する(Xには、HまたはLを記載)。例えば、CPUA21及びCPUB22の駆動開始前には、RS−FF32は、(R,S,Q)=(L,L,L)である。
次に、CPUA21及びCPUB22の駆動開始後、CPUA21がCPUB22との間での通信異常を検出した際の電子回路によるリセット制御について図5、図6及び図7(a)〜図7(e)を参照して説明する。図5は、本発明の実施形態の車載器用リセット回路を適用した電子回路における、通信異常検出時のリセット制御を説明するシーケンス図である。図6は、通信異常検出時のリセット制御におけるCPUAの処理の流れを示すフローチャートである。図7は、リセット制御に用いる信号のタイムチャートであり、図7(a)はCPUAが入力するINT1のタイムチャート、図7(b)はCPUAが出力するP01(RESET2)のタイムチャート、図7(c)はRS−FFに入力するRのタイムチャート、図7(d)はRS−FFに入力するSのタイムチャート、図7(e)はRS−FFから出力するQのタイムチャートである。尚、CPUA21及びCPUB22の駆動開始後には、[バッテリからの電力供給開始時のリセット制御]で説明したとおり、RS−FF32は、(R,S,Q)=(L,H,H)である。
次に、CPUA21及びCPUB22の駆動開始後、CPUB22への電力供給の遮断による通信異常を検出した際の電子回路によるリセット制御について図8、図9及び図10(a)〜図10(e)を参照して説明する。図8は、本発明の実施形態の車載器用リセット回路を適用した電子回路における、電力供給の遮断による通信異常検出時のリセット制御を説明するシーケンス図である。図9は、電力供給の遮断による通信異常検出時のリセット制御におけるCPUAの処理の流れを示すフローチャートである。図10は、リセット制御に用いる信号のタイムチャートであり、図10(a)は電源ICAが出力するRESET1のタイムチャート、図10(b)は電源ICBが出力するRESET2のタイムチャート、図10(c)はRS−FFに入力するSのタイムチャート、図10(d)はRS−FFに入力するRのタイムチャート、図10(e)はRS−FFから出力するQのタイムチャートである。尚、CPUA21及びCPUB22の駆動開始後には、[バッテリからの電力供給開始時のリセット制御]で説明したとおり、RS−FF32は、(R,S,Q)=(L,H,H)である。
12 電源ICB
21 CPUA
22 CPUB
31 論理積回路31
32 RS−FF
41 入出力ポート
Claims (1)
- 第1制御部と、
前記第1制御部との間で信号の入出力が可能な第2制御部と、
前記第2制御部に対するリセット処理の実行を命令するリセット信号を前記第1制御部に出力する電源回路と、
を備え、
前記第1制御部は、
前記電源回路からの前記リセット信号がない場合、前記第2制御部から入力する、通信異常の有無を示す制御信号に基づいて、前記リセット信号を前記第2制御部に出力し、
前記電源回路からの前記リセット信号がある場合、前記リセット信号を前記第2制御部に出力するとともに、前記第2制御部が当該リセット信号に基づくリセット処理を実行している期間、前記制御信号に基づく前記リセット信号の出力制御を停止する、
ことを特徴とする車載器用リセット回路。
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP2011108624A JP5778477B2 (ja) | 2011-05-13 | 2011-05-13 | 車載器用リセット回路 |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
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JP2011108624A JP5778477B2 (ja) | 2011-05-13 | 2011-05-13 | 車載器用リセット回路 |
Publications (2)
Publication Number | Publication Date |
---|---|
JP2012239148A JP2012239148A (ja) | 2012-12-06 |
JP5778477B2 true JP5778477B2 (ja) | 2015-09-16 |
Family
ID=47461632
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
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JP2011108624A Active JP5778477B2 (ja) | 2011-05-13 | 2011-05-13 | 車載器用リセット回路 |
Country Status (1)
Country | Link |
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Family Cites Families (4)
Publication number | Priority date | Publication date | Assignee | Title |
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JP2002116921A (ja) * | 2000-10-06 | 2002-04-19 | Matsushita Electric Ind Co Ltd | 中央演算装置の補助装置 |
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JP5281448B2 (ja) * | 2009-03-23 | 2013-09-04 | 富士通テン株式会社 | 電子制御装置、異常監視方法 |
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2011
- 2011-05-13 JP JP2011108624A patent/JP5778477B2/ja active Active
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