JP5711447B2 - 電源装置及び画像形成装置 - Google Patents
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Description
また、本発明の他の一態様に係る電源装置は、電力を供給する直流電源と、複数の昇圧回路と、該複数の昇圧回路の各々を駆動する複数のクロックを発生するクロック発生手段と、該複数の昇圧回路の各々のデューティ比に応じて前記直流電源からの出力を制御する電源調整回路と、を含む電源装置であって、前記昇圧回路は、それぞれ、1次側巻線に前記直流電源からの出力を供給される昇圧トランスと、前記昇圧トランスの2次側巻線に接続されて出力電圧を発生する出力手段と、前記出力手段から出力される出力電圧の目標値と、前記出力手段から出力された出力電圧の電圧値とを比較する比較手段と、前記直流電源から前記昇圧トランスに供給される電力を、前記クロック及び前記比較手段での比較結果に応じてスイッチングするスイッチング手段と、を含み、前記電源調整回路は、前記複数の昇圧回路の各々のデューティ比を検出する検出手段と、前記複数の昇圧回路のデューティ比を、それぞれ所定の値と比較する制御領域比較手段と、前記制御領域比較手段の比較結果に応じて前記昇圧トランスの1次側巻線に供給される前記直流電源の出力を調整する直流電源調整手段と、を含むことを特徴とする。
また、本発明の他の一態様に係る電源装置は、入力電圧を変換して出力するためのトランスと、前記トランスを駆動する駆動部とを各々が有する複数の電圧変換手段と、前記複数の電圧変換手段の駆動部の各々の駆動デューティ比のうち、最も高い駆動デューティ比を検出するデューティ比検出手段と、前記デューティ比検出手段によって検出された前記最も高い駆動デューティ比に応じた信号がベース端子に入力される第一のトランジスタと、前記第一のトランジスタのコレクタ端子にベース端子が接続され、且つ、コレクタ端子が前記複数の電圧変換手段の夫々のトランスに接続された第二のトランジスタとを有し、前記最も高い駆動デューティ比に応じた信号が入力されて前記第一のトランジスタのベース電流が調整されて、前記第二のトランジスタのコレクタ電流が調整されることにより、前記複数の電圧変換手段のトランスの負荷を調整する負荷調整手段と、を有することを特徴とする。
また、本発明の他の一態様に係る画像形成装置は、画像を形成するための複数の画像形成手段を有する画像形成装置であって、それぞれが、入力電圧を変換して出力するためのトランスと、前記トランスを駆動する駆動部とを有し、前記複数の画像形成手段の各々に電圧を出力する複数の電圧変換手段と、前記複数の電圧変換手段の駆動部の各々の駆動デューティ比のうち、最も高い駆動デューティ比を検出するデューティ比検出手段と、前記デューティ比検出手段によって検出された前記最も高い駆動デューティ比に応じた信号がベース端子に入力される第一のトランジスタと、前記第一のトランジスタのコレクタ端子にベース端子が接続され、且つ、コレクタ端子が前記複数の電圧変換手段の夫々のトランスに接続された第二のトランジスタとを有し、前記最も高い駆動デューティ比に応じた信号が入力されて前記第一のトランジスタのベース電流が調整されて、前記第二のトランジスタのコレクタ電流が調整されることにより、前記複数の電圧変換手段のトランスの負荷を調整する負荷調整手段と、を有することを特徴とする。
本発明の実施形態について説明する前に、前提となる技術について図面を用いて説明する。図2は1種類の高電圧を出力する昇圧回路のブロック図である。図2において201が昇圧回路であり、出力端子202から所望の高圧電圧が出力される。207は昇圧トランスであり、トランス電源203から供給される直流電圧が1次側巻線に印加され、FET250のスイッチング動作によって駆動される。なお、FET250は中央演算処理装置(CPU)204から出力されるクロックによって動作する。CPU204は、クロック発生手段として機能する。昇圧トランス207が駆動すると、2次側巻線に高圧交流電圧が発生する。高圧交流電圧はダイオード213とコンデンサ209によって整流され、出力端子202には、負極の直流高圧が発生する。出力端子202は抵抗210、212、214によって分圧された後にコンパレータ205の正極入力に接続されている。
<構成>
図1は本発明に係る画像形成装置の第1実施形態としてのカラーレーザビームプリンタの構成を説明するための図である。
帯電ローラ2a〜dに印加する帯電バイアスを生成する電源装置100の構成を以下に説明する。図3は電源装置100の内部回路図である。電源装置100は、昇圧回路350a〜d、デューティ比判定回路351、及びトランス電源352で構成されている。帯電バイアスは、昇圧回路350a〜dにそれぞれ設けられた出力端子304a〜dから出力される。出力端子304a〜dは、それぞれ帯電ローラ2a〜dに接続されており、各ローラに異なるレベルの高圧バイアスを印加できる構成になっている。電源装置100はCPU353からの制御信号であるクロックCLK1〜4及び目標電圧信号CONT(A〜D)により制御され、所望のタイミング及びレベルで帯電バイアスを出力する。つまり、CPU353は、クロックを発生するクロック発生手段として機能する。また、電源装置100においては、昇圧回路350a〜d内に設けられた第1制御ループによる制御と、デューティ比判定回路351及び直流電源としてのトランス電源352で構成した第2制御ループによる制御によって、出力レベル制御を行っている。
帯電バイアスを生成する昇圧回路350a〜dの内部構成について詳しく説明する。昇圧回路350a〜dは、それぞれ異なるデューティ比で駆動可能であり、1つの直流電源から出力された電圧を、複数の負荷に合わせて昇圧して出力する。4つの昇圧回路350a〜dは何れも同じ構成であるため、ここでは例として昇圧回路350aについてのみ説明する。301aは昇圧トランスである。昇圧トランス301aの1次側巻線にはトランス電源352から供給される電圧が印加されている。CPU353からCLK1が出力されるとFET311aのスイッチング動作により昇圧トランス301aが駆動し、2次側巻線に高圧交流電圧が発生する。発生した高圧交流電圧はダイオード309aとコンデンサ307aによって整流され、出力端子304aに負極の直流電圧-Vout(a)が発生する。出力端子304aは、抵抗308a,306a、305aによって分圧された後にコンパレータ302aの正極入力に接続されている。
ここで、昇圧回路350aの出力電圧に現われるリップルについて説明する。図4で示すように出力電圧にはノコギリ状のリップルが現われる。
このリップルのレベルは電圧制御による昇圧トランス301aの駆動区間/停止区間の比率(以下、デューティ比、と記す)の大きさにより決まり、デューティ比が高いほど、リップルが小さくなる。図5(a)と図5(b)に示す波形は、それぞれ、昇圧トランス301aのデューティ比が大きい場合と、デューティ比が小さい場合の出力電圧を示す。
図3において、デューティ比判定回路351は、昇圧トランス301a〜dの各デューティ比を検出し、所定デューティ比以上で制御されている昇圧トランスを選択して、後述するトランス電源の制御信号を生成する動作を行う。 昇圧トランス301aのFET311aを駆動するクロック信号COMP1はデューティ比判定回路351内のFET327aのゲート端子に接続されている。FET327aのソース端子は電源Vcc、抵抗325a、326a、コンデンサ329aで構成されたフィルタ回路を介してオペアンプ324aの正入力端子に接続されている。これによりオペアンプ324aの正入力にはCOMP1のデューティ比に対応する直流電圧Vpが印加される。電圧Vpは以下の式であらわされる。
ここでVccは電源電圧、DUTY1は昇圧トランス301aのデューティ比、DUTY2はCPU353から出力されるクロックCLK1のHIGHのDUTYである。
Vn=Vcc×(1 − 0.9×DUTY2) (式2)
(1)昇圧トランス301aのデューティ比が90%未満の場合
この場合、オペアンプ324aの出力端子には電源電圧である24Vが出力される。このとき、ダイオード323aはオフ状態となる。
(2)昇圧トランス301aのデューティ比が90%以上の場合
この場合、Vp<Vnとなることから、オペアンプ324aの出力端子の電圧は低下し、ダイオード323aがOn状態となる。ダイオード323aのアノード側電圧はトランス電源352の制御信号として出力される。
このような回路を構成することで、昇圧トランス301a〜dのうち、デューティ比が90%以上の昇圧トランスに相当するオペアンプの出力のみが、トランス電源352を駆動する。
以上のように、FET327a、電源Vcc、抵抗325a、326a、コンデンサ329aで構成されたフィルタ回路は、複数の昇圧回路350a〜dの各々のデューティ比を検出する検出手段として機能する。また、オペアンプ324aは、複数の昇圧回路350a〜dのデューティ比を、それぞれ所定の値(ここでは90%)と比較する制御領域比較手段として機能する。
トランス電源352はデューティ比判定回路351からの出力結果に基づいて、昇圧トランス301a〜dの1次側巻線に印加する電源電圧を調整する。つまり、トランス電源は、制御領域比較手段の比較結果に応じて昇圧トランスの1次側巻線に供給される直流電源の出力を調整する直流電源調整手段として機能する。昇圧トランス301a〜dのうち、昇圧トランス301aのみのデューティ比が90%を超えた場合、オペアンプ324aの出力が低下する。そして、ダイオード323a、抵抗322を介してトランジスタ320のベース電流が流れ、トランジスタ320によって、昇圧トランス301a〜dの1次側巻線に電圧が印加される。
以上のように、デューティ比判定回路351は、複数の昇圧回路の各々のデューティ比に応じて直流電源からの出力を制御する電源調整回路として機能する。
電源装置100では、デューティ比判定回路351及びトランス電源352によって形成された制御ループにより、出力電圧に発生するリップルを低減する。本実施形態では、この制御ループを第2制御ループと呼ぶ。デューティ比判定回路351とトランス電源352との組合せは、複数の昇圧回路350a〜dの内、最もデューティ比が高い昇圧回路の駆動条件に応じて、各昇圧回路への入力電圧を制御する制御回路として機能する。トランス電源352は、デューティ比判定回路351の出力に基づいて、昇圧トランス301a〜dへの入力電圧を制御する。
即ち、全ての昇圧トランスのデューティ比が高い状態において、第2制御ループによる電圧制御が行われることで、各高圧出力のリップルが低減される。図6A、Bは電源装置によって出力される4個の帯電バイアスの出力値と、デューティ比の関係を示すものである。図6Aは4つの高圧バイアスの出力値を全て−500Vで制御した場合のデューティ比を示す。出力1のデューティ比が90%となるよう第2制御ループによって制御されている。
以下、本発明の第2実施形態について、図7及び図8A、Bに基づいて説明する。図7は第2実施形態としての電源装置300の構成図である。第1制御ループの構成は、第1実施形態と同じ構成であり、第2制御ループを構成する下記の点が第1実施形態の構成と異なるので、ここでは、第1実施形態と異なる以下の個所のみ説明する。
・負荷調整回路701を追加
・デューティ比判定回路351の出力を負荷調整回路701に接続
・昇圧トランスの1次側巻線に印加する電源を24Vに固定
負荷調整回路701はデューティ比判定回路351の検知結果に基づいて、昇圧トランス301a〜dの2次側負荷電流を調整する。抵抗710a〜dは、それぞれ昇圧トランス301a〜dに接続され、トランジスタ703を介して24V電源に接続されている。トランジスタ703は抵抗702を介してトランジスタ704のコレクタ端子接続されている。このような構成とすることで、トランジスタ704のベース電流を調整し、トランジスタ703のコレクタ電流を変化させ、昇圧トランス301a〜dの負荷電流を可変制御できる。トランジスタ704のベースは抵抗711を介してデューティ比判定回路351に接続されている。
電源装置300では、デューティ比判定回路351及び負荷調整回路701によって形成された第2制御ループにより、出力電圧に発生するリップルのレベルが低減される制御が働く。これにより、最も高いデューティ比で制御される昇圧トランスのデューティ比が90%となるよう、昇圧トランスの負荷が制御される。デューティ比判定回路351及び負荷調整回路701は、複数の昇圧回路の内、最もデューティ比が高い昇圧回路の駆動条件に応じて、昇圧回路の負荷を制御する制御回路として機能する。
Claims (10)
- 電力を供給する直流電源と、複数の昇圧回路と、該複数の昇圧回路の各々を駆動する複数のクロックを発生するクロック発生手段と、該複数の昇圧回路の各々のデューティ比に応じて前記直流電源からの出力を制御する電源調整回路と、を含む電源装置であって、
前記昇圧回路は、それぞれ、
1次側巻線に前記直流電源からの出力を供給される昇圧トランスと、
前記昇圧トランスの2次側巻線に接続されて出力電圧を発生する出力手段と、
前記出力手段から出力される出力電圧の目標値と、前記出力手段から出力された出力電圧の電圧値とを比較する比較手段と、
前記直流電源から前記昇圧トランスに供給される電力を、前記クロック及び前記比較手段での比較結果に応じてスイッチングするスイッチング手段と、
を含み、
前記電源調整回路は、
前記複数の昇圧回路の各々のデューティ比を検出する検出手段と、
前記複数の昇圧回路のデューティ比を、それぞれ所定の値と比較する制御領域比較手段と、
前記制御領域比較手段の比較結果に応じて前記昇圧トランスの1次側巻線に供給される前記直流電源の電力を調整する直流電源調整手段と、
を含むことを特徴とする電源装置。 - 電力を供給する直流電源と、複数の昇圧回路と、該複数の昇圧回路の各々を駆動する複数のクロックを発生するクロック発生手段と、該複数の昇圧回路の各々のデューティ比に応じて前記直流電源からの出力を制御する電源調整回路と、を含む電源装置であって、
前記昇圧回路は、それぞれ、
1次側巻線に前記直流電源からの出力を供給される昇圧トランスと、
前記昇圧トランスの2次側巻線に接続されて出力電圧を発生する出力手段と、
前記出力手段から出力される出力電圧の目標値と、前記出力手段から出力された出力電圧の電圧値とを比較する比較手段と、
前記直流電源から前記昇圧トランスに供給される電力を、前記クロック及び前記比較手段での比較結果に応じてスイッチングするスイッチング手段と、
を含み、
前記電源調整回路は、
前記複数の昇圧回路の各々のデューティ比を検出する検出手段と、
前記複数の昇圧回路のデューティ比を、それぞれ所定の値と比較する制御領域比較手段と、
前記制御領域比較手段の比較結果に応じて前記昇圧トランスの1次側巻線に供給される前記直流電源の出力を調整する直流電源調整手段と、
を含むことを特徴とする電源装置。 - 請求項1または2に記載の電源装置を備え、該電源装置によって出力された電力を利用して画像形成を行なうことを特徴とする画像形成装置。
- 入力電圧を変換して出力するためのトランスと、前記トランスを駆動する駆動部とを各々が有する複数の電圧変換手段と、
前記複数の電圧変換手段の駆動部の各々の駆動デューティ比のうち、最も高い駆動デューティ比を検出するデューティ比検出手段と、
前記デューティ比検出手段によって検出された前記最も高い駆動デューティ比に応じた信号がベース端子に入力される第一のトランジスタと、前記第一のトランジスタのコレクタ端子にベース端子が接続され、且つ、コレクタ端子が前記複数の電圧変換手段の夫々のトランスに接続された第二のトランジスタとを有し、前記最も高い駆動デューティ比に応じた信号が入力されて前記第一のトランジスタのベース電流が調整されて、前記第二のトランジスタのコレクタ電流が調整されることにより、前記複数の電圧変換手段のトランスの負荷を調整する負荷調整手段と、
を有することを特徴とする電源装置。 - 前記最も高い駆動デューティ比を100%未満の一定の値に制御することを特徴とする請求項4に記載の電源装置。
- 前記最も高い駆動デューティ比の駆動部を有する電圧変換手段以外の電圧変換手段の駆動部の駆動デューティ比は、前記一定の値より低いことを特徴とする請求項5に記載の電源装置。
- 画像を形成するための複数の画像形成手段を有する画像形成装置であって、
それぞれが、入力電圧を変換して出力するためのトランスと、前記トランスを駆動する駆動部とを有し、前記複数の画像形成手段の各々に電圧を出力する複数の電圧変換手段と、
前記複数の電圧変換手段の駆動部の各々の駆動デューティ比のうち、最も高い駆動デューティ比を検出するデューティ比検出手段と、
前記デューティ比検出手段によって検出された前記最も高い駆動デューティ比に応じた信号がベース端子に入力される第一のトランジスタと、前記第一のトランジスタのコレクタ端子にベース端子が接続され、且つ、コレクタ端子が前記複数の電圧変換手段の夫々のトランスに接続された第二のトランジスタとを有し、前記最も高い駆動デューティ比に応じた信号が入力されて前記第一のトランジスタのベース電流が調整されて、前記第二のトランジスタのコレクタ電流が調整されることにより、前記複数の電圧変換手段のトランスの負荷を調整する負荷調整手段と、
を有することを特徴とする画像形成装置。 - 前記最も高い駆動デューティ比を100%未満の一定の値に制御することを特徴とする請求項7に記載の画像形成装置。
- 前記最も高い駆動デューティ比の駆動部を有する電圧変換手段以外の電圧変換手段の駆動部の駆動デューティ比は、前記一定の値より低いことを特徴とする請求項8に記載の画像形成装置。
- 前記画像形成手段は、像担持体を帯電させる帯電手段を含むことを特徴とする請求項7乃至9のいずれか1項に記載の画像形成装置。
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