JP5339716B2 - 抵抗メモリ素子及びその製造方法 - Google Patents
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Description
基板の上部にPt電極を50nm厚さに形成した後、前記Pt電極の上部に0.05wt%のTiイオンがドーピングされたNiターゲットを利用したリアクティブスパッタリング法(O2分圧:10モル%、スパッタリング温度:常温(約25℃))により、0.05wt%のTiイオンを含めたNiO層(厚さは500Åであり、サイズは100μm×100μmである)を形成した。次いで、前記0.05wt%のTiイオンを含有したNiO層の上部にPt電極を形成することによって、抵抗メモリ素子を完成した。
0.05wt%のTiイオンがドーピングされたNiターゲットの代わりに、0.1wt%のTiイオンがドーピングされたNiターゲットを利用して0.1wt%のTiイオンを含めたNiO層を形成した点を除いては、前記実施例1と同じ方法で抵抗メモリ素子を完成した。
0.05wt%のTiイオンがドーピングされたNiターゲットの代わりに、純粋なNiターゲットを利用し、スパッタリング温度を約400℃に変化させてNiO層を形成した点を除いては、前記実施例1と同じ方法で抵抗メモリ素子を完成した。
前記実施例2から得た0.1wt%のTiイオンを含めたNiO層(常温蒸着)を備えた抵抗メモリ素子と、比較例1から得た純粋なNiO層(約400℃の高温蒸着)を備えた抵抗メモリ素子とのXRDデータを図3に示した。このとき、比較のために、常温で蒸着された純粋なNiO層を備えた抵抗メモリ素子のXRDデータ(NiO,R.T.で表示されたデータ)も図3に共に示した。
前記実施例1、2及び比較例1の抵抗メモリ素子の電圧−電流特性を測定した結果を図4に示した。
22 抵抗層
23 上部電極
Claims (17)
- 下部電極と、
前記下部電極上に備えられ、金属酸化物及び金属イオンドーパントを含めた抵抗層と、
前記抵抗層の上部の上部電極と、を備え、
前記抵抗層中の金属イオンドーパントは、前記金属酸化物の金属位置に置換されて酸素と結合し、余剰電子を残すことで前記金属酸化物のホールを相殺させることを特徴とする抵抗メモリ素子。 - 前記抵抗層中の金属酸化物は、Ni酸化物、Ti酸化物、Hf酸化物、Zr酸化物、Zn酸化物、W酸化物、Co酸化物及びNb酸化物からなる群から選択された一つ以上の酸化物であることを特徴とする請求項1に記載の抵抗メモリ素子。
- 前記抵抗層中の金属酸化物は、NiOであることを特徴とする請求項1に記載の抵抗メモリ素子。
- 前記抵抗層中の金属イオンドーパントは、遷移金属イオンであることを特徴とする請求項1に記載の抵抗メモリ素子。
- 前記抵抗層中の金属イオンドーパントは、Niイオン、Tiイオン、Hfイオン、Zrイオン、Znイオン、Wイオン、Coイオン及びNbイオンからなる群から選択された一つ以上のイオンであることを特徴とする請求項1に記載の抵抗メモリ素子。
- 前記抵抗層中の金属イオンドーパントは、Tiイオンであることを特徴とする請求項1に記載の抵抗メモリ素子。
- 前記抵抗層中の金属イオンドーパントの含量は、0.0001wt%ないし5wt%であることを特徴とする請求項1に記載の抵抗メモリ素子。
- 前記抵抗層のうち、金属酸化物がNiOであり、金属イオンドーパントがTiイオンであることを特徴とする請求項1に記載の抵抗メモリ素子。
- (イ)下部電極を形成する工程と、
(ロ)前記下部電極上に金属酸化物及び金属イオンドーパントを含めた抵抗層を形成する工程と、
(ハ)前記抵抗層上に上部電極を形成する工程と、を含み、
前記(ロ)抵抗層を形成する工程において、前記金属イオンドーパントを前記金属酸化物の金属位置に置換させて酸素と結合させ、余剰電子を残すことで前記金属酸化物のホールを相殺することを特徴とする抵抗メモリ素子の製造方法。 - 前記抵抗層の形成工程を常温ないし200℃で行うことを特徴とする請求項9に記載の抵抗メモリ素子の製造方法。
- 前記抵抗層の形成工程を常温で行うことを特徴とする請求項9に記載の抵抗メモリ素子の製造方法。
- 前記抵抗層中の金属酸化物は、Ni酸化物、Ti酸化物、Hf酸化物、Zr酸化物、Zn酸化物、W酸化物、Co酸化物及びNb酸化物からなる群から選択された一つ以上の酸化物であることを特徴とする請求項9に記載の抵抗メモリ素子の製造方法。
- 前記金属イオンドーパントは、Niイオン、Tiイオン、Hfイオン、Zrイオン、Znイオン、Wイオン、Coイオン及びNbイオンからなる群から選択された一つ以上のイオンであることを特徴とする請求項9に記載の抵抗メモリ素子の製造方法。
- 前記抵抗層の形成工程を、前記金属イオンドーパントがドーピングされた金属ターゲットを利用した蒸着法により行うことを特徴とする請求項9に記載の抵抗メモリ素子の製
造方法。 - 前記抵抗層の形成工程を、二つ以上の金属ターゲットを利用した蒸着法により行うことを特徴とする請求項9に記載の抵抗メモリ素子の製造方法。
- 前記抵抗層の形成工程を、スパッタリング法、化学気相蒸着法、プラズマ気相蒸着法または原子層蒸着法を利用して行うことを特徴とする請求項9に記載の抵抗メモリ素子の製造方法。
- 前記抵抗層の形成工程を、TiイオンがドーピングされたNiターゲットを利用した蒸着法により行うことを特徴とする請求項9に記載の抵抗メモリ素子の製造方法。
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