JP5052221B2 - 半導体集積回路 - Google Patents
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Description
10:マイクロコントローラ、11:揮発メモリ、15:リセット検出回路、
20:フラッシュメモリ、21:フラッシュメモリ制御回路、22:フラッシュメモリプログラミング回路、
30:プログラム領域、31:データ領域、32:トリミングデータ領域、
40、41:レジスタ、45、46:トリミング制御回路、
50:抵抗、51:コンデンサ、52:トランジスタ、53:ヒューズ
Claims (3)
- マイクロコントローラと、揮発性メモリと、前記マイクロコントローラを制御するプログラムデータと前記揮発性メモリに書込む制御データとが混在して格納されるブロック毎にデータの消去、書込みが可能な不揮発性メモリと、前記プログラムデータ及び前記制御データの書込みあるいは読出しを制御する制御回路と、あるいはさらに別の記憶装置とを備えた半導体集積回路において、
前記制御回路は、前記不揮発性メモリの初期化要求の信号を検知し、初期化前に、前記不揮発性メモリから前記制御データを読出し、該読出した制御データを前記揮発性メモリあるいは前記別の記憶装置に書込む制御を行うとともに、前記不揮発性メモリの初期化後に、前記揮発性メモリあるいは前記別の記憶装置から前記制御データを読出し、該読出した制御データを前記不揮発性メモリに書込む制御を行うことを特徴とする半導体集積回路。 - 請求項1記載の半導体集積回路において、
前記制御回路は、初期化後に前記制御データが書込まれた前記不揮発性メモリに前記プログラムデータを書込む際、前記制御データが書込まれた前記不揮発性メモリのアドレスをスキップして前記プログラムデータを書込む制御を行うことを特徴とする半導体集積回路。 - 請求項1又は2いずれか記載の半導体集積回路において、
前記制御回路は、前記半導体装置の電源投入の信号を検知し、前記不揮発性メモリから前記制御データを読出し、該読出した制御データを前記揮発性メモリに書込む制御を行うことを特徴とする半導体集積回路。
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