JP4998665B2 - 半導体装置の製造方法 - Google Patents
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Description
装置の製造方法および半導体装置を提供することにある。
(a)半導体層に、凹部の第1認識マークを形成する工程と、
(b)前記第1認識マークを用いて、前記半導体層にウェルを形成する工程と、
(c)前記半導体層に素子分離絶縁層を形成する工程と、
(d)前記第1認識マークの内面を覆う第1絶縁層を形成する工程と、
(e)前記第1絶縁層の上に前記第1認識マークを埋め込む第2絶縁層を形成し、第2認識マークを形成する工程と、
(f)前記半導体層に、前記第2認識マークを用いてトランジスタを形成する工程と、を含む。
前記第1認識マークは、スクライブ領域に形成されることができる。
前記工程(c)は、前記半導体層に溝を形成する工程と、
前記溝に絶縁層を埋め込む工程と、を含み、
前記絶縁層を埋め込む工程は、
前記工程(e)における前記第2絶縁層の形成と同時に行われることができる。
前記第1絶縁層は、窒化膜であり、前記第2絶縁層は、酸化膜であることができる。
チップ領域およびスクライブ領域を有する半導体層と、
前記チップ領域に設けられたトランジスタと、
前記スクライブ領域に設けられた認識マークと、を含み、
前記認識マークは、
前記半導体層に設けられた凹部と、
前記凹部の内面を覆って設けられた第1絶縁層と、
前記第1絶縁層の上であって、前記凹部を埋め込む第2絶縁層と、を含むことができる。
前記第1絶縁層の露出面は、前記半導体層の上面と同一または該半導体層の上面と比して低い位置にあり、
前記第2絶縁層の上面は、前記半導体層の上面と同一または該半導体層の上面と比して高い位置にあることができる。
前記第2絶縁層の上面は、前記半導体層に設けられた素子分離絶縁層の上面と同一の高さにあることができる。
平面視したとき、前記認識マークの端から所定の距離を有する領域には、前記素子分離絶縁層が設けられていないことができる。
前記トランジスタは、
前記半導体層に設けられたウェルと、
前記半導体層の上方に設けられたゲート絶縁層と、
前記ゲート絶縁層の上方に設けられたゲート電極と、
前記半導体層内に形成されたチャネル領域と、
前記半導体層に設けられたソース領域およびドレイン領域と、
前記チャネル領域と、前記ソース領域およびドレイン領域との間に設けられたオフセット絶縁層と、を含むことができる。
まず、本実施の形態にかかる半導体装置について図1を参照しつつ説明する。図1は、本実施の形態にかかる半導体装置を模式的に示す断面図である。
次に、本実施の形態にかかる半導体装置の変形例について図2を参照しつつ説明する。図2は、本変形例にかかる半導体装置を模式的に示す断面図である。本変形例にかかる半導体装置は、上記の実施の形態にかかる半導体装置と比して認識マーク200が異なる例である。以下の説明では、図1に示す半導体装置と異なる点についてのみ示す。
次に、図3ないし図9を参照しつつ、本実施の形態にかかる半導体装置の製造方法について説明する。図3ないし図9は、本実施の形態にかかる半導体装置の製造工程を模式的に示す断面図である。
Claims (5)
- (a)半導体層に、凹部の第1認識マークを形成する工程と、
(b)前記第1認識マークを用いて、前記半導体層にウェルを形成する工程と、
(c)前記半導体層に素子分離絶縁層を形成する工程と、
(d)前記第1認識マークの内面を覆う第1絶縁層を形成する工程と、
(e)前記第1絶縁層の上に前記第1認識マークを埋め込む第2絶縁層を形成し、第2認識マークを形成する工程と、
(f)前記半導体層に、前記第2認識マークを用いてトランジスタを形成する工程と、を含み、
前記工程(c)は、前記半導体層に溝を形成する工程と、
前記溝に絶縁層を埋め込む工程と、を含み、
前記絶縁層を埋め込む工程は、
前記工程(e)における前記第2絶縁層の形成と同時に行われ、
前記第1絶縁層および前記第2絶縁層は、光の屈折率の異なる材質の絶縁層である、半導体装置の製造方法。 - 請求項1において、
前記第1認識マークは、スクライブ領域に形成される、半導体装置の製造方法。 - 請求項1または2において、
前記第1絶縁層は、窒化膜であり、前記第2絶縁層は、酸化膜である、半導体装置の製造方法。 - 請求項1ないし3のいずれか1項において、
前記工程(e)では、
前記第1絶縁層の露出面が、前記第2絶縁層の上面と比して低い位置となるように、前記第1絶縁層をエッチングして、前記第2認識マークを形成する、半導体装置の製造方法。 - 請求項4において、
前記第2絶縁層の上面は、前記素子分離絶縁層の上面と同一の高さにある、半導体装置の製造方法。
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