JP4901458B2 - 電子部品内蔵基板 - Google Patents
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Description
図11に示すように、特許文献1における電子部品内蔵基板100は、下層側配線基板10と上層側配線基板20との間に電子部品30を挟む配置とし、配線基板10,20をはんだボール40で電気的に接続すると共に、封止樹脂50により封止された構成を有している。
このようなはんだボールを用いることにより、上下配線基板間でコア材がストッパとして作用することにより、上下配線基板間の離間距離を一定に保つことができ、電子部品内蔵基板の寸法精度を高めることができる。また、電子部品内蔵基板の機械的強度の向上にも有効に作用する。
これにより、電子部品内蔵基板(半導体装置)の実装密度を向上させることができる。
以下、電子部品内蔵基板の参考例について、図面に基づいて説明する。図1は、第1参考例における電子部品内蔵基板の横断面図である。図2は、図1の電子部品内蔵基板における開口部付近の平面図である。図3は第1参考例において用いられるはんだボールの構造を示す断面図である。
本参考例における電子部品内蔵基板100は、一対の配線基板(下層側配線基板10と上層側配線基板20)の間に電子部品30が搭載され、一方の配線基板である下層側配線基板10と他方の配線基板である上層側配線基板20とは、はんだボール40を介して電気的に接続されている。また、下層側配線基板10と上層側配線基板20の間には封止樹脂50が注入されている。
銅コア42入りのはんだボール40を用いることにより、下層側配線基板10と上層側配線基板20は、少なくとも下層側配線基板10の接続パッド12Aと上層側配線基板20の接続パッド22Aの離間距離が銅コア42の径寸法となる離間距離を維持した状態で電気的に接続される。
まず、図4に示すように、一方の配線基板である下層側配線基板10に電子部品である半導体素子30を搭載する。半導体素子30は、バンプ36を下層側配線基板10の上面に形成した接続パッド12Bに位置合わせしてフリップチップ方式により下層側配線基板10に搭載する。半導体素子30を下層側配線基板10にフリップチップ接続した後、半導体素子30と下層側配線基板10の上面との間にアンダーフィル樹脂80を注入する。
図6に示すように、リフロー後のはんだボールは、銅コア42の外周を被覆していたはんだ44が溶融し、はんだ44および銅コア42により下層側配線基板10の接続パッド12Aと上層側配線基板20の接続パッド22Aとを電気的に接続すると共に、銅コア42がストッパとして作用して互いの配線基板間10,20の離間距離を維持した状態になる。
配線基板10,20間に封止樹脂50を充填する方法としては、例えば図7に示すように、樹脂封止用の金型90,91により下層側配線基板10と上層側配線基板20をクランプし、ゲート94から下層側配線基板10と上層側配線基板20の間に封止樹脂50を圧入する方法がある。封止樹脂50を圧入した後、封止樹脂50を加熱して硬化させる。
なお、本製造方法の説明においては、1つの電子部品内蔵基板100を図示して説明しているが、実際の製造方法においては、大判の下層側配線基板10および上層側配線基板20を用いて、複数の電子部品内蔵基板100,100,100,・・・を同時に樹脂封止した後個々の基板外形に沿って個片に切断する。
図9は本発明にかかる電子部品内蔵基板の第1実施形態における構造を示す横断面図である。本実施形態は、下層側配線基板10と上層側配線基板20の間に液状の封止樹脂50を注入して封止した電子部品内蔵基板100である。図9には下層側配線基板10の上面側に設けられた接続パッド12Aと上層側配線基板20の下面側に設けられた接続パッド22Aとをはんだボール40により電気的に接続した後、下層側配線基板10と上層側配線基板20に液状の封止樹脂50を注入した後、封止樹脂50を熱硬化させた状態を示している。
次に第2参考例について説明する。図10は電子部品内蔵基板の第2参考例における構成を示す横断面図である。本参考例では、第1参考例で説明した電子部品内蔵基板(半導体装置)10の上にさらに他の電子部品(半導体素子)60を搭載した電子部品内蔵基板(半導体装置)110を示している。電子部品60が開口部24を覆った状態で上層側配線基板20に搭載されている。
また、図10に示すような電子部品60を搭載する他に、チップキャパシタやチップ抵抗等の回路部品等を上層側配線基板20に搭載することもできる。回路部品等を上層側配線基板20に搭載する際においても、回路部品等により開口部24を覆う形態に搭載することが可能である。
例えば、以上の実施形態においては、電子部品30として半導体素子を例に説明しているが、電子部品30は半導体素子に限定されるものではなく、他の電子部品を用いてもよい。
さらにまた、半導体素子30を下層側配線基板10に搭載する際はフリップチップ接続によらず、ワイヤボンディングにより接続することもできる。
12,22 配線パターン
12A,12B,22A 接続パッド
13,23 レジスト
14,62 外部接続端子
20 上層側配線基板
24 開口部
30,60 電子部品(半導体素子)
32 電極面
36 バンプ
40 はんだボール
42 銅コア
44 はんだ
50 封止樹脂
80 アンダーフィル樹脂
90,91 樹脂封止用の金型
100,110 電子部品内蔵基板
H スルーホール
Claims (4)
- 一対の配線基板間に電子部品を搭載した電子部品内蔵基板であって、
前記配線基板同士がはんだボールを介して電気的に接続され、
前記電子部品が搭載された一方の配線基板と対向する他方の配線基板に、前記電子部品と対向する位置に前記電子部品の平面形状よりも大きく開口する開口部が設けられ、
前記電子部品は、裏面側が前記開口部に入り込む配置であると共に裏面の位置が前記開口部の深さ方向における中途位置に位置するように搭載されていて、
前記一対の配線基板間が、前記電子部品の裏面および前記開口部内を露出させた状態で封止樹脂によって封止されていることを特徴とする電子部品内蔵基板。 - 前記はんだボールとして、金属からなるコア材の外表面にはんだが被覆されたコア入りはんだボールが用いられていることを特徴とする請求項1記載の電子部品内蔵基板。
- 前記コア材は銅からなることを特徴とする請求項2記載の電子部品内蔵基板。
- 前記開口部が形成された配線基板の外面に、少なくとも前記開口部の領域の一部を覆う配置に電子部品あるいは回路部品が搭載されていることを特徴とする請求項1〜3のうちのいずれか一項に記載の電子部品内蔵基板。
Priority Applications (5)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP2006348750A JP4901458B2 (ja) | 2006-12-26 | 2006-12-26 | 電子部品内蔵基板 |
| US11/962,656 US7872359B2 (en) | 2006-12-26 | 2007-12-21 | Electronic component contained substrate |
| KR1020070136348A KR20080060167A (ko) | 2006-12-26 | 2007-12-24 | 전자 부품 내장 기판 |
| TW096150213A TW200832674A (en) | 2006-12-26 | 2007-12-26 | Electronic component contained substrate |
| CNA200710160631XA CN101211900A (zh) | 2006-12-26 | 2007-12-26 | 包含电子元件的基板 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP2006348750A JP4901458B2 (ja) | 2006-12-26 | 2006-12-26 | 電子部品内蔵基板 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JP2008159955A JP2008159955A (ja) | 2008-07-10 |
| JP4901458B2 true JP4901458B2 (ja) | 2012-03-21 |
Family
ID=39611747
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP2006348750A Active JP4901458B2 (ja) | 2006-12-26 | 2006-12-26 | 電子部品内蔵基板 |
Country Status (5)
| Country | Link |
|---|---|
| US (1) | US7872359B2 (ja) |
| JP (1) | JP4901458B2 (ja) |
| KR (1) | KR20080060167A (ja) |
| CN (1) | CN101211900A (ja) |
| TW (1) | TW200832674A (ja) |
Families Citing this family (17)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP5279631B2 (ja) * | 2009-06-23 | 2013-09-04 | 新光電気工業株式会社 | 電子部品内蔵配線基板と電子部品内蔵配線基板の製造方法 |
| JP5445001B2 (ja) * | 2009-09-29 | 2014-03-19 | 沖電気工業株式会社 | 半導体素子内蔵基板及び半導体素子内蔵基板の製造方法 |
| TWI419283B (zh) * | 2010-02-10 | 2013-12-11 | 日月光半導體製造股份有限公司 | 封裝結構 |
| JP5589462B2 (ja) * | 2010-03-16 | 2014-09-17 | カシオ計算機株式会社 | 半導体装置及び半導体装置の製造方法 |
| US20120159118A1 (en) | 2010-12-16 | 2012-06-21 | Wong Shaw Fong | Lower IC Package Structure for Coupling with an Upper IC Package to Form a Package-On-Package (PoP) Assembly and PoP Assembly Including Such a Lower IC Package Structure |
| CN202276549U (zh) * | 2011-09-26 | 2012-06-13 | 番禺得意精密电子工业有限公司 | 电连接组件 |
| US8969730B2 (en) * | 2012-08-16 | 2015-03-03 | Apple Inc. | Printed circuit solder connections |
| JP5993248B2 (ja) * | 2012-08-27 | 2016-09-14 | 新光電気工業株式会社 | 電子部品内蔵基板及びその製造方法 |
| JP5935188B2 (ja) * | 2012-12-28 | 2016-06-15 | 京セラ株式会社 | 配線基板およびその製造方法 |
| US9484327B2 (en) * | 2013-03-15 | 2016-11-01 | Qualcomm Incorporated | Package-on-package structure with reduced height |
| US9905491B1 (en) | 2013-09-27 | 2018-02-27 | STATS ChipPAC Pte. Ltd. | Interposer substrate designs for semiconductor packages |
| CN106030795A (zh) * | 2014-12-16 | 2016-10-12 | 英特尔公司 | 包括层叠电子器件的电子组装件 |
| US9859200B2 (en) * | 2014-12-29 | 2018-01-02 | STATS ChipPAC Pte. Ltd. | Integrated circuit packaging system with interposer support structure mechanism and method of manufacture thereof |
| JP6570924B2 (ja) * | 2015-08-31 | 2019-09-04 | 新光電気工業株式会社 | 電子部品装置及びその製造方法 |
| US20180053753A1 (en) * | 2016-08-16 | 2018-02-22 | Freescale Semiconductor, Inc. | Stackable molded packages and methods of manufacture thereof |
| WO2021033227A1 (ja) * | 2019-08-19 | 2021-02-25 | 株式会社Fuji | 積層ユニットの接着方法 |
| KR102822947B1 (ko) * | 2020-06-29 | 2025-06-20 | 삼성전자주식회사 | 반도체 패키지, 및 이를 가지는 패키지 온 패키지 |
Family Cites Families (12)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH09148496A (ja) * | 1995-11-27 | 1997-06-06 | Hitachi Ltd | 半導体装置及びその製造方法 |
| JP3619523B2 (ja) * | 1996-12-04 | 2005-02-09 | 株式会社ルネサステクノロジ | 半導体装置 |
| JPH118474A (ja) * | 1997-06-16 | 1999-01-12 | Nec Corp | 多層基板の製造方法 |
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| JP2002076265A (ja) * | 2000-09-01 | 2002-03-15 | Sony Corp | 半導体デバイスの実装方法、半導体デバイス及び半導体装置 |
| JP3644678B2 (ja) * | 2001-01-30 | 2005-05-11 | 三菱電機株式会社 | 半導体装置及びその製造方法 |
| US20020127771A1 (en) * | 2001-03-12 | 2002-09-12 | Salman Akram | Multiple die package |
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| JP2003347722A (ja) * | 2002-05-23 | 2003-12-05 | Ibiden Co Ltd | 多層電子部品搭載用基板及びその製造方法 |
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| US6982491B1 (en) * | 2004-01-20 | 2006-01-03 | Asat Ltd. | Sensor semiconductor package and method of manufacturing the same |
| JP5068990B2 (ja) * | 2006-12-26 | 2012-11-07 | 新光電気工業株式会社 | 電子部品内蔵基板 |
-
2006
- 2006-12-26 JP JP2006348750A patent/JP4901458B2/ja active Active
-
2007
- 2007-12-21 US US11/962,656 patent/US7872359B2/en active Active
- 2007-12-24 KR KR1020070136348A patent/KR20080060167A/ko not_active Withdrawn
- 2007-12-26 CN CNA200710160631XA patent/CN101211900A/zh active Pending
- 2007-12-26 TW TW096150213A patent/TW200832674A/zh unknown
Also Published As
| Publication number | Publication date |
|---|---|
| US7872359B2 (en) | 2011-01-18 |
| US20080174977A1 (en) | 2008-07-24 |
| CN101211900A (zh) | 2008-07-02 |
| TW200832674A (en) | 2008-08-01 |
| KR20080060167A (ko) | 2008-07-01 |
| JP2008159955A (ja) | 2008-07-10 |
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Legal Events
| Date | Code | Title | Description |
|---|---|---|---|
| A621 | Written request for application examination |
Free format text: JAPANESE INTERMEDIATE CODE: A621 Effective date: 20090924 |
|
| A977 | Report on retrieval |
Free format text: JAPANESE INTERMEDIATE CODE: A971007 Effective date: 20110711 |
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| A131 | Notification of reasons for refusal |
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|
| A521 | Request for written amendment filed |
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| TRDD | Decision of grant or rejection written | ||
| A01 | Written decision to grant a patent or to grant a registration (utility model) |
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| A01 | Written decision to grant a patent or to grant a registration (utility model) |
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|
| A61 | First payment of annual fees (during grant procedure) |
Free format text: JAPANESE INTERMEDIATE CODE: A61 Effective date: 20111227 |
|
| R150 | Certificate of patent or registration of utility model |
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| FPAY | Renewal fee payment (event date is renewal date of database) |
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