JP4886311B2 - 半導体集積回路及びそのテスト方法 - Google Patents
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Description
102、202、302 ノーマル外部出力端子
103、203、303 入力バッファ
104、204、304 出力バッファ
105、305 スルーパステストモード端子
106、506 モードセレクト端子
110、210、310、410,510,610 ハードマクロ
111、311、411,511,611 スルーパステスト出力端子
112、312、412,512,612 スルーパステスト入力端子
113、313 ANDゲート
114、314 セレクタ
120、420,520,620 セレクタ回路
130、330 内部ロジック
205 テストモード端子
220 テスト回路
307、308 外部端子
Claims (6)
- ノーマル外部入力端子と、
前記ノーマル外部入力端子からの入力信号を処理する内部ロジックを有するハードマクロと、
前記内部ロジックにより処理された前記ハードマクロからの出力信号を出力するノーマル外部出力端子と、を備えた半導体集積回路であって、
前記ハードマクロは、
前記ノーマル外部入力端子に接続される内部入力端子と、
前記ノーマル外部出力端子に接続される内部出力端子と、
前記内部入力端子に前記内部ロジックを介さずに接続されスルーパステスト出力端子と、
前記内部出力端子に前記内部ロジックを介さずに接続されたスルーパステスト入力端子と、を備え、
当該半導体集積回路は、
前記スルーパステスト出力端子と前記スルーパステスト入力端子を接続する接続回路を更に備え、
スルーパステストを実施する場合に、前記ノーマル外部入力端子から入力されたテストパターンが、前記ハードマクロ及び前記接続回路を介して前記ノーマル外部出力端子から出力される半導体集積回路。 - 前記接続回路はセレクタで構成され、当該セレクタは前記スルーパステスト出力端子と接続された複数の配線の一部を選択し、前記スルーパステスト入力端子に入力することを特徴とする請求項1に記載の半導体集積回路。
- 前記スルーパステスト出力端子数よりも前記スルーパステスト入力端子数の方が多い場合に、前記接続回路は、前記スルーパステスト出力端子に含まれる1つの端子を前記スルーパステスト入力端子に含まれる複数の端子に分岐接続したことを特徴とする請求項1に記載の半導体集積回路。
- ノーマル外部入力端子と、
前記ノーマル外部入力端子からの入力信号を処理する内部ロジックを有するハードマクロと、
前記内部ロジックにより処理された前記ハードマクロからの出力信号を出力するノーマル外部出力端子と、を備えた半導体集積回路のテスト方法であって、
前記ノーマル外部入力端子を介して前記ハードマクロへ入力されたテストパターンを、前記内部ロジックを介さずに、前記ハードマクロに設けられたスルーパステスト出力端子へ出力し、
前記スルーパステスト出力端子から出力されたテストパターンを、接続回路を介し、前記ハードマクロに設けられたスルーパステスト入力端子へ入力し、
前記スルーパステスト入力端子から入力されたテストパターンを、前記内部ロジックを介さずに、前記ノーマル外部出力端子へ出力する半導体集積回路のテスト方法。 - 複数の前記スルーパステスト出力端子の各々から出力されたテストパターンの一部を選択し、前記スルーパステスト入力端子に入力することを特徴とする請求項4に記載の半導体集積回路のテスト方法。
- 前記スルーパステスト出力端子数よりも前記スルーパステスト入力端子数の方が多い場合に、前記スルーパステスト出力端子に含まれる1つの端子から出力されたテストパターンを前記スルーパステスト入力端子に含まれる複数の端子に入力したことを特徴とする請求項4に記載の半導体集積回路のテスト方法。
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JP3616306B2 (ja) * | 2000-04-26 | 2005-02-02 | シャープ株式会社 | 半導体集積回路 |
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