JP4581484B2 - 制御装置および制御プログラム - Google Patents
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Claims (11)
- プログラムを格納するメモリと、当該メモリに格納されたプログラムを実行するCPUと、を含む制御装置であって、
前記CPUは、第1のプログラムを実行することにより、当該CPUの所定の出力ポートを制御して被制御装置を制御する第1のモード、または、第1のモードとは異なる第2のプログラムを実行することにより、前記所定の出力ポートの制御を停止させた状態で前記被制御装置に対し所定の処理を実行する第2のモードのいずれかのモードで動作するかを判断するモード判断部を備え、
前記第2のモードで動作しているときに、前記第2のプログラムに含まれる異常出力検知プログラムを実行することにより検知した前記所定の出力ポートの出力値が、初期値と異なる場合に当該所定の出力ポートの出力状態は異常と判定することを特徴とする制御装置。 - 請求項1に記載の制御装置であって、
前記CPUは、前記異常出力検知プログラムに従って、前記所定の出力ポートの出力状態が異常であると判定した場合、当該所定の出力ポートに、前記初期値を設定することを特徴とする制御装置。 - 請求項1又は2に記載の制御装置であって、
前記CPUは、前記異常出力検知プログラムに従って、前記所定の出力ポートの出力状態が異常であると判定した場合、当該CPUをリセットすることを特徴とする制御装置。 - 請求項1〜3のいずれか1項に記載の制御装置であって、
前記CPUは、前記異常出力検知プログラムに従って、前記所定の出力ポートの出力状態が異常であると判定した場合、当該所定の出力ポートに、前記初期値を設定した後に、当該CPUをリセットすることを特徴とする制御装置。 - 請求項1〜4のいずれか1項に記載の制御装置であって、
前記第1および第2のプログラムは、それぞれ、ループ処理を実行するためのプログラムであることを特徴とする制御装置。 - 請求項5に記載の制御装置であって、
前記CPUから入力されるクリア信号によってクリアされるタイマを備え、当該タイマの値が所定値を超過した場合に前記CPUをリセットするウォッチドッグタイマを有し、
前記第1および第2のプログラムは、それぞれ、前記ウォッチドッグタイマに前記クリア信号を出力するためのコマンドを含むことを特徴とする制御装置。 - 請求項5又は6に記載の制御装置であって、
前記CPUは、起動直後に、モード選択プログラムを実行することにより、前記第1または第2のプログラムのいずれを実行すべきかを選択し、選択されたプログラムを実行することを特徴とする制御装置。 - 請求項1〜7のいずれか1項に記載の制御装置であって、
前記異常出力検知プログラムは、前記第2のプログラムに組み込まれていることを特徴とする制御装置。 - 請求項1〜8のいずれか1項に記載の制御装置であって、
前記被制御装置は、機能部品を用いて記録媒体に画像を形成するプリントエンジンであり、
前記第1のモードは、前記所定の出力ポートを制御して前記機能部品に供給される電圧または電流を制御することにより、前記プリントエンジンに画像形成を行わせるモードであり、
前記第2のモードは、前記所定の出力ポートの制御を停止させて前記機能部品に対する電圧または電流の供給を停止させた状態で所定の処理を行うモードである、
ことを特徴とする制御装置。 - 請求項9に記載の制御装置であって、
前記所定の処理は、外部装置からプログラムを取得し、取得したプログラムによって前記第1のプログラムを書き換える処理であることを特徴とする制御装置。 - CPU搭載のコンピュータを、
第1のプログラムを実行することにより、当該CPUの所定の出力ポートを制御して被制御装置を制御する第1のモード、または、第1のモードとは異なる第2のプログラムを実行することにより、前記所定の出力ポートの制御を停止させた状態で前記被制御装置に対し所定の処理を実行する第2のモードのいずれかのモードで動作するかを判断するモード判断部として機能させ、
前記第2のモードで動作しているときに、前記第2のプログラムに含まれる異常出力検知プログラムを実行することにより検知した前記所定の出力ポートの出力値が、初期値と異なる場合に当該所定の出力ポートの出力状態は異常と判定することを特徴とする制御プログラム。
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