JP4522079B2 - Icチップ実装用基板 - Google Patents
Icチップ実装用基板 Download PDFInfo
- Publication number
- JP4522079B2 JP4522079B2 JP2003390484A JP2003390484A JP4522079B2 JP 4522079 B2 JP4522079 B2 JP 4522079B2 JP 2003390484 A JP2003390484 A JP 2003390484A JP 2003390484 A JP2003390484 A JP 2003390484A JP 4522079 B2 JP4522079 B2 JP 4522079B2
- Authority
- JP
- Japan
- Prior art keywords
- resin
- substrate
- layer
- chip
- optical element
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Expired - Fee Related
Links
Images
Classifications
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L24/00—Arrangements for connecting or disconnecting semiconductor or solid-state bodies; Methods or apparatus related thereto
- H01L24/01—Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
- H01L24/02—Bonding areas ; Manufacturing methods related thereto
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2224/00—Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
- H01L2224/01—Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
- H01L2224/10—Bump connectors; Manufacturing methods related thereto
- H01L2224/1012—Auxiliary members for bump connectors, e.g. spacers
- H01L2224/10122—Auxiliary members for bump connectors, e.g. spacers being formed on the semiconductor or solid-state body to be connected
- H01L2224/10125—Reinforcing structures
- H01L2224/10126—Bump collar
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2224/00—Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
- H01L2224/01—Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
- H01L2224/42—Wire connectors; Manufacturing methods related thereto
- H01L2224/44—Structure, shape, material or disposition of the wire connectors prior to the connecting process
- H01L2224/45—Structure, shape, material or disposition of the wire connectors prior to the connecting process of an individual wire connector
- H01L2224/45001—Core members of the connector
- H01L2224/45099—Material
- H01L2224/451—Material with a principal constituent of the material being a metal or a metalloid, e.g. boron (B), silicon (Si), germanium (Ge), arsenic (As), antimony (Sb), tellurium (Te) and polonium (Po), and alloys thereof
- H01L2224/45138—Material with a principal constituent of the material being a metal or a metalloid, e.g. boron (B), silicon (Si), germanium (Ge), arsenic (As), antimony (Sb), tellurium (Te) and polonium (Po), and alloys thereof the principal constituent melting at a temperature of greater than or equal to 950°C and less than 1550°C
- H01L2224/45144—Gold (Au) as principal constituent
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2224/00—Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
- H01L2224/01—Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
- H01L2224/42—Wire connectors; Manufacturing methods related thereto
- H01L2224/47—Structure, shape, material or disposition of the wire connectors after the connecting process
- H01L2224/48—Structure, shape, material or disposition of the wire connectors after the connecting process of an individual wire connector
- H01L2224/4805—Shape
- H01L2224/4809—Loop shape
- H01L2224/48091—Arched
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2224/00—Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
- H01L2224/01—Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
- H01L2224/42—Wire connectors; Manufacturing methods related thereto
- H01L2224/47—Structure, shape, material or disposition of the wire connectors after the connecting process
- H01L2224/48—Structure, shape, material or disposition of the wire connectors after the connecting process of an individual wire connector
- H01L2224/481—Disposition
- H01L2224/48135—Connecting between different semiconductor or solid-state bodies, i.e. chip-to-chip
- H01L2224/48137—Connecting between different semiconductor or solid-state bodies, i.e. chip-to-chip the bodies being arranged next to each other, e.g. on a common substrate
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2224/00—Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
- H01L2224/01—Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
- H01L2224/42—Wire connectors; Manufacturing methods related thereto
- H01L2224/47—Structure, shape, material or disposition of the wire connectors after the connecting process
- H01L2224/48—Structure, shape, material or disposition of the wire connectors after the connecting process of an individual wire connector
- H01L2224/481—Disposition
- H01L2224/48151—Connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive
- H01L2224/48221—Connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive the body and the item being stacked
- H01L2224/48225—Connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive the body and the item being stacked the item being non-metallic, e.g. insulating substrate with or without metallisation
- H01L2224/48227—Connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive the body and the item being stacked the item being non-metallic, e.g. insulating substrate with or without metallisation connecting the wire to a bond pad of the item
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2224/00—Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
- H01L2224/73—Means for bonding being of different types provided for in two or more of groups H01L2224/10, H01L2224/18, H01L2224/26, H01L2224/34, H01L2224/42, H01L2224/50, H01L2224/63, H01L2224/71
- H01L2224/732—Location after the connecting process
- H01L2224/73251—Location after the connecting process on different surfaces
- H01L2224/73265—Layer and wire connectors
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2924/00—Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
- H01L2924/01—Chemical elements
- H01L2924/01004—Beryllium [Be]
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2924/00—Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
- H01L2924/01—Chemical elements
- H01L2924/01005—Boron [B]
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2924/00—Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
- H01L2924/01—Chemical elements
- H01L2924/01006—Carbon [C]
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2924/00—Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
- H01L2924/01—Chemical elements
- H01L2924/01012—Magnesium [Mg]
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2924/00—Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
- H01L2924/01—Chemical elements
- H01L2924/01013—Aluminum [Al]
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2924/00—Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
- H01L2924/01—Chemical elements
- H01L2924/01014—Silicon [Si]
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2924/00—Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
- H01L2924/01—Chemical elements
- H01L2924/01019—Potassium [K]
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2924/00—Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
- H01L2924/01—Chemical elements
- H01L2924/0102—Calcium [Ca]
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2924/00—Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
- H01L2924/01—Chemical elements
- H01L2924/01023—Vanadium [V]
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2924/00—Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
- H01L2924/01—Chemical elements
- H01L2924/01024—Chromium [Cr]
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2924/00—Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
- H01L2924/01—Chemical elements
- H01L2924/01029—Copper [Cu]
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2924/00—Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
- H01L2924/01—Chemical elements
- H01L2924/0103—Zinc [Zn]
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2924/00—Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
- H01L2924/01—Chemical elements
- H01L2924/01033—Arsenic [As]
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2924/00—Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
- H01L2924/01—Chemical elements
- H01L2924/01046—Palladium [Pd]
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2924/00—Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
- H01L2924/01—Chemical elements
- H01L2924/01047—Silver [Ag]
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2924/00—Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
- H01L2924/01—Chemical elements
- H01L2924/01049—Indium [In]
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2924/00—Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
- H01L2924/01—Chemical elements
- H01L2924/0105—Tin [Sn]
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2924/00—Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
- H01L2924/01—Chemical elements
- H01L2924/01058—Cerium [Ce]
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2924/00—Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
- H01L2924/01—Chemical elements
- H01L2924/01074—Tungsten [W]
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2924/00—Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
- H01L2924/01—Chemical elements
- H01L2924/01078—Platinum [Pt]
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2924/00—Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
- H01L2924/01—Chemical elements
- H01L2924/01079—Gold [Au]
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2924/00—Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
- H01L2924/01—Chemical elements
- H01L2924/01082—Lead [Pb]
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2924/00—Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
- H01L2924/01—Chemical elements
- H01L2924/01087—Francium [Fr]
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2924/00—Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
- H01L2924/013—Alloys
- H01L2924/0132—Binary Alloys
- H01L2924/01322—Eutectic Alloys, i.e. obtained by a liquid transforming into two solid phases
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2924/00—Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
- H01L2924/013—Alloys
- H01L2924/014—Solder alloys
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2924/00—Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
- H01L2924/10—Details of semiconductor or other solid state devices to be connected
- H01L2924/102—Material of the semiconductor or solid state bodies
- H01L2924/1025—Semiconducting materials
- H01L2924/1026—Compound semiconductors
- H01L2924/1032—III-V
- H01L2924/10329—Gallium arsenide [GaAs]
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2924/00—Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
- H01L2924/10—Details of semiconductor or other solid state devices to be connected
- H01L2924/11—Device type
- H01L2924/12—Passive devices, e.g. 2 terminal devices
- H01L2924/1204—Optical Diode
- H01L2924/12041—LED
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2924/00—Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
- H01L2924/10—Details of semiconductor or other solid state devices to be connected
- H01L2924/11—Device type
- H01L2924/14—Integrated circuits
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2924/00—Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
- H01L2924/15—Details of package parts other than the semiconductor or other solid state devices to be connected
- H01L2924/151—Die mounting substrate
- H01L2924/1515—Shape
- H01L2924/15153—Shape the die mounting substrate comprising a recess for hosting the device
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2924/00—Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
- H01L2924/15—Details of package parts other than the semiconductor or other solid state devices to be connected
- H01L2924/151—Die mounting substrate
- H01L2924/1517—Multilayer substrate
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2924/00—Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
- H01L2924/15—Details of package parts other than the semiconductor or other solid state devices to be connected
- H01L2924/181—Encapsulation
Landscapes
- Engineering & Computer Science (AREA)
- Computer Hardware Design (AREA)
- Microelectronics & Electronic Packaging (AREA)
- Power Engineering (AREA)
- Wire Bonding (AREA)
Description
光ファイバは、(1)低損失、(2)高帯域、(3)細径・軽量、(4)無誘導、(5)省資源等の特徴を有しており、この特徴を有する光ファイバを用いた通信システムでは、従来のメタリックケーブルを用いた通信システムに比べ、中継器数を大幅に削減することができ、建設、保守が容易になり、通信システムの経済化、高接続信頼性化を図ることができる。
前記光学素子ICチップに備えられた電極パッドと前記光学素子駆動用ICチップに備えられた電極パッドとがワイヤーボンディングによって、電気的に接続されて、前記通孔内に収容され、
前記通孔の内部において、前記光学素子ICチップ、光学素子駆動用ICチップと、前記ワイヤーボンディングに用いる金属線とが透光性の有機樹脂で封止され、
前記光学素子ICチップが、ファーストボンディングを行うための四角形の電極パッドを備え、
前記光学素子駆動用ICチップが、前記光学素子ICチップの電極パッドよりもワイヤーボンディングを行う方向と平行方向の長さを垂直方向に対して大きくした、セカンドボンディングを行うための長方形の電極バッドを備えることを技術的特徴とする。
即ち、ICチップへの電気接続素子の電極パッドの形状が長方形であるため、ICチップへの電気接続素子にセカンドボンディングを行っても、キャピラリがICチップへの電気接続素子の電極パッドからずれることなく、ボンディングを行うことが可能である。これにより、ICチップにファーストボンディングを行い、ICチップへの電気接続素子にセカンドボンディングを行うことができるため、接続信頼性を高めることができる。さらに、セカンドボンディングが電極パッドからずれないためのICチップへの電気接続素子の回路にダメージを与えることを防止することができるとともに、ボンディング強度の低下を防止することが可能となる。
このため、ICチップおよび金属線等が周囲の雰囲気に晒されることがなく、また、基板の熱膨張による応力の影響を受け難い。これにより、ICチップが受けるダメージを低減することができるとともに、ボンディング強度の低下を防止することが可能となる。また、透過性の高い樹脂を使用することで、ICチップを受光素子又は発光素子として使用する場合、導波路等の光路との間の導光路として使用することができる。
(1)通常のサブトラクティブ又はアディティブで基板を製造してレーザ加工を使用したざぐり加工で凹部を形成する方法。
(2)通常のサブトラクティブ又はアディティブで基板を製造する方法で、最外層を形成する際にざぐりができるようにする。サブトラクティブ法では、最外層に予めざぐり加工してある基材を準備して、積層プレスして形成する(この場合は、最外層だけでなく内層も同様にざぐり加工しておき、凹部の深さを深くしても良い)。アディティブ法では、層間絶縁材を形成する際に露光、現像でざぐり部が形成するする。
(3)光学素子挿入用基板とパッケージ基板とを別々に作製した後、両者を貼り合わせ、さらに所定の工程を経る方法。
ワイヤーボンディグを行うためには、パッド表面の清浄度が重要になり、樹脂異物がある場合は勿論、Ni/Auメッキの状態が悪くても、ワイヤーボンディグの接続強度に影響を及ぼすため非常に重要である。
具体的には、例えば、基板aにドリル加工やレーザ処理等により貫通孔を形成した後、該貫通孔の壁面を含む基板aの表面全体に無電解めっき処理等を施すことによりベタの導体層を形成し、次いで、導体層にパターン状にエッチング処理を施すことにより導体回路と基板aを挟んだ導体回路間を接続するスルーホールとを形成することができる。
また、予め、ベタの導体層が形成された基板に貫通孔を形成した後、該貫通孔の壁面に無電解めっき処理等を施し、さらに、導体層にエッチング処理を施すことにより導体回路とスルーホールとを形成してもよい。
また、この工程において、基板aに貫通孔を形成した後には、該貫通孔にデスミア処理を施すことが望ましい。上記デスミア処理としては、例えば、過マンガン酸やクロム酸等の酸化剤を用いて薬液処理や、プラズマを用いたドライ処理等が挙げられる。
また、両面銅張積層基板や片面銅張積層基板、RCC基板等をベタの導体層が形成された基板として用いてもよい。
なお、コンフォーマル基板やアディティブ法で形成された基板を導体回路の形成された基板として用い、この基板に貫通孔の形成する処理とその壁面の導体層を形成する処理とを施し、導体回路とスルーホールとを形成してもよい。
また、スルーホール内に樹脂充填材を充填する場合には、充填前にスルーホールの壁面に粗化面を形成しておくことが望ましい。これにより、スルーホールと樹脂充填材層との密着性がより向上するからである。
上記エポキシ樹脂としては特に限定されないが、ビスフェノール型エポキシ樹脂およびノボラック型エポキシ樹脂からなる群より選択される少なくとも一種が望ましい。
ビスフェノール型エポキシ樹脂は、A型やF型の樹脂を選択することにより、希釈溶媒を使用しなくてもその粘度を調製することができ、ノボラック型エポキシ樹脂は、高強度で耐熱性や耐薬品性に優れ、無電解めっき液等の強塩基性溶液中であっても分解せず、また、熱分解もし難いからである。
また、上記ノボラック型エポキシ樹脂としては、フェノールノボラック型エポキシ樹脂およびクレゾールノボラック型エポキシ樹脂から選択される少なくとも一種が望ましい。
また、上記無機粒子は、シランカップリング剤等により、コーティングされていてもよい。無機粒子とエポキシ樹脂との密着性が向上するからである。
上記無機粒子の平均粒径は、0.1〜5.0μmが望ましい。
上記熱硬化性樹脂としては、例えば、ポリイミド樹脂、フェノール樹脂等が挙げられ、上記熱可塑性樹脂としては、例えば、ポリテトラフルオロエチレン(PTFE)、4フッ化エチレン6フッ化プロピレン共重合体(FEP)、4フッ化エチレンパーフロロアルコキシ共重合体(PFA)等のフッ素樹脂、ポリエチレンテレフタレート(PET)、ポリスルフォン(PSF)、ポリフェニレンスルフィド(PPS)、熱可塑型ポリフェニレンエーテル(PPE)、ポリエーテルスルフォン(PES)、ポリエーテルイミド(PEI)、ポリフェニレンスルフォン(PPES)、ポリエチレンナフタレート(PEN)、ポリエーテルエーテルケトン(PEEK)、ポリオレフィン系樹脂等が挙げられる。これらは、単独で用いてもよいし、2種以上を併用してもよい。
なお、上記エポキシ樹脂に代えて、これらの樹脂を用いてもよい。
即ち、まず、基板に貫通孔を形成した後、該貫通孔の壁面を含む基板の表面に導体層を形成し、ついで、その壁面に導体層の形成された貫通孔内に樹脂充填材を充填する。さらに、樹脂充填材の露出面、および、基板表面に形成した導体層上にめっき処理等により導体層を積層形成した後、導体回路非形成部およびスルーホール非形成部の導体層をエッチング除去することにより、導体回路およびスルーホールの形成と蓋めっき層の形成とを同時に行うことができる。
この工程では、基板aのパッケージ基板と貼り合わせる側の導体回路非形成部の全部または一部に接着剤層を形成する。上記接着剤層は、パッケージ基板との充分な接着性が得られるように塗布すればよい。従って、後述する(c)の工程で貫通孔が形成される部分には、接着剤層を形成してもよいし、しなくてもよい。
具体例としては、例えば、エポキシ樹脂、フェノール樹脂、ポリイミド樹脂、BT樹脂等が挙げられる。また、予め、シート状に成形された接着剤を用いてもよい。
上記貫通孔の形成は、例えば、ルーター加工等により行うことができる。
また、上記貫通孔の形成位置は特に限定されないが、通常、基板の中央に形成する。
上記薬液処理は、例えば、クロム酸、過マンガン酸塩等の水溶液からなる酸化剤を使用して行うことができる。
このような(a)〜(c)の工程を経ることにより光学素子挿入用基板を作製することができる。
(A)パッケージ基板の作製では、まず、基板Aの両面に導体回路を形成する第一の導体回路形成工程(A)を行う。
この工程は、例えば、上述した光学素子挿入用基板の作製の(a)の工程と同様の方法により行うことができる。
なお、基板Aとしては、例えば、上述した基板aと同様のものを用いることができる。
上記スルーホールは、上記基板Aにドリル加工やレーザ処理等により貫通孔を形成した後、該貫通孔の壁面に無電解めっき処理等を施すことにより形成する。また、スルーホールを形成した場合には、該スルーホール内に樹脂充填材を充填することが望ましい。なお、樹脂充填材の充填は、例えば、スルーホールに相当する部分に開口が形成されたマスクを基板上に載置し、スキージを用いて行うことができる。
上記粗化形成処理としては、例えば、黒化(酸化)−還元処理、第二銅錯体と有機酸塩とを含むエッチング液等を用いたエッチング処理、Cu−Ni−P針状合金めっきによる処理等が挙げられる。
なお、この粗化形成処理は、スルーホール内に樹脂充填材を充填する前に行い、スルーホールの壁面にも粗化面を形成してもよい。スルーホールと樹脂充填材との密着性が向上するからである。
具体的には、例えば、下記(i)〜(vi)の工程を経ることにより行うことができる。
即ち、(i)まず、導体回路を形成した基板A上に、熱硬化性樹脂や樹脂複合体からなる未硬化の樹脂層を形成するか、または、熱可塑性樹脂からなる樹脂層を形成する。
上記未硬化の樹脂層は、未硬化の樹脂をロールコーター、カーテンコーター等により塗布して成形してもよく、また、未硬化(半硬化)の樹脂フィルムを熱圧着して形成してもよい。さらに、未硬化の樹脂フィルムの片面に銅箔等の金属層が形成された樹脂フィルムを貼付してもよい。
また、熱可塑性樹脂からなる樹脂層は、フィルム状に成形した樹脂成形体を熱圧着することにより形成することが望ましい。
なお、上記熱硬化は、後述するバイアホール用開口を形成した後に行ってもよい。
また、熱硬化性樹脂と熱可塑性樹脂との複合体(樹脂複合体)としては、熱硬化性樹脂と熱可塑性樹脂とを含むものであれば特に限定されず、その具体例としては、例えば、粗化面形成用樹脂組成物等が挙げられる。
なお、上記「難溶性」および「可溶性」という語は、同一の粗化液に同一時間浸漬した場合に、相対的に溶解速度の早いものを便宜上「可溶性」といい、相対的に溶解速度の遅いものを便宜上「難溶性」と呼ぶ。
上記アルミナ粒子は、ふっ酸で溶解除去することができ、炭酸カルシウムは塩酸で溶解除去することができる。また、ナトリウム含有シリカやドロマイトはアルカリ水溶液で溶解除去することができる。
なお、上記樹脂粒子は予め硬化処理されていることが必要である。硬化させておかないと上記樹脂粒子が樹脂マトリックスを溶解させる溶剤に溶解してしまうため、均一に混合されてしまい、酸や酸化剤で樹脂粒子のみを選択的に溶解除去することができないからである。
また、上記金属粒子は、絶縁性を確保するために、表層が樹脂等により被覆されていてもよい。
上記バイアホール用開口は、レーザ処理により形成することが望ましい。上記レーザ処理は、上記硬化処理前に行ってもよいし、硬化処理後に行ってもよい。 また、感光性樹脂からなる層間樹脂絶縁層を形成した場合には、露光、現像処理を行うことにより、バイアホール用開口を設けてもよい。なお、この場合、露光、現像処理は、上記硬化処理前に行う。
また、短パルスの炭酸ガスレーザを用いて、バイアホール用開口を形成すると、開口内の樹脂残りが少なく、開口周縁の樹脂に対するダメージが小さい。
光学系レンズとマスクとを介することにより、同一強度で、かつ、照射角度が同一のレーザ光を複数の部分に同時に照射することができるからである。
なお、この粗化面は、眉間樹脂絶縁層とその上に形成する薄膜導体層との密着性を高めるために形成するものであり、層間樹脂絶縁層と薄膜導体層との間に充分な密着性がある場合には形成しなくてもよい。
また、粗化面を形成した後には、アルカリ等の水溶液や中和液等を用いて、層間樹脂絶縁層の表面を中和することが望ましい。
次工程に、酸や酸化剤の影響を与えないようにすることができるからである。
また、上記粗化面の形成は、プラズマ処理等を用いて行ってもよい。
上記薄膜導体層は、無電解めっき、スパッタリング、蒸着等の方法を用いて形成することができる。なお、層間樹脂絶縁層の表面に粗化面を形成しなかった場合には、上記薄膜導体層は、スパッタリングにより形成することが望ましい。
なお、無電解めっきにより薄膜導体層を形成する場合には、被めっき表面に、予め、触媒を付与しておく。上記触媒としては、例えば、塩化パラジウム等が挙げられる。
また、上記薄膜導体層の材質としては、例えば、Cu、Ni、P、Pd、Co、W等が挙げられる。これらのなかでは、CuやNiが望ましい。
エッチング液としては、例えば、硫酸−過酸化水素水溶液、過硫酸アンモニウム等の過硫酸塩水溶液、塩化第二鉄、塩化第二銅、塩酸等が挙げられる。また、エッチング液として上述した第二銅錯体と有機酸とを含む混合溶液を用いてもよい。
即ち、上記薄膜導体層上の全面に電解めっき層を形成した後、該電解めっき層上の一部にドライフィルムを用いてエッチングレジストを形成し、その後、エッチングレジスト非形成部下の電解めっき層および薄膜導体層をエッチングにより除去し、さらに、エッチングレジストを剥離することにより独立した導体回路を形成してもよい。
具体的には、未硬化のソルダーレジスト組成物をロールコータやカーテンコータ等により塗布したり、フィルム状に成形したソルダーレジスト組成物を圧着したりした後、硬化処理を施すことによりソルダーレジスト層を形成する。
また、上記ソルダーレジスト組成物は、エラストマーや無機フィラーが配合されていてもよい。
また、ソルダーレジスト組成物として、市販のソルダーレジスト組成物を使用してもよい。
上記金属層は、ニッケル、パラジウム、金、銀、白金等の耐食性金属により上記導体回路表面を被覆することにより形成することができる。
具体的には、ニッケル−金、ニッケル−銀、ニッケル−パラジウム、ニッケル−パラジウム−金等の金属により形成することが望ましい。
また、上記半田パッドは、例えば、めっき、蒸着、電着等の方法を用いて形成することができるが、これらのなかでは、被覆層の均一性に優れるという点からめっきが望ましい。
また、この工程で形成するソルダーレジスト層には、後述する工程で光学素子挿入用基板との貼り合わせの際に用いる位置合わせ用マーク等を形成しておいてもよい。
このような(A)〜(C)の工程を経ることによりパッケージ基板を作製することができる。
具体的には、両者の位置合わせを行った後、接着剤層が軟化する温度(通常、60〜200℃程度)まで昇温し、次いで、1〜10MPa程度の圧力でプレスすることにより、光学素子挿入用基板とパッケージ基板とを貼り合わせる。
また、上記発光素子の材料としては、例えば、ガリウム、砒素およびリンの化合物(GaAsP)、ガリウム、アルミニウムおよび砒素の化合物(GaAlAs)、ガリウムおよび砒素の化合物(GaAs)、インジウム、ガリウムおよび砒素の化合物(InGaAs)、インジウム、ガリウム、砒素およびリンの化合物(InGaAsP)等が挙げられる。これらは、通信波長を考慮して使い分ければよく、例えば、通信波長が0.85μm帯の場合にはGaAlAsを使用することができ、通信波長が1.3μm帯や1.55μm帯の場合には、InGaAsやInGaAsPを使用することができる。
上記樹脂結合法では、エポキシ系樹脂やポリイミド系樹脂等の熱硬化性樹脂を主剤とし、これらの樹脂成分以外に硬化剤やフィラー、溶剤等を含むペーストをパッケージ基板上に塗布し、次いで、光学素子およびICチップをペースト上に載置した後、該ペーストを加熱硬化させることにより光学素子およびICチップを取り付ける。導電性ペーストとしては、Sn/Pb、Sn/Agなどの半田(低融点金属)ペーストを用いることができる。
なお、上記ペーストの塗布は、例えば、ディスペンス法、スタンピング法、スクリーン印刷法等により行うことができる。
半田結合方法としては、Sn/Pb、Sn/Agなどの半田(低融点金属)ペーストにより行うことが望ましい。半田溶融時のセルフアライメントにより光学素子を所望の位置に取り付けることができるからである。Pbを用いず、濡れ性の点から半田としては、SnAg系、SnAgCu系がよい。リフローの温度は、半田の融点プラス10〜50℃の範囲で行えばよい。リフローで融解する他に、オーブンで半田を溶解してもよい。
ダイボンド樹脂の厚みは、特に決まりはないが、5〜100μmの厚みであることが望ましい。5μm未満では接着性の低下があり、100μmを超えると、熱硬化時に素子が傾いたりしてしまう。
ダイボンド樹脂の熱硬化は、80〜200℃の間で行うことが望ましい。ガラス転移点付近での気泡抜きを完全に行うために、ステップ硬化を行ってもよい。
上記ポリマー材料としては、従来公知のものを用いることができ、具体的には、例えば、アクリル樹脂、ポリイミド樹脂、エポキシ樹脂、UV硬化性エポキシ樹脂、シリコン樹脂およびベンゾシクロブテン等から製造されるポリマーが挙げられる。
この工程では、具体的には、未硬化のソルダーレジスト組成物をロールコータやカーテンコータ等により塗布したり、フィルム状に成形したソルダーレジスト組成物を圧着したりした後、硬化処理を施すことによりソルダーレジスト層を形成する。
上記ソルダーレジスト組成物としては、例えば、パッケージ基板を作製する際に用いたソルダーレジスト組成物と同様のもの等を用いることができる。
上記樹脂組成物としては、熱硬化性樹脂、熱可塑性樹脂、感光性樹脂、熱硬化性樹脂の一部が感光性化された樹脂、これらの複合体等を樹脂成分とするものが挙げられる。上記樹脂成分の具体例としては、例えば、エポキシ樹脂、フェノール樹脂、ポリイミド樹脂、オレフィン樹脂、BT樹脂等が挙げられる。
また、上記樹脂組成物には、上記樹脂成分以外に、例えば、樹脂粒子、無機粒子、金属粒子等の粒子が含まれていてもよい。これらの粒子を含ませることにより樹脂充填層と、基板、ソルダーレジスト層、層間樹脂絶縁層等との間で熱膨張係数の整合を図ることができ、また、粒子の種類によっては難燃性を付与することもできる。
また、上記熱硬化性樹脂と上記熱可塑性樹脂との樹脂複合体や、上記アクリル基を付与した樹脂や上記感光性樹脂と上記熱可塑性樹脂との樹脂複合体を用いることもできる。
また、上記樹脂粒子としては、ゴムからなる樹脂粒子を用いることもできる。
また、上記無機粒子として、リンやリン化合物からなるものを用いることもできる。
これらの樹脂粒子、無機粒子および金属粒子は、それぞれ単独で用いてもよいし、2種以上併用してもよい。
また、上記粒子の粒径(粒子の一番長い部分の長さ)は、通信光の波長より短いことが望ましい。粒径が通信光の波長より長いと光信号の伝送を阻害することがあるからである。
なお、本明細書において、通信波長光の透過率(%)とは、上記樹脂充填層への垂直方向の入射光の強さをI1、上記樹脂充填層を通過して出てきた光の強さをI2とした場合に下記式(1)より算出される値である。
透過率(%)=(I2/I1)×100・・・(1)
具体的には、例えば、受光素子の受光面や発光素子の発光面の高さまでの領域には、ワイヤボンディングやその接続エリア等を保護する性質に優れた樹脂組成物や、耐熱性に特に優れた樹脂組成物を充填し、上記受光面や発光面より高い領域には、通信光の伝送性に特に優れる樹脂組成物を用いて樹脂充填層を形成する等である。
上記研磨処理は、例えば、バフ研磨、紙やすり等による研磨、鏡面研磨、クリーン研磨等により行うことができる。また、酸や酸化剤、薬液等を用いた化学研磨を行ってもよい。また、これらの方法を2種以上組み合わせて研磨処理を行ってもよい。
具体的には、まず、上記光学素子挿入用基板と上記パッケージ基板とを貫通するスルーホール用貫通孔をドリル加工やレーザ処理等により形成する。次に、このスルーホール用貫通孔の壁面を含む光学素子挿入用基板の露出面およびバッケージ基板の露出面に無電解めっき、スパッタリング等により薄膜導体層を形成する。さらに、その表面に薄膜導体層が形成された基板の上にめっきレジストを形成した後、該めっきレジスト非形成部に電解めっき層を形成し、その後、上記めっきレジストと該めっきレジスト下の薄膜導体層を除去することにより、上記光学素子挿入用基板と上記パッケージ基板とを貫通するスルーホールを形成することができる。
なお、スルーホールを形成した後には、該スルーホール内に樹脂充填材を充填することが望ましい。
上記金属層は、ニッケル、パラジウム、金、銀、白金等の耐食性金属により上記導体回路表面を被覆することにより形成することができる。
具体的には、ニッケル−金、ニッケル−銀、ニッケル−パラジウム、ニッケル−パラジウム−金等の金属により形成することが望ましい。
また、上記金属層は、例えば、めっき、蒸着、電着等の方法を用いて形成することができるが、これらのなかでは、被覆層の均一性に優れるという点からめっきが望ましい。なお、この金属層は、後工程で半田バンプ等を形成する際に半田パッドとしての役割を果たすこととなる。
このような一連の工程を経ることによりICチップ実装用基板を製造することができる。半田ペーストとしては、SnAg、SnAgCuが望ましいが、SnPb、SnAgCuIn、SnAgCuBi等でもよい。
先ず、本発明の第1実施例に係るICチップ実装用基板20の構成について、図11および図12を参照して説明する。図11は、第1実施例に係るICチップ実装用基板の一部を模式的に示す部分断面図であり、図12は、図11に示すICチップ実装用基板にICチップを搭載し、ドータボードに取り付けた状態を模式的に示す部分断面図である。
なお、ICチップ102から伝送される電気信号は、パッケージ基板10を介して図略の発光素子へ伝送され、光信号に変換される。この光信号は発光素子に形成されている発光部から垂直に下方へ発射され、45°にカットされた図略の光導波路の端面を介して入射され、光導波路中を伝幡する。
(a)樹脂充填材の調製
ビスフェノールF型エポキシモノマー(油化シェル社製、分子量:310、YL983U)100重量部、表面にシランカップリング剤がコーティングされた平均粒径が1.6μmで、最大粒子の直径が15μm以下のSiO2球状粒子(アドテック社製、CRS 1101−CE)72重量部およびレベリング剤(サンノプコ社製 ベレノールS4)1.5重量部を容器にとり、攪拌混合することにより、その粘度が23±1℃で30〜60Pa・sの樹脂充填材を調製した。
なお、硬化剤として、イミダゾール硬化剤(四国化成社製、2E4MZ−CN)6.5重量部を用いた。
(1)厚さ0.8mmのガラスエポキシ樹脂またはBT(ビスマレイミドトリアジン)樹脂からなる絶縁性基板80の片面に18μmの銅箔81がラミネートされている両面銅張積層板80Aを出発材料とした(図1(A)参照)。まず、この銅張積層板にドリルで貫通孔84を穿設し、無電解めっき処理を施すことにより、その表面(貫通孔84の壁面を含む)に導体層82を形成した(図1(B)参照)。
即ち、スキージを用いて貫通孔内に樹脂充填材を押し込んだ後、100℃、20分の条件で乾燥させた。
次いで、100℃で1時間、120℃で3時間、150℃で1時間、180℃で7時間の加熱処理を行って樹脂充填材層90を形成した(図1(E)参照)。
なお、導体層92を形成する面には、予め、パラジウム触媒を付与しておき、導体層92を形成しない例の面には、めっきレジストを形成しておくことにより、基板の片面に導体層92を形成した。
また、エッチング処理は、硫酸と過酸化水素との混合液を用いて行った。
(a)層間樹脂絶縁層用樹脂フィルムの作製
ビスフェノールA型エポキシ樹脂(エポキシ当量469、油化シェルエポキシ社製エピコート1001)30重量部、クレゾールノボラック型エポキシ樹脂(エポキシ当量215、大日本インキ化学工業社製 エピクロンN−673)40重量部、トリアジン構造含有フェノールノボラック樹脂(フェノール性水酸基当量120、大日本インキ化学工業社製 フェノライトKA−7052)30重量部をエチルジグリコールアセテート20重量部、ソルベントナフサ20重量部に攪拌しながら加熱溶解させ、そこへ末端エポキシ化ポリブタジエンゴム(ナガセ化成工業社製 デナレックスR−45EPT)15重量部と2−フェニル−4、5−ビス(ヒドロキシメチル)イミダゾール粉砕品1.5重量部、微粉砕シリカ2重量部、シリコン系消泡剤0.5重量部を添加しエポキシ樹脂組成物を調製した。
得られたエポキシ樹脂組成物を厚さ38μmのPETフィルム上に乾燥後の厚さが50μmとなるようにロールコーターを用いて塗布した後、80〜120℃で10分間乾燥させることにより、層間樹脂絶縁層用樹脂フィルムを作製した。
光学素子挿入用基板の作製の(a)の工程と同様にして行った。
(1)厚さ0.8mmのガラスエポキシ樹脂またはBT(ビスマレイミドトリアジン)樹脂からなる絶縁性基板30の両面に18μmの銅箔32がラミネートされている両面銅張積層板30Aを出発材料とした(図3(A)参照)。まず、この銅張積層板にドリルで貫通孔34を穿設し、無電解めっき処理を施して導体層33を形成した(図3(B)参照)。そして、パターン状にエッチングすることにより、基板30の両面に下層導体回路38とスルーホール36とを形成した(図3(C)参照)。
即ち、まず、スキージを用いてスルーホール36内に樹脂充填材40を押し込んだ後、100℃、20分の条件で乾燥させた。次に、導体回路非形成部に相当する部分が開口したマスクを基板上に載置し、スキージを用いて凹部となっている導体回路非形成部にも樹脂充填材40を充填し、100℃、20分の条件で乾燥させることにより樹脂充填材40の層を形成した。
次いで、100℃で1時間、120℃で3時間、150℃で1時間、180℃で7時間の加熱処理を行って樹脂充填材層40を形成した(図4(A)参照)。
さらに、粗面化処理(粗化深さ3μm)した該基板の表面に、パラジウム触媒を付与することにより、層間樹脂絶縁層50の表面(バイアホール用開口50aの内壁面を含む)に触媒核を付着させた(図示せず)。即ち、上記基板を塩化パラジウム(PbCl2)と塩化第一スズ(SnCl2)とを含む触媒液中に浸漬し、パラジウム金属を析出させることにより触媒を付与した。
〔無電解めっき液〕
NiSO4 0.003 mol/l
酒石酸 0.200 mol/l
硫酸銅 0.030 mol/l
HCHO 0.050 mol/l
NaOH 0.100 mol/l
α、α’ −ビビリジル 100 mg/l
ポリエチレングリコール(PEG) 0.10 g/l
〔無電解めっき条件〕
34℃の液温度で40分
〔電解めっき液〕
硫酸 2.24 mol/l
硫酸銅 0.26 mol/l
添加剤 19.5 ml/l
(アトテックジャパン社製、カバラシドGL)
〔電解めっき条件〕
電流密度 1A/dm2
時間 65 分
温度 22±2 ℃
また、粘度測定は、B型粘度計(東京計器社製、DVL−B型)で60rpmの場合はローターNo.4、6rpmの場合はローターNo.3によった。
なお、ソルダーレジスト組成物としては、市販のソルダーレジスト組成物を用いることもできる。
そして、さらに、80℃で1時間、100℃で1時間、120℃で1時間、150℃で3時間の条件でそれぞれ加熱処理を行ってソルダーレジスト組成物の層62αを硬化させ、導体回路160に至る開口62a、光学素子挿入用基板取り付け用の開口62bを有するソルダーレジスト層62を形成した(図7(A)参照)。
(1)マスラミネート方式による積層プレスを行い、上記Aで作製した光学素子挿入用基板100(図2(D)参照)と、上記Bで作製したパッケージ基板10(図7(B)参照)とを、上記光学素子挿入用基板100に形成した接着剤層96を介して貼り合わせた基板を得た(図8(A)参照)。即ち、両者の位置合わせを行った後、150℃まで昇温し、さらに5MPaの圧力でプレスすることにより光学素子挿入用基板100とパッケージ基板10とを貼り合わせた。
(3)ソルダーレジスト層上のレシーバーIC14の取り付け位置にエポキシ樹脂からなる接着剤70を塗布した後、レシーバーIC14を取り付ける(図8(B)。
なお、ICをダイボンディングする際には、Agペースト、導電性ペーストを用いてもよい。
受光素子12の電極12dをボールボンディングで行い、レシーバーIC14の電極14dをウエッジボンディングを行うことによって接続される。
また、受光素子12とレシーバーIC14とをワイヤボンディングにより電気接続しているため、受光素子12とレシーバーIC14との間の配線長を短くすることができる。さらに、受光素子12に伝送された信号を受光素子12に隣接したレシーバーIC14で駆動条件を調整することが可能となるため、ノイズの影響を受けにくくして信号のクオリティーを高めることができる。
さらに、樹脂組成物の露出面にバフ研磨と鏡面研磨とを施した。その後、加熱処理を行い、樹脂充填層74とした(図10(A)参照)。
なお、樹脂充填層74は、波長1.85μm光の垂直方向の透過率が91%である。
(1)電極パッド14dを100×300μmの長方形に形成した場合には、セカンドボンディグが適正に行えた。
(2)電極パッド14dを100×200μmの長方形に形成した場合には、セカンドボンディグが適正に行えた。
(3)電極パッド14dを100×180μmの長方形に形成した場合には、セカンドボンディグ時に、キャピラリがパッドかはみ出したり、または、ウェッジボンディグエリアがパッドからはみ出した。
第1実施例に係るICチップ実装用基板では、1のレシーバーIC14(ドライバーIC15)の上に1の受光素子12(発光素子13)を配設した。この代わりに、図14に示すように、1のレシーバーIC14(ドライバーIC15)の上に複数の受光素子12(発光素子13)を配設することもできる。
第1実施例に係るICチップ実装用基板では、レシーバーIC14(ドライバーIC15)の上に受光素子12(発光素子13)を配設した。この代わりに、図15及び図16に示す改変例2のように、レシーバーIC14(ドライバーIC15)と並列に受光素子12(発光素子13)を配設し、ワイヤーボンディグ72により接続することもできる。
第1実施例に係るICチップ実装用基板では、基板に凹部を設けて素子を配置した。これに対して、改変例3では、図17に示すように基板の平坦頂部に受光素子12(発光素子13)及びレシーバーIC14(ドライバーIC15)を配置し、ワイヤーボンディグ72により接続している。
改変例4では、改変例3と同様に、図18に示すように基板の平坦頂部に受光素子12(発光素子13)及びレシーバーIC14(ドライバーIC15)を配置し、ワイヤーボンディグ72により接続している。そして、透明樹脂74でポッティング(樹脂封止)してから、発光素子13の発光面/受光素子12の受光面の上が平坦になるように透明樹脂74を研磨する。
従来技術では2ndボンディング部分で金ワイヤウェッジ部とパッド部の界面で切断されたものがあったが、本実施例では切断が発生しない。配線長が短いために2ndでの断線が発生し難かった。
また、プル強度は、一般的なワイヤボンディングの規格最低3g以上に対して、従来技術では3gを下回るカ所が出たが、本実施例では下回ることがなかった。
12 受光素子(光学素子)
12a 受光部
12d 電極(光学素子に備えられた電極パッド)
13 発光素子(光学素子)
13a 発光部
13d 電極(光学素子に備えられた電極パッド)
14 レシーバーIC(ICチップ)
14d 電極(ICチップに備えられた電極パッド)
15 ドライバーIC(ICチップ)
15d 電極(ICチップに備えられた電極パッド)
18 光導波路
20 ICチップ実装用基板
22 層間樹脂絶縁層
23 めっきレジスト
30 基板
32 銅箔
36 スルーホール
40 樹脂充填層
50 層間樹脂絶縁層
58 バイアホール
60 導体回路
62 ソルダーレジスト層
62c 開口
70 半田
70γ 半田ペースト
72 ワイヤ(金属線)
74 樹脂充填層(有機樹脂)
79U、79D 半田バンプ
94 蓋めっき層
98 通孔(凹部)
100 光学素子挿入用基板
102 ICチップ
108 ドータボード
160e 接続パッド
162 グランド層
Claims (5)
- 素子収容用の通孔を有する素子挿入用基板と、素子接続パッドを有する多層ビルドアップ配線板からなるパッケージ基板とを貼り合わせてなり、複数のICチップを実装するICチップ実装用基板であって、
前記光学素子ICチップに備えられた電極パッドと前記光学素子駆動用ICチップに備えられた電極パッドとがワイヤーボンディングによって、電気的に接続されて、前記通孔内に収容され、
前記通孔の内部において、前記光学素子ICチップ、光学素子駆動用ICチップと、前記ワイヤーボンディングに用いる金属線とが透光性の有機樹脂で封止され、
前記光学素子ICチップが、ファーストボンディングを行うための四角形の電極パッドを備え、
前記光学素子駆動用ICチップが、前記光学素子ICチップの電極パッドよりもワイヤーボンディングを行う方向と平行方向の長さを垂直方向に対して大きくした、セカンドボンディングを行うための長方形の電極バッドを備えることを特徴とするICチップ実装用基板。 - 前記光学素子ICチップが、前記光学素子駆動用ICチップの上に搭載されることを特徴とする請求項1に記載のICチップ実装用基板。
- 前記光学素子ICチップと前記光学素子駆動用ICチップとが並列に配置されることを特徴とする請求項1に記載のICチップ実装用基板。
- 前記素子挿入用基板が樹脂基板であることを特徴とする請求項1に記載のICチップ実装用基板。
- 前記素子挿入用基板が金属板であることを特徴とする請求項1に記載のICチップ実装用基板。
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP2003390484A JP4522079B2 (ja) | 2003-11-20 | 2003-11-20 | Icチップ実装用基板 |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP2003390484A JP4522079B2 (ja) | 2003-11-20 | 2003-11-20 | Icチップ実装用基板 |
Publications (2)
Publication Number | Publication Date |
---|---|
JP2005158767A JP2005158767A (ja) | 2005-06-16 |
JP4522079B2 true JP4522079B2 (ja) | 2010-08-11 |
Family
ID=34717845
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP2003390484A Expired - Fee Related JP4522079B2 (ja) | 2003-11-20 | 2003-11-20 | Icチップ実装用基板 |
Country Status (1)
Country | Link |
---|---|
JP (1) | JP4522079B2 (ja) |
Families Citing this family (3)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
KR100782774B1 (ko) * | 2006-05-25 | 2007-12-05 | 삼성전기주식회사 | Sip 모듈 |
WO2012169242A1 (ja) * | 2011-06-10 | 2012-12-13 | 株式会社村田製作所 | 多チャンネル型dc-dcコンバータ |
JP2014072325A (ja) * | 2012-09-28 | 2014-04-21 | Hitachi Chemical Co Ltd | 多層配線基板及びその製造方法 |
Citations (15)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPH01166532A (ja) * | 1987-12-22 | 1989-06-30 | Nec Corp | Ledアレイチップ用ボンディングパッド |
JPH02181453A (ja) * | 1989-01-06 | 1990-07-16 | Kawasaki Steel Corp | 半導体装置 |
JPH0375673U (ja) * | 1989-11-22 | 1991-07-30 | ||
JPH0529663A (ja) * | 1991-07-23 | 1993-02-05 | Sharp Corp | 光半導体装置およびその樹脂封止方法 |
JPH05190592A (ja) * | 1992-01-13 | 1993-07-30 | Rohm Co Ltd | Ledヘッド駆動用ic |
JPH06333974A (ja) * | 1993-05-25 | 1994-12-02 | Seiko Epson Corp | 集積回路のボンディングパッド構造 |
JPH0786495A (ja) * | 1993-06-29 | 1995-03-31 | Sumitomo Electric Ind Ltd | 半導体デバイス |
JPH08250652A (ja) * | 1995-02-24 | 1996-09-27 | At & T Corp | マルチチップモジュールパッケージ |
JPH1056030A (ja) * | 1996-08-08 | 1998-02-24 | Seiko Epson Corp | 半導体装置及びその製造方法 |
JPH11265975A (ja) * | 1998-03-17 | 1999-09-28 | Mitsubishi Electric Corp | 多層化集積回路装置 |
JP2001185676A (ja) * | 1999-12-24 | 2001-07-06 | Sharp Corp | 半導体装置 |
JP2002016102A (ja) * | 2000-06-28 | 2002-01-18 | Seiko Epson Corp | 半導体装置及びその製造方法、回路基板並びに電子機器 |
JP2002110898A (ja) * | 2000-09-28 | 2002-04-12 | Oki Electric Ind Co Ltd | 半導体装置 |
JP2002184805A (ja) * | 2000-12-15 | 2002-06-28 | Oki Data Corp | 半導体装置およびワイヤボンディング方法 |
JP2002237644A (ja) * | 2001-02-09 | 2002-08-23 | Hitachi Cable Ltd | 光送信器 |
-
2003
- 2003-11-20 JP JP2003390484A patent/JP4522079B2/ja not_active Expired - Fee Related
Patent Citations (15)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPH01166532A (ja) * | 1987-12-22 | 1989-06-30 | Nec Corp | Ledアレイチップ用ボンディングパッド |
JPH02181453A (ja) * | 1989-01-06 | 1990-07-16 | Kawasaki Steel Corp | 半導体装置 |
JPH0375673U (ja) * | 1989-11-22 | 1991-07-30 | ||
JPH0529663A (ja) * | 1991-07-23 | 1993-02-05 | Sharp Corp | 光半導体装置およびその樹脂封止方法 |
JPH05190592A (ja) * | 1992-01-13 | 1993-07-30 | Rohm Co Ltd | Ledヘッド駆動用ic |
JPH06333974A (ja) * | 1993-05-25 | 1994-12-02 | Seiko Epson Corp | 集積回路のボンディングパッド構造 |
JPH0786495A (ja) * | 1993-06-29 | 1995-03-31 | Sumitomo Electric Ind Ltd | 半導体デバイス |
JPH08250652A (ja) * | 1995-02-24 | 1996-09-27 | At & T Corp | マルチチップモジュールパッケージ |
JPH1056030A (ja) * | 1996-08-08 | 1998-02-24 | Seiko Epson Corp | 半導体装置及びその製造方法 |
JPH11265975A (ja) * | 1998-03-17 | 1999-09-28 | Mitsubishi Electric Corp | 多層化集積回路装置 |
JP2001185676A (ja) * | 1999-12-24 | 2001-07-06 | Sharp Corp | 半導体装置 |
JP2002016102A (ja) * | 2000-06-28 | 2002-01-18 | Seiko Epson Corp | 半導体装置及びその製造方法、回路基板並びに電子機器 |
JP2002110898A (ja) * | 2000-09-28 | 2002-04-12 | Oki Electric Ind Co Ltd | 半導体装置 |
JP2002184805A (ja) * | 2000-12-15 | 2002-06-28 | Oki Data Corp | 半導体装置およびワイヤボンディング方法 |
JP2002237644A (ja) * | 2001-02-09 | 2002-08-23 | Hitachi Cable Ltd | 光送信器 |
Also Published As
Publication number | Publication date |
---|---|
JP2005158767A (ja) | 2005-06-16 |
Similar Documents
Publication | Publication Date | Title |
---|---|---|
US8076782B2 (en) | Substrate for mounting IC chip | |
US7783141B2 (en) | Substrate for mounting IC chip and device for optical communication | |
US7693382B2 (en) | Substrate for mounting IC chip, multilayered printed circuit board, and device for optical communication | |
JP4036644B2 (ja) | Icチップ実装用基板、icチップ実装用基板の製造方法、および、光通信用デバイス | |
JP2003110245A (ja) | 光学素子実装用基板の製造方法、光学素子実装用基板及び光学素子 | |
JP3801921B2 (ja) | 光通信用デバイス、および、光通信用デバイスの製造方法 | |
JP5092191B2 (ja) | Icチップ実装用基板 | |
JP4540275B2 (ja) | Icチップ実装用基板、および、icチップ実装用基板の製造方法 | |
JP4703067B2 (ja) | Icチップ実装用基板の製造方法 | |
JP4056315B2 (ja) | 光通信用デバイスおよび光通信用デバイスの製造方法 | |
JP4831901B2 (ja) | 多層プリント配線板 | |
JP3992553B2 (ja) | 光通信用デバイスおよび光通信用デバイスの製造方法 | |
JP2002289911A (ja) | 光通信用デバイス | |
JP4454453B2 (ja) | Icチップ実装用基板および光通信用デバイス | |
JP4789381B2 (ja) | 多層プリント配線板 | |
JP4014464B2 (ja) | 光通信用デバイスおよび光通信用デバイスの製造方法 | |
JP2002236228A (ja) | 多層プリント配線板 | |
JP4522079B2 (ja) | Icチップ実装用基板 | |
JP4393463B2 (ja) | 光通信用デバイス | |
JP3771169B2 (ja) | 光通信用デバイス | |
JP4605955B2 (ja) | Icチップ実装用基板 | |
JP4627942B2 (ja) | Icチップ実装用基板の製造方法 | |
JP2005157115A (ja) | Icチップ実装用基板、マザーボード用基板、光通信用デバイス、icチップ実装用基板の製造方法、および、マザーボード用基板の製造方法 | |
JP2003110121A (ja) | 光学素子実装用基板の製造方法及び光学素子実装用基板 | |
JP4827809B2 (ja) | Icチップ実装用基板 |
Legal Events
Date | Code | Title | Description |
---|---|---|---|
RD04 | Notification of resignation of power of attorney |
Free format text: JAPANESE INTERMEDIATE CODE: A7424 Effective date: 20050901 |
|
A621 | Written request for application examination |
Free format text: JAPANESE INTERMEDIATE CODE: A621 Effective date: 20061023 |
|
A977 | Report on retrieval |
Free format text: JAPANESE INTERMEDIATE CODE: A971007 Effective date: 20080513 |
|
A131 | Notification of reasons for refusal |
Free format text: JAPANESE INTERMEDIATE CODE: A131 Effective date: 20090714 |
|
A521 | Request for written amendment filed |
Free format text: JAPANESE INTERMEDIATE CODE: A523 Effective date: 20090902 |
|
A131 | Notification of reasons for refusal |
Free format text: JAPANESE INTERMEDIATE CODE: A131 Effective date: 20100316 |
|
A521 | Request for written amendment filed |
Free format text: JAPANESE INTERMEDIATE CODE: A523 Effective date: 20100507 |
|
TRDD | Decision of grant or rejection written | ||
A01 | Written decision to grant a patent or to grant a registration (utility model) |
Free format text: JAPANESE INTERMEDIATE CODE: A01 Effective date: 20100525 |
|
A01 | Written decision to grant a patent or to grant a registration (utility model) |
Free format text: JAPANESE INTERMEDIATE CODE: A01 |
|
A61 | First payment of annual fees (during grant procedure) |
Free format text: JAPANESE INTERMEDIATE CODE: A61 Effective date: 20100525 |
|
R150 | Certificate of patent or registration of utility model |
Ref document number: 4522079 Country of ref document: JP Free format text: JAPANESE INTERMEDIATE CODE: R150 Free format text: JAPANESE INTERMEDIATE CODE: R150 |
|
FPAY | Renewal fee payment (event date is renewal date of database) |
Free format text: PAYMENT UNTIL: 20130604 Year of fee payment: 3 |
|
R250 | Receipt of annual fees |
Free format text: JAPANESE INTERMEDIATE CODE: R250 |
|
R250 | Receipt of annual fees |
Free format text: JAPANESE INTERMEDIATE CODE: R250 |
|
R250 | Receipt of annual fees |
Free format text: JAPANESE INTERMEDIATE CODE: R250 |
|
LAPS | Cancellation because of no payment of annual fees |