JP4371739B2 - シリアルａｔａインタフェースを持つ電子機器及びシリアルａｔａバスのパワーセーブ方法 - Google Patents

シリアルａｔａインタフェースを持つ電子機器及びシリアルａｔａバスのパワーセーブ方法 Download PDF

Info

Publication number
JP4371739B2
JP4371739B2 JP2003310361A JP2003310361A JP4371739B2 JP 4371739 B2 JP4371739 B2 JP 4371739B2 JP 2003310361 A JP2003310361 A JP 2003310361A JP 2003310361 A JP2003310361 A JP 2003310361A JP 4371739 B2 JP4371739 B2 JP 4371739B2
Authority
JP
Japan
Prior art keywords
mode
command
serial ata
power save
host
Prior art date
Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
Expired - Lifetime
Application number
JP2003310361A
Other languages
English (en)
Other versions
JP2005078514A (ja
Inventor
史 猪狩
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
Toshiba Corp
Original Assignee
Toshiba Corp
Priority date (The priority date is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the date listed.)
Filing date
Publication date
Application filed by Toshiba Corp filed Critical Toshiba Corp
Priority to JP2003310361A priority Critical patent/JP4371739B2/ja
Priority to SG200503835A priority patent/SG113619A1/en
Priority to SG200404527A priority patent/SG109565A1/en
Priority to US10/931,949 priority patent/US7328356B2/en
Priority to CNB200410068692XA priority patent/CN1296799C/zh
Publication of JP2005078514A publication Critical patent/JP2005078514A/ja
Priority to US11/956,996 priority patent/US7747885B2/en
Priority to US12/398,524 priority patent/US20090177905A1/en
Priority to US12/398,530 priority patent/US20090172312A1/en
Priority to US12/398,544 priority patent/US7809967B2/en
Priority to US12/398,585 priority patent/US7770041B2/en
Priority to US12/398,556 priority patent/US7882378B2/en
Priority to US12/398,513 priority patent/US8219837B2/en
Priority to US12/398,569 priority patent/US7856565B2/en
Priority to US12/398,499 priority patent/US7797562B2/en
Priority to US12/398,576 priority patent/US7856567B2/en
Application granted granted Critical
Publication of JP4371739B2 publication Critical patent/JP4371739B2/ja
Priority to US12/879,332 priority patent/US8732502B2/en
Priority to US15/160,846 priority patent/USRE47050E1/en
Priority to US15/837,317 priority patent/USRE48190E1/en
Anticipated expiration legal-status Critical
Expired - Lifetime legal-status Critical Current

Links

Images

Classifications

    • G—PHYSICS
    • G06—COMPUTING; CALCULATING OR COUNTING
    • G06F—ELECTRIC DIGITAL DATA PROCESSING
    • G06F1/00—Details not covered by groups G06F3/00 - G06F13/00 and G06F21/00
    • G06F1/26—Power supply means, e.g. regulation thereof
    • G06F1/32—Means for saving power
    • G06F1/3203—Power management, i.e. event-based initiation of a power-saving mode
    • G06F1/3206—Monitoring of events, devices or parameters that trigger a change in power modality
    • G06F1/3228—Monitoring task completion, e.g. by use of idle timers, stop commands or wait commands
    • G—PHYSICS
    • G06—COMPUTING; CALCULATING OR COUNTING
    • G06F—ELECTRIC DIGITAL DATA PROCESSING
    • G06F1/00—Details not covered by groups G06F3/00 - G06F13/00 and G06F21/00
    • G06F1/26—Power supply means, e.g. regulation thereof
    • G06F1/32—Means for saving power
    • G06F1/3203—Power management, i.e. event-based initiation of a power-saving mode
    • G06F1/3234—Power saving characterised by the action undertaken
    • G06F1/325—Power saving in peripheral device
    • G06F1/3268—Power saving in hard disk drive
    • G—PHYSICS
    • G06—COMPUTING; CALCULATING OR COUNTING
    • G06F—ELECTRIC DIGITAL DATA PROCESSING
    • G06F3/00—Input arrangements for transferring data to be processed into a form capable of being handled by the computer; Output arrangements for transferring data from processing unit to output unit, e.g. interface arrangements
    • G06F3/06—Digital input from, or digital output to, record carriers, e.g. RAID, emulated record carriers or networked record carriers
    • G06F3/0601—Interfaces specially adapted for storage systems
    • G—PHYSICS
    • G06—COMPUTING; CALCULATING OR COUNTING
    • G06F—ELECTRIC DIGITAL DATA PROCESSING
    • G06F3/00—Input arrangements for transferring data to be processed into a form capable of being handled by the computer; Output arrangements for transferring data from processing unit to output unit, e.g. interface arrangements
    • G06F3/06—Digital input from, or digital output to, record carriers, e.g. RAID, emulated record carriers or networked record carriers
    • G06F3/0601—Interfaces specially adapted for storage systems
    • G06F3/0668—Interfaces specially adapted for storage systems adopting a particular infrastructure
    • G06F3/0671—In-line storage system
    • G06F3/0673—Single storage device
    • Y—GENERAL TAGGING OF NEW TECHNOLOGICAL DEVELOPMENTS; GENERAL TAGGING OF CROSS-SECTIONAL TECHNOLOGIES SPANNING OVER SEVERAL SECTIONS OF THE IPC; TECHNICAL SUBJECTS COVERED BY FORMER USPC CROSS-REFERENCE ART COLLECTIONS [XRACs] AND DIGESTS
    • Y02—TECHNOLOGIES OR APPLICATIONS FOR MITIGATION OR ADAPTATION AGAINST CLIMATE CHANGE
    • Y02D—CLIMATE CHANGE MITIGATION TECHNOLOGIES IN INFORMATION AND COMMUNICATION TECHNOLOGIES [ICT], I.E. INFORMATION AND COMMUNICATION TECHNOLOGIES AIMING AT THE REDUCTION OF THEIR OWN ENERGY USE
    • Y02D10/00—Energy efficient computing, e.g. low power processors, power management or thermal management
    • Y—GENERAL TAGGING OF NEW TECHNOLOGICAL DEVELOPMENTS; GENERAL TAGGING OF CROSS-SECTIONAL TECHNOLOGIES SPANNING OVER SEVERAL SECTIONS OF THE IPC; TECHNICAL SUBJECTS COVERED BY FORMER USPC CROSS-REFERENCE ART COLLECTIONS [XRACs] AND DIGESTS
    • Y02—TECHNOLOGIES OR APPLICATIONS FOR MITIGATION OR ADAPTATION AGAINST CLIMATE CHANGE
    • Y02D—CLIMATE CHANGE MITIGATION TECHNOLOGIES IN INFORMATION AND COMMUNICATION TECHNOLOGIES [ICT], I.E. INFORMATION AND COMMUNICATION TECHNOLOGIES AIMING AT THE REDUCTION OF THEIR OWN ENERGY USE
    • Y02D30/00—Reducing energy consumption in communication networks
    • Y02D30/50—Reducing energy consumption in communication networks in wire-line communication networks, e.g. low power modes or reduced link rate

Landscapes

  • Engineering & Computer Science (AREA)
  • Theoretical Computer Science (AREA)
  • Physics & Mathematics (AREA)
  • General Engineering & Computer Science (AREA)
  • General Physics & Mathematics (AREA)
  • Power Sources (AREA)
  • Signal Processing For Digital Recording And Reproducing (AREA)

Description

本発明は、シリアルＡＴＡ（AT Attachment）インタフェースを持つ電子機器に係り、特にシリアルＡＴＡインタフェースの規格に準拠したシリアルＡＴＡバスのパワーセーブに好適な、ディスクドライブに代表される電子機器及びシリアルＡＴＡバスのパワーセーブ方法に関する。
現在、ディスクドライブの新インタフェースであるシリアルＡＴＡインタフェースの規格が策定中である。シリアルＡＴＡインタフェースは、従来のＡＴＡインタフェース（つまりパラレルＡＴＡインタフェース）と同様に、磁気ディスクドライブに代表される周辺機器とホストシステム（ホスト）との間のインタフェースとして用いられる。
シリアルＡＴＡインタフェースを持つ周辺機器、例えば磁気ディスクドライブ（以下、ＨＤＤと称する）は、ホストとシリアルＡＴＡバスにより接続される。このようなＨＤＤでは、従来のＡＴＡインタフェースとの互換性を確保するために、従来のＡＴＡインタフェースをシリアルＡＴＡインタフェースに、そしてシリアルＡＴＡインタフェースを従来のＡＴＡインタフェースに、それぞれ変換する必要がある。このようなインタフェース変換は、例えばシリアルＡＴＡブリッジと呼ばれるＬＳＩ（ブリッジＬＳＩ）で行われる。
シリアルＡＴＡ規格では、機能別に３つの層、つまりＰＨＹ（Physcal Layer）層（物理層）、ＬＩＮＫ層（リンク層）及びトランスポート（Transport）層が定義されている。ＰＨＹ層は高速の信号送受信を実行する機能を持つ部分であり、受信内容を解釈してＬＩＮＫ層に伝達し、またＬＩＮＫ層からの要求に応じて信号の出力を実施する。ＬＩＮＫ層はＴｒａｎｓｐｏｒｔ層（トランスポート層）からの要求内容に応じてＰＨＹ層に信号出力の要求を出し、またＰＨＹ層からの受信入力をＴｒａｎｓｐｏｒｔ層へ伝達する。Ｔｒａｎｓｐｏｒｔ層は従来のＡＴＡ規格における動作への変換を行う。このＴｒａｎｓｐｏｒｔ層の役割は、従来のＡＴＡ接続の場合と比較すると、ブリッジＬＳＩが磁気ディスクドライブに用いられたとき、ホスト側のＡＴＡ信号出力を行う部分に相当する。このブリッジＬＳＩとＨＤＤ内のディスクコントローラ（ＨＤＣ）との間は、従来のＡＴＡインタフェース規格に準拠したＡＴＡバス（またはそれに準じたバス）で接続される。このためブリッジＬＳＩとＨＤＤ内のＨＤＣとの間の接続部分は、従来のＡＴＡインタフェース規格と同等の、またはそれに準じた動作となる。このように、シリアルＡＴＡインタフェースにおいては、論理的コマンド等のプロトコルについては従来のＡＴＡ規格との互換性を有する一方、従来パラレルで接続されていた部分がシリアル信号に変換されるる。
シリアルＡＴＡインタフェースでは、従来のＡＴＡインタフェース（つまりパラレルＡＴＡインタフェース）の規格に準拠したパワーセーブの状態（モード）の他に、周辺機器とホストとを接続するシリアルＡＴＡバス自体を対象としてパワーセーブする状態が定義されている。このシリアルＡＴＡバス自体のパワーをセーブするという概念は従来のＡＴＡ規格では存在しない。
シリアルＡＴＡインタフェースの規格では、シリアルＡＴＡインタフェースの電力管理モードとして、“ＰＨＹ ＲＥＡＤＹ（ＩＤＬＥ）”，“ＰＡＲＴＩＡＬ（パーシャル）”及び“ＳＬＵＭＢＥＲ（スランバ）”の３種類が定義されている。“ＰＨＹ ＲＥＡＤＹ”モードとは、ＰＨＹ層の動作を実現する回路（ＰＨＹ回路）と主ＰＬＬ（Phase-Locked Loop）回路とが動作し、ホスト側及び周辺機器側の各々のインタフェース状態が同期している状態をいう。“ＰＡＲＴＩＡＬ”及び“ＳＬＵＭＢＥＲ”モードとは、ＰＨＹ回路は動作しているが、インタフェース信号は中立になっている状態をいう。
“ＰＡＲＴＩＡＬ”及び“ＳＬＵＭＢＥＲ”モードの定義上の違いは、それらのモードから“ＰＨＹ ＲＥＡＤＹ（ＩＤＬＥ）”モードへの復帰時間にある。即ち、“ＰＡＲＴＩＡＬ”モードでは、当該モードからの復帰時間は１０μｓを超えてはならないと定義されている。これに対し、“ＳＬＵＭＢＥＲ”モードでは、当該モードからの復帰時間は１０ｍｓを超えてはならないと定義されている。“ＰＡＲＴＩＡＬ”または“ＳＬＵＭＢＥＲ”モードで、機器内のどの部分の省電力機能を動作させるか（つまり、どの回路の電源を遮断するか）は、復帰時間、インタフェースの電源状態を遵守している限り製造者側で任意に規定できる。
従来のＡＴＡインタフェース規格に準拠したパワーセーブ（つまりＡＴＡパワーセーブ）の状態への遷移は、基本的には、ホスト側の主導により実現される。このＡＴＡパワーセーブの状態として、“ＩＤＬＥ（アイドル）”，“ＳＴＡＮＤＢＹ（スタンバイ）”及び“ＳＬＥＥＰ（スリープ）”等が定義されている。これに対し、シリアルＡＴＡインタフェース規格に準拠したシリアルＡＴＡバス自体のパワーセーブ（つまりシリアルＡＴＡパワーセーブ）の状態（“ＰＡＲＴＩＡＬ”または“ＳＬＵＭＢＥＲ”）への遷移は、ホスト側または周辺機器側のどちらの主導によって実現されても構わない。しかし、シリアルＡＴＡパワーセーブの状態を制御する技術（特にＡＴＡパワーセーブの状態にシリアルＡＴＡパワーセーブの状態を連携させる技術）に関しては、シリアルＡＴＡインタフェースの規格が策定中であることから、従来は何も知られておらず、文献も存在しない。
上記したように、ＨＤＤのインタフェースにシリアルＡＴＡインタフェースを適用して当該ＨＤＤをシリアルＡＴＡバスによりホストと接続する場合、ＨＤＤには、従来のＡＴＡインタフェースをシリアルＡＴＡインタフェースに変換するシリアルＡＴＡインタフェース制御回路回路（シリアルＡＴＡブリッジ）を設ける必要がある。このようなＨＤＤでは、シリアルＡＴＡインタフェース制御回路とＨＤＤのディスクコントローラ（ＨＤＣ）との接続部分の動作は、従来のＡＴＡインタフェース規格と同等、またはそれに準じた動作となる。このため、ディスクコントローラからは、シリアルＡＴＡブリッジが、命令を発行するホストであるかのように認識される。よって、ＨＤＤにおけるシリアルＡＴＡブリッジ周辺を除く部分の動作は従来のＨＤＤと変わらない。このシリアルＡＴＡインタフェースを適用するＨＤＤでは、シリアルＡＴＡインタフェース制御回路とディスクコントローラ（ＨＤＣ）とを接続する従来のＡＴＡバスは、当該ＨＤＤにおける印刷配線基板（ＰＣＢ）上に実現可能であることから、ＡＴＡバスの配線長が短縮される。このため、シリアルＡＴＡインタフェースを適用するＨＤＤでは、従来のＡＴＡバスで実現が難しかったデータ転送速度の向上が期待される。
さて、シリアルＡＴＡインタフェースは、従来のＡＴＡ規格との互換性を確保することを前提として検討されている規格である。このため、シリアルＡＴＡインタフェースで規定されている新たなパワーセーブの概念を実現するには、その旨の指示を行うための新たな手段をホスト側に設ける必要がある。しかし、新たな手段を適用することにより、従来のＡＴＡ規格から逸脱する虞がある。特に、新たな手段をホスト側に設けることはシステム全体への影響が大きい。
本発明は上記事情を考慮してなされたものでその目的は、シリアルＡＴＡ規格で定義されたシリアルＡＴＡバスのパワーセーブ機能を有効に活用して消費電力を低減できる、シリアルＡＴＡインタフェースを持つ電子機器及びシリアルＡＴＡバスのパワーセーブ方法を提供することにある。
本発明の１つの観点によれば、シリアルＡＴＡインタフェースを持つ電子機器が提供される。この電子機器は、予め定められたコマンドの発行または受信を検知する手段と、この検知手段によって検知されたコマンドの実行完了を確認する手段と、この確認手段によるコマンド実行完了確認に応じてシリアルＡＴＡインタフェースのパワーセーブモードに移行する制御を行う手段とを備えることを特徴とする。
このような構成の電子機器においては、予め定められたコマンドの発行または受信が検知された場合に、当該コマンドの実行完了が確認されたことに応じて、シリアルＡＴＡインタフェース（シリアルＡＴＡバス）のパワーセーブモードへの移行が制御される。これにより、上記予め定められたコマンドとして、例えばＡＴＡインタフェースのパワーセーブ系のコマンドであるスリープコマンドのように、リード／ライトモードへの復帰に時間がかかるコマンドが定義されるならば、当該コマンドの発行または受信が検知された場合に、シリアルＡＴＡバスもパワーセーブモードに移行される。この結果、消費電力を低減できる。つまり本発明によれば、シリアルＡＴＡ規格で定義されたシリアルＡＴＡバスのパワーセーブ機能を、従来のＡＴＡ規格との互換性を維持しながら有効に活用して消費電力を低減できる。
ここで、シリアルＡＴＡインタフェースのパワーセーブモードへの移行制御を、シリアルＡＴＡインタフェースとＡＴＡインタフェースとの間のインタフェース変換を行うシリアルＡＴＡインタフェース制御回路で自律的に行わせることも可能である。そのため、シリアルＡＴＡインタフェース制御回路に、次の各手段、即ちインタフェース変換の対象となるコマンドの受信に応じてシリアルＡＴＡインタフェースのアイドルモードに移行する毎に予め設定された一定時間を計測するための時間計測を開始する計測手段と、この計測手段により上記一定時間が計測されても新たなコマンドが受信されたなかった場合に、シリアルＡＴＡインタフェースの所定のパワーセーブモードに移行する手段とを持たせると良い。
また、上記電子機器がホストとシリアルＡＴＡバスを介して接続されるディスクドライブである場合には、当該ディスクドライブに、次の各手段、即ちホストからのコマンドの実行完了を当該コマンドの発行元に報告するための手段と、この報告手段による予め定められたコマンドの実行完了報告後にシリアルＡＴＡインタフェースのパワーセーブモードに移行する制御を行う手段とを持たせると良い。また、予め定められたコマンドとして、ＡＴＡインタフェースのパワーセーブ系のコマンドを定義するならば、シリアルＡＴＡ規格で定義されたシリアルＡＴＡバスのパワーセーブ機能を、従来のＡＴＡ規格との互換性を維持しながら有効に活用して、ディスクドライブでの消費電力を低減できる。このため、上記ディスクドライブを記憶装置として用いるホスト、例えば電池で駆動されるノートブック型のパーソナルコンピュータの稼働可能時間を延ばすことができる。
さて、上記予め定められたコマンドの実行完了報告後にシリアルＡＴＡインタフェースのパワーセーブモードに直ちに移行すると、その移行直後にホストからコマンドが発行された場合、リード／ライトコマンドが実行可能なリード／ライトモード（アクティブモード）に復帰（遷移）するのに時間を要する。例えば、スピンドルモータが完全に停止したかをディスクドライブに問い合わせるのに用いられるチェックパワーモードコマンドは、ＡＴＡインタフェースのパワーセーブ系のコマンドの実行完了報告直後に発行される可能性が高い。そこで、コマンドの実行完了報告後、ホストからのコマンドの受信頻度から決定される時間が経過するのを待ってシリアルＡＴＡインタフェースのパワーセーブモードに移行する構成とすると良い。この受信頻度は、ホストからのコマンドの受信時刻を表す受信時刻情報を記憶手段に記憶し、当該記憶手段に記憶されている受信時刻情報によって示されるコマンド受信時刻の系列から算出すれば良い。
また、シリアルＡＴＡインタフェースのパワーセーブモードに移行可能とするためには、ディスクドライブ側だけでなくホスト側でもシリアルＡＴＡインタフェースのパワーセーブ機能をサポートしている必要がある。そこで上記ディスクドライブに、上記制御手段によるシリアルＡＴＡインタフェースのパワーセーブモードへの移行制御の結果をもとに、ホスト側が当該シリアルＡＴＡインタフェースのパワーセーブ機能をサポートしているか否かを判定する手段と、この判定手段による判定結果を示すフラグ情報を記憶する手段とを追加し、上記フラグ情報によりホスト側がシリアルＡＴＡインタフェースのパワーセーブ機能をサポートしていないことが示されている場合、当該シリアルＡＴＡインタフェースのパワーセーブモードへの移行制御が抑止される構成とすると良い。このような構成においては、ホスト側がシリアルＡＴＡインタフェースのパワーセーブ機能をサポートしていないにも拘わらずに、ディスクドライブ側から無用なシリアルＡＴＡインタフェースのパワーセーブモードへの移行制御が行われるのを防止できる。これにより、シリアルＡＴＡバスでの無駄な状態遷移を発生させず当該シリアルＡＴＡバスを安定した状態に保つことができる。
本発明によれば、予め定められたコマンドの発行または受信が検知された場合に、当該コマンドの実行完了が確認されたことに応じて、シリアルＡＴＡインタフェース（シリアルＡＴＡバス）のパワーセーブモードへの移行が制御される構成とすることにより、シリアルＡＴＡ規格で定義されたシリアルＡＴＡバスのパワーセーブ機能を有効に活用して消費電力を低減できる。
以下、本発明をシリアルＡＴＡインタフェース（以下、ＳＡＴＡインタフェースと称する）を持つ磁気ディスクドライブを備えたシステムに適用した一実施形態につき図面を参照して説明する。図１は本発明の一実施形態に係る磁気ディスクドライブ（以下、ＨＤＤと称する）１０を備えたシステムの構成を示すブロック図である。ＨＤＤ１０は、従来から知られている、ＡＴＡインタフェースを用いてパラレルデータ転送を行うＨＤＤの構成であるＨＤＤ本体１１に加えて、ＳＡＴＡインタフェース制御回路１２を備えている。ＳＡＴＡインタフェース制御回路１２は、ＨＤＤ本体１１とＡＴＡバス（パラレルＡＴＡバス）１３を介して接続されると共に、ホスト（ホストシステム）２０とＳＡＴＡバス（シリアルＡＴＡバス）３０を介して接続される周辺機器用のＳＡＴＡブリッジである。ＳＡＴＡインタフェース制御回路１２は、ＡＴＡインタフェースとＳＡＴＡインタフェースとの間のインタフェース変換を行う例えば１チップのＬＳＩ（Large Scale Integlated Circuit）である。ＳＡＴＡインタフェース制御回路１２は特に、ＳＡＴＡバス３０を介して与えられた指示をＡＴＡバス１３（ＡＴＡインタフェース）の信号規則に変換し、当該ＡＴＡバス１３を介してＨＤＤ本体１１に送信する機能を有する。
ホスト２０はＨＤＤ１０を記憶装置として利用する電子機器であり、例えばパーソナルコンピュータである。ホスト２０は、従来から知られている、ＡＴＡインタフェースを用いてパラレルデータ転送を行うホストの構成であるホスト本体２１に加えて、ＳＡＴＡインタフェース制御回路２２を備えている。ＳＡＴＡインタフェース制御回路２２は、ホスト本体２１とＡＴＡバス（パラレルＡＴＡバス）２３を介して接続されると共に、ＨＤＤ１０とＳＡＴＡバス（シリアルＡＴＡバス）３０を介して接続される、ＡＴＡバス接続のホスト型ブリッジである。ＳＡＴＡインタフェース制御回路２２は、ＨＤＤ１０内のＳＡＴＡインタフェース制御回路１２と同様に、ＡＴＡインタフェースとＳＡＴＡインタフェースとの間のインタフェース変換を行う１チップのＬＳＩである。ＳＡＴＡインタフェース制御回路２２は特に、ホスト２０側のＡＴＡバス２３を介して与えられた指示をＳＡＴＡバス３０（ＳＡＴＡインタフェース）の信号規則に変換し、当該ＳＡＴＡバス３０を介してＨＤＤ１０に送信する機能を有する。
ＳＡＴＡインタフェース制御回路１２，２２は、それぞれ、物理層処理部１２１，２２１と、リンク／トランスポート層処理部１２２，２２２とを備えている。物理層処理部１２１，２２１は、ＳＡＴＡバス３０を介して高速のシリアルデータ転送（送受信）を実行する機能を有する。ここでのデータ転送速度は、１．５Ｇｂｐｓ（ギガビット／秒）である。物理層処理部１２１，２２１は、ＳＡＴＡバス３０から受信した内容を解釈してリンク／トランスポート層処理部１２２，２２２（中のリンク層処理部）に伝達する。また物理層処理部１２１，２２１は、リンク／トランスポート層処理部１２２，２２２（中のリンク層処理部）からの要求に応じてシリアルデータ信号を出力（送信）する。リンク／トランスポート層処理部１２２，２２２は、リンク層処理部とトランスポート層処理部（図示せず）とを備えている。リンク層処理部は、トランスポート層処理部からの要求内容に応じて物理層処理部１２１，２２１に信号出力の要求を出し、また物理層処理部１２１，２２１からの受信入力をトランスポート層処理部へ伝達する。トランスポート層処理部はＡＴＡインタフェースとＳＡＴＡインタフェースとの間のインタフェース変換を行う。
なお、ＡＴＡバス１３，２３に代えて、当該ＡＴＡバスに準じたバス、例えばＰＣＩバス（Peripheral Component Interconnect Bus）を用いることも可能である。この場合、ＳＡＴＡインタフェース制御回路１２，２２（を構成するＳＡＴＡブリッジ）をＰＣＩブリッジ内に設けることが可能である。また、ＳＡＴＡインタフェース制御回路１２，２２（を構成するＳＡＴＡブリッジ）には、ＳＡＴＡバス３０との間でシリアルＡＴＡインタフェースの信号を送受信する機能を持たせれば良い。
図２は、図１中のＨＤＤ本体１１の構成を示すブロック図である。ＨＤＤ本体１１は、記録媒体としてのディスク１１１を備えている。このディスク１１１の２つのディスク面の少なくとも一方のディスク面は、データが磁気記録される記録面をなしている。この記録面をなす、ディスク１１１の一方のディスク面に対応して、ヘッド（磁気ヘッド）１１２が配置されている。なお、図１では、作図の都合上、ヘッド１１２が１つであるＨＤＤ１０の例が示されている。しかし、一般には、ディスク１１１の２つのディスク面が共に記録面をなしており、各々のディスク面に対応してヘッドが配置される。また図１の構成では、単一枚のディスク１１１を備えたＨＤＤ１０を想定している。しかし、ディスク１１１が複数枚積層配置されたＨＤＤであっても構わない。
ディスク１１１はスピンドルモータ（以下、ＳＰＭと称する）１１３により高速に回転させられる。ヘッド１１２は、ディスク１１１へのデータ書き込み（データ記録）及びディスク１１１からのデータ読み出し（データ再生）に用いられる。ヘッド１１２は、アクチュエータ１１４の先端に取り付けられている。アクチュエータ１１４は、当該アクチュエータ１１４の駆動源となるボイスコイルモータ（以下、ＶＣＭと称する）１１５を有している。アクチュエータ１１４は、このＶＣＭ１１５により駆動されて、ヘッド１１２をディスク１１１の半径方向に移動する。これにより、ヘッド１１２は、目標トラック上に位置付けられる。ＳＰＭ１１３及びＶＣＭ１１５は、モータドライバＩＣ１１６からそれぞれ供給される駆動電流（ＳＰＭ電流及びＶＣＭ電流）により駆動される。モータドライバＩＣ１１６は、ＣＰＵ１２１から指定された量のＳＰＭ電流をＳＰＭ１１３に対して供給する。またモータドライバＩＣ１１６は、ＣＰＵ１２１から指定された量のＶＣＭ電流をＶＣＭ１１５に対して供給する。
ヘッド１１２はヘッドＩＣ（ヘッドアンプ回路）１１７と接続されている。ヘッドＩＣ１１７はヘッド１１２により読み出されたリード信号を増幅するリードアンプ、及びライトデータをライト電流に変換するライトアンプを含む。ヘッドＩＣ１１７は、リード／ライトＩＣ（リード／ライトチャネル）１１８と接続されている。リード／ライトＩＣ１１８は、リード信号に対するＡ／Ｄ（アナログ／デジタル）変換処理、ライトデータの符号化処理及びリードデータの復号化処理等の各種の信号処理を実行する信号処理デバイスである。リード／ライトＩＣ１１８はディスクコントローラ（以下、ＨＤＣと称する）１１９と接続されている。
ＨＤＣ１１９は当該ＨＤＣ１１９とディスク１１１との間のデータ転送を制御するディスク制御機能を有する。ＨＤＣ１１９はまた、ＡＴＡインタフェースを持つ。即ちＨＤＣ１１９は、ホスト２０との間で、ＡＴＡバス１３を介してコマンド（リード／ライトコマンド等）、及びデータをＡＴＡインタフェースにより送受信するＡＴＡインタフェース制御機能を有する。但し、ＨＤＤ１０がＳＡＴＡインタフェースを持つ本実施形態では、ＨＤＣ１１９は、従来のＨＤＤとは異なって、ＡＴＡバス１３を介してＳＡＴＡインタフェース制御回路１２と接続され、当該ＳＡＴＡインタフェース制御回路１２及びＳＡＴＡバス３０を介してホスト２０と接続されている。ＨＤＣ１１９はまた、バッアァＲＡＭ１２０を制御するバッファ制御機能を有する。ＨＤＣ１１９は、ＨＤＤ１０の状態をホスト２０に通知するためのステータスレジスタ１１９ａを含む。
バッファＲＡＭ１２０の記憶領域の一部は、ホスト２０とＨＤＤ１０内のＨＤＣ１１９との間で転送されるデータを一時格納するデータバッファのための領域に用いられる。バッアァＲＡＭ１２０の記憶領域の別の一部は、後述するＳＡＴＡパワーセーブ不可フラグＦを記憶するフラグ記憶領域１２０ａと、受信コマンドの受信時刻を表す時刻情報を記憶するコマンド受信時刻記憶領域１２０ｂとに用いられる。コマンド受信時刻記憶領域１２０ｂは最新の一定数の受信コマンドの受信時刻情報を記憶するリングバッファとして用いられる。
ＣＰＵ１３０は、制御プログラムが予め格納された図示せぬ不揮発性メモリ（例えば書き換えが可能な不揮発性メモリであるフラッシュＲＯＭ）を有している。ＣＰＵ１３０は、この不揮発性メモリに格納されている制御プログラムに従ってＨＤＤ１０内の各部を制御する。特にＣＰＵ１３０は、ＨＤＣ１１９によって受信されたホスト２０からのコマンドがＡＴＡインタフェースのパワーセーブモード（以下、ＡＴＡパワーセーブモードと称する）を指定する特定コマンド（ＡＴＡパワーセーブコマンド）の場合に、ＨＤＤ１０を当該コマンドで指定されたＡＴＡパワーセーブモードに設定する。またＣＰＵ１３０は、ＡＴＡパワーセーブモードの設定時に、そのモードに予め対応付けられたＳＡＴＡパワーセーブモードをＨＤＣ１１９、ＡＴＡバス１３を介してＳＡＴＡインタフェース制御回路１２によって設定させる。
図３は、本実施形態で適用されるＡＴＡパワーセーブモード（ＡＴＡインタフェース規格に準拠したパワーセーブの状態）の状態遷移を示す図である。本実施形態では、ＡＴＡパワーセーブモードとして、アクティブ・アイドルモードＭ１、パフォーマンス・アイドルモードＭ２、ローパワー・アイドルモードＭ３、スタンバイモードＭ４及びスリープモードＭ５の５種類が用意されている。また、ＡＴＡインタフェースのモードとして、これらのパワーセーブ系のモードＭ１〜Ｍ５の他に、リード／ライトコマンドが実行可能なリード／ライトモード（アクティブモード）Ｍ０が用意される。ここで、消費電力は、リード／ライトモードＭ０→アクティブ・アイドルモードＭ１→パフォーマンス・アイドルモードＭ２→ローパワー・アイドルモードＭ３→スタンバイモードＭ４→スリープモードＭ５の順に小さくなる。
ＨＤＤ１０（内のＨＤＤ本体１１）では、リード／ライトモードＭ０におけるリード／ライトコマンドに従うリード／ライトの実行が終了すると、当該ＨＤＤ１０での消費電力の節約のために、ＣＰＵ１３０の制御によってアクティブ・アイドルモードＭ１に遷移させられる。アクティブ・アイドルモードＭ１に遷移した後一定時間Ｔ１が経過してもホスト２０から新たなコマンドが送られなかった場合には、当該ＨＤＤ１０での消費電力の一層の節約のために、ＣＰＵ１３０の制御によってパフォーマンス・アイドルモードＭ２に自動的に遷移させられる。モードＭ１及びＭ２は、製造者側で任意に規定されたＡＴＡパワーセーブモードである。
パフォーマンス・アイドルモードＭ２に遷移した後一定時間Ｔ２が経過してもホスト２０から新たなコマンドが送られなかった場合には、当該ＨＤＤ１０での消費電力の一層の節約のために、ＣＰＵ１３０の制御によってローパワー・アイドルモードＭ３に遷移させられる。このモードＭ３は、ＡＴＡインタフェース規格の“ＩＤＬＥ（アイドル）”に相当する。このため、上記各モードＭ１，Ｍ２においてホスト２０からアイドルコマンドが送られた場合、ＨＤＤ１０のＡＴＡパワーセーブモードは、当該コマンドに従ってローパワー・アイドルモードＭ３に遷移される。同様に、上記各モードＭ１，Ｍ２，Ｍ３においてホスト２０からスタンバイコマンドが送られた場合、ＨＤＤ１０のＡＴＡパワーセーブモードは、当該コマンドに従ってスタンバイモードＭ４に遷移される。なお、スタンバイコマンドの一種に、スタンバイモードに遷移するまでの時間を指定可能なスタンバイ・イミーディエット（Standby Immediate）コマンドが知られている。スタンバイ・イミーディエットコマンドの場合には、当該コマンドで指定された時間後に、スタンバイモードＭ４に遷移される。また、上記各モードＭ１，Ｍ２，Ｍ３，Ｍ４においてホスト２０からスリープコマンドが送られた場合、ＨＤＤ１０のＡＴＡパワーセーブモードは、当該コマンドに従ってスリープモードＭ５に遷移される。また、上記各モードＭ１，Ｍ２，Ｍ３，Ｍ４，Ｍ５においてホスト２０からリード／ライトコマンドが送られた場合、ＨＤＤ１０のＡＴＡパワーセーブモードは、当該コマンドに従ってリード／ライトモードＭ０に遷移される。
図４は、上記各モードＭ０〜Ｍ５と当該モードＭ０〜Ｍ５におけるＨＤＤ本体１１内の各回路の電源ＯＦＦ状態との対応関係を示す。リード／ライトモードＭ０では、ＨＤＤ本体１１内の各回路に、当該ＨＤＤ本体１１にてリード／ライト動作を即時に実行できるように電源が供給される。アクティブ・アイドルモードＭ１、パフォーマンス・アイドルモードＭ２及びローパワー・アイドルモードＭ３の各アイドルモードでは、ＨＤＤ本体１１内の一部の回路への電源供給が遮断（ＯＦＦ）される。アクティブ・アイドルモードＭ１では、ディスク１１１はＳＰＭ１１３により回転されており、ヘッド１１２は、サーボ制御によりディスク１１１上のあるトラックに位置決めされている。パフォーマンス・アイドルモードＭ２では、ディスク１１１はＳＰＭ１１３により回転されており、ヘッド１１２はサーボ制御されずにディスク１１１上の任意のトラック上に存在する。ローパワー・アイドルモードＭ３では、ディスク１１１はＳＰＭ１１３により回転されているが、ヘッド１１２はディスク１１１から外れた退避箇所に移動されている。このためアクティブ・アイドルモードＭ１ではリード／ライトＩＣ１１８内の一部の回路（ライトチャネル）への電源供給だけが遮断される。これに対し、パフォーマンス・アイドルモードＭ２ではモータドライバＩＣ１１６内の一部の回路（ＶＣＭドライバ）及びリード／ライトＩＣ１１８内の一部の回路への電源供給が遮断される。また、ローパワー・アイドルモードＭ３では、モータドライバＩＣ１１６内の一部の回路への電源供給が遮断されると共に、ヘッドＩＣ１１７及びリード／ライトＩＣ１１８への電源供給が遮断される。リード／ライトモードＭ０に復帰するまでの時間（つまり、リード／ライトを再び実行可能とするまでの復帰時間）は、上記各アイドルモードによって異なり、アクティブ・アイドルモードＭ１→パフォーマンス・アイドルモードＭ２→ローパワー・アイドルモードＭ３の順に長くなる。上記各アイドルモードで必要となる消費電力は、アクティブ・アイドルモードＭ１→パフォーマンス・アイドルモードＭ２→ローパワー・アイドルモードＭ３の順に小さくなり、復帰時間が長い方が小さい。
スタンバイモードＭ４では、ＳＰＭ１１３の回転は停止される。ここでは、ＳＰＭ１１３、モータドライバＩＣ１１６、ヘッドＩＣ１１７、リード／ライトＩＣ１１８及びバッアァＲＡＭ１２０への電源供給が遮断される。このため、スタンバイモードＭ４での消費電力は、ローパワー・アイドルモードＭ３よりも更に小さくなり、逆に復帰時間は長くなる。
スリープモードＭ５では、ＨＤＣ１１９内の一部の回路（リセット処理回路）だけに電源が供給されるだけで、殆どの回路への電源供給が遮断される。ここでは、リード／ライトモードＭ０への復帰はリセット動作によってのみ可能であり、復帰時間はスタンバイモードＭ４から復帰する場合と同程度である。スリープモードＭ５における消費電力は、上記各モードＭ０〜Ｍ５の中で最も小さい。
図５は、上記各モードＭ１〜Ｍ５からリード／ライトモードＭ０に復帰するのに要する時間の一例を示す。
図６は、上記モードＭ０〜Ｍ５と、ＨＤＤ１０が当該モードＭ０〜Ｍ５に設定された場合に、当該ＨＤＤ１０内のＣＰＵ１３０の制御によって設定されるＳＡＴＡパワーセーブモードとの関係を示す。図６の例では、ＡＴＡパワーセーブモード（ＡＴＡインタフェースモード）がリード／ライトモードＭ０の場合、ＳＡＴＡパワーセーブモード（ＳＡＴＡインタフェースモード）はアイドル（Ｉｄｌｅ）モードＭ１１に設定される。また、ＡＴＡパワーセーブモードがアクティブ・アイドルモードＭ１またはパフォーマンス・アイドルモードＭ２の場合、ＳＡＴＡパワーセーブモードはパーシャル（Ｐａｒｔｉａｌ）モードＭ１２に設定される。但し、パフォーマンス・アイドルモードＭ２はアクティブ・アイドルモードＭ１からしか遷移しないため、パフォーマンス・アイドルモードＭ２への遷移時には、パーシャルモードＭ１２が継続されることになる。また、ＡＴＡパワーセーブモードがローパワー・アイドルモードＭ３、スタンバイモードＭ４またはスリープモードＭ５の場合、ＳＡＴＡパワーセーブモードはスランバ（Ｓｌｕｍｂｅｒ）モードＭ１３に設定される。
次に、図１のシステムにおける動作を、ＨＤＤ１０内のＨＤＤ本体１１においてホスト２０からのコマンドを受信した場合に行われるパワー制御を例に、図７のフローチャートを参照して説明する。
今、ホスト２０のホスト本体２１からＡＴＡバス２３にＡＴＡインタフェース規格に準拠したＨＤＤ１０宛てのコマンドが送出されたものとする。このＡＴＡバス２３上のコマンドはホスト２０のＳＡＴＡインタフェース制御回路２２で受信される。ＳＡＴＡインタフェース制御回路２２のリンク／トランスポート層処理部２２２は、受信コマンドをＳＡＴＡインタフェース規格に準拠したコマンド（ＳＡＴＡバス３０の信号規則）に変換してＳＡＴＡバス３０に送出する。このＳＡＴＡバス３０上のコマンドはＨＤＤ１０のＳＡＴＡインタフェース制御回路１２で受信される。ＳＡＴＡインタフェース制御回路１２のリンク／トランスポート層処理部１２２は、受信コマンドをＡＴＡインタフェース規格に準拠したコマンド（ＡＴＡバス１３の信号規則）に変換してＡＴＡバス１３に送出する。このＡＴＡバス１３上のコマンドはＨＤＤ１０のＨＤＤ本体１１に設けられたＨＤＣ１１９で受信される。ＨＤＣ１１９からは、ＳＡＴＡインタフェース制御回路１２がホストとして認識される。ＨＤＣ１１９によって受信されたコマンドはＣＰＵ１３０に渡される。
ＣＰＵ１３０は、ＨＤＣ１１９から渡されたコマンドを受け取ると、当該コマンドの受信時刻を表すコマンド受信時刻情報をバッアァＲＡＭ１２０内のコマンド受信時刻記憶領域１２０ｂに格納する（ステップＳ１）。次にＣＰＵ１３０は、受信コマンドが予め定められたコマンドの１つであるか否かを判定する（ステップＳ２）。ここで、予め定められたコマンドは、パワーセーブに関係するコマンドであり、アイドルコマンド、スタンバイコマンド、及びスリープコマンドである。
受信コマンドが予め定められたコマンドの１つである場合、ＣＰＵ１３０は以下に述べる処理を実行する。まずＣＰＵ１３０は、受信コマンドを解釈して当該コマンドの指示する動作を実行する（ステップＳ３）。つまり、受信コマンドがアイドルコマンドである場合、ＣＰＵ１３０はＨＤＤ１０のＡＴＡパワーセーブモードをローパワー・アイドルモードＭ３に遷移させる。また、受信コマンドがスタンバイコマンドである場合、ＣＰＵ１３０はＨＤＤ１０のＡＴＡパワーセーブモードをスタンバイモードＭ４に遷移させる。また、受信コマンドがスリープコマンドである場合、ＣＰＵ１３０はＨＤＤ１０のＡＴＡパワーセーブモードをスリープモードＭ５に遷移させる。
ＣＰＵ１３０は、受信コマンドを実行し終えて、当該コマンドの実行完了を確認すると、当該コマンドの実行完了をホスト２０に報告するための処理を行う（ステップＳ４）。即ちＣＰＵ１３０は、コマンド実行完了を示す応答ステータスをステータスレジスタ１１９ａに設定して、ＡＴＡバス１３に割り込み信号を送出する。ＳＡＴＡインタフェース制御回路１２は、この割り込み信号に応じて、ＨＤＣ１１９内のステータスレジスタ１１９ａの内容をリードする。ＳＡＴＡインタフェース制御回路１２は、リードしたステータスレジスタ１１９ａの内容をもとに、ＳＡＴＡインタフェース規格に準拠したコマンド実行完了報告をＳＡＴＡバス３０を介してホスト２０に送出する。ホスト２０内のＳＡＴＡインタフェース制御回路２２は、ＳＡＴＡバス３０上のコマンド実行完了報告を受信すると、ホスト本体２１に対してＡＴＡバス２３を介して割り込み信号を送出する。ホスト本体２１は、この割り込み信号に応じてＳＡＴＡインタフェース制御回路２２からコマンド実行完了報告（コマンド完了応答）を受け取る。
さて本実施形態では、ホスト２０からＨＤＤ１０に送られたコマンドが、予め定められたコマンド、即ちパワーセーブに関係するコマンドの１つである場合、ＣＰＵ１３０はＳＡＴＡインタフェース制御回路１２に対し、ＳＡＴＡパワーセーブモードの制御（つまりＡＴＡバス１３のパワー制御）を実行する。ここでは、アイドルコマンド、スタンバイコマンド、またはスリープコマンドの場合、いずれもスランバモードＭ１３に遷移するように制御される。
ＣＰＵ１３０によるＳＡＴＡパワーセーブモードの制御は、ＳＡＴＡインタフェース規格に準拠したＳＡＴＡパワーセーブモードを指定する信号パターンが設定されたプリミティブをＡＴＡバス１３を介してＳＡＴＡインタフェース制御回路１２のリンク／トランスポート層処理部１２２（に含まれているリンク処理部）に送信することにより実現される。なお、ＳＡＴＡインタフェース制御回路１２内にＳＡＴＡパワーセーブモードの制御のための制御レジスタを設け、当該レジスタをＣＰＵ１３０から制御することにより、ＳＡＴＡバス３０を目的のＳＡＴＡパワーセーブモードに遷移させても良い。
本実施形態では以下に示す理由により、ＡＴＡパワーセーブに関係するコマンドの実行完了の報告（コマンド完了応答）後、対応するＳＡＴＡパワーセーブモードに直ちに遷移させる構成を適用していない。まず、コマンド実行完了報告後に、ＳＡＴＡバス３０を即時にスランバモードＭ１３に遷移させると、当該スランバモードＭ１３の定義から、コマンドの応答に対して最大１０ｍｓの復帰時間を要する。ここで、ホスト２０がスタンバイコマンド、例えばスタンバイ・イミーディエットコマンドをＨＤＤ１０に対して発行し、しかる後にチェックパワーモードコマンドを用いてＨＤＤ１０内のＳＰＭ１１３の停止を確実に監視しようという場合を想定する。この場合、スタンバイ・イミーディエットコマンドの実行完了報告（コマンド完了応答）後、ＳＡＴＡパワーセーブモードを即時にスランバモードＭ１３に移行してしまうと、引き続くチェックパワーモードコマンドに対する完了応答の速度が低下してしまう。このため本実施形態では、コマンド完了応答後にＳＡＴＡバス３０を無条件で即時にスランバモードＭ１３に遷移させることはしない。
このことについて、更に詳細に説明する。まず、スタンバイ・イミーディエットコマンドの終了時点で即時にスランバモードＭ１３に遷移した場合に、その直後にホスト２０がＨＤＤ１０に対してチェックパワーモードコマンドを発行したものとする。この場合、チェックパワーモードコマンドの発行時点には、ＳＡＴＡバス３０は既にスランバモードＭ１３移行している。この状態でＳＡＴＡバス３０を通してホスト２０からＨＤＤ１０のＨＤＣ１１９にコマンドが伝達されるためには、当該ＳＡＴＡバス３０が通信可能な状態、つまりアイドルモードＭ１１に復帰されなければならない。このとき、ホスト２０内のＳＡＴＡインタフェース制御回路２２では、チェックパワーモードコマンドに応じて、ＳＡＴＡインタフェースの状態遷移規則に従って復帰手順が実施される。この場合、ホスト２０では、チェックパワーモードコマンドの完了応答が、ＳＡＴＡバス３０の復帰時間だけ遅くなったように認識される。
さて、ホスト２０から発行されたコマンド（チェックパワーモードコマンド）は、当該コマンドの発行に応じて、ＳＡＴＡバス３０の状態がスランバモードＭ１３（パワーセーブ状態）からアイドルモードＭ１１に復帰し、ホスト２０とＨＤＤ１０との間の交信が可能となった後にＨＤＤ１０に到達する。そして、ＳＡＴＡインタフェース制御回路１２のリンク／トランスポート層処理部１２２（に含まれているトランスポート層処理部）が作動して、ＨＤＤ１０内のＨＤＣ１１９に対してコマンドを発行する。このため、ホスト２０から発行されたコマンドは、ＳＡＴＡバス３０の復帰時間だけ遅れてＨＤＤ１０内のＨＤＣ１１９に到達する。しかし、ＨＤＣ１１９は、その遅れを認識できない。
そこで本実施形態では、ＨＤＤ１０内のＣＰＵ１３０は、ＳＡＴＡパワーセーブモードを制御しようとする場合、まずバッアァＲＡＭ１２０のコマンド受信時刻記憶領域１２０ｂに記憶されているコマンド受信時刻情報の示す例えば一定個数のコマンド受信時刻の系列から、コマンドの受信頻度を算出する（ステップＳ７）。ここで、コマンド受信頻度には、例えばコマンド受信時刻系列で示されるコマンド受信時間間隔の平均値、或いは最も確率の高いコマンド受信時間間隔を用いることができる。なお、一定個数のコマンド受信時刻の系列に代えて、現在時刻を基準とする一定時間内に受信されたコマンド受信時刻の系列を用いても構わない。
ＣＰＵ１３０は、算出されたコマンド受信頻度（コマンド受信時間間隔）から、今回受信したコマンドで決まるＳＡＴＡパワーセーブモードに遷移するタイミングを決定し、そのタイミングが到来するのを待って、当該ＳＡＴＡパワーセーブモードへの遷移を制御する（ステップＳ８）。ここでは、算出されたコマンド受信頻度、つまりコマンド受信時間間隔をＴcとすると、ＣＰＵ１３０は時間Ｔcを待っても次のコマンドがＨＤＣ１１９で受信されなかった場合に、ＳＡＴＡバス３０を、今回受信したコマンドで決まるＳＡＴＡパワーセーブモードにＳＡＴＡインタフェース制御回路１２によって遷移させる（ステップＳ９）。これにより、ＡＴＡパワーセーブ系のコマンドの実行時に、当該コマンドで決まるＳＡＴＡパワーセーブモードへの遷移を制御しても、ホスト２０から次のコマンドが送られた場合に、当該次のコマンドに対する完了応答が遅れることを防止できる。
なお、ＡＴＡパワーセーブ系のコマンドの後にホスト２０からＨＤＤ１０にチェックパワーモードコマンドが発行される可能性が高いことを考慮して、ＡＴＡパワーセーブ系のコマンドの完了応答後に、ＣＰＵ１３０がＳＰＭ１１３の停止状態を確認し、その確認時点から予め定められた一定時間後にスランバモードＭ１３への遷移を制御するようにしても、次のコマンドに対する完了応答が遅れることを防止できる。また、ＳＰＭ１１３の再起動を必要としないコマンドを最も最近に受信した時点から一定時間後にスランバモードＭ１３への遷移を制御するようにしても良い。また本実施形態では、ホスト２０からのＡＴＡパワーセーブ系のコマンドが、アイドルコマンド、スタンバイコマンドコマンドまたはスリープコマンドのいずれの場合にも、ＳＡＴＡパワーセーブモードをスランバモードＭ１３としている。しかし、コマンドの種類、或いはＳＡＴＡインタフェース制御回路１２の構成（アイドルモードＭ１１に復帰する能力）によっては、より短時間で復帰できるパーシャルモードＭ１２に遷移するようにしても良い。
さて本実施形態では、ＨＤＤ１０における消費電力を低減するために、図３に示すように、ホスト２０からのＡＴＡパワーセーブ系のコマンドとは別に、ＨＤＤ１０内部で自律的にＡＴＡパワーセーブモードの遷移が行われる構成が適用されている。つまり、ＨＤＤ１０内のＣＰＵ１３０は、リード／ライトモードＭ０でのリード／ライト実行が終了すると、直ちにリード／ライトモードＭ０からアクティブ・アイドルモードＭ１に遷移させる。またアクティブ・アイドルモードＭ１への遷移後、一定時間Ｔ１を経過してもホスト２０から新たなコマンドが送られなかった場合には、ＨＤＤ１０内のＣＰＵ１３０はアクティブ・アイドルモードＭ１からパフォーマンス・アイドルモードＭ２に遷移させる。またパフォーマンス・アイドルモードＭ２への遷移後、一定時間Ｔ２を経過してもホスト２０から新たなコマンドが送られなかった場合には、ＣＰＵ１３０はパフォーマンス・アイドルモードＭ２からローパワー・アイドルモードＭ３に遷移させる。ここで、上記時間Ｔ１，Ｔ２を、先に述べたコマンド受信頻度（コマンド受信時間間隔）から、例えば一定周期で動的に変更すると良い。
本実施形態では、このＨＤＤ１０内部でのＣＰＵ１３０の制御による自律的なＡＴＡパワーセーブモードの遷移時に、図３に示すように、その遷移に連動してＳＡＴＡパワーセーブモードも遷移させている。具体的には、リード／ライトモードＭ０からアクティブ・アイドルモードＭ１への遷移時に、アイドルモードＭ１１からパーシャルモードＭ１２に遷移される。また、アクティブ・アイドルモードＭ１からパフォーマンス・アイドルモードＭ２に遷移した場合には、パーシャルモードＭ１２が継続される。また、パフォーマンス・アイドルモードＭ２からローパワー・アイドルモードＭ３の遷移時には、パーシャルモードＭ１２からスランバモードＭ１３に遷移される。ローパワー・アイドルモードＭ３では、ヘッド１１２はディスク１１１から外れた退避箇所に移動される。ＨＤＤ１０が、この状態になると、その後ホスト２０からリード／ライトコマンドが与えられた場合に、リード／ライトモードＭ０に復帰するにのに要する時間は３０ms以上（図６参照）と比較的長い。そこで、このような場合に、本実施形態のようにＳＡＴＡバス３０をスランバモードＭ１３に設定してＳＡＴＡバス３０（ＳＡＴＡインタフェース）での消費電力を抑えることは有効である。
ホスト２０からＨＤＤ１０へのアクセスは時系列的に集中、或いは分散の傾向がある。例えばコマンド受信時間間隔が非常に短い状態が続いた後に、一定時間を超えてコマンドが受信されないことがある。このような場合、ＣＰＵ１３０が、ホスト２０におけるアプリケーションの実行が終了したものと推定して、比較的短時間で消費電力を下げるＡＴＡパワーセーブモードに設定すると良い。また、コマンド受信時間間隔は比較的長いものの、その状態が長時間続く場合、つまり継続してＨＤＤ１０がアクセスされる場合には、ＣＰＵ１３０が消費電力を下げる状態にするまでの時間が比較的長いＡＴＡパワーセーブモードに設定すると良い。ここでも、これらのＳＡＴＡパワーセーブモードと連動してＳＡＴＡパワーセーブモードを制御すると良い。
また、本実施形態では、ＳＡＴＡパワーセーブモード（ＳＡＴＡバス３０のパワーセーブ）がＨＤＤ１０内のＣＰＵ１３０によって制御される。しかし、この制御が、ＳＡＴＡインタフェース制御回路１２によって行われる構成とすることも可能である。図８は、ＳＡＴＡインタフェース制御回路１２によってＳＡＴＡパワーセーブモードが制御される場合の状態遷移を示す。今、ホスト２０からのコマンドがＳＡＴＡインタフェース制御回路１２で受信された結果、ＳＡＴＡバス３０がアイドルモードＭ１１に遷移（復帰）したものとする。このアイドルモードＭ１１への遷移時点から一定時間Ｔを経過しても新たなコマンドがホスト２０から送られなかった場合、ＳＡＴＡインタフェース制御回路１２は、ＳＡＴＡバス３０をアイドルモードＭ１１からパーシャルモードＭ１２に遷移させる制御を行う。このパーシャルモードＭ１２への遷移時点から一定時間Ｔを経過しても新たなコマンドがホスト２０から送られなかった場合、ＳＡＴＡインタフェース制御回路１２は、ＳＡＴＡバス３０をパーシャルモードＭ１２からスランバモードＭ１３に遷移させる制御を行う。このスランバモードＭ１３は、新たなコマンドがホスト２０から送られるまで継続される。ここで、一定時間Ｔは、タイマ（時間計測手段）を用いて計測すれば良い。なお、アイドルモードＭ１１からパーシャルモードＭ１２に遷移した場合、新たなコマンドがホスト２０から送られるまで当該パーシャルモードＭ１２が継続される構成としても良い。またアイドルモードＭ１１から直接スランバモードＭ１３に遷移させる構成とすることも可能である。また、このＳＡＴＡインタフェース制御回路１２によるＳＡＴＡパワーセーブモード制御機能を、ＨＤＤ１０内のＨＤＣ１１９に持たせることも可能である。
本実施形態では、ＳＡＴＡパワーセーブモードの制御（ＳＡＴＡバス３０のパワーセーブ）がＨＤＤ１０側から（つまりＨＤＤ１０の主導により）行われる。このＳＡＴＡパワーセーブモードの制御のためには、ＨＤＤ１０側のＳＡＴＡインタフェース制御回路１２だけでなく、ホスト２０側のＳＡＴＡインタフェース制御回路２２も共にＳＡＴＡパワーセーブモードに対応していること（つまりＳＡＴＡパワーセーブ機能をサポートしていること）が必要となる。もし、ＳＡＴＡインタフェース制御回路２２がＳＡＴＡパワーセーブモード（パーシャルモードＭ１２及びスランバモードＭ１３の各モード）に対応していない場合、指示されたＳＡＴＡパワーセーブモードへの遷移は不可能となる。この状態については、ＳＡＴＡバスにより相互接続されたＳＡＴＡインタフェース制御回路（本実施形態では、ＳＡＴＡインタフェース制御回路１２及び２２）相互の動作で知ることができる方法が、ＳＡＴＡインタフェース規格で定義されている。今、ＨＤＤ１０がＳＡＴＡバス３０を介して接続されているホスト２０が、スランバモードＭ１３に対応していない（ＳＡＴＡインタフェース制御回路２２を含む）ものとする。この場合、ＨＤＤ１０側からスランバモードＭ１３への移行指示（を表すパターンを含むプリミティブ）がホスト２０に発行される都度、当該ホスト２０（内のＳＡＴＡインタフェース制御回路２２）からはスランバモードＭ１３への移行不能の応答が返される。このように、ＨＤＤ１０がＳＡＴＡバス３０を介して接続されているホスト２０がＳＡＴＡパワーセーブモードに対応していない場合、ＨＤＤ１０側からホスト２０に対してＳＡＴＡパワーセーブモードへの移行指示を発行しても、ホスト２０からは常に移行不能の応答が返されるだけであり、ＳＡＴＡパワーセーブモードの制御は失敗する。つまり、ＨＤＤ１０がＳＡＴＡパワーセーブモードに対応していないホスト２０とＳＡＴＡバス３０を介して接続されている場合、ＨＤＤ１０がＳＡＴＡパワーセーブモードの制御を実行することは無駄である。
そこで本実施形態では、ホスト２０から指示されたＳＡＴＡパワーセーブモードへの移行不能の応答が返された場合、つまりＳＡＴＡパワーセーブモードの制御に失敗した場合、ＨＤＤ１０内のＣＰＵ１３０は、バッアァＲＡＭ１２０内のフラグ記憶領域１２０ａに記憶されているＳＡＴＡパワーセーブ不可フラグＦをＯＮ状態にする（ステップＳ９，Ｓ１０）。これにより、次にＳＡＴＡパワーセーブモードの制御が必要となった場合、ＣＰＵ１３０はＳＡＴＡパワーセーブ不可フラグＦの状態を参照することで、ＳＡＴＡパワーセーブが不可であるか否かを判定することができる（ステップＳ５，Ｓ６）。ＳＡＴＡパワーセーブ不可フラグＦがＯＮ状態にある場合、ＣＰＵ１３０はＳＡＴＡパワーセーブが不可であると判定する。この場合、ＣＰＵ１３０はＳＡＴＡパワーセーブモードの制御の実行（ステップＳ７，Ｓ８）を控える。これにより、ホスト２０のＳＡＴＡインタフェース制御回路２２がＳＡＴＡパワーセーブモードに対応していないにも拘わらずに、不要なＳＡＴＡパワーセーブモードの状態遷移のための制御が行われることを防止でき、シリアルＡＴＡバス３０の動作を安定させることができる。
ＨＤＤ１０及びホスト２０の双方がＳＡＴＡパワーセーブモードに対応している場合、ホスト２０側から（つまりホスト２０の主導により）ＳＡＴＡパワーセーブモードを制御することも可能である。しかし、ＨＤＤ１０内では、ホスト２０からのＡＴＡパワーセーブ系のコマンドとは別に自律的にＡＴＡパワーセーブモードへの状態遷移が行われている。したがって、このＨＤＤ１０内のＡＴＡパワーセーブモードに無関係にホスト２０側からＳＡＴＡバス３０のＳＡＴＡパワーセーブモードを制御するよりも、上記実施形態のようにＨＤＤ１０内のＡＴＡパワーセーブモードに連動させてＨＤＤ１０側からＳＡＴＡバス３０のＳＡＴＡパワーセーブモードを制御する方が、ＨＤＤ１０内のＡＴＡパワーセーブモードに適したＳＡＴＡパワーセーブモードを設定することができる。
上記実施形態では、本発明をＨＤＤ（磁気ディスクドライブ）を備えたシステムに適用した場合について説明した。しかし本発明は、光ディスクドライブ、光磁気ディスクドライブなどＨＤＤ以外のディスクドライブを備えたシステム、更にはディスクドライブ以外の電子機器を備えたシステムでも、ＳＡＴＡインタフェースを持つ電子機器を備えたシステムであれば、適用可能である。
なお、本発明は、上記実施形態そのままに限定されるものではなく、実施段階ではその要旨を逸脱しない範囲で構成要素を変形して具体化できる。また、上記実施形態に開示されている複数の構成要素の適宜な組み合せにより種々の発明を形成できる。例えば、実施形態に示される全構成要素から幾つかの構成要素を削除してもよい。
本発明の一実施形態に係る磁気ディスクドライブ（ＨＤＤ）１０を備えたシステムの構成を示すブロック図。 図１中のＨＤＤ１０に含まれているＨＤＤ本体１１の構成を示すブロック図。 同実施形態で適用されるＡＴＡパワーセーブモードの状態遷移を示す図。 図３中の各ＡＴＡパワーセーブモードと当該各ＡＴＡパワーセーブモードにおけるＨＤＤ本体１１内の各回路の電源ＯＦＦ状態との対応関係を示す図。 図３中の各ＡＴＡパワーセーブモード（Ｍ１〜Ｍ５）からリード／ライトモードＭ０に復帰するのに要する時間の一例を示す図。 図３中の各ＡＴＡパワーセーブモードと、ＨＤＤ１０が当該モードに設定された場合に設定されるＳＡＴＡパワーセーブモードとの関係を示す図。 ＨＤＤ１０内のＨＤＤ本体１１においてホスト２０からのコマンドを受信した場合に行われるパワー制御の手順を示すフローチャート。 同実施形態の変形例で適用されるＳＡＴＡパワーセーブモードの状態遷移を示す図。
符号の説明
１０…ＨＤＤ（磁気ディスクドライブ、電子機器）、１１…ＨＤＤ本体、１２，２２…ＳＡＴＡインタフェース制御回路（シリアルＡＴＡインタフェース制御回路）、１３，２３…ＡＴＡバス、２０…ホスト、２１…ホスト本体、３０…ＳＡＴＡバス（シリアルＡＴＡバス）、１１１…ディスク、１１２…ヘッド、１１３…ＳＰＭ（スピンドルモータ）、１１６…モータドライバ、１１７…ヘッドＩＣ、１１８…リード／ライトＩＣ、１１９…ＨＤＣ（ディスクコントローラ）、１１９ａ…ステータスレジスタ、１２０…バッアァＲＡＭ、１２０ａ…フラグ記憶領域、１２０ｂ…コマンド受信時刻記憶領域、１３０…ＣＰＵ。

Claims (11)

  1. ホストとシリアルＡＴＡバスを介して接続される、シリアルＡＴＡインタフェースを持つ電子機器において、
    ホストから出力された電子機器を第１のパワーセーブモードに設定することを指定するコマンドを受信する受信手段と、
    前記コマンドの受信の後、前記第１のパワーセーブモードに対応付けられたシリアルＡＴＡインタフェースの第２のパワーセーブモードの設定を制御する制御手段と
    を具備することを特徴とするシリアルＡＴＡインタフェースを持つ電子機器。
  2. 前記第１のパワーセーブモードを指定するコマンドがＡＴＡインタフェース規格で定められたスリープコマンド、スタンバイコマンドまたはアイドルコマンドであり、
    前記第２のパワーセーブモードがスランバモードまたはパーシャルモードである
    ことを特徴とする請求項１記載のシリアルＡＴＡインタフェースを持つ電子機器。
  3. 前記制御手段による前記制御に基づいて、前記ホスト側がシリアルＡＴＡインタフェースのパワーセーブ機能をサポートしているか否かを検出する手段と、
    前記検出結果を示すフラグ情報を記憶する手段とを更に具備し、
    前記制御手段は、前記制御の前に前記フラグ情報を参照し、当該フラグ情報により前記ホスト側が前記シリアルＡＴＡインタフェースのパワーセーブ機能をサポートしていないことが検出された場合、前記制御を控えることを特徴とする請求項１記載のシリアルＡＴＡインタフェースを持つ電子機器。
  4. 前記シリアルＡＴＡインタフェースがアイドルモード、またはパワーセーブモードの１つであるパーシャルモードに移行する毎に予め設定された一定時間を計測するための時間計測を開始する計測手段と、
    前記計測手段により前記一定時間が計測されているときに前記ホストからのコマンドが受信されなかった場合に、前記シリアルＡＴＡインタフェースを、前記アイドルモードまたはパーシャルモードから、それぞれパーシャルモードまたはスランバモードに移行する移行手段と
    を更に具備することを特徴とする請求項１記載のシリアルＡＴＡインタフェースを持つ電子機器。
  5. 前記電子機器はディスクドライブを備える
    ことを特徴とする請求項１乃至４のいずれかに記載のシリアルＡＴＡインタフェースを持つ電子機器。
  6. ホストとシリアルＡＴＡバスを介して接続される、シリアルＡＴＡインタフェースを持つ電子機器に設けられたコントローラにおいて、
    ホストから出力された電子機器を第１のパワーセーブモードに設定することを指定するコマンドを受信する受信手段と、
    前記コマンドの受信の後、前記第１のパワーセーブモードに対応付けられたシリアルＡＴＡインタフェースの第２のパワーセーブモードの設定を制御する制御手段と
    を具備することを特徴とするコントローラ。
  7. 前記第１のパワーセーブモードを指定するコマンドがＡＴＡインタフェース規格で定められたスリープコマンド、スタンバイコマンドまたはアイドルコマンドであり、
    前記第２のパワーセーブモードがスランバモードまたはパーシャルモードである
    ことを特徴とする請求項６記載のコントローラ。
  8. 前記請求項１に記載の電子機器と、
    前記電子機器を利用するホストと、
    前記電子機器と前記ホストが接続されるシリアルＡＴＡバスと
    を具備することを特徴とする情報機器。
  9. 前記第１のパワーセーブモードを指定するコマンドがＡＴＡインタフェース規格で定められたスリープコマンド、スタンバイコマンドまたはアイドルコマンドであり、
    前記第２のパワーセーブモードがスランバモードまたはパーシャルモードである
    ことを特徴とする請求項８記載の情報機器。
  10. ホストとシリアルＡＴＡバスを介して接続される、シリアルＡＴＡインタフェースを持つ電子機器におけるシリアルＡＴＡバスのパワーセーブ方法であって、
    ホストから出力された電子機器を第１のパワーセーブモードに設定することを指定するコマンドを受信するステップと、
    前記コマンドの受信の後、前記第１のパワーセーブモードに対応付けられたシリアルＡＴＡインタフェースの第２のパワーセーブモードを設定するステップと
    を具備することを特徴とするシリアルＡＴＡバスのパワーセーブ方法。
  11. 前記第１のパワーセーブモードを指定するコマンドがＡＴＡインタフェース規格で定められたスリープコマンド、スタンバイコマンドまたはアイドルコマンドであり、
    前記第２のパワーセーブモードがスランバモードまたはパーシャルモードである
    ことを特徴とする請求項１０記載のシリアルＡＴＡバスのパワーセーブ方法。
JP2003310361A 2003-09-02 2003-09-02 シリアルａｔａインタフェースを持つ電子機器及びシリアルａｔａバスのパワーセーブ方法 Expired - Lifetime JP4371739B2 (ja)

Priority Applications (18)

Application Number Priority Date Filing Date Title
JP2003310361A JP4371739B2 (ja) 2003-09-02 2003-09-02 シリアルａｔａインタフェースを持つ電子機器及びシリアルａｔａバスのパワーセーブ方法
SG200503835A SG113619A1 (en) 2003-09-02 2004-08-20 Electronic device with serial ata interface and power saving method for serial ata buses
SG200404527A SG109565A1 (en) 2003-09-02 2004-08-20 Electronic device with serial ata interface and power saving method for serial ata buses
US10/931,949 US7328356B2 (en) 2003-09-02 2004-09-01 Apparatus and method for saving power in a disk drive with a serial ATA interface connected to a host via a serial ATA bus
CNB200410068692XA CN1296799C (zh) 2003-09-02 2004-09-02 串行at嵌入式接口电子设备及串行at嵌入式总线节能方法
US11/956,996 US7747885B2 (en) 2003-09-02 2007-12-14 Electronic device with serial ATA interface and power saving method for serial ATA buses
US12/398,556 US7882378B2 (en) 2003-09-02 2009-03-05 Electronic device with serial ATA interface and power saving method for serial ATA buses
US12/398,499 US7797562B2 (en) 2003-09-02 2009-03-05 Electronic device with serial ATA interface and power saving method for serial ATA buses
US12/398,544 US7809967B2 (en) 2003-09-02 2009-03-05 Electronic device with serial ATA interface and power saving method for serial ATA buses
US12/398,585 US7770041B2 (en) 2003-09-02 2009-03-05 Electronic device with serial ATA interface and power saving method for serial ATA buses
US12/398,524 US20090177905A1 (en) 2003-09-02 2009-03-05 Electronic device with serial ata interface and power saving method for serial ata buses
US12/398,513 US8219837B2 (en) 2003-09-02 2009-03-05 Electronic device and power saving method using predetermined command to designate portion of device in power saving mode
US12/398,569 US7856565B2 (en) 2003-09-02 2009-03-05 Electronic device with serial ATA interface and power saving method for serial ATA buses
US12/398,530 US20090172312A1 (en) 2003-09-02 2009-03-05 Electronic device with serial ata interface and power saving method for serial ata buses
US12/398,576 US7856567B2 (en) 2003-09-02 2009-03-05 Electronic device with serial ATA interface and power saving method for serial ATA buses
US12/879,332 US8732502B2 (en) 2003-09-02 2010-09-10 Electronic device with serial ATA interface and power saving method for serial ATA buses
US15/160,846 USRE47050E1 (en) 2003-09-02 2016-05-20 Electronic device with serial ATA interference and power saving method for serial ATA buses
US15/837,317 USRE48190E1 (en) 2003-09-02 2017-12-11 Electronic device with serial ATA interface and power saving method for serial ATA buses

Applications Claiming Priority (1)

Application Number Priority Date Filing Date Title
JP2003310361A JP4371739B2 (ja) 2003-09-02 2003-09-02 シリアルａｔａインタフェースを持つ電子機器及びシリアルａｔａバスのパワーセーブ方法

Related Child Applications (10)

Application Number Title Priority Date Filing Date
JP2008248669A Division JP4327893B2 (ja) 2008-09-26 2008-09-26 シリアルａｔａインタフェースを持つ電子機器
JP2009009225A Division JP2009080856A (ja) 2009-01-19 2009-01-19 シリアルａｔａインタフェースを持つ電子機器
JP2009009229A Division JP4405576B2 (ja) 2009-01-19 2009-01-19 シリアルａｔａインタフェースを持つ電子機器
JP2009009226A Division JP4410298B2 (ja) 2009-01-19 2009-01-19 シリアルａｔａインタフェースを持つ電子機器
JP2009009232A Division JP4405578B2 (ja) 2009-01-19 2009-01-19 シリアルａｔａインタフェースを持つ電子機器
JP2009009228A Division JP4352100B2 (ja) 2009-01-19 2009-01-19 シリアルａｔａインタフェースを持つ電子機器
JP2009009227A Division JP4352099B2 (ja) 2009-01-19 2009-01-19 シリアルａｔａインタフェースを持つ電子機器
JP2009009231A Division JP4405577B2 (ja) 2009-01-19 2009-01-19 シリアルａｔａインタフェースを持つ電子機器
JP2009009230A Division JP4435260B2 (ja) 2009-01-19 2009-01-19 シリアルａｔａインタフェースを持つ電子機器
JP2009009224A Division JP4374070B2 (ja) 2009-01-19 2009-01-19 シリアルａｔａインタフェースを持つ電子機器

Publications (2)

Publication Number Publication Date
JP2005078514A JP2005078514A (ja) 2005-03-24
JP4371739B2 true JP4371739B2 (ja) 2009-11-25

Family

ID=34412255

Family Applications (1)

Application Number Title Priority Date Filing Date
JP2003310361A Expired - Lifetime JP4371739B2 (ja) 2003-09-02 2003-09-02 シリアルａｔａインタフェースを持つ電子機器及びシリアルａｔａバスのパワーセーブ方法

Country Status (4)

Country Link
US (14) US7328356B2 (ja)
JP (1) JP4371739B2 (ja)
CN (1) CN1296799C (ja)
SG (2) SG109565A1 (ja)

Families Citing this family (120)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
US7885282B2 (en) * 2003-07-24 2011-02-08 Seagate Technology Llc Dynamic control of physical layer quality on a serial bus
JP4371739B2 (ja) * 2003-09-02 2009-11-25 株式会社東芝 シリアルａｔａインタフェースを持つ電子機器及びシリアルａｔａバスのパワーセーブ方法
US20050138441A1 (en) * 2003-12-19 2005-06-23 Huffman Amber D. Power management without interrupt latency
US7783802B1 (en) * 2004-02-09 2010-08-24 Lsi Corporation Serial advanced technology attachment (SATA) switch that toggles with power control to hard disk drive while avolding interruption to system
JP2005339135A (ja) * 2004-05-26 2005-12-08 Toshiba Corp シリアルａｔａインタフェースを持つ電子機器及び同機器におけるパワーセーブ制御方法
JP2006099665A (ja) * 2004-09-30 2006-04-13 Hitachi Global Storage Technologies Netherlands Bv データ記憶装置及びそのシリアル・インターフェース部のパワー・セーブ・モードの制御方法
US20060069930A1 (en) * 2004-09-30 2006-03-30 Seagate Technology Llc Bus architecture with reduced power mode during an access time
JP4614967B2 (ja) * 2004-10-22 2011-01-19 パナソニック株式会社 外部記憶装置およびその電源管理方法
JP2006139459A (ja) * 2004-11-11 2006-06-01 Hitachi Global Storage Technologies Netherlands Bv メディア・ドライブ及びそのパワー・セーブ方法
JP2006164012A (ja) * 2004-12-09 2006-06-22 Hitachi Global Storage Technologies Netherlands Bv データ記憶装置及びそのパワー・セーブ・モードの制御方法
JP4295204B2 (ja) * 2004-12-16 2009-07-15 インターナショナル・ビジネス・マシーンズ・コーポレーション 磁気ディスク装置の電力制御方法、プログラム、電力制御装置、および電子情報機器
JP2007012136A (ja) * 2005-06-29 2007-01-18 Toshiba Corp 映像表示装置とその記録媒体の記録再生制御方法
JP2007026125A (ja) * 2005-07-19 2007-02-01 Hitachi Ltd 記録再生装置
JP2007034537A (ja) * 2005-07-25 2007-02-08 Sony Corp 複合型記憶装置、データ書込方法及びプログラム
KR101205324B1 (ko) 2005-11-25 2012-11-28 삼성전자주식회사 직렬 인터페이스 방식을 갖는 시스템의 전력을 제어하는방법
JP4983033B2 (ja) * 2006-02-08 2012-07-25 ソニー株式会社 通信装置および方法、並びにプログラム
JP4897387B2 (ja) * 2006-08-10 2012-03-14 株式会社日立製作所 ストレージ装置およびこれを用いたデータの管理方法
JP2008071047A (ja) * 2006-09-13 2008-03-27 Kwok-Yan Leung ディスクインターフェースカード
KR100914932B1 (ko) * 2007-01-30 2009-08-31 삼성전자주식회사 Ｓａｔａ 인터페이스에서의 파워 세이빙 모드 제어 방법
US7925799B2 (en) 2007-04-27 2011-04-12 Ricoh Company, Ltd. Serial ATA interface control circuit and power management method wherein start and completion of data transfer is monitored during DMA operations using memory control unit
JP2008293476A (ja) * 2007-04-27 2008-12-04 Ricoh Co Ltd インターフェース制御回路、画像処理装置および電力管理方法
JP2008276691A (ja) * 2007-05-07 2008-11-13 Kwok-Yan Leung ハードディスクインターフェースを模擬したインターフェースカード
WO2009060503A1 (ja) * 2007-11-05 2009-05-14 Pioneer Corporation 情報記憶装置、情報記録再生装置、及び消費電力管理方法
US8032690B2 (en) * 2008-02-01 2011-10-04 Skymedi Corporation Non-volatile memory device, and method of accessing a non-volatile memory device
US8051314B2 (en) * 2008-06-25 2011-11-01 Intel Corporation Serial ATA (SATA) power optimization through automatic deeper power state transition
US8364992B2 (en) * 2008-11-25 2013-01-29 Hgst, Netherlands B.V. Method and system for reducing power consumption by command selection in a hard disk drive
JP2010152853A (ja) * 2008-12-26 2010-07-08 Toshiba Corp データ記憶装置
JP4840786B2 (ja) * 2009-02-04 2011-12-21 東芝ストレージデバイス株式会社 通信インタフェース回路、電子機器および通信方法
US8478928B2 (en) 2009-04-23 2013-07-02 Samsung Electronics Co., Ltd. Data storage device and information processing system incorporating data storage device
US8918663B2 (en) 2009-06-07 2014-12-23 Hewlett-Packard Development Company, L.P. Method for active power management in a Serial ATA interface to operate at most a predetermined rate upon a refused speed request
US8245064B2 (en) * 2009-06-16 2012-08-14 Seagate Technology Llc Power conservation during a power mode transition
JP5355337B2 (ja) * 2009-10-06 2013-11-27 キヤノン株式会社 情報処理装置、情報処理装置の電源制御方法
JP5574701B2 (ja) * 2009-12-28 2014-08-20 キヤノン株式会社 データ処理装置及びデータ処理装置を制御するためのプログラム
WO2011098657A1 (en) * 2010-02-12 2011-08-18 Nokia Corporation Method and apparatus for reporting of measurement data
US8417979B2 (en) * 2010-12-23 2013-04-09 Western Digital Technologies, Inc. Method and system for progressive power reduction of inactive device while maintaining ready status with host
KR101747797B1 (ko) 2011-01-26 2017-06-15 삼성전자주식회사 사타 인터페이스 및 그것의 전원 관리 방법
US8443221B2 (en) * 2011-03-04 2013-05-14 Sandisk Technologies Inc. Methods, systems, and computer readable media for advanced power management for serial advanced technology attachment (SATA)-based storage devices
US8745282B2 (en) * 2011-06-08 2014-06-03 Lsi Corporation Concurrent response for device information during an initialization process for a storage device
US8700850B1 (en) 2011-06-24 2014-04-15 Western Digital Technologies, Inc. Data storage device evaluating a SATA connector to detect a non-SATA host
US9158722B1 (en) 2011-11-02 2015-10-13 Western Digital Technologies, Inc. Data storage device to communicate with a host in a SATA or a USB mode
US9778720B2 (en) * 2011-12-30 2017-10-03 Intel Corporation PCIE device power state control
JP5843656B2 (ja) 2012-02-24 2016-01-13 三菱電機株式会社 情報処理装置及び情報処理方法
US9116694B2 (en) * 2012-09-26 2015-08-25 Intel Corporation Efficient low power exit sequence for peripheral devices
US20140223213A1 (en) * 2013-02-05 2014-08-07 Kabushiki Kaisha Toshiba Memory system
US9141299B2 (en) * 2013-03-14 2015-09-22 Intel Corporation Method for reducing power consumption in solid-state storage device
KR102094902B1 (ko) 2013-07-08 2020-03-30 삼성전자주식회사 액티브 상태에서 인터페이스 모드를 전환하는 스토리지 시스템 및 ufs 시스템
TWI512456B (zh) * 2013-12-09 2015-12-11 Silicon Motion Inc 睡眠模式量測方法
TW201533657A (zh) * 2014-02-18 2015-09-01 Toshiba Kk 資訊處理系統及記憶體系統
CN105446653B (zh) 2014-08-27 2018-12-14 阿里巴巴集团控股有限公司 一种数据合并方法和设备
KR102482527B1 (ko) 2015-12-18 2022-12-29 삼성전자주식회사 시리얼 인터페이스를 사용하는 저장 장치의 작동 방법과 이를 포함하는 데이터 처리 시스템의 작동 방법
US10394310B2 (en) * 2016-06-06 2019-08-27 Dell Products, Lp System and method for sleeping states using non-volatile memory components
US10564700B2 (en) 2016-07-22 2020-02-18 Canon Kabushiki Kaisha Image forming apparatus and power control method for image forming apparatus
JP6779687B2 (ja) 2016-07-25 2020-11-04 キヤノン株式会社 電子機器及び電子機器の制御方法
JP6849513B2 (ja) * 2016-07-25 2021-03-24 キヤノン株式会社 電子機器及び電子機器の制御方法
EP3429128B1 (en) * 2017-05-15 2022-04-06 xFusion Digital Technologies Co., Ltd. Hard drive operation method and hard drive manager
US10359954B2 (en) 2017-05-31 2019-07-23 Alibaba Group Holding Limited Method and system for implementing byte-alterable write cache
US10884926B2 (en) 2017-06-16 2021-01-05 Alibaba Group Holding Limited Method and system for distributed storage using client-side global persistent cache
US10303241B2 (en) * 2017-06-19 2019-05-28 Alibaba Group Holding Limited System and method for fine-grained power control management in a high capacity computer cluster
US10678443B2 (en) 2017-07-06 2020-06-09 Alibaba Group Holding Limited Method and system for high-density converged storage via memory bus
US10564856B2 (en) 2017-07-06 2020-02-18 Alibaba Group Holding Limited Method and system for mitigating write amplification in a phase change memory-based storage device
US10303601B2 (en) 2017-08-11 2019-05-28 Alibaba Group Holding Limited Method and system for rearranging a write operation in a shingled magnetic recording device
US10423508B2 (en) 2017-08-11 2019-09-24 Alibaba Group Holding Limited Method and system for a high-priority read based on an in-place suspend/resume write
US10496829B2 (en) 2017-09-15 2019-12-03 Alibaba Group Holding Limited Method and system for data destruction in a phase change memory-based storage device
US10642522B2 (en) 2017-09-15 2020-05-05 Alibaba Group Holding Limited Method and system for in-line deduplication in a storage drive based on a non-collision hash
US10503409B2 (en) 2017-09-27 2019-12-10 Alibaba Group Holding Limited Low-latency lightweight distributed storage system
US10789011B2 (en) 2017-09-27 2020-09-29 Alibaba Group Holding Limited Performance enhancement of a storage device using an integrated controller-buffer
US10860334B2 (en) 2017-10-25 2020-12-08 Alibaba Group Holding Limited System and method for centralized boot storage in an access switch shared by multiple servers
US10445190B2 (en) 2017-11-08 2019-10-15 Alibaba Group Holding Limited Method and system for enhancing backup efficiency by bypassing encoding and decoding
US10877898B2 (en) 2017-11-16 2020-12-29 Alibaba Group Holding Limited Method and system for enhancing flash translation layer mapping flexibility for performance and lifespan improvements
JP7022605B2 (ja) * 2018-01-26 2022-02-18 キヤノン株式会社 情報処理装置とその制御方法、及びプログラム
US10496548B2 (en) 2018-02-07 2019-12-03 Alibaba Group Holding Limited Method and system for user-space storage I/O stack with user-space flash translation layer
US10891239B2 (en) 2018-02-07 2021-01-12 Alibaba Group Holding Limited Method and system for operating NAND flash physical space to extend memory capacity
US10831404B2 (en) 2018-02-08 2020-11-10 Alibaba Group Holding Limited Method and system for facilitating high-capacity shared memory using DIMM from retired servers
US10402112B1 (en) 2018-02-14 2019-09-03 Alibaba Group Holding Limited Method and system for chunk-wide data organization and placement with real-time calculation
US11379155B2 (en) 2018-05-24 2022-07-05 Alibaba Group Holding Limited System and method for flash storage management using multiple open page stripes
US10921992B2 (en) 2018-06-25 2021-02-16 Alibaba Group Holding Limited Method and system for data placement in a hard disk drive based on access frequency for improved IOPS and utilization efficiency
US11816043B2 (en) 2018-06-25 2023-11-14 Alibaba Group Holding Limited System and method for managing resources of a storage device and quantifying the cost of I/O requests
US10871921B2 (en) 2018-07-30 2020-12-22 Alibaba Group Holding Limited Method and system for facilitating atomicity assurance on metadata and data bundled storage
US10996886B2 (en) 2018-08-02 2021-05-04 Alibaba Group Holding Limited Method and system for facilitating atomicity and latency assurance on variable sized I/O
US10747673B2 (en) 2018-08-02 2020-08-18 Alibaba Group Holding Limited System and method for facilitating cluster-level cache and memory space
US11327929B2 (en) 2018-09-17 2022-05-10 Alibaba Group Holding Limited Method and system for reduced data movement compression using in-storage computing and a customized file system
US10852948B2 (en) 2018-10-19 2020-12-01 Alibaba Group Holding System and method for data organization in shingled magnetic recording drive
US10795586B2 (en) 2018-11-19 2020-10-06 Alibaba Group Holding Limited System and method for optimization of global data placement to mitigate wear-out of write cache and NAND flash
US10769018B2 (en) 2018-12-04 2020-09-08 Alibaba Group Holding Limited System and method for handling uncorrectable data errors in high-capacity storage
US10884654B2 (en) 2018-12-31 2021-01-05 Alibaba Group Holding Limited System and method for quality of service assurance of multi-stream scenarios in a hard disk drive
US10977122B2 (en) 2018-12-31 2021-04-13 Alibaba Group Holding Limited System and method for facilitating differentiated error correction in high-density flash devices
US11061735B2 (en) 2019-01-02 2021-07-13 Alibaba Group Holding Limited System and method for offloading computation to storage nodes in distributed system
US11132291B2 (en) 2019-01-04 2021-09-28 Alibaba Group Holding Limited System and method of FPGA-executed flash translation layer in multiple solid state drives
US11200337B2 (en) 2019-02-11 2021-12-14 Alibaba Group Holding Limited System and method for user data isolation
US10922234B2 (en) 2019-04-11 2021-02-16 Alibaba Group Holding Limited Method and system for online recovery of logical-to-physical mapping table affected by noise sources in a solid state drive
US10908960B2 (en) 2019-04-16 2021-02-02 Alibaba Group Holding Limited Resource allocation based on comprehensive I/O monitoring in a distributed storage system
US11169873B2 (en) 2019-05-21 2021-11-09 Alibaba Group Holding Limited Method and system for extending lifespan and enhancing throughput in a high-density solid state drive
US10860223B1 (en) 2019-07-18 2020-12-08 Alibaba Group Holding Limited Method and system for enhancing a distributed storage system by decoupling computation and network tasks
US11126561B2 (en) 2019-10-01 2021-09-21 Alibaba Group Holding Limited Method and system for organizing NAND blocks and placing data to facilitate high-throughput for random writes in a solid state drive
US11042307B1 (en) 2020-01-13 2021-06-22 Alibaba Group Holding Limited System and method for facilitating improved utilization of NAND flash based on page-wise operation
US11449455B2 (en) 2020-01-15 2022-09-20 Alibaba Group Holding Limited Method and system for facilitating a high-capacity object storage system with configuration agility and mixed deployment flexibility
US10872622B1 (en) 2020-02-19 2020-12-22 Alibaba Group Holding Limited Method and system for deploying mixed storage products on a uniform storage infrastructure
US10923156B1 (en) 2020-02-19 2021-02-16 Alibaba Group Holding Limited Method and system for facilitating low-cost high-throughput storage for accessing large-size I/O blocks in a hard disk drive
US11150986B2 (en) 2020-02-26 2021-10-19 Alibaba Group Holding Limited Efficient compaction on log-structured distributed file system using erasure coding for resource consumption reduction
US11144250B2 (en) 2020-03-13 2021-10-12 Alibaba Group Holding Limited Method and system for facilitating a persistent memory-centric system
US11200114B2 (en) 2020-03-17 2021-12-14 Alibaba Group Holding Limited System and method for facilitating elastic error correction code in memory
US11385833B2 (en) 2020-04-20 2022-07-12 Alibaba Group Holding Limited Method and system for facilitating a light-weight garbage collection with a reduced utilization of resources
US11281575B2 (en) 2020-05-11 2022-03-22 Alibaba Group Holding Limited Method and system for facilitating data placement and control of physical addresses with multi-queue I/O blocks
US11461262B2 (en) 2020-05-13 2022-10-04 Alibaba Group Holding Limited Method and system for facilitating a converged computation and storage node in a distributed storage system
US11494115B2 (en) 2020-05-13 2022-11-08 Alibaba Group Holding Limited System method for facilitating memory media as file storage device based on real-time hashing by performing integrity check with a cyclical redundancy check (CRC)
US11218165B2 (en) 2020-05-15 2022-01-04 Alibaba Group Holding Limited Memory-mapped two-dimensional error correction code for multi-bit error tolerance in DRAM
US11507499B2 (en) 2020-05-19 2022-11-22 Alibaba Group Holding Limited System and method for facilitating mitigation of read/write amplification in data compression
US11556277B2 (en) 2020-05-19 2023-01-17 Alibaba Group Holding Limited System and method for facilitating improved performance in ordering key-value storage with input/output stack simplification
US11263132B2 (en) 2020-06-11 2022-03-01 Alibaba Group Holding Limited Method and system for facilitating log-structure data organization
US11422931B2 (en) 2020-06-17 2022-08-23 Alibaba Group Holding Limited Method and system for facilitating a physically isolated storage unit for multi-tenancy virtualization
US11354200B2 (en) 2020-06-17 2022-06-07 Alibaba Group Holding Limited Method and system for facilitating data recovery and version rollback in a storage device
US11354233B2 (en) 2020-07-27 2022-06-07 Alibaba Group Holding Limited Method and system for facilitating fast crash recovery in a storage device
US11372774B2 (en) 2020-08-24 2022-06-28 Alibaba Group Holding Limited Method and system for a solid state drive with on-chip memory integration
JP6992142B2 (ja) * 2020-10-13 2022-01-13 キヤノン株式会社 電子機器及び電子機器の制御方法
US11487465B2 (en) 2020-12-11 2022-11-01 Alibaba Group Holding Limited Method and system for a local storage engine collaborating with a solid state drive controller
US11734115B2 (en) 2020-12-28 2023-08-22 Alibaba Group Holding Limited Method and system for facilitating write latency reduction in a queue depth of one scenario
US11416365B2 (en) 2020-12-30 2022-08-16 Alibaba Group Holding Limited Method and system for open NAND block detection and correction in an open-channel SSD
US11726699B2 (en) 2021-03-30 2023-08-15 Alibaba Singapore Holding Private Limited Method and system for facilitating multi-stream sequential read performance improvement with reduced read amplification
US11461173B1 (en) 2021-04-21 2022-10-04 Alibaba Singapore Holding Private Limited Method and system for facilitating efficient data compression based on error correction code and reorganization of data placement
US11476874B1 (en) 2021-05-14 2022-10-18 Alibaba Singapore Holding Private Limited Method and system for facilitating a storage server with hybrid memory for journaling and data storage

Family Cites Families (36)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
US730989A (en) * 1902-10-30 1903-06-16 Dayve Boris De Waltoff Dispensing apparatus.
JPH0640734Y2 (ja) 1990-01-19 1994-10-26 日本碍子株式会社 壁パネルの雨仕舞構造
JP2586188B2 (ja) 1990-07-19 1997-02-26 三菱電機株式会社 光ディスク装置
US5517649A (en) * 1994-04-19 1996-05-14 Maxtor Corporation Adaptive power management for hard disk drives
JP2986048B2 (ja) 1994-04-26 1999-12-06 インターナショナル・ビジネス・マシーンズ・コーポレイション コンピュータ・システムに装着可能な拡張デバイス、拡張デバイスの制御方法及び拡張デバイスを有するコンピュータ・システムの制御方法
US5481733A (en) * 1994-06-15 1996-01-02 Panasonic Technologies, Inc. Method for managing the power distributed to a disk drive in a laptop computer
CN1075895C (zh) * 1994-12-27 2001-12-05 联华电子股份有限公司 直接由pcmcia接口支持硬盘/光盘机信号的控制电路及方法
JPH08335357A (ja) 1995-06-08 1996-12-17 Fujitsu Ltd 記憶装置
US5682273A (en) * 1995-06-30 1997-10-28 International Business Machines Corporation Disk drive for portable computer with adaptive demand-driven power management
JPH0950350A (ja) 1995-08-07 1997-02-18 Fujitsu Ltd 記憶装置
JPH11212687A (ja) 1998-01-26 1999-08-06 Fujitsu Ltd バス制御装置
US7016595B1 (en) * 1999-05-28 2006-03-21 Nikon Corporation Television set capable of controlling external device and image storage controlled by television set
KR100490934B1 (ko) 1999-08-25 2005-05-27 시게이트 테크놀로지 엘엘씨 디스크 드라이브의 지능형 파워 관리
JP2001135009A (ja) 1999-11-04 2001-05-18 Hitachi Ltd 光ディスク装置およびその制御方法
JP3490037B2 (ja) * 1999-12-27 2004-01-26 Ｎｅｃマイクロシステム株式会社 コマンドパケット自動受信シーケンス回路
US6725385B1 (en) 2000-09-11 2004-04-20 International Business Machines Corporation Intelligent electronic power controller
US7069456B2 (en) * 2000-12-28 2006-06-27 Intel Corporation Method and apparatus facilitating direct access to a serial ATA device by an autonomous subsystem
CA2443781A1 (en) * 2001-04-24 2002-10-31 Innogenetics N.V. Core-glycosylated hcv envelope proteins
US6854045B2 (en) 2001-06-29 2005-02-08 Intel Corporation Hardware emulation of parallel ATA drives with serial ATA interface
JP2002117616A (ja) 2001-08-22 2002-04-19 Hitachi Ltd ディスク装置
US6845420B2 (en) * 2001-10-11 2005-01-18 International Business Machines Corporation System for supporting both serial and parallel storage devices on a connector
US7020834B2 (en) 2001-10-18 2006-03-28 Via Technologies, Inc. Circuit and signal encoding method for reducing the number of serial ATA external PHY signals
US20030135577A1 (en) 2001-12-19 2003-07-17 Weber Bret S. Dual porting serial ATA disk drives for fault tolerant applications
US20030158991A1 (en) 2002-02-01 2003-08-21 Klaus-Peter Deyring Transceiver circuitry for sending and detecting OOB signals on serial ATA buses
US6976190B1 (en) 2002-07-31 2005-12-13 Western Digital Technologies, Inc. Serial ATA disk drive having a parallel ATA test interface and method
KR200302586Y1 (ko) * 2002-10-08 2003-01-30 주식회사 민택기술 트랜스폰더
US20040083324A1 (en) * 2002-10-24 2004-04-29 Josef Rabinovitz Large array of mass data storage devices connected to a computer by a serial link
US7246192B1 (en) * 2003-01-10 2007-07-17 Marvell International Ltd. Serial/parallel ATA controller and converter
US7028199B2 (en) * 2003-06-25 2006-04-11 Lsi Logic Corporation Method and apparatus of automatic power management control for Serial ATA interface
US7254732B2 (en) 2003-06-25 2007-08-07 Lsi Corporation Method and apparatus of automatic power management control for serial ATA device directly attached to SAS/SATA host controller
US7010711B2 (en) 2003-06-25 2006-03-07 Lsi Logic Corporation Method and apparatus of automatic power management control for native command queuing Serial ATA device
US7330989B2 (en) 2003-06-25 2008-02-12 Lsi Logic Corporation Method and apparatus of automatic power management control for Serial ATA interface utilizing a combination of IOP control and specialized hardware control
JP2005056179A (ja) * 2003-08-05 2005-03-03 Toshiba Corp シリアルａｔａインタフェース持つ電子機器及び信号振幅調整方法
JP4371739B2 (ja) 2003-09-02 2009-11-25 株式会社東芝 シリアルａｔａインタフェースを持つ電子機器及びシリアルａｔａバスのパワーセーブ方法
TWI221256B (en) 2003-10-15 2004-09-21 Via Tech Inc Method and apparatus for driving a non-native SATA hard disk
JP4374070B2 (ja) 2009-01-19 2009-12-02 株式会社東芝 シリアルａｔａインタフェースを持つ電子機器

Also Published As

Publication number Publication date
US20090177905A1 (en) 2009-07-09
US20090172312A1 (en) 2009-07-02
USRE48190E1 (en) 2020-09-01
US7856567B2 (en) 2010-12-21
US20090172445A1 (en) 2009-07-02
SG109565A1 (en) 2005-03-30
US7882378B2 (en) 2011-02-01
US20090172446A1 (en) 2009-07-02
US8732502B2 (en) 2014-05-20
CN1296799C (zh) 2007-01-24
US7797562B2 (en) 2010-09-14
US20050235171A1 (en) 2005-10-20
JP2005078514A (ja) 2005-03-24
US7770041B2 (en) 2010-08-03
SG113619A1 (en) 2005-08-29
US20090172448A1 (en) 2009-07-02
US7809967B2 (en) 2010-10-05
US8219837B2 (en) 2012-07-10
US20090172313A1 (en) 2009-07-02
US20090172204A1 (en) 2009-07-02
US7747885B2 (en) 2010-06-29
US20090172447A1 (en) 2009-07-02
CN1624633A (zh) 2005-06-08
US7328356B2 (en) 2008-02-05
US7856565B2 (en) 2010-12-21
USRE47050E1 (en) 2018-09-18
US20080133951A1 (en) 2008-06-05
US20110010573A1 (en) 2011-01-13
US20090172209A1 (en) 2009-07-02

Similar Documents

Publication Publication Date Title
JP4371739B2 (ja) シリアルａｔａインタフェースを持つ電子機器及びシリアルａｔａバスのパワーセーブ方法
US20050144490A1 (en) Electronic device with serial ATA interface and power saving method for serial ATA buses
JP2006099665A (ja) データ記憶装置及びそのシリアル・インターフェース部のパワー・セーブ・モードの制御方法
US20140025979A1 (en) Interface device and interface method
JP4374070B2 (ja) シリアルａｔａインタフェースを持つ電子機器
JP4405577B2 (ja) シリアルａｔａインタフェースを持つ電子機器
JP4405578B2 (ja) シリアルａｔａインタフェースを持つ電子機器
JP4327893B2 (ja) シリアルａｔａインタフェースを持つ電子機器
JP4435260B2 (ja) シリアルａｔａインタフェースを持つ電子機器
JP4410298B2 (ja) シリアルａｔａインタフェースを持つ電子機器
JP4405576B2 (ja) シリアルａｔａインタフェースを持つ電子機器
JP4352099B2 (ja) シリアルａｔａインタフェースを持つ電子機器
JP4352100B2 (ja) シリアルａｔａインタフェースを持つ電子機器
JP2006099913A (ja) ディスク装置及びその制御方法
JP2009080856A (ja) シリアルａｔａインタフェースを持つ電子機器

Legal Events

Date Code Title Description
A621 Written request for application examination

Free format text: JAPANESE INTERMEDIATE CODE: A621

Effective date: 20051207

A977 Report on retrieval

Free format text: JAPANESE INTERMEDIATE CODE: A971007

Effective date: 20081114

A131 Notification of reasons for refusal

Free format text: JAPANESE INTERMEDIATE CODE: A131

Effective date: 20081118

A521 Request for written amendment filed

Free format text: JAPANESE INTERMEDIATE CODE: A523

Effective date: 20090119

A131 Notification of reasons for refusal

Free format text: JAPANESE INTERMEDIATE CODE: A131

Effective date: 20090519

A521 Request for written amendment filed

Free format text: JAPANESE INTERMEDIATE CODE: A523

Effective date: 20090714

TRDD Decision of grant or rejection written
A01 Written decision to grant a patent or to grant a registration (utility model)

Free format text: JAPANESE INTERMEDIATE CODE: A01

Effective date: 20090804

A01 Written decision to grant a patent or to grant a registration (utility model)

Free format text: JAPANESE INTERMEDIATE CODE: A01

A61 First payment of annual fees (during grant procedure)

Free format text: JAPANESE INTERMEDIATE CODE: A61

Effective date: 20090901

FPAY Renewal fee payment (event date is renewal date of database)

Free format text: PAYMENT UNTIL: 20120911

Year of fee payment: 3

R151 Written notification of patent or utility model registration

Ref document number: 4371739

Country of ref document: JP

Free format text: JAPANESE INTERMEDIATE CODE: R151

FPAY Renewal fee payment (event date is renewal date of database)

Free format text: PAYMENT UNTIL: 20120911

Year of fee payment: 3

FPAY Renewal fee payment (event date is renewal date of database)

Free format text: PAYMENT UNTIL: 20120911

Year of fee payment: 3

FPAY Renewal fee payment (event date is renewal date of database)

Free format text: PAYMENT UNTIL: 20130911

Year of fee payment: 4

EXPY Cancellation because of completion of term