JP3558449B2 - 電子部品構体 - Google Patents

電子部品構体 Download PDF

Info

Publication number
JP3558449B2
JP3558449B2 JP14692196A JP14692196A JP3558449B2 JP 3558449 B2 JP3558449 B2 JP 3558449B2 JP 14692196 A JP14692196 A JP 14692196A JP 14692196 A JP14692196 A JP 14692196A JP 3558449 B2 JP3558449 B2 JP 3558449B2
Authority
JP
Japan
Prior art keywords
semiconductor element
electrode
bump
bumps
inner lead
Prior art date
Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
Expired - Fee Related
Application number
JP14692196A
Other languages
English (en)
Other versions
JPH09330949A (ja
Inventor
法人 塚原
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
Panasonic Corp
Panasonic Holdings Corp
Original Assignee
Panasonic Corp
Matsushita Electric Industrial Co Ltd
Priority date (The priority date is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the date listed.)
Filing date
Publication date
Application filed by Panasonic Corp, Matsushita Electric Industrial Co Ltd filed Critical Panasonic Corp
Priority to JP14692196A priority Critical patent/JP3558449B2/ja
Priority to EP97924372A priority patent/EP0844656A4/en
Priority to US09/011,039 priority patent/US20020014685A1/en
Priority to PCT/JP1997/001990 priority patent/WO1997048131A1/ja
Priority to CN97190679A priority patent/CN1195423A/zh
Priority to KR1019980700848A priority patent/KR19990036180A/ko
Publication of JPH09330949A publication Critical patent/JPH09330949A/ja
Application granted granted Critical
Publication of JP3558449B2 publication Critical patent/JP3558449B2/ja
Anticipated expiration legal-status Critical
Expired - Fee Related legal-status Critical Current

Links

Images

Classifications

    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L24/00Arrangements for connecting or disconnecting semiconductor or solid-state bodies; Methods or apparatus related thereto
    • H01L24/80Methods for connecting semiconductor or other solid state bodies using means for bonding being attached to, or being formed on, the surface to be connected
    • H01L24/86Methods for connecting semiconductor or other solid state bodies using means for bonding being attached to, or being formed on, the surface to be connected using tape automated bonding [TAB]
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L21/00Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
    • H01L21/02Manufacture or treatment of semiconductor devices or of parts thereof
    • H01L21/04Manufacture or treatment of semiconductor devices or of parts thereof the devices having at least one potential-jump barrier or surface barrier, e.g. PN junction, depletion layer or carrier concentration layer
    • H01L21/50Assembly of semiconductor devices using processes or apparatus not provided for in a single one of the subgroups H01L21/06 - H01L21/326, e.g. sealing of a cap to a base of a container
    • H01L21/60Attaching or detaching leads or other conductive members, to be used for carrying current to or from the device in operation
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L24/00Arrangements for connecting or disconnecting semiconductor or solid-state bodies; Methods or apparatus related thereto
    • H01L24/01Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L24/10Bump connectors ; Manufacturing methods related thereto
    • H01L24/11Manufacturing methods
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L24/00Arrangements for connecting or disconnecting semiconductor or solid-state bodies; Methods or apparatus related thereto
    • H01L24/01Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L24/10Bump connectors ; Manufacturing methods related thereto
    • H01L24/12Structure, shape, material or disposition of the bump connectors prior to the connecting process
    • H01L24/13Structure, shape, material or disposition of the bump connectors prior to the connecting process of an individual bump connector
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L24/00Arrangements for connecting or disconnecting semiconductor or solid-state bodies; Methods or apparatus related thereto
    • H01L24/01Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L24/10Bump connectors ; Manufacturing methods related thereto
    • H01L24/12Structure, shape, material or disposition of the bump connectors prior to the connecting process
    • H01L24/14Structure, shape, material or disposition of the bump connectors prior to the connecting process of a plurality of bump connectors
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L24/00Arrangements for connecting or disconnecting semiconductor or solid-state bodies; Methods or apparatus related thereto
    • H01L24/01Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L24/10Bump connectors ; Manufacturing methods related thereto
    • H01L24/15Structure, shape, material or disposition of the bump connectors after the connecting process
    • H01L24/17Structure, shape, material or disposition of the bump connectors after the connecting process of a plurality of bump connectors
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L24/00Arrangements for connecting or disconnecting semiconductor or solid-state bodies; Methods or apparatus related thereto
    • H01L24/01Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L24/50Tape automated bonding [TAB] connectors, i.e. film carriers; Manufacturing methods related thereto
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/01Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L2224/02Bonding areas; Manufacturing methods related thereto
    • H01L2224/04Structure, shape, material or disposition of the bonding areas prior to the connecting process
    • H01L2224/05Structure, shape, material or disposition of the bonding areas prior to the connecting process of an individual bonding area
    • H01L2224/0554External layer
    • H01L2224/05573Single external layer
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/01Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L2224/10Bump connectors; Manufacturing methods related thereto
    • H01L2224/11Manufacturing methods
    • H01L2224/113Manufacturing methods by local deposition of the material of the bump connector
    • H01L2224/1133Manufacturing methods by local deposition of the material of the bump connector in solid form
    • H01L2224/1134Stud bumping, i.e. using a wire-bonding apparatus
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/01Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L2224/10Bump connectors; Manufacturing methods related thereto
    • H01L2224/11Manufacturing methods
    • H01L2224/118Post-treatment of the bump connector
    • H01L2224/1183Reworking, e.g. shaping
    • H01L2224/1184Reworking, e.g. shaping involving a mechanical process, e.g. planarising the bump connector
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/01Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L2224/10Bump connectors; Manufacturing methods related thereto
    • H01L2224/12Structure, shape, material or disposition of the bump connectors prior to the connecting process
    • H01L2224/13Structure, shape, material or disposition of the bump connectors prior to the connecting process of an individual bump connector
    • H01L2224/13001Core members of the bump connector
    • H01L2224/13075Plural core members
    • H01L2224/1308Plural core members being stacked
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/01Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L2224/10Bump connectors; Manufacturing methods related thereto
    • H01L2224/12Structure, shape, material or disposition of the bump connectors prior to the connecting process
    • H01L2224/13Structure, shape, material or disposition of the bump connectors prior to the connecting process of an individual bump connector
    • H01L2224/13001Core members of the bump connector
    • H01L2224/13075Plural core members
    • H01L2224/1308Plural core members being stacked
    • H01L2224/13082Two-layer arrangements
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/01Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L2224/10Bump connectors; Manufacturing methods related thereto
    • H01L2224/12Structure, shape, material or disposition of the bump connectors prior to the connecting process
    • H01L2224/13Structure, shape, material or disposition of the bump connectors prior to the connecting process of an individual bump connector
    • H01L2224/13001Core members of the bump connector
    • H01L2224/13099Material
    • H01L2224/131Material with a principal constituent of the material being a metal or a metalloid, e.g. boron [B], silicon [Si], germanium [Ge], arsenic [As], antimony [Sb], tellurium [Te] and polonium [Po], and alloys thereof
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/01Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L2224/10Bump connectors; Manufacturing methods related thereto
    • H01L2224/12Structure, shape, material or disposition of the bump connectors prior to the connecting process
    • H01L2224/13Structure, shape, material or disposition of the bump connectors prior to the connecting process of an individual bump connector
    • H01L2224/13001Core members of the bump connector
    • H01L2224/13099Material
    • H01L2224/131Material with a principal constituent of the material being a metal or a metalloid, e.g. boron [B], silicon [Si], germanium [Ge], arsenic [As], antimony [Sb], tellurium [Te] and polonium [Po], and alloys thereof
    • H01L2224/13117Material with a principal constituent of the material being a metal or a metalloid, e.g. boron [B], silicon [Si], germanium [Ge], arsenic [As], antimony [Sb], tellurium [Te] and polonium [Po], and alloys thereof the principal constituent melting at a temperature of greater than or equal to 400°C and less than 950°C
    • H01L2224/13124Aluminium [Al] as principal constituent
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/01Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L2224/10Bump connectors; Manufacturing methods related thereto
    • H01L2224/12Structure, shape, material or disposition of the bump connectors prior to the connecting process
    • H01L2224/13Structure, shape, material or disposition of the bump connectors prior to the connecting process of an individual bump connector
    • H01L2224/13001Core members of the bump connector
    • H01L2224/13099Material
    • H01L2224/131Material with a principal constituent of the material being a metal or a metalloid, e.g. boron [B], silicon [Si], germanium [Ge], arsenic [As], antimony [Sb], tellurium [Te] and polonium [Po], and alloys thereof
    • H01L2224/13138Material with a principal constituent of the material being a metal or a metalloid, e.g. boron [B], silicon [Si], germanium [Ge], arsenic [As], antimony [Sb], tellurium [Te] and polonium [Po], and alloys thereof the principal constituent melting at a temperature of greater than or equal to 950°C and less than 1550°C
    • H01L2224/13144Gold [Au] as principal constituent
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/01Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L2224/10Bump connectors; Manufacturing methods related thereto
    • H01L2224/12Structure, shape, material or disposition of the bump connectors prior to the connecting process
    • H01L2224/13Structure, shape, material or disposition of the bump connectors prior to the connecting process of an individual bump connector
    • H01L2224/13001Core members of the bump connector
    • H01L2224/13099Material
    • H01L2224/131Material with a principal constituent of the material being a metal or a metalloid, e.g. boron [B], silicon [Si], germanium [Ge], arsenic [As], antimony [Sb], tellurium [Te] and polonium [Po], and alloys thereof
    • H01L2224/13138Material with a principal constituent of the material being a metal or a metalloid, e.g. boron [B], silicon [Si], germanium [Ge], arsenic [As], antimony [Sb], tellurium [Te] and polonium [Po], and alloys thereof the principal constituent melting at a temperature of greater than or equal to 950°C and less than 1550°C
    • H01L2224/13147Copper [Cu] as principal constituent
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/01Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L2224/10Bump connectors; Manufacturing methods related thereto
    • H01L2224/12Structure, shape, material or disposition of the bump connectors prior to the connecting process
    • H01L2224/14Structure, shape, material or disposition of the bump connectors prior to the connecting process of a plurality of bump connectors
    • H01L2224/141Disposition
    • H01L2224/14104Disposition relative to the bonding areas, e.g. bond pads, of the semiconductor or solid-state body
    • H01L2224/1411Disposition relative to the bonding areas, e.g. bond pads, of the semiconductor or solid-state body the bump connectors being bonded to at least one common bonding area
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2924/00Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
    • H01L2924/0001Technical content checked by a classifier
    • H01L2924/00013Fully indexed content
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2924/00Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
    • H01L2924/0001Technical content checked by a classifier
    • H01L2924/00014Technical content checked by a classifier the subject-matter covered by the group, the symbol of which is combined with the symbol of this group, being disclosed without further technical details
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2924/00Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
    • H01L2924/01Chemical elements
    • H01L2924/01004Beryllium [Be]
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2924/00Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
    • H01L2924/01Chemical elements
    • H01L2924/01005Boron [B]
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2924/00Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
    • H01L2924/01Chemical elements
    • H01L2924/01006Carbon [C]
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2924/00Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
    • H01L2924/01Chemical elements
    • H01L2924/01013Aluminum [Al]
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2924/00Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
    • H01L2924/01Chemical elements
    • H01L2924/01029Copper [Cu]
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2924/00Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
    • H01L2924/01Chemical elements
    • H01L2924/01033Arsenic [As]
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2924/00Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
    • H01L2924/01Chemical elements
    • H01L2924/01078Platinum [Pt]
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2924/00Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
    • H01L2924/01Chemical elements
    • H01L2924/01079Gold [Au]
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2924/00Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
    • H01L2924/01Chemical elements
    • H01L2924/01082Lead [Pb]
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2924/00Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
    • H01L2924/013Alloys
    • H01L2924/014Solder alloys

Landscapes

  • Engineering & Computer Science (AREA)
  • Computer Hardware Design (AREA)
  • Microelectronics & Electronic Packaging (AREA)
  • Power Engineering (AREA)
  • Manufacturing & Machinery (AREA)
  • Physics & Mathematics (AREA)
  • Condensed Matter Physics & Semiconductors (AREA)
  • General Physics & Mathematics (AREA)
  • Wire Bonding (AREA)

Description

【0001】
【発明の属する技術分野】
本発明は、半導体素子の電極とテープキャリアのインナーリードとが、半田等の低融点合金を用いて結線された電子部品構体に関し、特に、金属ワイヤの先端に形成した金属ボールを半導体素子の電極に接合してバンプを形成し、テープキャリアのインナーリードと結線された電子部品構体に関するものである。
【0002】
【従来の技術】
従来、半導体素子の電極とテープキャリアのインナーリードとが結線された電子部品構体としては、例えば図25〜図29に示されるものが挙げられる。すなわち、図25に示すように半導体素子1の電極2上に電気メッキ法によりSnや半田等のバンプ3が形成されている。4は半導体素子1のアクティブ面を保護するパシベーション膜である。
【0003】
そして、図26に示すように、前記各電極2上に形成されたバンプ3上にテープキャリア5の各インナーリード6が対向するように位置決めする。その後、図27に示すように、加熱されたボンディングツール7にて各インナーリード6の先端部を一括して押圧する。その結果、図28に示すように、各インナーリード6の表面に形成されたSnや半田等のメッキ層8が溶融され、バンプ3とインナーリード6とが合金層9を介して結線された電子部品構体が形成される。
【0004】
しかしながら、図25に示すように電気メッキ法で形成可能なバンプ3の最大高さHは約20μmと低いため、図29に示すように、前記メッキ層8を溶融して、合金層9を介してバンプ3とインナーリード6とを結線する際に、溶融した合金層9の量と比較して、インナーリード6と半導体素子1との隙間が狭く、過剰な合金層9aが半導体素子1のエッジ部に接触してしまい、半導体素子1の動作不良を引き起こすという問題があった。
【0005】
また、上記の電気メッキ法により形成されたバンプ3よりも背の高いバンプを形成するために、電気メッキ法とは別に、図30〜図34に示すように、ワイヤボンディング法により形成されるバンプ11を用いた従来例が挙げられる。すなわち、図30において、(a)で示すように、金、銅、アルミニウム、半田等で製作された金属ワイヤ12をセラミックやルビーで作られたキャピラリー13に通し、通した金属ワイヤ12の先端とトーチと呼ばれる電極14との間で放電し、金属ボール15を形成する。
【0006】
次に、(b)で示すように、予熱されている半導体素子1の電極2の上に前記金属ボール15を押圧し、超音波振動を加え、温度、圧力、超音波振動の作用によって、前記金属ボール15を半導体素子1の電極2に接合する。その後、(c)で示すように、キャピラリー13を鉛直方向に上昇させ、(d)で示すように、金属ワイヤ12を引きちぎって金属ボールによるバンプ11を形成する。
【0007】
このようにして、図31に示すように、半導体素子1の各電極2上にバンプ11を1個ずつ形成した後、図32に示すように、前記バンプ11上にテープキャリア5のインナーリード6が対向するように位置決めし、図33に示すように加熱されたボンディングツール7にて各インナーリード6の先端部を一括して押圧する。その結果、各インナーリード6の表面に形成されたSnや半田等のメッキ層8が溶融され、金属ボールによるバンプ11とインナーリード6とが合金層9を介して結線された電子部品構体が形成される。
【0008】
これによると、図31に示すように、ワイヤボンディング法で形成可能なバンプ11の最大高さHは約50μmとなり、電気メッキ法により形成された図25のバンプ3と比較して高く形成することができる。
【0009】
【発明が解決しようとする課題】
しかしながら、ワイヤボンディング法で形成されたバンプ11では、図34に示すように、バンプ11と合金層9との接触面積が小さいため、溶融した合金層9を保持する力が小さく、過剰な合金層9aが半導体素子1のエッジ部に流れて接触してしまい、半導体素子1の動作不良を引き起こすという問題が依然として解決できなかった。
【0010】
本発明は、上記の問題点に鑑み、半導体素子の電極とテープキャリアのインナーリードとを高い信頼性をもって接合できる電子部品構体の提供を目的としている。
【0011】
【課題を解決するための手段】
本発明の電子部品構体においては、半導体素子の電極上に、金属ボールによるバンプを複数個形成したものであり、この本発明によれば、半導体素子の電極とテープキャリアのインナーリードとを高い信頼性をもって接合できる。
【0012】
【発明の実施の形態】
本発明の請求項1に記載の発明は、半導体素子をテープキャリアのインナーリードに接合するに際して、前記半導体素子の電極には、金属ワイヤの先端を溶融して形成した金属ボールを前記半導体素子の電極上に接合してバンプを形成し、前記インナーリードの表面にはメッキ層を形成し、前記インナーリードを半導体素子のバンプに位置合わせした状態で前記メッキ層を溶融して合金層を介して半導体素子を前記インナーリードに接合した電子部品構体において、前記金属ボールによるバンプは、前記電極1個に対して、複数個形成されているものであり、これによると、半導体素子の電極にインナーリードが対向するように位置決めした後、加熱されたボンディングツールにてインナーリードの先端を押圧し、インナーリードの表面に形成されたメッキ層を溶融し、バンプとインナーリードとを合金層を介して結線する際において、半導体素子の電極上に1個の金属ボールによるバンプが形成されている場合と比較して、バンプと合金層との接触面積が拡大し、溶融した合金層を保持する力が大きくなり、さらに、複数のバンプが抵抗となって溶融した合金層の流れを阻止する役目を果たすため、合金層が半導体素子のエッジ部に流れて接触することを防止でき、高い信頼性をもって半導体素子の電極とテープキャリアのインナーリードとを接合することができる。
【0013】
請求項2に記載の発明は、バンプは、キャピラリーを通した金属ワイヤの先端を溶融して前記金属ワイヤの先端に金属ボールを形成し、前記キャピラリーを移動して前記金属ボールを半導体素子の電極上に位置決めし、前記金属ボールを半導体素子の電極に接合し、前記キャピラリーを上昇させ、横にずらして下降させ、前記金属ワイヤを半導体素子の電極に接合した金属ボール上に接合し、前記キャピラリーを再度上昇させ、前記金属ボールを半導体素子の電極に接合した状態で残すように前記金属ワイヤを引きちぎって半導体素子の電極上に形成される前記金属ボールによる2段突起形状のバンプであるものであり、これによると、半導体素子の電極上に形成された複数のバンプの高さが均一となるため、半導体素子の電極にインナーリードが対向するように位置決めした後、加熱されたボンディングツールにてインナーリードの先端を押圧し、インナーリードの表面に形成されたメッキ層を溶融し、バンプとインナーリードとを合金層を介して結線する際において、インナーリードが各バンプに均等かつ確実に接触するため、各金属ボールによるバンプとインナーリードとが合金層を介して確実に結線される。さらに、バンプと合金層との接触面積が拡大し、溶融した合金層を保持する力が大きくなり、複数のバンプが抵抗となって溶融した合金層の流れを阻止する役目を果たすため、合金層が半導体素子のエッジ部に流れて接触することを防止でき、高い信頼性をもって半導体素子の電極とテープキャリアのインナーリードとを接合することができる。
【0016】
以下、本発明の実施の形態について、図1から図24を用いて説明する。
(実施の形態1)
図1、図2に示すように、半導体素子1のアクティブ面には、電極2と前記アクティブ面を保護するパシベーション膜4とが形成されている。半導体素子1の電極2上には、ワイヤボンディング法を用いて形成した金属ボールによるバンプ11が複数形成されている。尚、前記ワイヤボンディング法は先の従来の技術において図30の(a)〜(d)を用いて説明したため、ここでの説明は省略する。
【0017】
ワイヤボンディング法により各電極2上に複数のバンプ11を形成した後、図3に示すように、複数のバンプ11上にテープキャリア5のインナーリード6が対向するように位置決めし、加熱されたボンディングツール7にてインナーリード6の先端部を一括して押圧し、インナーリード6の表面に形成されたSnや半田等のメッキ層8を溶融する。その結果、図4に示すように、複数のバンプ11とインナーリード6とが合金層9を介して結線された電子部品構体が形成される。
【0018】
これによれば、半導体素子1の電極2上に金属ボールによるバンプ11が複数形成されているため、図34に示すような金属ボールによるバンプ11が各電極2上に1個だけ形成されている場合と比較して、バンプ11と合金層9との接触面積が拡大し、溶融した合金層9を保持する力が大きくなる。また複数のバンプ11が抵抗となって溶融した合金層9の流れを阻止する役目を果たすため、合金層9が半導体素子1のエッジ部に流れて接触することを防止でき、高い信頼性をもって半導体素子1の電極2とテープキャリア5のインナーリード6とを接合することができる。
【0019】
(実施の形態2)
図5、図6に示すように、ワイヤボンディング法により、半導体素子1の電極2上に、金属ボールによるバンプ11を形成した後、さらに、そのバンプ11上にワイヤボンディング法でバンプ11を形成し、バンプ11が2段に積み重ねられている。すなわち、電極2上に形成された金属ボールによる1段目のバンプ11上にさらに、金属ワイヤ12の先端に形成された金属ボール15を位置決めし、熱圧着もしくは超音波併用熱圧着により金属ボール15を1段目のバンプ11に接合し、金属ボール15を1段目のバンプ11上に接合した状態で残すように金属ワイヤ12を引きちぎって、1段目のバンプ11上に2段目のバンプ11を形成している。
【0020】
その後、図7に示すように、前記2段のバンプ11上にテープキャリア5のインナーリード6が対向するように位置決めし、加熱されたボンディングツール7にてインナーリード6の先端部を一括して押圧し、インナーリード6の表面に形成されたSnや半田等のメッキ層8を溶融する。その結果、図8に示すように、2段のバンプ11とインナーリード6とが合金層9を介して結線された電子部品構体が形成される。
【0021】
これによれば、図25に示した電気メッキ法によりバンプ3を形成した場合、その高さHは最大約20μm、また、図31に示したワイヤボンディング法によりバンプ11を1個だけ形成した場合、その高さHは約50μmであるのに対して、図6に示すようにワイヤボンディング法によりバンプ11を2段に積み重ねた場合で約100μm以上の高さHとなるため、図8に示すように、インナーリード6と半導体素子1との隙間が広くなり、接合に要する合金層9の量を拡大することができ、過剰な合金層が半導体素子1のエッジに接触することを防ぐことができ、高い信頼性をもって半導体素子1の電極2とテープキャリア5のインナーリード6とを接合することができる。
【0022】
なお、積み重ねるバンプ11は、2段に限定されず、図9に示すように3段でも、或はそれ以上でも良い。
(実施の形態3)
先に述べた(実施の形態1)において、ワイヤボンディング法を用いてバンプ11(一般に引きちぎりバンプと呼ばれている)を電極2上に複数設ける場合、図30の(c)と(d)に示すように金属ボール15から金属ワイヤ12が引きちぎられる加減によって、図10に示すように、各バンプ11の高さHにバラツキhが発生する恐れがあった。たとえば、高さHが45μmのバンプ11を複数形成すると、その高さのバラツキhは約±10μmとなる。
【0023】
したがって、図11に示すように、複数個のバンプ11上にインナーリード6が対向するように位置決めし、加熱されたボンディングツール7にてインナーリード6の先端部を一括して押圧し、インナーリード6の表面に形成されたSnや半田等のメッキ層8を溶融する際、高さHのバラツキhによってインナーリード6に接触しないバンプ11が発生し、その結果、図12に示すように、接合後、合金層9を介してインナーリード6と接触しないバンプ11が発生する可能性がある。
【0024】
このようなことから、(実施の形態3)では、複数のバンプを設ける際、各バンプの高さを均一にするため、各バンプを2段突起形状に形成したものである。すなわち、図13において、(a)で示すように、金、銅、アルミニウム、半田等で製作された金属ワイヤ12をセラミックやルビーで作られたキャピラリー13に通し、通した金属ワイヤ12の先端とトーチと呼ばれる電極14との間で放電し、金属ボール15を形成する。
【0025】
次に、(b)で示すように、予熱されている半導体素子1の電極2の上に前記金属ボール15を押圧し、超音波振動を加え、温度、圧力、超音波振動の作用によって、前記金属ボール15を半導体素子1の電極2に接合する。その後、(c)で示すように、キャピラリー13を鉛直方向に上昇させ、さらに(d)で示すように、キャピラリー13を横にずらして下降させ、(e)で示すように、金属ワイヤ12を金属ボール15上に接触させ、温度、圧力(或いは、温度、圧力、超音波振動)の作用によって金属ワイヤ12を金属ボール15に接合し、(f)で示すように、キャピラリー13を再度上昇させ、金属ワイヤ12を引きちぎることにより、2段突起形状のバンプ20が形成される。このようにして形成される2段突起形状のバンプ20は高さHが均一になるため、図15に示すように、半導体素子1の電極2上に、2段突起形状のバンプ20を複数形成すると、各バンプ20の高さHは均一となる。たとえば、高さHが45μmの2段突起形状のバンプ20を複数形成した場合、各高さHのバラツキhは±2μmとなり問題のない範囲におさまる。
【0026】
したがって、図16に示すように、ボンディングツール7でインナーリード6を押圧した際、各バンプ20が確実にインナーリード6に接触し、その結果、図17に示すように、各バンプ20とインナーリード6とが合金層9を介して均等かつ確実に接合され、さらに、先述した(実施の形態1)と同様に、バンプ20が複数形成されているため、合金層9が半導体素子1のエッジ部に流れるのを防ぐことができ、高い信頼性をもって半導体素子1の電極2とテープキャリア5のインナーリード6とを接合することができる。
【0027】
(実施の形態4)
先に述べた(実施の形態2)のようにワイヤボンディング法を用いてバンプ11(一般に引きちぎりバンプと呼ばれている)を2段に積み重ねたものを各電極2上に設ける場合においても、図18に示すように、各バンプ11の高さHにバラツキhが発生する恐れがあった。
【0028】
したがって、図19に示すように、各電極2上に形成されたバンプ11上に各インナーリード6が対向するように位置決めし、加熱されたボンディングツール7にて各インナーリード6の先端部を一括して押圧し、インナーリード6の表面に形成されたSnや半田等のメッキ層8を溶融する際、高さHのバラツキhによってインナーリード6に接触しないバンプ11が発生し、その結果、図20に示すように、接合後、合金層9を介してインナーリード6と接触しないバンプ11が発生する可能性がある。
【0029】
このようなことから、(実施の形態4)では、2段に積み重ねたバンプを半導体素子1の各電極2上に設ける際、各バンプを2段突起形状にしたものである。すなわち、2段突起形状のバンプ20の形成方法は先述した(実施の形態3)と同様であり、これによると、図22に示すように、2段に積み重ねた各バンプ20の高さHが均一となる。したがって、図23に示すように、ボンディングツール7で各インナーリード6を押圧した際、各電極2上のバンプ20が確実に各インナーリード6に接触し、その結果、図24に示すように、各バンプ20と各インナーリード6とが合金層9を介して均等かつ確実に接合され、さらに、先述した(実施の形態2)と同様に、バンプ20を積み重ねたことによりバンプ20の高さHが高くなって、インナーリード6と半導体素子1との隙間が広くなり、接合に要する合金層9の量を拡大することができ、過剰な合金層が半導体素子1のエッジに接触することを防ぐことができるため、高い信頼性をもって半導体素子1の電極2とテープキャリア5のインナーリード6とを接合することができる。
【0030】
なお、積み重ねるバンプ20は、2段に限定されず、3段でも、或はそれ以上でも良い。
【0031】
【発明の効果】
以上説明したように、本発明のうち請求項1記載の発明によると、インナーリードの表面に形成されたメッキ層を溶融し、バンプとインナーリードとを合金層を介して結線する際において、半導体素子の電極上に複数の金属ボールによるバンプを形成しているため、電極上に1個の金属ボールによるバンプが形成されている場合と比較して、バンプと合金層との接触面積が拡大し、溶融した合金層を保持する力が大きくなり、さらに、複数のバンプが抵抗となって溶融した合金層の流れを阻止する役目を果たすため、合金層が半導体素子のエッジ部に流れて接触することを防止でき、高い信頼性をもって半導体素子の電極とテープキャリアのインナーリードとを接合することができる。
【0033】
さらに、請求項記載の発明によると、請求項1記載の発明による効果に加えて、バンプを2段突起形状に形成することにより、半導体素子の電極上に形成された複数のバンプの高さが均一となるため、加熱されたボンディングツールにてインナーリードの先端を押圧した際、インナーリードが各バンプに均等かつ確実に接触するため、各バンプとインナーリードとが合金層を介して確実に結線される。
【図面の簡単な説明】
【図1】本発明の実施の形態1における電子部品構体の半導体素子の電極上に形成されたバンプの斜視図である。
【図2】同、電子部品構体の半導体素子の電極上に形成されたバンプの正面図である。
【図3】同、電子部品構体の半導体素子の電極上に形成されたバンプとテープキャリアのインナーリードとを接合する際の状態を示した図である。
【図4】同、電子部品構体の半導体素子の電極上に形成されたバンプとテープキャリアのインナーリードとを接合した状態を示す図である。
【図5】本発明の実施の形態2における電子部品構体の半導体素子の電極上に2段に形成されたバンプの斜視図である。
【図6】同、電子部品構体の半導体素子の電極上に形成されたバンプの正面図である。
【図7】同、電子部品構体の半導体素子の電極上に形成されたバンプとテープキャリアのインナーリードとを接合する際の状態を示した図である。
【図8】同、電子部品構体の半導体素子の電極上に形成されたバンプとテープキャリアのインナーリードとを接合した状態を示す図である。
【図9】同、電子部品構体の半導体素子の電極上に3段に形成されたバンプの正面図である。
【図10】半導体素子の電極上に形成された複数の引きちぎりバンプの高さのバラツキを示す図である。
【図11】半導体素子の電極上に形成された複数の引きちぎりバンプとテープキャリアのインナーリードとを接合する際の状態を示した図である。
【図12】半導体素子の電極上に形成された複数の引きちぎりバンプとテープキャリアのインナーリードとを接合した状態を示す図である。
【図13】本発明の実施の形態3における電子部品構体の半導体素子の電極上に形成される2段突起形状のバンプの形成方法を示す図である。
【図14】同、電子部品構体の半導体素子の電極上に形成された2段突起形状のバンプの正面図である。
【図15】同、2段突起形状のバンプを電極上に複数形成した正面図である。
【図16】同、電子部品構体の半導体素子の電極上に形成された2段突起形状のバンプとテープキャリアのインナーリードとを接合する際の状態を示した図である。
【図17】同、電子部品構体の半導体素子の電極上に形成された2段突起形状のバンプとテープキャリアのインナーリードとを接合した状態を示す図である。
【図18】半導体素子の電極上に2段に形成された引きちぎりバンプの高さのバラツキを示す図である。
【図19】半導体素子の電極上に2段に形成された引きちぎりバンプとテープキャリアのインナーリードとを接合する際の状態を示した図である。
【図20】半導体素子の電極上に2段に形成された引きちぎりバンプとテープキャリアのインナーリードとを接合した状態を示す図である。
【図21】本発明の実施の形態4における電子部品構体の半導体素子の電極上に2段に形成された2段突起形状のバンプの正面図である。
【図22】同、電子部品構体の半導体素子の電極上に2段に形成された2段突起形状のバンプの正面図である。
【図23】同、電子部品構体の半導体素子の電極上に2段に形成された2段突起形状のバンプとテープキャリアのインナーリードとを接合する際の状態を示した図である。
【図24】同、電子部品構体の半導体素子の電極上に2段に形成された2段突起形状のバンプとテープキャリアのインナーリードとを接合した状態を示す図である。
【図25】従来、半導体素子の電極上に電気メッキ法により形成されたバンプの正面図である。
【図26】同、電気メッキ法により形成されたバンプの斜視図である。
【図27】同、電気メッキ法により形成されたバンプとテープキャリアのインナーリードとを接合する際の状態を示した図である。
【図28】同、電気メッキ法により形成されたバンプとテープキャリアのインナーリードとを接合した状態を示す図である。
【図29】同、電気メッキ法により形成されたバンプとテープキャリアのインナーリードとを接合した際の問題点を示す図である。
【図30】従来、金属ボールによるバンプの形成方法を示す図である。
【図31】同、半導体素子の電極上に形成された金属ボールによるバンプの正面図である。
【図32】同、半導体素子の電極上に形成された金属ボールによるバンプの斜視図である。
【図33】同、電子部品構体の半導体素子の電極上に形成されたバンプとテープキャリアのインナーリードとを接合した状態を示す図である。
【図34】同、金属ボールによるバンプとテープキャリアのインナーリードとを接合した際の問題点を示す図である。
【符号の説明】
1 半導体素子
2 電極
5 テープキャリア
6 インナーリード
8 メッキ層
9 合金層
11 バンプ
12 金属ワイヤ
13 キャピラリー
15 金属ボール
20 2段突起形状のバンプ

Claims (2)

  1. 半導体素子をテープキャリアのインナーリードに接合するに際して、前記半導体素子の電極には、金属ワイヤの先端を溶融して形成した金属ボールを前記半導体素子の電極上に接合してバンプを形成し、前記インナーリードの表面にはメッキ層を形成し、前記インナーリードを半導体素子のバンプに位置合わせした状態で前記メッキ層を溶融して合金層を介して半導体素子を前記インナーリードに接合した電子部品構体において、前記金属ボールによるバンプは、前記電極1個に対して、複数個形成されていることを特徴とする電子部品構体。
  2. バンプは、キャピラリーを通した金属ワイヤの先端を溶融して前記金属ワイヤの先端に金属ボールを形成し、前記キャピラリーを移動して前記金属ボールを半導体素子の電極上に位置決めし、前記金属ボールを半導体素子の電極に接合し、前記キャピラリーを上昇させ、横にずらして下降させ、前記金属ワイヤを半導体素子の電極に接合した金属ボール上に接合し、前記キャピラリーを再度上昇させ、前記金属ボールを半導体素子の電極に接合した状態で残すように前記金属ワイヤを引きちぎって半導体素子の電極上に形成される前記金属ボールによる2段突起形状のバンプであることを特徴とする請求項1記載の電子部品構体。
JP14692196A 1996-06-10 1996-06-10 電子部品構体 Expired - Fee Related JP3558449B2 (ja)

Priority Applications (6)

Application Number Priority Date Filing Date Title
JP14692196A JP3558449B2 (ja) 1996-06-10 1996-06-10 電子部品構体
EP97924372A EP0844656A4 (en) 1996-06-10 1997-06-09 ELECTRONIC MODULE STRUCTURE
US09/011,039 US20020014685A1 (en) 1996-06-10 1997-06-09 Electronic component with ball bonded pads connected to a plated lead frame
PCT/JP1997/001990 WO1997048131A1 (fr) 1996-06-10 1997-06-09 Structure de composant electronique
CN97190679A CN1195423A (zh) 1996-06-10 1997-06-09 电子组件结构体
KR1019980700848A KR19990036180A (ko) 1996-06-10 1997-06-09 전자부품 구조체

Applications Claiming Priority (1)

Application Number Priority Date Filing Date Title
JP14692196A JP3558449B2 (ja) 1996-06-10 1996-06-10 電子部品構体

Publications (2)

Publication Number Publication Date
JPH09330949A JPH09330949A (ja) 1997-12-22
JP3558449B2 true JP3558449B2 (ja) 2004-08-25

Family

ID=15418588

Family Applications (1)

Application Number Title Priority Date Filing Date
JP14692196A Expired - Fee Related JP3558449B2 (ja) 1996-06-10 1996-06-10 電子部品構体

Country Status (6)

Country Link
US (1) US20020014685A1 (ja)
EP (1) EP0844656A4 (ja)
JP (1) JP3558449B2 (ja)
KR (1) KR19990036180A (ja)
CN (1) CN1195423A (ja)
WO (1) WO1997048131A1 (ja)

Families Citing this family (11)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
US7390732B1 (en) * 1997-07-15 2008-06-24 Hitachi, Ltd. Method for producing a semiconductor device with pyramidal bump electrodes bonded onto pad electrodes arranged on a semiconductor chip
TW465064B (en) * 2000-12-22 2001-11-21 Advanced Semiconductor Eng Bonding process and the structure thereof
JP3727615B2 (ja) * 2002-06-26 2005-12-14 株式会社新川 ワイヤボンディング用ワイヤのイニシャルボール形成方法およびワイヤボンディング装置
US7115998B2 (en) 2002-08-29 2006-10-03 Micron Technology, Inc. Multi-component integrated circuit contacts
US20070200234A1 (en) * 2006-02-28 2007-08-30 Texas Instruments Incorporated Flip-Chip Device Having Underfill in Controlled Gap
CN101924046A (zh) * 2009-06-16 2010-12-22 飞思卡尔半导体公司 在半导体器件中形成引线键合的方法
US10411085B2 (en) * 2016-12-29 2019-09-10 Taiwan Semiconductor Manufacturing Co., Ltd. Semiconductor device and a method for fabricating the same
JP6858939B2 (ja) * 2017-04-28 2021-04-14 東北マイクロテック株式会社 外部接続機構、半導体装置及び積層パッケージ
US10535644B1 (en) * 2018-06-29 2020-01-14 Taiwan Semiconductor Manufacturing Co., Ltd. Manufacturing method of package on package structure
FR3088018B1 (fr) * 2018-11-06 2023-01-13 Mbda France Procede de liaison par brassage permettant d'ameliorer la tenue en fatigue de joints brases
US20200203243A1 (en) * 2018-12-19 2020-06-25 Texas Instruments Incorporated Universal leaded/leadless chip scale package for microelecronic devices

Family Cites Families (6)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
US5025348A (en) * 1987-11-20 1991-06-18 Casio Computer Co., Ltd. Bonding structure of an electronic device and a method for manufacturing the same
US5014111A (en) * 1987-12-08 1991-05-07 Matsushita Electric Industrial Co., Ltd. Electrical contact bump and a package provided with the same
JP2733418B2 (ja) * 1992-09-16 1998-03-30 松下電子工業株式会社 半導体装置の製造方法
JPH06268013A (ja) * 1993-03-15 1994-09-22 Hitachi Ltd 半導体装置とそれに用いられるキャリアテープの製造方法
JPH06302645A (ja) * 1993-04-15 1994-10-28 Fuji Xerox Co Ltd 電子部品の端子接続方法とこの接続方法で接続した電子機器およびその端子接続用バンプ
JP3184014B2 (ja) * 1993-07-26 2001-07-09 株式会社東芝 半導体装置

Also Published As

Publication number Publication date
EP0844656A1 (en) 1998-05-27
JPH09330949A (ja) 1997-12-22
KR19990036180A (ko) 1999-05-25
EP0844656A4 (en) 2000-03-29
US20020014685A1 (en) 2002-02-07
WO1997048131A1 (fr) 1997-12-18
CN1195423A (zh) 1998-10-07

Similar Documents

Publication Publication Date Title
US5889326A (en) Structure for bonding semiconductor device to substrate
JP3420076B2 (ja) フリップチップ実装基板の製造方法及びフリップチップ実装基板及びフリップチップ実装構造
JP3558449B2 (ja) 電子部品構体
US5985692A (en) Process for flip-chip bonding a semiconductor die having gold bump electrodes
JP2003133508A (ja) 半導体装置
JPH08139128A (ja) 半導体装置
JP3308855B2 (ja) 半導体装置の製造方法
JPH0778932A (ja) 半導体装置の製造方法
JPH08236578A (ja) 半導体素子のフリップチップ実装方法およびこの実装方 法に用いられる接着剤
JP3129272B2 (ja) 半導体装置とその製造装置および製造方法
JP2003297874A (ja) 電子部品の接続構造及び接続方法
US6258622B1 (en) Flip clip bonding leadframe-type packaging method for integrated circuit device and a device formed by the packaging method
JPS60194543A (ja) バンプ電極形成方法
JP3006957B2 (ja) 半導体装置の実装体
JP2798040B2 (ja) 半導体装置の製造方法
JP2848373B2 (ja) 半導体装置
JPH0357223A (ja) 半導体装置
JP2001127102A (ja) 半導体装置およびその製造方法
JPH08148496A (ja) 半導体装置及び半導体装置用バンプ
JP3383727B2 (ja) 半導体素子のバンプ形成方法
JP2882130B2 (ja) 半導体装置の製造方法
JPH01227458A (ja) バンプ電極形成方法
JP4608178B2 (ja) 電子デバイスおよび電子デバイス形成方法
JPH05144872A (ja) バンプ電極の接合方法
JPH08107261A (ja) 電気回路装置相互の接続構造および接続方法

Legal Events

Date Code Title Description
A521 Written amendment

Free format text: JAPANESE INTERMEDIATE CODE: A523

Effective date: 20031226

A131 Notification of reasons for refusal

Free format text: JAPANESE INTERMEDIATE CODE: A131

Effective date: 20040127

A521 Written amendment

Free format text: JAPANESE INTERMEDIATE CODE: A523

Effective date: 20040326

TRDD Decision of grant or rejection written
A01 Written decision to grant a patent or to grant a registration (utility model)

Free format text: JAPANESE INTERMEDIATE CODE: A01

Effective date: 20040420

A61 First payment of annual fees (during grant procedure)

Free format text: JAPANESE INTERMEDIATE CODE: A61

Effective date: 20040518

FPAY Renewal fee payment (event date is renewal date of database)

Free format text: PAYMENT UNTIL: 20090528

Year of fee payment: 5

FPAY Renewal fee payment (event date is renewal date of database)

Free format text: PAYMENT UNTIL: 20100528

Year of fee payment: 6

FPAY Renewal fee payment (event date is renewal date of database)

Free format text: PAYMENT UNTIL: 20110528

Year of fee payment: 7

LAPS Cancellation because of no payment of annual fees