JP3478519B2 - プリンタ装置 - Google Patents
プリンタ装置Info
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- JP3478519B2 JP3478519B2 JP18855396A JP18855396A JP3478519B2 JP 3478519 B2 JP3478519 B2 JP 3478519B2 JP 18855396 A JP18855396 A JP 18855396A JP 18855396 A JP18855396 A JP 18855396A JP 3478519 B2 JP3478519 B2 JP 3478519B2
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- JP
- Japan
- Prior art keywords
- communication
- dma
- function
- data
- host device
- Prior art date
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- Expired - Lifetime
Links
Classifications
-
- G—PHYSICS
- G06—COMPUTING; CALCULATING OR COUNTING
- G06F—ELECTRIC DIGITAL DATA PROCESSING
- G06F13/00—Interconnection of, or transfer of information or other signals between, memories, input/output devices or central processing units
- G06F13/38—Information transfer, e.g. on bus
- G06F13/42—Bus transfer protocol, e.g. handshake; Synchronisation
- G06F13/4265—Bus transfer protocol, e.g. handshake; Synchronisation on a point to point bus
- G06F13/4269—Bus transfer protocol, e.g. handshake; Synchronisation on a point to point bus using a handshaking protocol, e.g. Centronics connection
Description
【０００１】
【発明の属する技術分野】本発明は、プリンタ装置に関
し、ことにＤＭＡ機能を用いてパラレルでデータの高速
転送を行うプリンタ装置の改良に関する。
し、ことにＤＭＡ機能を用いてパラレルでデータの高速
転送を行うプリンタ装置の改良に関する。
【０００２】
【従来の技術】データの転送の際にインタフェースの制
御を介在させず直接データをメモリに転送するＤＭＡ機
能を用いて、パラレルデータの高速送受信を行うプリン
タ装置が存在する。ＤＭＡ機能とは、指定のソースアド
レスからディスティネーションアドレスへ、指定バイト
数分だけＣＰＵを介在させること無くデータを転送させ
る機能であり、ソースをパラレルポートに、ディスティ
ネーションを受信バッファにしておくことによって、パ
ラレルデータの受信を高速に行うことができるというも
のである。
御を介在させず直接データをメモリに転送するＤＭＡ機
能を用いて、パラレルデータの高速送受信を行うプリン
タ装置が存在する。ＤＭＡ機能とは、指定のソースアド
レスからディスティネーションアドレスへ、指定バイト
数分だけＣＰＵを介在させること無くデータを転送させ
る機能であり、ソースをパラレルポートに、ディスティ
ネーションを受信バッファにしておくことによって、パ
ラレルデータの受信を高速に行うことができるというも
のである。
【０００３】一方、ＩＥＥＥ（米国電気電子技術者協
会）が規格化した新しいパラレルポートインタフェース
の規格ＩＥＥＥ１２８４の出た転送方法では、双方向モ
ードに入る場合には、これから入りたい双方向モードを
印字装置に対して通知するため、ネゴシエーションフェ
イズ時に１バイトのデータをホストから転送する規格に
なっている。
会）が規格化した新しいパラレルポートインタフェース
の規格ＩＥＥＥ１２８４の出た転送方法では、双方向モ
ードに入る場合には、これから入りたい双方向モードを
印字装置に対して通知するため、ネゴシエーションフェ
イズ時に１バイトのデータをホストから転送する規格に
なっている。
【０００４】今、ＤＭＡ転送が行われている最中に、ホ
スト装置から双方向モードに入る要求（ネゴシエーショ
ン）がなされた場合、従来機では、ネゴシエーション時
に送られてくる拡張コードまでも受信バッファに取り込
んでしまい、双方向パラレルが実現できないで文字欠け
が発生してしまうなどの問題があった。これは、ＤＭＡ
転送中はＣＰＵの介在がないため、いわば所得したくな
いデータまでも機械的に受信バッファに転送してしまう
ためであり、これがために、ＤＭＡを用いたパラレル高
速通信と、ソフトウエア制御による双方向通信とは両立
しないという問題があった。
スト装置から双方向モードに入る要求（ネゴシエーショ
ン）がなされた場合、従来機では、ネゴシエーション時
に送られてくる拡張コードまでも受信バッファに取り込
んでしまい、双方向パラレルが実現できないで文字欠け
が発生してしまうなどの問題があった。これは、ＤＭＡ
転送中はＣＰＵの介在がないため、いわば所得したくな
いデータまでも機械的に受信バッファに転送してしまう
ためであり、これがために、ＤＭＡを用いたパラレル高
速通信と、ソフトウエア制御による双方向通信とは両立
しないという問題があった。
【０００５】
【発明が解決しようとする課題】上述のごとく、従来の
プリンタ装置では、ＤＭＡ受信中にホスト装置から双方
向モードに入る要求がなされた場合、この要求を区別で
きず受信バッファに取り込むことになり、ＤＭＡを用い
たパラレル高速通信と、ソフトウエア制御による双方向
通信とが両立しないという問題があった。
プリンタ装置では、ＤＭＡ受信中にホスト装置から双方
向モードに入る要求がなされた場合、この要求を区別で
きず受信バッファに取り込むことになり、ＤＭＡを用い
たパラレル高速通信と、ソフトウエア制御による双方向
通信とが両立しないという問題があった。
【０００６】本発明はこの点を解決して、高速通信が可
能でかつ双方向通信の可能なプリンタ装置の実現を課題
とする。
能でかつ双方向通信の可能なプリンタ装置の実現を課題
とする。
【０００７】
【課題を解決するための手段】上記課題を達成するた
め、本発明は、ホスト装置からのＤＭＡ転送に基づくパ
ラレルデータの受信を行うＤＭＡ機能と、ホスト装置と
の間でＩＥＥＥ１２８４規格に準拠した双方向通信を行
う双方向通信機能とを具備するプリンタ装置において、
前記ＤＭＡ転送におけるデータ転送を行うピンとは別に
前記ＩＥＥＥ１２８４規格に準拠したパラレルデータの
双方向通信に入るための１２８４ａｃｔｉｖｅ信号を送
るピンと、前記ＤＭＡ転送中に前記ホスト装置が１２８
４ａｃｔｉｖｅ信号をハイにした場合には、前記ＤＭＡ
機能に基づくデータ受信を中止した後に、前記双方向通
信機能に基づく通信を行う通信制御手段とを具備するこ
とを特徴とする。
め、本発明は、ホスト装置からのＤＭＡ転送に基づくパ
ラレルデータの受信を行うＤＭＡ機能と、ホスト装置と
の間でＩＥＥＥ１２８４規格に準拠した双方向通信を行
う双方向通信機能とを具備するプリンタ装置において、
前記ＤＭＡ転送におけるデータ転送を行うピンとは別に
前記ＩＥＥＥ１２８４規格に準拠したパラレルデータの
双方向通信に入るための１２８４ａｃｔｉｖｅ信号を送
るピンと、前記ＤＭＡ転送中に前記ホスト装置が１２８
４ａｃｔｉｖｅ信号をハイにした場合には、前記ＤＭＡ
機能に基づくデータ受信を中止した後に、前記双方向通
信機能に基づく通信を行う通信制御手段とを具備するこ
とを特徴とする。
【０００８】ここで、ホスト装置からの前記双方向通信
機能に基づく通信要求があった場合には、前記フラグ手
段がＯＮの時には前記ＤＭＡ機能に基づくデータ受信を
中止し受信条件を初期化した後に、前記フラグ手段がＯ
ＦＦの時には直ちに、双方向通信可能信号を出力する通
信制御手段を具備することを特徴とする。
機能に基づく通信要求があった場合には、前記フラグ手
段がＯＮの時には前記ＤＭＡ機能に基づくデータ受信を
中止し受信条件を初期化した後に、前記フラグ手段がＯ
ＦＦの時には直ちに、双方向通信可能信号を出力する通
信制御手段を具備することを特徴とする。
【０００９】また、前記通信制御手段は前記ＤＭＡ機能
に基づくデータ受信を中止した後に前記双方向通信機能
に基づく通信を行った場合には、前記双方向通信機能に
基づく通信終了後に前記ＤＭＡ機能に基づくデータ受信
を自動的に再開する事を特徴とする。
に基づくデータ受信を中止した後に前記双方向通信機能
に基づく通信を行った場合には、前記双方向通信機能に
基づく通信終了後に前記ＤＭＡ機能に基づくデータ受信
を自動的に再開する事を特徴とする。
【００１０】
【発明の実施の形態】以下、本発明にかかるプリンタ装
置を添付図面を参照にして詳細に説明する。本発明が実
施されるプリンタ装置はＤＭＡコントローラとＩＥＥＥ
１２８４に基づく通信機能を有している。ＤＮＡ転送の
場合は、ＣＰＵはＤＭＡコントローラに対しては、初期
アドレス、サイクルの種類、転送サイズなどを設定し、
ＤＭＡコントローラはデータ転送に必要なソースアドレ
ス、デスティネーションアドレスを生成し、ソースの読
みだしサイクル、デスティネーションの書き込みサイク
ルを駆動してデータ転送を行う。
置を添付図面を参照にして詳細に説明する。本発明が実
施されるプリンタ装置はＤＭＡコントローラとＩＥＥＥ
１２８４に基づく通信機能を有している。ＤＮＡ転送の
場合は、ＣＰＵはＤＭＡコントローラに対しては、初期
アドレス、サイクルの種類、転送サイズなどを設定し、
ＤＭＡコントローラはデータ転送に必要なソースアドレ
ス、デスティネーションアドレスを生成し、ソースの読
みだしサイクル、デスティネーションの書き込みサイク
ルを駆動してデータ転送を行う。
【００１１】ＩＥＥＥ１２８４に基づく通信機能はセン
トロニクスのステータス信号４本を使って４ビット単位
にプリンタ装置からホスト装置にデータ線を用いてホス
ト装置からプリンタ装置にデータを転送するニブルモー
ドや、ＰＳ／２のパラレルポートのデータ線が双方向転
送ができることを用いるバイトモード等が用いられるが
ここではニブルモードを用いる場合で説明する。
トロニクスのステータス信号４本を使って４ビット単位
にプリンタ装置からホスト装置にデータ線を用いてホス
ト装置からプリンタ装置にデータを転送するニブルモー
ドや、ＰＳ／２のパラレルポートのデータ線が双方向転
送ができることを用いるバイトモード等が用いられるが
ここではニブルモードを用いる場合で説明する。
【００１２】本発明では、ＤＭＡを用いたパラレル高速
通信中にホスト装置から双方向モードに入るための要求
がくると、ただちに、ＤＭＡによる高速転送を中断し
て、割り込み処理に戻すことによって、高速通信と双方
向通信の可能なプリンタ装置を実現する。
通信中にホスト装置から双方向モードに入るための要求
がくると、ただちに、ＤＭＡによる高速転送を中断し
て、割り込み処理に戻すことによって、高速通信と双方
向通信の可能なプリンタ装置を実現する。
【００１３】図１は、本発明の一実施形態のプリンタコ
ントローラの構成を示すブロック図である。このプリン
タコントローラの基本的な機能はホスト装置からのデー
タコードを理解して、プリンタエンジンにそれに応じて
プリンタ装置に画像を印刷させることである。また、ホ
スト装置、操作パネル、エンジンドライバ等と接続され
ており、必要に応じて相互の仲介的な役割をも果たす。
このプリンタコントローラの各ブロックは共通のアドレ
スデータバスで接続されている。
ントローラの構成を示すブロック図である。このプリン
タコントローラの基本的な機能はホスト装置からのデー
タコードを理解して、プリンタエンジンにそれに応じて
プリンタ装置に画像を印刷させることである。また、ホ
スト装置、操作パネル、エンジンドライバ等と接続され
ており、必要に応じて相互の仲介的な役割をも果たす。
このプリンタコントローラの各ブロックは共通のアドレ
スデータバスで接続されている。
【００１４】以下、各ブロックの説明を以下に述べる。
１００はプリンタコントローラである。１０１は、プロ
グラムＲＯＭ１０４内のプログラム、パネル装置１１０
からのモード指示、ホスト装置１１２からのコマンドに
よってコントローラ全体を制御するＣＰＵである。
１００はプリンタコントローラである。１０１は、プロ
グラムＲＯＭ１０４内のプログラム、パネル装置１１０
からのモード指示、ホスト装置１１２からのコマンドに
よってコントローラ全体を制御するＣＰＵである。
【００１５】１０２は、フォントデータやプログラムを
外部から供給するＩＣカードである。１０３は、パネル
装置１１０からのモード指示の内容等を記憶しておく不
揮発性記憶装置でＮＶＲＡＭで構成される。
外部から供給するＩＣカードである。１０３は、パネル
装置１１０からのモード指示の内容等を記憶しておく不
揮発性記憶装置でＮＶＲＡＭで構成される。
【００１６】１０４は、コントローラの制御プログラム
が格納されているプログラムＲＯＭである。１０５は、
フォントのパターンデータなどを記憶するフォントＲＯ
Ｍである。
が格納されているプログラムＲＯＭである。１０５は、
フォントのパターンデータなどを記憶するフォントＲＯ
Ｍである。
【００１７】１０６は、ＣＰＵ１０１のワークメモリ、
入力データのインプットバッファ、プリントデータのペ
ージバッファ、ダウンロードフォント用のメモリ等とし
て使用されるＲＡＭである。１０７は、エンジン１０８
とコマンドおよびステータスや印字データの通信を行う
エンジンインタフェースである。
入力データのインプットバッファ、プリントデータのペ
ージバッファ、ダウンロードフォント用のメモリ等とし
て使用されるＲＡＭである。１０７は、エンジン１０８
とコマンドおよびステータスや印字データの通信を行う
エンジンインタフェースである。
【００１８】１０８は、実際に印字を行うエンジンであ
る。１０９は、パネル装置１１０とコマンドおよびステ
ータスの通信を行うパネルインタフェースである。
る。１０９は、パネル装置１１０とコマンドおよびステ
ータスの通信を行うパネルインタフェースである。
【００１９】１１０は、使用者に現在のプリンタの状態
を知らせたり、モード指示を行ったりするパネル装置で
ある。１１１は、ホスト装置１１２と通信を行うホスト
インタフェースであり、通常はセントロＩ／ＦやＲＳ２
３２Ｃである。
を知らせたり、モード指示を行ったりするパネル装置で
ある。１１１は、ホスト装置１１２と通信を行うホスト
インタフェースであり、通常はセントロＩ／ＦやＲＳ２
３２Ｃである。
【００２０】１１２は、プリンタの上位装置であるホス
ト装置である。このプリンタコントローラを有するプリ
ンタ装置に対しホスト装置１１２が双方向モードに入る
ように要求を行う場合を考える。ＩＥＥＥ１２８４規格
によれば、ホスト装置１１２がプリンタ装置に対し双方
向モードを要求する場合は、ある手順をふむことにな
る。
ト装置である。このプリンタコントローラを有するプリ
ンタ装置に対しホスト装置１１２が双方向モードに入る
ように要求を行う場合を考える。ＩＥＥＥ１２８４規格
によれば、ホスト装置１１２がプリンタ装置に対し双方
向モードを要求する場合は、ある手順をふむことにな
る。
【００２１】図２は、ニブルモードが行われるセントロ
ニクス・コネクタのピン配置の例を示す図表である。図
２で、ピン番号は３６ピンコネクタの場合のピン番号を
示す。セントロニクス信号名はセントロニクスの場合の
信号名を示す。信号源はＨがホストからプリンタへの信
号を、Ｐがプリンタからホストへの信号を示す。ペアリ
ターンはピン１９からピン３０の接地（Ｓｉｇｎａｌ
Ｇｒｏｕｎｄ）の内でペアになるピンを示す。
ニクス・コネクタのピン配置の例を示す図表である。図
２で、ピン番号は３６ピンコネクタの場合のピン番号を
示す。セントロニクス信号名はセントロニクスの場合の
信号名を示す。信号源はＨがホストからプリンタへの信
号を、Ｐがプリンタからホストへの信号を示す。ペアリ
ターンはピン１９からピン３０の接地（Ｓｉｇｎａｌ
Ｇｒｏｕｎｄ）の内でペアになるピンを示す。
【００２２】（）で括ったピン番のない欄はセントロニ
クスとＩＥＥＥ１２８４に共通であり、（）で括ったピ
ン番のある欄はＩＥＥＥ１２８４では（）内のピンを選
ぶことを示す。
クスとＩＥＥＥ１２８４に共通であり、（）で括ったピ
ン番のある欄はＩＥＥＥ１２８４では（）内のピンを選
ぶことを示す。
【００２３】ＩＥＥＥ１２８４信号名はＩＥＥＥ１２８
４・ニブルモードでの信号名を示す。ＮＤは使用が確定
していないピンである。プリンタ装置からホスト装置１
１２へのデータ転送は各ピンのうち、ＡＣＫ１０とＢＵ
ＳＹ１１、ＰＥ１２、ＳＥＬＥＣＴ１３、ＦＡＬＴ３２
を用いて行われる。
４・ニブルモードでの信号名を示す。ＮＤは使用が確定
していないピンである。プリンタ装置からホスト装置１
１２へのデータ転送は各ピンのうち、ＡＣＫ１０とＢＵ
ＳＹ１１、ＰＥ１２、ＳＥＬＥＣＴ１３、ＦＡＬＴ３２
を用いて行われる。
【００２４】また図３は、この場合のプリンタコントロ
ーラの処理を示すフローチャートである。図３にそって
ＩＥＥＥ１２８４に基づく通信を開始する場合のプリン
タコントローラの動作を説明する。ホスト装置１１２は
１２８４ａｃｔｉｖｅ信号をハイにし、これによりプリ
ンタコントローラに割り込みが発生する（ステップ２０
１）。この割り込みを受けると、プリンタコントローラ
はＤＭＡフラグがオンかどうかを判定する（ステップ２
０２）。
ーラの処理を示すフローチャートである。図３にそって
ＩＥＥＥ１２８４に基づく通信を開始する場合のプリン
タコントローラの動作を説明する。ホスト装置１１２は
１２８４ａｃｔｉｖｅ信号をハイにし、これによりプリ
ンタコントローラに割り込みが発生する（ステップ２０
１）。この割り込みを受けると、プリンタコントローラ
はＤＭＡフラグがオンかどうかを判定する（ステップ２
０２）。
【００２５】ＤＭＡによる高速転送が行われていてＤＭ
Ａフラグがオンの場合は、ＤＭＡによる高速転送を中断
して（ステップ２０３）、ステップ２０４に進む。ＤＭ
Ａによる高速転送が行われていずＤＭＡフラグがオンで
ない場合は、そのままステップ２０４に進む。ステップ
２０４でプリンタコントローラはＡＣＫ信号をローに、
ＦＡＵＬＴ信号とＳＥＬＥＣＴ信号をハイに設定する。
これに対してホスト装置１１２はＳＴＢ信号をローに落
とし、拡張コードをデータバス上にのせて、双方向のモ
ードを指定する。以下ＩＥＥＥの規格に乗っ取って双方
向通信処理を続行する（ステップ２０５）。
Ａフラグがオンの場合は、ＤＭＡによる高速転送を中断
して（ステップ２０３）、ステップ２０４に進む。ＤＭ
Ａによる高速転送が行われていずＤＭＡフラグがオンで
ない場合は、そのままステップ２０４に進む。ステップ
２０４でプリンタコントローラはＡＣＫ信号をローに、
ＦＡＵＬＴ信号とＳＥＬＥＣＴ信号をハイに設定する。
これに対してホスト装置１１２はＳＴＢ信号をローに落
とし、拡張コードをデータバス上にのせて、双方向のモ
ードを指定する。以下ＩＥＥＥの規格に乗っ取って双方
向通信処理を続行する（ステップ２０５）。
【００２６】このように、本発明ではプリンタ装置に、
ＤＭＡを用いたパラレル高速通信が進行中であるかどう
かを示すフラグを設けておき、このフラグをＤＭＡを用
いたパラレル高速通信を開始する時にはオン、ＤＭＡを
用いたパラレル高速通信を終了、中止する時にはオフに
しておく。そうして、プリンタ装置は、ホスト装置から
の１２８４ａｃｔｉｖｅ信号の変化による割り込みが発
生したら、現在ＤＭＡが進行中であるかどうかを示すこ
のフラグをチェックする。
ＤＭＡを用いたパラレル高速通信が進行中であるかどう
かを示すフラグを設けておき、このフラグをＤＭＡを用
いたパラレル高速通信を開始する時にはオン、ＤＭＡを
用いたパラレル高速通信を終了、中止する時にはオフに
しておく。そうして、プリンタ装置は、ホスト装置から
の１２８４ａｃｔｉｖｅ信号の変化による割り込みが発
生したら、現在ＤＭＡが進行中であるかどうかを示すこ
のフラグをチェックする。
【００２７】もし、フラグがオンで、ＤＭＡを用いたパ
ラレル高速通信が進行中であることが分かれば、ＤＭＡ
を中断させるような信号をＤＭＡ用の専用ＩＣ（ＡＳＩ
Ｃ）に出力し、これまでに受信したデータについて、受
信バッファの管理変数などをアップデートし、ＤＭＡ通
信から割り込みによる受信処理に戻す。処理終了後、Ａ
ＣＫ信号をローに、ＦＡＵＬＴ信号とＳＥＬＥＣＴ信号
をハイに設定して、ホスト装置に対して拡張コードの受
信可能を通知する。以下ＩＥＥＥの規格にしたがって双
方向通信を実行する。双方向通信が終了した後は、ＤＭ
Ａによる高速通信中止時の状態に戻して、ＤＭＡによる
高速通信を再開する。
ラレル高速通信が進行中であることが分かれば、ＤＭＡ
を中断させるような信号をＤＭＡ用の専用ＩＣ（ＡＳＩ
Ｃ）に出力し、これまでに受信したデータについて、受
信バッファの管理変数などをアップデートし、ＤＭＡ通
信から割り込みによる受信処理に戻す。処理終了後、Ａ
ＣＫ信号をローに、ＦＡＵＬＴ信号とＳＥＬＥＣＴ信号
をハイに設定して、ホスト装置に対して拡張コードの受
信可能を通知する。以下ＩＥＥＥの規格にしたがって双
方向通信を実行する。双方向通信が終了した後は、ＤＭ
Ａによる高速通信中止時の状態に戻して、ＤＭＡによる
高速通信を再開する。
【００２８】
【発明の効果】以上説明したように本発明は、ホスト装
置からのＤＭＡ転送に基づくパラレルデータの受信を行
うＤＭＡ機能と、ホスト装置との間でＩＥＥＥ１２８４
規格に準拠した双方向通信を行う双方向通信機能とを具
備するプリンタ装置において、前記ＤＭＡ転送における
データ転送を行うピンとは別に前記ＩＥＥＥ１２８４規
格に準拠したパラレルデータの双方向通信に入るための
１２８４ａｃｔｉｖｅ信号を送るピンと、前記ＤＭＡ転
送中に前記ホスト装置が１２８４ａｃｔｉｖｅ信号をハ
イにした場合には、前記ＤＭＡ機能に基づくデータ受信
を中止した後に、前記双方向通信機能に基づく通信を行
う通信制御手段とを具備することを特徴とする。これに
より、現在プリンタ装置がＤＭＡ受信中かどうかが容易
に判定でき、ＤＭＡ受信中にホスト装置から双方向モー
ドに入る要求がなされた場合でも、これに応じた処理が
可能になる。
置からのＤＭＡ転送に基づくパラレルデータの受信を行
うＤＭＡ機能と、ホスト装置との間でＩＥＥＥ１２８４
規格に準拠した双方向通信を行う双方向通信機能とを具
備するプリンタ装置において、前記ＤＭＡ転送における
データ転送を行うピンとは別に前記ＩＥＥＥ１２８４規
格に準拠したパラレルデータの双方向通信に入るための
１２８４ａｃｔｉｖｅ信号を送るピンと、前記ＤＭＡ転
送中に前記ホスト装置が１２８４ａｃｔｉｖｅ信号をハ
イにした場合には、前記ＤＭＡ機能に基づくデータ受信
を中止した後に、前記双方向通信機能に基づく通信を行
う通信制御手段とを具備することを特徴とする。これに
より、現在プリンタ装置がＤＭＡ受信中かどうかが容易
に判定でき、ＤＭＡ受信中にホスト装置から双方向モー
ドに入る要求がなされた場合でも、これに応じた処理が
可能になる。
【００２９】ここで、ホスト装置からの双方向通信機能
に基づく通信要求があった場合には、フラグ手段がＯＮ
の時にはＤＭＡ機能に基づくデータ受信を中止し受信条
件を初期化した後に、フラグ手段がＯＦＦの時には直ち
に、双方向通信可能信号を出力する通信制御手段を具備
することを特徴とする。これにより、ＤＭＡ機能に基づ
く高速データ通信が可能でかつＩＥＥＥ１２８４規格に
よる双方向通信の可能なプリンタ装置を実現できる。
に基づく通信要求があった場合には、フラグ手段がＯＮ
の時にはＤＭＡ機能に基づくデータ受信を中止し受信条
件を初期化した後に、フラグ手段がＯＦＦの時には直ち
に、双方向通信可能信号を出力する通信制御手段を具備
することを特徴とする。これにより、ＤＭＡ機能に基づ
く高速データ通信が可能でかつＩＥＥＥ１２８４規格に
よる双方向通信の可能なプリンタ装置を実現できる。
【００３０】また、通信制御手段はＤＭＡ機能に基づく
データ受信を中止した後に双方向通信機能に基づく通信
を行った場合には、双方向通信機能に基づく通信終了後
にＤＭＡ機能に基づくデータ受信を自動的に再開する事
を特徴とする。これにより、ＤＭＡ機能に基づく高速通
信を中止してＩＥＥＥ１２８４規格による双方向通信を
行った後に、再度、ＤＭＡ機能に基づく高速通信を自動
的に再開できる。
データ受信を中止した後に双方向通信機能に基づく通信
を行った場合には、双方向通信機能に基づく通信終了後
にＤＭＡ機能に基づくデータ受信を自動的に再開する事
を特徴とする。これにより、ＤＭＡ機能に基づく高速通
信を中止してＩＥＥＥ１２８４規格による双方向通信を
行った後に、再度、ＤＭＡ機能に基づく高速通信を自動
的に再開できる。
【図１】本発明のプリンタコントローラの一実施形態の
構成を示すブロック図。
構成を示すブロック図。
【図２】セントロニクス・コネクタのピン配置例とＩＥ
ＥＥ１２８４の信号の対応を示す図表。
ＥＥ１２８４の信号の対応を示す図表。
【図３】本発明のプリンタコントローラの処理を示すフ
ローチャート。
ローチャート。
１００ プリンタコントローラ
１０１ ＣＰＵ
１０２ ＩＣカード
１０３ 不揮発性記憶装置
１０４ プログラムＲＯＭ
１０５ フォントＲＯＭ
１０６ ＲＡＭ
１０７ エンジンインタフェース
１０８ エンジン
１０９ パネルインタフェース
１１０ パネル装置
１１１ ホストインタフェース
１１２ ホスト装置
フロントページの続き
(56)参考文献 特開 平４−306754（ＪＰ，Ａ)
特開 平４−257049（ＪＰ，Ａ)
特開 平８−156342（ＪＰ，Ａ)
特開 平１−277928（ＪＰ，Ａ)
特開 平８−30543（ＪＰ，Ａ)
特開 平４−316149（ＪＰ，Ａ)
特開 平８−337015（ＪＰ，Ａ)
特開 平４−68433（ＪＰ，Ａ)
特開 平６−161891（ＪＰ，Ａ)
特開 平６−110829（ＪＰ，Ａ)
特開 平５−265667（ＪＰ，Ａ)
特開 平７−271714（ＪＰ，Ａ)
特開 平７−149001（ＪＰ，Ａ)
特開 平６−282501（ＪＰ，Ａ)
(58)調査した分野(Int.Cl.7，ＤＢ名)
G06F 3/12
B41J 29/38
Claims (3)
- 【請求項１】 ホスト装置からのＤＭＡ転送に基づくパ
ラレルデータの受信を行うＤＭＡ機能と、ホスト装置と
の間でＩＥＥＥ１２８４規格に準拠した双方向通信を行
う双方向通信機能とを具備するプリンタ装置において、前記ＤＭＡ転送におけるデータ転送を行うピンとは別に
前記ＩＥＥＥ１２８４規格に準拠したパラレルデータの
双方向通信に入るための１２８４ａｃｔｉｖｅ信号を送
るピンと、 前記ＤＭＡ転送中に前記ホスト装置が１２８４ａｃｔｉ
ｖｅ信号をハイにした場合には、前記ＤＭＡ機能に基づ
くデータ受信を中止した後に、前記双方向通信機能に基
づく通信を行う通信制御手段と を具備することを特徴と
するプリンタ装置。 - 【請求項２】 ホスト装置からの前記双方向通信機能に
基づく通信要求があった場合には、前記フラグ手段がＯ
Ｎの時には前記ＤＭＡ機能に基づくデータ受信を中止し
受信条件を初期化した後に、前記フラグ手段がＯＦＦの
時には直ちに、双方向通信可能信号を出力する通信制御
手段を具備することを特徴とする請求項１記載のプリン
タ装置。 - 【請求項３】 前記通信制御手段は前記ＤＭＡ機能に基
づくデータ受信を中止した後に前記双方向通信機能に基
づく通信を行った場合には、前記双方向通信機能に基づ
く通信終了後に前記ＤＭＡ機能に基づくデータ受信を自
動的に再開する事を特徴とする請求項２記載のプリンタ
装置。
Priority Applications (2)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP18855396A JP3478519B2 (ja) | 1996-06-28 | 1996-06-28 | プリンタ装置 |
| US08/886,050 US5974477A (en) | 1996-06-28 | 1997-06-30 | Image forming apparatus capable of receiving data in high speed in accordance with high speed data transmission interface |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP18855396A JP3478519B2 (ja) | 1996-06-28 | 1996-06-28 | プリンタ装置 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPH1021019A JPH1021019A (ja) | 1998-01-23 |
| JP3478519B2 true JP3478519B2 (ja) | 2003-12-15 |
Family
ID=16225718
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP18855396A Expired - Lifetime JP3478519B2 (ja) | 1996-06-28 | 1996-06-28 | プリンタ装置 |
Country Status (2)
| Country | Link |
|---|---|
| US (1) | US5974477A (ja) |
| JP (1) | JP3478519B2 (ja) |
Families Citing this family (4)
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|---|---|---|---|---|
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| US7373347B2 (en) * | 2002-07-22 | 2008-05-13 | Ricoh Company, Ltd. | Information processing apparatus and information processing method |
| JP2004118828A (ja) * | 2002-09-03 | 2004-04-15 | Ricoh Co Ltd | 画像処理装置 |
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| DE69127851T2 (de) * | 1990-05-22 | 1998-04-30 | Nec Corp | Direktspeicherzugriffübertragungssystem und Benutzung |
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| JP3448689B2 (ja) * | 1993-02-22 | 2003-09-22 | 株式会社日立製作所 | Ｉｏ制御方法および情報処理装置 |
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| US5710939A (en) * | 1995-05-26 | 1998-01-20 | National Semiconductor Corporation | Bidirectional parallel data port having multiple data transfer rates, master, and slave operation modes, and selective data transfer termination |
| JP3016415B2 (ja) * | 1995-06-14 | 2000-03-06 | ブラザー工業株式会社 | データ転送方法及びそのデータ転送システム |
| US5651114A (en) * | 1995-06-23 | 1997-07-22 | Lexmark International, Inc. | External network adapter for handling normal and alternate channel data over a single bi-directional channel connected to a printer |
| US5819111A (en) * | 1996-03-15 | 1998-10-06 | Adobe Systems, Inc. | System for managing transfer of data by delaying flow controlling of data through the interface controller until the run length encoded data transfer is complete |
| US5896550A (en) * | 1997-04-03 | 1999-04-20 | Vlsi Technology, Inc. | Direct memory access controller with full read/write capability |
-
1996
- 1996-06-28 JP JP18855396A patent/JP3478519B2/ja not_active Expired - Lifetime
-
1997
- 1997-06-30 US US08/886,050 patent/US5974477A/en not_active Expired - Lifetime
Also Published As
| Publication number | Publication date |
|---|---|
| US5974477A (en) | 1999-10-26 |
| JPH1021019A (ja) | 1998-01-23 |
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