JP3379100B2 - シングルダマシン構造の埋め込み配線及びその形成方法 - Google Patents

シングルダマシン構造の埋め込み配線及びその形成方法

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Description

【発明の詳細な説明】
【0001】
【発明の属する技術分野】本発明は、シングルダマシン
構造の埋め込み配線及びその形成方法に関し、更に詳し
くは、電気的接続の信頼性が高いシングルダマシン構造
の埋め込み配線及びその形成方法に関するものである。
【0002】
【従来の技術】半導体装置の微細化、高集積化に伴い、
半導体装置の配線も微細化、多層化しているために、絶
縁膜上に配線を形成する方法に代えて、絶縁膜内に埋め
込み金属配線を形成する、いわゆるダマシン法が実用化
されている。ここで、図4を参照して、従来の方法で、
シングルダマシン構造の埋め込み配線を形成する方法を
説明する。図4(a)から(e)は、従来の方法でシン
グルダマシン構造の埋め込み配線を形成する際の工程毎
の基板断面図である。先ず、下層配線10の上に、順
次、下部層間絶縁膜12及びエッチングストッパ層14
を成膜する(図4(a))。次いで、下部層間絶縁膜1
2及びエッチングストッパ層14を貫通して、下層配線
10に達するコンタクトホール18を形成する(図4
(b))。更に、スパッタリング等により導電体膜とし
てタングステン(W)膜を成膜してコンタクトホール1
8をWで埋め込み、エッチバック等を行ってエッチング
ストッパ層14の上のW膜を除去し、コンタクトプラグ
20を形成する(図4(c))。
【0003】次いで、上部層間絶縁膜22を成膜し、更
に、フォトレジスト膜を成膜してパターンニングしてマ
スクを形成し、続いて、エッチングし、フォトレジスト
膜を除去する。この結果、配線溝24が形成される(図
4(d))。次いで、低電気抵抗の金属膜を全面に成膜
し、上部層間絶縁膜上の金属膜を除去して、シングルダ
マシン構造の埋め込み配線28を形成する(図4
(e))。低電気抵抗の金属膜は、例えばアルミニウム
(Al)や銅(Cu)からなる。
【0004】
【発明が解決しようとする課題】しかし、従来の方法で
シングルダマシン構造の埋め込み配線を形成すると、コ
ンタクトプラグと配線溝との間でいわゆる目ずれが生じ
て、コンタクトプラグ上からずれた位置に配線溝が形成
されることが多く、この結果、コンタクトプラグと埋め
込み配線との間で電気的な接続不良が生じるという問題
があった。この問題は、半導体装置の微細化、高集積化
のために埋め込み配線の幅をコンタクトプラグの幅と同
程度にまで狭めた、いわゆるボーダーレスビアが形成さ
れていると、一層顕著であった。以上のような事情に照
らして、本発明の目的は、電気的接続の信頼性が高いシ
ングルダマシン構造の埋め込み配線及びその形成方法を
提供することである。
【0005】
【課題を解決するための手段】上記目的を達成するため
に、本発明に係るシングルダマシン構造の埋め込み配線
は、下層配線上に順次成膜された下部層間絶縁膜、エッ
チングストッパ層、及び、上部層間絶縁膜と、上部層間
絶縁膜、エッチングストッパ層、及び、下部層間絶縁膜
を貫通して下層配線に電気的に接続するコンタクトプラ
グと、上部層間絶縁膜に形成された配線溝を埋め込み、
かつ、コンタクトプラグの上部側壁に電気的に接続する
埋め込み配線とを備えていることを特徴としている。
【0006】これにより、埋め込み配線はコンタクトプ
ラグの上部側壁に電気的に接続するので、電気的接続の
信頼性が従来に比べて遙かに高い。
【0007】本発明では、配線溝及びコンタクトプラグ
が同じ幅を有する場合に、特に有効な効果が奏される。
エッチングストッパ層は、例えばSiN膜からなる。コ
ンタクトプラグは、例えばタングステン又はタングステ
ン合金からなる。埋め込み配線は、例えば、アルミニウ
ム、銅、及びこれらの合金の何れかからなる。
【0008】本発明方法に係るシングルダマシン構造の
埋め込み配線の形成方法は、下層配線上に、順次、下部
層間絶縁膜、エッチングストッパ層、及び、上部層間絶
縁膜を成膜する工程と、上部層間絶縁膜、エッチングス
トッパ層、及び、下部層間絶縁膜を貫通して、下層配線
に達するコンタクトホールを形成する工程と、スパッタ
リングにより導電体膜を全面に成膜し、更に、上部層間
絶縁膜上の導電体膜をエッチバックにより除去してコン
タクトプラグを形成する工程と、上部層間絶縁膜をエッ
チングしてパターンニングし、コンタクトプラグの上部
側壁を露出させる配線溝を形成する工程と、低電気抵抗
の金属膜を全面に成膜し、更に、上部層間絶縁膜上の金
属膜を除去して埋め込み配線を形成する工程とを備えて
いる。
【0009】エッチングストッパ層としては、例えばS
iN膜を成膜する。本発明方法では、上部層間絶縁膜を
エッチングして配線溝を形成する際、エッチングストッ
パ層がエッチングを自動的に停止させる。また、上部層
間絶縁膜上の金属膜を除去する際、例えば化学機械研磨
により除去する。
【0010】本発明方法により、電気的接続の信頼性の
高いシングルダマシン構造の埋め込み配線を形成するこ
とができる。
【0011】
【発明の実施の形態】以下に、実施形態例を挙げ、添付
図面を参照して、本発明の実施の形態を具体的かつより
詳細に説明する。実施形態例 本実施形態例は、本発明に係るシングルダマシン構造の
埋め込み配線を本発明方法により形成する一実施形態例
である。図1は、本実施形態例でシングルダマシン構造
の埋め込み配線を形成する際の工程毎の基板断面図であ
る。先ず、下層配線10の上に、順次、下部層間絶縁膜
30、SiN膜からなるエッチングストッパ層32、及
び、上部層間絶縁膜34を成膜する(図1(a))。次
いで、上部層間絶縁膜34、エッチングストッパ層3
2、及び、下部層間絶縁膜30を貫通して、下層配線1
0に達するコンタクトホール36を形成する(図1
(b))。更に、スパッタリング等により導電体膜とし
てタングステン(W)膜を成膜してコンタクトホール3
6をWで埋め込み、エッチバックして上部層間絶縁膜3
4の上のW膜を除去し、コンタクトプラグ40を形成す
る(図1(c))。
【0012】次いで、フォトレジスト膜を成膜してパタ
ーンニングしてマスクを形成し、続いて、エッチング
し、フォトレジスト膜を除去する。エッチングでは、エ
ッチングストッパ層32がエッチングを自動的に停止さ
せる。このようにして、コンタクトプラグ40と同じ幅
を有する配線溝44を形成する(図1(d))。尚、コ
ンタクトプラグ40と配線溝44との関係を判り易くす
るために、図1(d)に示した基板の斜視断面図を図2
に示す。次いで、例えばアルミニウム(Al)や銅(C
u)などの低電気抵抗の金属膜を全面に成膜する。更
に、CMP研磨を行って上部層間絶縁膜上の金属膜を除
去する。この結果、シングルダマシン構造の埋め込み配
線48が得られる(図1(e))。尚、コンタクトプラ
グ40と埋め込み配線48との関係を判り易くするため
に、図1(e)に示した基板の斜視断面図を図3に示
す。
【0013】本実施形態例で形成されたシングルダマシ
ン構造の埋め込み配線48は、コンタクトプラグ40の
側壁に電気的に接続するので、コンタクトプラグ40と
埋め込み配線48との間でいわゆる目ずれが生じても、
従来のように電気的な接続不良を起こすことはない。従
って、電気的接続の信頼性が、従来に比べて遙かに高
い。
【0014】
【発明の効果】本発明によれば、上部層間絶縁膜に形成
された配線溝を埋め込み、かつ、コンタクトプラグの上
部側壁に電気的に接続するシングルダマシン構造の埋め
込み配線を備えている。これにより、コンタクトプラグ
と埋め込み配線との間の電気的接続の信頼性が、従来に
比べて遙かに高くなる。
【図面の簡単な説明】
【図1】実施形態例でシングルダマシン構造の埋め込み
配線を形成する際の工程毎の基板断面図である。
【図2】図1(d)に示した基板の斜視断面図である。
【図3】図1(e)に示した基板の斜視断面図である。
【図4】従来の方法でシングルダマシン構造の埋め込み
配線を形成する際の工程毎の基板断面図である。
【符号の説明】
10 下層配線 12 下部層間絶縁膜 14 エッチングストッパ層 18 コンタクトホール 20 コンタクトプラグ 22 上部層間絶縁膜 24 配線溝 28 シングルダマシン構造の埋め込み配線 30 下部層間絶縁膜 32 エッチングストッパ層 34 上部層間絶縁膜 36 コンタクトホール 40 コンタクトプラグ 44 配線溝 48 シングルダマシン構造の埋め込み配線

Claims (8)

    (57)【特許請求の範囲】
  1. 【請求項1】 下層配線上に順次成膜された下部層間絶
    縁膜、エッチングストッパ層、及び、上部層間絶縁膜
    と、 上部層間絶縁膜、エッチングストッパ層、及び、下部層
    間絶縁膜を貫通して下層配線に電気的に接続するコンタ
    クトプラグと、 上部層間絶縁膜に形成された配線溝を埋め込み、かつ、
    コンタクトプラグの上部層間絶縁膜に隣接する上部側壁
    に電気的に接続する埋め込み配線とを備え、 配線溝及びコンタクトプラグが、相互に同じ幅を有する
    ことを特徴とするシングルダマシン構造の埋め込み配
    線。
  2. 【請求項2】 エッチングストッパ層が、SiN膜から
    なることを特徴とする請求項1に記載のシングルダマシ
    ン構造の埋め込み配線。
  3. 【請求項3】 コンタクトプラグが、タングステン又は
    タングステン合金からなることを特徴とする請求項1又
    は2に記載のシングルダマシン構造の埋め込み配線。
  4. 【請求項4】 埋め込み配線が、アルミニウム、銅、及
    びこれらの合金の何れかからなることを特徴とする請求
    項1から3のうち何れか1項に記載のシングルダマシン
    構造の埋め込み配線。
  5. 【請求項5】 シングルダマシン構造の埋め込み配線の
    形成方法であって、 下層配線上に、順次、下部層間絶縁膜、エッチングスト
    ッパ層、及び、上部層間絶縁膜を成膜する工程と、 上部層間絶縁膜、エッチングストッパ層、及び、下部層
    間絶縁膜を貫通して、下層配線に達するコンタクトホー
    ルを形成する工程と、 スパッタリングにより導電体膜を全面に成膜し、更に、
    上部層間絶縁膜上の導電体膜をエッチバックにより除去
    してコンタクトプラグを形成する工程と、 上部層間絶縁膜をエッチングストッパ層までエッチング
    してパターンニングし、コンタクトプラグの上部側壁を
    露出させ、且つ、コンタクトプラグと同じ幅を有する配
    線溝を形成する工程と、 低電気抵抗の金属膜を全面に成膜し、更に、上部層間絶
    縁膜上の金属膜を除去して埋め込み配線を形成する工程
    とを備えていることを特徴とするシングルダマシン構造
    の埋め込み配線の形成方法。
  6. 【請求項6】 エッチングストッパ層としてSiN膜を
    成膜することを特徴とする請求項5に記載のシングルダ
    マシン構造の埋め込み配線の形成方法。
  7. 【請求項7】 上部層間絶縁膜をエッチングして配線溝
    を形成する際、エッチングストッパ層がエッチングを自
    動的に停止させることを特徴とする請求項5又は6に記
    載のシングルダマシン構造の埋め込み配線の形成方法。
  8. 【請求項8】 上部層間絶縁膜上の金属膜を除去する
    際、化学機械研磨して除去することを特徴とする請求項
    5から7のうち何れか1項に記載のシングルダマシン構
    造の埋め込み配線の形成方法。
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KR1019990036868A KR100338850B1 (ko) 1998-09-04 1999-09-01 매입배선구조 및 그 형성방법
TW088115101A TW459289B (en) 1998-09-04 1999-09-02 Embedded wiring structure and method for forming the same
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Families Citing this family (11)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
US6611010B2 (en) 1999-12-03 2003-08-26 Kabushiki Kaisha Toshiba Semiconductor device
TWI248192B (en) * 2002-10-18 2006-01-21 Matsushita Electric Ind Co Ltd Semiconductor integrated circuit and its manufacturing method
KR100598245B1 (ko) * 2002-12-30 2006-07-07 동부일렉트로닉스 주식회사 반도체 금속 배선 형성 방법
JP4954448B2 (ja) * 2003-04-05 2012-06-13 ローム・アンド・ハース・エレクトロニック・マテリアルズ,エル.エル.シー. 有機金属化合物
KR100539444B1 (ko) * 2003-07-11 2005-12-27 매그나칩 반도체 유한회사 반도체 소자의 금속배선 형성방법
JPWO2005034234A1 (ja) 2003-10-02 2006-12-14 富士通株式会社 半導体装置及びその製造方法
US7332805B2 (en) * 2004-01-06 2008-02-19 International Business Machines Corporation Electronic package with improved current carrying capability and method of forming the same
KR100704784B1 (ko) 2005-03-07 2007-04-10 삼성전자주식회사 적층된 반도체 장치 및 그 제조방법
TWI405515B (zh) 2009-12-30 2013-08-11 Unimicron Technology Corp 線路板及其製程
US9059166B2 (en) * 2013-05-09 2015-06-16 International Business Machines Corporation Interconnect with hybrid metallization
CN103607660A (zh) * 2013-11-22 2014-02-26 乐视致新电子科技(天津)有限公司 智能电视的界面切换的控制方法和控制装置

Family Cites Families (10)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
DE4432459A1 (de) * 1994-09-12 1996-03-14 Basf Ag Verfahren zur Herstellung mehrfarbiger Keramikformteile
US5565707A (en) * 1994-10-31 1996-10-15 International Business Machines Corporation Interconnect structure using a Al2 Cu for an integrated circuit chip
JPH08201399A (ja) 1995-01-20 1996-08-09 Hitachi Constr Mach Co Ltd 微動機構
JPH08213459A (ja) 1995-02-06 1996-08-20 Mitsubishi Electric Corp 半導体装置及びその製造方法
JPH08316309A (ja) 1995-05-12 1996-11-29 Sony Corp 半導体装置の製造方法
JPH08335634A (ja) 1995-06-08 1996-12-17 Toshiba Corp 半導体装置の製造方法
US5854515A (en) * 1996-07-23 1998-12-29 Advanced Micro Devices, Inc. Integrated circuit having conductors of enhanced cross-sectional area
KR100219508B1 (ko) 1996-12-30 1999-09-01 윤종용 반도체장치의 금속배선층 형성방법
JPH10199972A (ja) 1997-01-08 1998-07-31 Sony Corp 配線構造の形成方法および配線構造
US6110826A (en) * 1998-06-08 2000-08-29 Industrial Technology Research Institute Dual damascene process using selective W CVD

Also Published As

Publication number Publication date
US6359329B1 (en) 2002-03-19
KR20000022840A (ko) 2000-04-25
TW459289B (en) 2001-10-11
KR100338850B1 (ko) 2002-05-30
CN1247383A (zh) 2000-03-15
CN1117392C (zh) 2003-08-06
JP2000082738A (ja) 2000-03-21

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