JP3305351B2 - 自動車のための制御装置をアプリケーション処理するための装置 - Google Patents
自動車のための制御装置をアプリケーション処理するための装置Info
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- F—MECHANICAL ENGINEERING; LIGHTING; HEATING; WEAPONS; BLASTING
- F02—COMBUSTION ENGINES; HOT-GAS OR COMBUSTION-PRODUCT ENGINE PLANTS
- F02P—IGNITION, OTHER THAN COMPRESSION IGNITION, FOR INTERNAL-COMBUSTION ENGINES; TESTING OF IGNITION TIMING IN COMPRESSION-IGNITION ENGINES
- F02P17/00—Testing of ignition installations, e.g. in combination with adjusting; Testing of ignition timing in compression-ignition engines
-
- F—MECHANICAL ENGINEERING; LIGHTING; HEATING; WEAPONS; BLASTING
- F02—COMBUSTION ENGINES; HOT-GAS OR COMBUSTION-PRODUCT ENGINE PLANTS
- F02P—IGNITION, OTHER THAN COMPRESSION IGNITION, FOR INTERNAL-COMBUSTION ENGINES; TESTING OF IGNITION TIMING IN COMPRESSION-IGNITION ENGINES
- F02P17/00—Testing of ignition installations, e.g. in combination with adjusting; Testing of ignition timing in compression-ignition engines
- F02P17/02—Checking or adjusting ignition timing
- F02P17/04—Checking or adjusting ignition timing dynamically
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- F02P—IGNITION, OTHER THAN COMPRESSION IGNITION, FOR INTERNAL-COMBUSTION ENGINES; TESTING OF IGNITION TIMING IN COMPRESSION-IGNITION ENGINES
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Description
【０００１】
【産業上の利用分野】本発明は、自動車用の制御装置、
特に点火制御装置及び又は噴射制御装置をアプリケーシ
ョン処理するための装置に関する。
特に点火制御装置及び又は噴射制御装置をアプリケーシ
ョン処理するための装置に関する。
【０００２】
【従来の技術】例えば自動車の点火装置、燃料噴射装
置、スキッドコントロール装置、ステアリング装置又は
その類似装置のための制御装置を組込み個所において、
高速マイクロコントローラ乃至マイクロプロセッサを備
えた制御装置によってアプリケーション処理することが
できるようにするため、公知の形式にあっては、汎用の
ＰＲＯＭ又はＥＰＲＯＭとして形成された制御装置のデ
ータ／プログラム読出しメモリが、データ処理装置によ
る通常の差し替えによって取り替えられている。その際
このデータ処理装置は、書込み／読出しメモリ（ＲＡ
Ｍ）を有している小さな付加的ハードウェアとして構成
されている。この書込み／読出しメモリは、制御装置の
ＥＰＲＯＭを代替している。つまり例えば操作コンピュ
ータのような外部の操作装置を介して、書込み／読出し
メモリのデータ及びプログラム値が直列のインタフェー
スを介して変換される。同時にデジタル形状の測定デー
タが、同一のインタフェースを介して伝送される。この
アプリケーション処理は、原理的には、マイクロプロセ
ッサを備えた任意の装置に対して使用可能である。
置、スキッドコントロール装置、ステアリング装置又は
その類似装置のための制御装置を組込み個所において、
高速マイクロコントローラ乃至マイクロプロセッサを備
えた制御装置によってアプリケーション処理することが
できるようにするため、公知の形式にあっては、汎用の
ＰＲＯＭ又はＥＰＲＯＭとして形成された制御装置のデ
ータ／プログラム読出しメモリが、データ処理装置によ
る通常の差し替えによって取り替えられている。その際
このデータ処理装置は、書込み／読出しメモリ（ＲＡ
Ｍ）を有している小さな付加的ハードウェアとして構成
されている。この書込み／読出しメモリは、制御装置の
ＥＰＲＯＭを代替している。つまり例えば操作コンピュ
ータのような外部の操作装置を介して、書込み／読出し
メモリのデータ及びプログラム値が直列のインタフェー
スを介して変換される。同時にデジタル形状の測定デー
タが、同一のインタフェースを介して伝送される。この
アプリケーション処理は、原理的には、マイクロプロセ
ッサを備えた任意の装置に対して使用可能である。
【０００３】制御装置の運転中にこのデータ変換を遂行
することができるようにするため、本出願人の公知の使
用装置ＶＳ１００−Ｄ１Ｍは、物理的に分離された２つ
のＲＡＭバンクを有しており、それらの間で夫々変換が
行われている。制御装置が第１ＲＡＭバンクに位置して
いる場合は、操作コンピュータによって第２ＲＡＭバン
クにだけアクセスすることができ、またその逆も可能で
ある。この形式は比較的経費が嵩み、かつ柔軟性に乏し
い。しかしこの両ＲＡＭバンクの代りに所謂デュアルポ
ートＲＡＭ（Ｄｕａｌ−Ｐｏｒｔ−ＲＡＭ）を使用し
て、制御装置の運転中同時に、外方側部によってもアク
セスできるようにすることも可能である。しかし例えば
測定データを読出し又はパラメータを変化せしめるため
に必要な、６４キロバイトより大きな記憶容量に対して
は、この種の構成ユニットは使用不可能である。
することができるようにするため、本出願人の公知の使
用装置ＶＳ１００−Ｄ１Ｍは、物理的に分離された２つ
のＲＡＭバンクを有しており、それらの間で夫々変換が
行われている。制御装置が第１ＲＡＭバンクに位置して
いる場合は、操作コンピュータによって第２ＲＡＭバン
クにだけアクセスすることができ、またその逆も可能で
ある。この形式は比較的経費が嵩み、かつ柔軟性に乏し
い。しかしこの両ＲＡＭバンクの代りに所謂デュアルポ
ートＲＡＭ（Ｄｕａｌ−Ｐｏｒｔ−ＲＡＭ）を使用し
て、制御装置の運転中同時に、外方側部によってもアク
セスできるようにすることも可能である。しかし例えば
測定データを読出し又はパラメータを変化せしめるため
に必要な、６４キロバイトより大きな記憶容量に対して
は、この種の構成ユニットは使用不可能である。
【０００４】
【発明が解決しようとする課題】本発明の課題は、上述
の欠点を除去することにある。
の欠点を除去することにある。
【０００５】
【課題を解決するための手段】本発明では、請求項１に
記載の特徴によって上記課題を解決することができた。
記載の特徴によって上記課題を解決することができた。
【０００６】
【発明の効果】請求項１の特徴を備えた本発明の装置
は、１メガビットの記憶容量を有している今日では標準
の静的なＲＡＭによって、デュアルポートＲＡＭの機能
を実現することができるという利点を有している。ＲＡ
Ｍ上への故障なしのアクセスが、本装置の直列のインタ
フェースによって、離れた遠隔地を介して、例えば駆動
容量に応じて夫々５ｍから１００ｍまでの遠隔地を介し
て実現可能である。また物理的に分離されたＲＡＭユニ
ットによる依存性が無くなり、かつ種々の特性を備えた
ＲＡＭの部分領域が、それらの間で任意に切り換えられ
るように規定されている（例えば書込みだけ、読出しだ
け、又は読出しと書込み）。
は、１メガビットの記憶容量を有している今日では標準
の静的なＲＡＭによって、デュアルポートＲＡＭの機能
を実現することができるという利点を有している。ＲＡ
Ｍ上への故障なしのアクセスが、本装置の直列のインタ
フェースによって、離れた遠隔地を介して、例えば駆動
容量に応じて夫々５ｍから１００ｍまでの遠隔地を介し
て実現可能である。また物理的に分離されたＲＡＭユニ
ットによる依存性が無くなり、かつ種々の特性を備えた
ＲＡＭの部分領域が、それらの間で任意に切り換えられ
るように規定されている（例えば書込みだけ、読出しだ
け、又は読出しと書込み）。
【０００７】別の利点は、ＲＡＭメモリがエミュレーシ
ョンメモリとして、多くの任意の個々のＲＡＭから簡単
な並列接続によって構成することができるという点にあ
る。これによって、データ処理装置のピンが個々のクリ
ップとして形成されている限り、その数を低く抑えるこ
とができる。
ョンメモリとして、多くの任意の個々のＲＡＭから簡単
な並列接続によって構成することができるという点にあ
る。これによって、データ処理装置のピンが個々のクリ
ップとして形成されている限り、その数を低く抑えるこ
とができる。
【０００８】ＲＡＭ内に記憶された全部のマッピング
は、これを側方切換装置によって切り換えることができ
るが、また個々のパラメータだけの場合も、夫々の活性
面の内方で側方切換装置なしで変化せしめることができ
る。
は、これを側方切換装置によって切り換えることができ
るが、また個々のパラメータだけの場合も、夫々の活性
面の内方で側方切換装置なしで変化せしめることができ
る。
【０００９】全装置、特にデータ処理装置は、必要とす
る構成部品の数が極く僅かである。これによって小さな
寸法を達成することができ、その結果、直列に近似した
制御装置内への組み込みも実現できるようになった。
る構成部品の数が極く僅かである。これによって小さな
寸法を達成することができ、その結果、直列に近似した
制御装置内への組み込みも実現できるようになった。
【００１０】バス管路のデータ処理装置からの引き出し
は、直列のインタフェースのために不必要である。これ
によって信頼性が向上し、かつ故障の再発が減少せしめ
られ、また新世代（例えば８０Ｃ１９６ＫＲ−１６ＭＨ
ｚ）の高速マイクロコントローラの使用が可能になっ
た。アプリケーション処理さるべき制御装置は、遠距離
を介しての故障なしのアクセスによって、その元の組込
み位置にそのままにして置かれる。その際光導体上の直
列状のアプリケーションインタフェースの切換によっ
て、伝送レートと故障の安全性とが更に向上せしめられ
る。このことは、試験台及び試験室において特に有利で
ある。
は、直列のインタフェースのために不必要である。これ
によって信頼性が向上し、かつ故障の再発が減少せしめ
られ、また新世代（例えば８０Ｃ１９６ＫＲ−１６ＭＨ
ｚ）の高速マイクロコントローラの使用が可能になっ
た。アプリケーション処理さるべき制御装置は、遠距離
を介しての故障なしのアクセスによって、その元の組込
み位置にそのままにして置かれる。その際光導体上の直
列状のアプリケーションインタフェースの切換によっ
て、伝送レートと故障の安全性とが更に向上せしめられ
る。このことは、試験台及び試験室において特に有利で
ある。
【００１１】別の利点は、異なる制御装置を同一の構造
体によって複雑な適合部無しで操作することができると
いう点にある。しかもこの構造体は、例えばパラメータ
調節、ＥＰＲＯＭ切換、データ検出、バイパス計算機能
等の異なる使用課題に関しても自在に使用可能である。
体によって複雑な適合部無しで操作することができると
いう点にある。しかもこの構造体は、例えばパラメータ
調節、ＥＰＲＯＭ切換、データ検出、バイパス計算機能
等の異なる使用課題に関しても自在に使用可能である。
【００１２】本発明の装置は、直列アプリケーションの
利点（制御装置への故障なしの任意の長さの接続部）
と、ＥＰＲＯＭインタフェースを介しての制御装置への
並列アプリケーションの利点（直列インタフェースの操
作のため制御装置コンピュータの付加的なソフトウェア
負荷がない）とを、全体として１体化せしめている。
利点（制御装置への故障なしの任意の長さの接続部）
と、ＥＰＲＯＭインタフェースを介しての制御装置への
並列アプリケーションの利点（直列インタフェースの操
作のため制御装置コンピュータの付加的なソフトウェア
負荷がない）とを、全体として１体化せしめている。
【００１３】請求項２以下に述べられている対策によ
り、請求項１で述べた装置の別の有利な構成要件が実現
されている。
り、請求項１で述べた装置の別の有利な構成要件が実現
されている。
【００１４】マイクロプロセッサによるこの形成で特に
有利なのは、書込み−読出しメモリの制御がマルチプレ
ックスバス制御によって行われる場合である。その際各
サイクルの間、第１位相においてはアドレス伝送が行わ
れ、また第２位相においてはデータの読込み又は読出し
が行われる。マルチプレックス運転の際のバス帯域幅の
劣悪な利用度が、これによって、第２アクセスのために
メモリ上で有利な形式で向上せしめられる。
有利なのは、書込み−読出しメモリの制御がマルチプレ
ックスバス制御によって行われる場合である。その際各
サイクルの間、第１位相においてはアドレス伝送が行わ
れ、また第２位相においてはデータの読込み又は読出し
が行われる。マルチプレックス運転の際のバス帯域幅の
劣悪な利用度が、これによって、第２アクセスのために
メモリ上で有利な形式で向上せしめられる。
【００１５】データ処理装置の特に省スペース的な配置
は、全制御部を（メモリを除いて）１つのチップ上に位
置せしめることによって達成される。これによってこの
チップは、簡単な形式で制御装置のデータ／プログラム
読出しメモリに問題なく代えることができ、また直列に
近似した制御装置又は直列制御装置の場合も同じ様に代
えることができる。その際このチップは、プログラミン
グ可能なＡＳＩＣ(Application Specific Integrated C
ircuit)チップとして形成されていると有利である。
は、全制御部を（メモリを除いて）１つのチップ上に位
置せしめることによって達成される。これによってこの
チップは、簡単な形式で制御装置のデータ／プログラム
読出しメモリに問題なく代えることができ、また直列に
近似した制御装置又は直列制御装置の場合も同じ様に代
えることができる。その際このチップは、プログラミン
グ可能なＡＳＩＣ(Application Specific Integrated C
ircuit)チップとして形成されていると有利である。
【００１６】別の利点が、データ処理装置上の書込み／
読出しメモリに対して平行な、データ／プログラム読出
しメモリの平行配置によって発生している。その際この
データ／プログラム読出しメモリは、有利にはＥＥＰＲ
ＯＭとして構成されている。これによって両メモリのデ
ータ内容は、指令制御されて相互にメモリ交換が行われ
るようになる。例えばリセットインパルスによりＥＥＰ
ＲＯＭの内容が書込み／読出しメモリに受け取られるよ
うになり、それによって、プリセットが実行できるよう
になる。反対にエミュレートされたデータをＥＥＰＲＯ
Ｍ内で保護することができる。
読出しメモリに対して平行な、データ／プログラム読出
しメモリの平行配置によって発生している。その際この
データ／プログラム読出しメモリは、有利にはＥＥＰＲ
ＯＭとして構成されている。これによって両メモリのデ
ータ内容は、指令制御されて相互にメモリ交換が行われ
るようになる。例えばリセットインパルスによりＥＥＰ
ＲＯＭの内容が書込み／読出しメモリに受け取られるよ
うになり、それによって、プリセットが実行できるよう
になる。反対にエミュレートされたデータをＥＥＰＲＯ
Ｍ内で保護することができる。
【００１７】
【実施例】本発明の実施例を図面に図示し、次にこれを
詳細に説明する。
詳細に説明する。
【００１８】書込み／読出しメモリ１０（ＲＡＭ）及び
データ／プログラム読出しメモリ１１（ＥＥＰＲＯＭ）
は、データ／アドレスバス１２を介して並列に接続され
ている。以下では表現を簡略化して、これらをＲＡＭ１
０、ＥＥＰＲＯＭ１１及びバス１２と呼ぶことにする。
ＥＥＰＲＯＭの代りに、原理的にはＥＰＲＯＭで代替す
ることも可能である。
データ／プログラム読出しメモリ１１（ＥＥＰＲＯＭ）
は、データ／アドレスバス１２を介して並列に接続され
ている。以下では表現を簡略化して、これらをＲＡＭ１
０、ＥＥＰＲＯＭ１１及びバス１２と呼ぶことにする。
ＥＥＰＲＯＭの代りに、原理的にはＥＰＲＯＭで代替す
ることも可能である。
【００１９】バス１２は、切換装置１３を介して、制御
装置１４又は並列インタフェース１６のための制御ユニ
ット１５のいづれかに接続可能である。切換装置１３は
概略だけが図示されており、該装置１３は、公知の形式
でゲート、ラッチ装置及びマルチプレクサによって実現
されていても宜い。同じように原理的には、データバス
及びアドレスバスのために別々の切換装置が設けられて
いても差支えない。
装置１４又は並列インタフェース１６のための制御ユニ
ット１５のいづれかに接続可能である。切換装置１３は
概略だけが図示されており、該装置１３は、公知の形式
でゲート、ラッチ装置及びマルチプレクサによって実現
されていても宜い。同じように原理的には、データバス
及びアドレスバスのために別々の切換装置が設けられて
いても差支えない。
【００２０】制御装置１４は、例えば自動車のための点
火制御装置及び又は噴射制御装置であって、有利な形式
でプログラム読出しメモリ（ＰＲＯＭ，ＥＰＲＯＭ又は
その類似品）を有している。更にこの制御装置は、セン
サ入口部及び制御出口部を有している。しかし制御装置
１４は、簡略化して単にブロックとして図示されてい
る。直列インタフェース１６のための制御ユニット１５
は、公知の形式で必要なアドレス計数器又はシフトレジ
スタ１７に接続されていて、入ってきた直列状の情報を
並列状のアドレスワードに変換できるようになってい
る。直列のインタフェース１６は、特に高い伝送レート
（１０Ｍｂｉｔ／ｓ）を備えたＶ−２４インタフェース
として又はマンチェスタＩＩ型（Ｍａｎｃｈｅｓｔｅｒ
ＩＩ）のコード化されたインタフェースとして構成さ
れている。このインタフェース１６には直列導線を介し
て外方の操作装置１９が接続されており、該装置１９に
対しては任意のコンピュータを使用することができる。
操作装置１９と直列インタフェース１６との間の接続
は、特に距離が離れている場合に橋絡することができる
ように、例えば光導体を介して行うこともできる。
火制御装置及び又は噴射制御装置であって、有利な形式
でプログラム読出しメモリ（ＰＲＯＭ，ＥＰＲＯＭ又は
その類似品）を有している。更にこの制御装置は、セン
サ入口部及び制御出口部を有している。しかし制御装置
１４は、簡略化して単にブロックとして図示されてい
る。直列インタフェース１６のための制御ユニット１５
は、公知の形式で必要なアドレス計数器又はシフトレジ
スタ１７に接続されていて、入ってきた直列状の情報を
並列状のアドレスワードに変換できるようになってい
る。直列のインタフェース１６は、特に高い伝送レート
（１０Ｍｂｉｔ／ｓ）を備えたＶ−２４インタフェース
として又はマンチェスタＩＩ型（Ｍａｎｃｈｅｓｔｅｒ
ＩＩ）のコード化されたインタフェースとして構成さ
れている。このインタフェース１６には直列導線を介し
て外方の操作装置１９が接続されており、該装置１９に
対しては任意のコンピュータを使用することができる。
操作装置１９と直列インタフェース１６との間の接続
は、特に距離が離れている場合に橋絡することができる
ように、例えば光導体を介して行うこともできる。
【００２１】更に同期化制御ユニット２０が設けられて
おり、該ユニット２０は、ＲＡＭ１０に対する交互のア
クセスを制御し且つ直列のインタフェース１６乃至その
制御ユニット１５を、制御装置１４の時間的なバス制御
を以て同期化する。このため、関与する構成部材は所要
の制御導線を介して接続されている。
おり、該ユニット２０は、ＲＡＭ１０に対する交互のア
クセスを制御し且つ直列のインタフェース１６乃至その
制御ユニット１５を、制御装置１４の時間的なバス制御
を以て同期化する。このため、関与する構成部材は所要
の制御導線を介して接続されている。
【００２２】この全装置の目的は、その運転中に制御装
置１４のアプリケーション処理を実行することができる
という点にある。つまりマッピング及びプログラムによ
るデータを、操作装置１９の助けを借りて変換又は適合
せしめることができる。このため、通常設けられている
制御装置１４のデータ／プログラム読出しメモリが隔離
せしめられており、その際対応するインタフェースに
は、構成部材１０乃至１３、１５乃至１７及び２０によ
って構成されているデータ処理装置２２が接続されてい
る。このため、インタフェース２１は差込みソケットと
して形成されていても宜く、その場合は読出しメモリだ
けを取り出すことができ、かつそれに対しデータ処理装
置２２を差し込むことができるようになっている。この
ためこのデータ処理装置２２は、ＲＡＭ１０及びＥＥＰ
ＲＯＭ１１を除いて、例えばプログラミング可能なＡＳ
ＩＣチップのような別個のチップ２３として構成されて
いる。勿論多層構造体で実現することも、又はハイブリ
ッドとして実現することも可能である。
置１４のアプリケーション処理を実行することができる
という点にある。つまりマッピング及びプログラムによ
るデータを、操作装置１９の助けを借りて変換又は適合
せしめることができる。このため、通常設けられている
制御装置１４のデータ／プログラム読出しメモリが隔離
せしめられており、その際対応するインタフェースに
は、構成部材１０乃至１３、１５乃至１７及び２０によ
って構成されているデータ処理装置２２が接続されてい
る。このため、インタフェース２１は差込みソケットと
して形成されていても宜く、その場合は読出しメモリだ
けを取り出すことができ、かつそれに対しデータ処理装
置２２を差し込むことができるようになっている。この
ためこのデータ処理装置２２は、ＲＡＭ１０及びＥＥＰ
ＲＯＭ１１を除いて、例えばプログラミング可能なＡＳ
ＩＣチップのような別個のチップ２３として構成されて
いる。勿論多層構造体で実現することも、又はハイブリ
ッドとして実現することも可能である。
【００２３】上述の装置の作用形式は、事実上ＲＡＭ１
０が制御装置１４の当初の読出しメモリの代りになって
いるということによって実現されている。必要なプログ
ラムデータ及びマッピングは、前以って読み込ませてお
くか（その場合はバッテリバッファが必要である）、又
は始動指令によってＥＥＰＲＯＭ１１のデータ内容がＲ
ＡＭ１０に伝達されるようになっているかのどちらかに
なっている。また別に、対応するデータを操作装置１９
によって読み込ませるという可能性もある。
０が制御装置１４の当初の読出しメモリの代りになって
いるということによって実現されている。必要なプログ
ラムデータ及びマッピングは、前以って読み込ませてお
くか（その場合はバッテリバッファが必要である）、又
は始動指令によってＥＥＰＲＯＭ１１のデータ内容がＲ
ＡＭ１０に伝達されるようになっているかのどちらかに
なっている。また別に、対応するデータを操作装置１９
によって読み込ませるという可能性もある。
【００２４】データ処理装置２２及び制御装置１４の運
転中、同期化制御ユニット２０は切換装置１３をサイク
ル的に切換える。第１サイクルにおいては、ＲＡＭ１０
が制御装置１４に接続され、かつそのマイクロコントロ
ーラがデータをＲＡＭ１０から読み取り、またその次の
サイクルにおいては、直列のインタフェース１６がその
制御ユニット１５を介してそのＲＡＭ１０にアクセスす
ることができ、かつそこでデータの読出し又はデータの
書込み乃至転記のいづれかを行う。この交互のアクセス
の際、特殊な時間パラメータが常時守られていなければ
ならないが、このことは同期化制御ユニット２０によっ
て保証されている。一見してこの使用形式の場合、最小
でも恰も２倍の速さでＲＡＭ１０が使用できるように思
われる。それは、それ自体の書込み時間乃至読出し時間
に対し同一のメモリ上に２倍のアクセスができるに相違
ないからである。しかしマルチプレックス運転にあって
は、この時間的な問題は重要ではない。それは、この場
合メモリアクセスが２つの位相に分配されているからで
ある。つまり第１位相においてはアドレスが送出され、
第２位相においてはデータが読み込まれ乃至は送出され
ている。マルチプレックス運転の際バス帯域幅の利用度
は原理的に良くないが、この例の場合にはメモリ上の第
２アクセスのために利用されている。
転中、同期化制御ユニット２０は切換装置１３をサイク
ル的に切換える。第１サイクルにおいては、ＲＡＭ１０
が制御装置１４に接続され、かつそのマイクロコントロ
ーラがデータをＲＡＭ１０から読み取り、またその次の
サイクルにおいては、直列のインタフェース１６がその
制御ユニット１５を介してそのＲＡＭ１０にアクセスす
ることができ、かつそこでデータの読出し又はデータの
書込み乃至転記のいづれかを行う。この交互のアクセス
の際、特殊な時間パラメータが常時守られていなければ
ならないが、このことは同期化制御ユニット２０によっ
て保証されている。一見してこの使用形式の場合、最小
でも恰も２倍の速さでＲＡＭ１０が使用できるように思
われる。それは、それ自体の書込み時間乃至読出し時間
に対し同一のメモリ上に２倍のアクセスができるに相違
ないからである。しかしマルチプレックス運転にあって
は、この時間的な問題は重要ではない。それは、この場
合メモリアクセスが２つの位相に分配されているからで
ある。つまり第１位相においてはアドレスが送出され、
第２位相においてはデータが読み込まれ乃至は送出され
ている。マルチプレックス運転の際バス帯域幅の利用度
は原理的に良くないが、この例の場合にはメモリ上の第
２アクセスのために利用されている。
【００２５】夫々の第２サイクルにあっては、直列イン
タフェース１６及び制御ユニット１５を介し操作装置１
９を用いてＲＡＭ１０にアクセスすることができ、その
際そのプログラムデータ又はマッピングが変化せしめら
れる。それに続くサイクルにおいては、既に変化せしめ
られたデータが制御装置１４によって読み取られ、その
結果、この制御装置１４の運転中その運転特性が変化せ
しめられる。第２サイクルの間に、例えば制御装置１４
のセンサによる測定データのようなデータも、ＲＡＭ１
０から操作装置１９内に読み取られかつ評価される。
タフェース１６及び制御ユニット１５を介し操作装置１
９を用いてＲＡＭ１０にアクセスすることができ、その
際そのプログラムデータ又はマッピングが変化せしめら
れる。それに続くサイクルにおいては、既に変化せしめ
られたデータが制御装置１４によって読み取られ、その
結果、この制御装置１４の運転中その運転特性が変化せ
しめられる。第２サイクルの間に、例えば制御装置１４
のセンサによる測定データのようなデータも、ＲＡＭ１
０から操作装置１９内に読み取られかつ評価される。
【００２６】個々のデータの外に、ＲＡＭ１０内の全マ
ッピング及び全プログラム領域が変化せしめられる。そ
の結果、基本的に異なる運転特性を時間的に直接前後し
てテストすることができるようになる。
ッピング及び全プログラム領域が変化せしめられる。そ
の結果、基本的に異なる運転特性を時間的に直接前後し
てテストすることができるようになる。
【００２７】ＥＥＰＲＯＭ１１の使用によって、エミュ
レーション操作の終了後新しく変化したＲＡＭ１０内の
データをＥＥＰＲＯＭ１１にメモリ替えすることが可能
となり、該データが保護されるようになる。しかし簡単
な実施例にあってはＥＥＰＲＯＭ１１も省略することが
できる。それは、原理的にデータを操作装置１９内で読
み込むことができ、又はバッテリバッファされたＲＡＭ
１０を使用することができるからである。
レーション操作の終了後新しく変化したＲＡＭ１０内の
データをＥＥＰＲＯＭ１１にメモリ替えすることが可能
となり、該データが保護されるようになる。しかし簡単
な実施例にあってはＥＥＰＲＯＭ１１も省略することが
できる。それは、原理的にデータを操作装置１９内で読
み込むことができ、又はバッテリバッファされたＲＡＭ
１０を使用することができるからである。
【００２８】同期化制御ユニット２０は、制御装置プロ
セッサの書込み指令をＲＡＭ１０の別の領域内に変移せ
しめるためにも使用される。この特殊な書込みオンリ領
域によって、記憶されたデータが随時直列インタフェー
ス１６の制御ユニット２０により読み出され、また測定
データとして操作装置１９によって更に処理される。こ
の形式によって同時に、ＲＡＭ１０の読出しオンリ領域
（プログラム領域及びデータ領域）のために書込みの保
護が行われる。
セッサの書込み指令をＲＡＭ１０の別の領域内に変移せ
しめるためにも使用される。この特殊な書込みオンリ領
域によって、記憶されたデータが随時直列インタフェー
ス１６の制御ユニット２０により読み出され、また測定
データとして操作装置１９によって更に処理される。こ
の形式によって同時に、ＲＡＭ１０の読出しオンリ領域
（プログラム領域及びデータ領域）のために書込みの保
護が行われる。
【図１】本発明の装置をブロック線図で表わした図であ
る。
る。
１０ 書込み／読出しメモリ １１ データ／プログラム読出しメモリ １２ データ／アドレスバス １３ 切換装置 １４ 制御装置 １５ 制御ユニット １６ インタフェース １７ アドレス計数器又はシフトレジスタ １８ 直列導線 １９ 操作装置 ２０ 同期化制御ユニット ２２ データ処理装置 ２３ チップ
フロントページの続き (56)参考文献 特開 昭55−128641（ＪＰ，Ａ) (58)調査した分野(Int.Cl.7，ＤＢ名) B60R 16/02 660 G06F 15/78 510
Claims (11)
- 【請求項１】 自動車のための制御装置をアプリケーシ
ョン処理するための装置であって、該装置は少くとも１
つのマイクロプロセッサと少くとも１つのデータ／プロ
グラム読出しメモリ（ＰＲＯＭ，ＥＰＲＯＭ又はその類
似品）（１１）とを有しており、また制御装置（１４）
のデータ／プログラム読出しメモリに代って書込み／読
出しメモリ（ＲＡＭ）（１０）を有しているデータ処理
装置（２２）と、直列のインタフェース（１６）を介し
て接続可能な操作装置（１９）とを備えている形式のも
のにおいて、 切換装置(１３)をサイクル的に切換えている制御ユニッ
ト（２０）が設けられており、その際書込み／読出しメ
モリ（１０）が、切換装置（１３）を介し第１サイクル
ではデータの読出しのために制御装置（１４）に接続さ
れ、第２サイクルではデータの読込み又は読出しのため
に直列のインタフェース(１６)に接続されることを特徴
とする、自動車のための制御装置をアプリケーション処
理するための装置。 - 【請求項２】 マルチプレックスバス制御を伴う制御装
置内のマイクロプロセッサのための装置であって、各サ
イクルの間、第１位相ではアドレス送出が、第２位相で
はデータの読込み又は読出しが、夫々行われていること
を特徴とする、請求項１記載の装置。 - 【請求項３】 直列のインタフェース（１６）が、高い
伝送レートを備えたマンチェスタＩＩ型コード装置（Ｍ
ａｎｃｈｅｓｔｅｒ ＩＩ−Ｋｏｄｉｅｒｕｎｇ）を有
していることを特徴とする、請求項１又は２記載の装
置。 - 【請求項４】 データ処理装置（２２）の全体の制御部
が、１つのチップ（２３）の上に配置されていることを
特徴とする、請求項１から３までのいづれか１項記載の
装置。 - 【請求項５】 チップが、プログラミング可能なアシッ
クチップ（ＡＳＩＣ−Ｃｈｉｐ）として構成されている
ことを特徴とする、請求項４記載の装置。 - 【請求項６】 同期化制御ユニットとして形成されてい
る制御ユニット（２０）が、書込み／読出しメモリ（１
０）に対する交互のアクセスを制御し且つ制御装置（１
４）の時間的なバス制御を以て直列インタフェース（１
６）を同期化 するために設けられていることを特徴とす
る、請求項１から５までのいづれか１項記載の装置。 - 【請求項７】 データ／プログラム読出しメモリ（１
１）が、書込み／読出しメモリ（１０）に対し並列状に
接続されていることを特徴とする、請求項１から６まで
のいづれか１項記載の装置。 - 【請求項８】 データ／プログラム読出しメモリ（１
１）が、ＥＥＰＲＯＭとして構成されていることを特徴
とする、請求項７記載の装置。 - 【請求項９】 書込み／読出しメモリ（１０）及びデー
タ／プログラム読出しメモリ（１１）のデータ内容が、
指令に応じて相互にメモリ交換可能であることを特徴と
する、請求項７又は８記載の装置。 - 【請求項１０】 制御装置（１４）のマイクロプロセッ
サの書込み指令を、書込み／読出しメモリ（１０）の特
別に規定された領域へ変移させるために、同期化制御ユ
ニットとして形成されている制御ユニット（２０）が設
けられていることを特徴とする、請求項１から９までの
いづれか１項記載の装置。 - 【請求項１１】 同期化制御ユニットとして形成された
制御ユニット（２０）は、制御装置（１４）のマイクロ
プロセッサの読出しアクセスの際“ウエイト状態”に適
合することなく、書込み／読出しメモリ（１０）への交
互のアクセスを制御することができるように設けられて
いることを特徴とする、請求項１から１０までのいづれ
か１項記載の装置。
Applications Claiming Priority (2)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| DE4107052A DE4107052B4 (de) | 1991-03-06 | 1991-03-06 | Vorrichtung zur Applikation von Steuergeräten, insbesondere Zünd- und/oder Einspritzsteuergeräten für Kraftfahrzeuge |
| DE4107052.6 | 1991-03-06 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPH05147476A JPH05147476A (ja) | 1993-06-15 |
| JP3305351B2 true JP3305351B2 (ja) | 2002-07-22 |
Family
ID=6426545
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP04870792A Expired - Lifetime JP3305351B2 (ja) | 1991-03-06 | 1992-03-05 | 自動車のための制御装置をアプリケーション処理するための装置 |
Country Status (3)
| Country | Link |
|---|---|
| JP (1) | JP3305351B2 (ja) |
| DE (1) | DE4107052B4 (ja) |
| IT (1) | IT1254656B (ja) |
Families Citing this family (11)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| CA2086449C (en) * | 1992-01-06 | 2000-03-07 | Steven W. Rogers | Computer interface board for electronic automotive vehicle service |
| FR2719919B1 (fr) * | 1994-05-11 | 1996-08-02 | Peugeot | Calculateur de pilotage du fonctionnement d'au moins un organe fonctionnel d'un véhicule automobile. |
| US5970251A (en) * | 1994-06-16 | 1999-10-19 | Robert Bosch Gmbh | Process for optimizing program parts for motor vehicle controllers |
| IT1275245B (it) * | 1995-02-22 | 1997-07-31 | Ducati Energia Spa | Metodo e apparecchiatura per la fasatura del sistema di accensione di motori a combustione interna |
| DE19729212C2 (de) * | 1997-07-09 | 2002-01-24 | Forsch Transferzentrum Ev An D | Verfahren zur optimierten Steuerung von Verbrennungsmotoren |
| EP0941910B1 (en) | 1997-10-02 | 2006-06-28 | Mitsubishi Denki Kabushiki Kaisha | Controller for automobile |
| DE19836748C1 (de) * | 1998-08-13 | 2000-04-20 | Siemens Ag | Verfahren zum Applizieren von Steuerdaten eines elektronischen Kraftfahrzeug-Steuergeräts |
| JP3785445B2 (ja) * | 2000-12-05 | 2006-06-14 | 株式会社ジェイテクト | 電動パワーステアリング制御装置の制御パラメータ調整教示装置、及び制御パラメータ調整教示システム |
| DE10306102A1 (de) * | 2003-02-14 | 2004-09-02 | Audi Ag | Steuergerät und zugehöriges Verfahren zur Übertragung von Daten an das Steuergerät |
| DE102005059593A1 (de) | 2005-05-25 | 2006-11-30 | Robert Bosch Gmbh | Verfahren und Vorrichtung zur Umschaltung bei einem Speicher für ein Steuergerät |
| DE102012218665B4 (de) | 2012-10-12 | 2018-09-20 | Schaeffler Engineering GmbH | Applikationssystem für Steuergeräte |
Family Cites Families (4)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US3798612A (en) * | 1971-09-13 | 1974-03-19 | Allen Bradly Co | Controller programmer |
| DE3021306A1 (de) * | 1980-06-06 | 1981-12-24 | Licentia Patent-Verwaltungs-Gmbh, 6000 Frankfurt | Anordnung mit einem wenigstens zwei teilnehmern gemeinsamen datenspeicher |
| DE3532164C2 (de) * | 1985-09-10 | 1996-07-11 | Licentia Gmbh | Anordnung mit einem wenigstens zwei Teilnehmern gemeinsamen Speicher |
| DE3829454A1 (de) * | 1988-08-31 | 1990-03-01 | Thomson Brandt Gmbh | Serielle datenschnittstelle |
-
1991
- 1991-03-06 DE DE4107052A patent/DE4107052B4/de not_active Expired - Lifetime
-
1992
- 1992-03-03 IT ITMI920468A patent/IT1254656B/it active
- 1992-03-05 JP JP04870792A patent/JP3305351B2/ja not_active Expired - Lifetime
Also Published As
| Publication number | Publication date |
|---|---|
| DE4107052A1 (de) | 1992-09-10 |
| DE4107052B4 (de) | 2005-09-29 |
| JPH05147476A (ja) | 1993-06-15 |
| ITMI920468A1 (it) | 1993-09-03 |
| IT1254656B (it) | 1995-09-28 |
| ITMI920468A0 (it) | 1992-03-03 |
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