JP3119624B2 - ノイズ除去装置およびノイズ除去方法、並びに記録媒体 - Google Patents
ノイズ除去装置およびノイズ除去方法、並びに記録媒体Info
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- JP3119624B2 JP3119624B2 JP10183267A JP18326798A JP3119624B2 JP 3119624 B2 JP3119624 B2 JP 3119624B2 JP 10183267 A JP10183267 A JP 10183267A JP 18326798 A JP18326798 A JP 18326798A JP 3119624 B2 JP3119624 B2 JP 3119624B2
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Description
【０００１】
【発明の属する技術分野】本発明は、ノイズ除去装置お
よびノイズ除去方法、並びに記録媒体に関し、特に、非
同期入力信号のグリッジノイズを除去するノイズ除去装
置およびノイズ除去方法、並びに記録媒体に関する。
よびノイズ除去方法、並びに記録媒体に関し、特に、非
同期入力信号のグリッジノイズを除去するノイズ除去装
置およびノイズ除去方法、並びに記録媒体に関する。
【０００２】
【従来の技術】従来、回路同士のインタフェース信号に
は、出力回路の動作クロックによるノイズや伝搬中に混
入するノイズが含まれている。出力回路の動作クロック
によるノイズは、出力回路の動作クロックでインタフェ
ース信号を叩き直して出力することにより、除去するこ
とができる。
は、出力回路の動作クロックによるノイズや伝搬中に混
入するノイズが含まれている。出力回路の動作クロック
によるノイズは、出力回路の動作クロックでインタフェ
ース信号を叩き直して出力することにより、除去するこ
とができる。
【０００３】また、伝搬中に混入するノイズの除去につ
いては、有効な手段がなく、ノイズが混入しないよう
に、Ｖ１１インタフェース（ＥＩＡ規格ＲＳ−４２２Ａ
に準拠したインタフェース）やインタフェース信号のシ
ールドなどの伝搬経路の低インピーダンス化で対処して
いる。
いては、有効な手段がなく、ノイズが混入しないよう
に、Ｖ１１インタフェース（ＥＩＡ規格ＲＳ−４２２Ａ
に準拠したインタフェース）やインタフェース信号のシ
ールドなどの伝搬経路の低インピーダンス化で対処して
いる。
【０００４】
【発明が解決しようとする課題】しかしながら、出力回
路の動作クロックによるノイズを除去する場合、出力タ
イミングが遅れるため、遅れる時間分のタイミング設計
を考慮しなくてはならない課題があった。
路の動作クロックによるノイズを除去する場合、出力タ
イミングが遅れるため、遅れる時間分のタイミング設計
を考慮しなくてはならない課題があった。
【０００５】また、伝搬中に混入するノイズを除去する
場合、部品点数の増大や、伝搬経路の配置設計に苦慮し
なくてはならない課題があった。
場合、部品点数の増大や、伝搬経路の配置設計に苦慮し
なくてはならない課題があった。
【０００６】本発明はこのような状況に鑑みてなされた
ものであり、入力回路でノイズを除去することにより、
出力回路でのノイズ除去対策を不要にし、出力回路の構
成を簡略化するとともに、出力信号の遅延を少なくし、
タイミング設計を容易にすることができるようにするも
のである。
ものであり、入力回路でノイズを除去することにより、
出力回路でのノイズ除去対策を不要にし、出力回路の構
成を簡略化するとともに、出力信号の遅延を少なくし、
タイミング設計を容易にすることができるようにするも
のである。
【０００７】
【課題を解決するための手段】請求項１に記載のノイズ
除去装置は、入力された非同期信号のノイズを除去する
ノイズ除去装置であって、所定の基準クロックの所定数
分の１の周期の動作クロックの立ち上がりに同期して、
非同期信号を取り込み、出力する第１の取り込み手段
と、動作クロックの立ち下がりに同期して、非同期信号
を取り込み、出力する第２の取り込み手段と、第１の取
り込み手段の出力と、第２の取り込み手段の出力に対し
て、排他的論理和を演算し、演算結果を出力する演算手
段と、動作クロックの立ち下がりで、演算手段の演算結
果に応じて、入力された非同期信号、及び直前に取り込
み、保持していた非同期信号のいずれかを出力する保持
出力手段と、演算手段の出力を、動作クロックの立ち下
がりで取り込む第３の取り込み手段と、第１の取り込み
手段の出力を、動作クロックの立ち下がりで取り込む第
４の取り込み手段と、第３の取り込み手段の出力に応じ
て、保持出力手段の出力、又は第４の取り込み手段の出
力を切り替えて出力する切り替え手段とを備えることを
特徴とする。請求項２に記載のノイズ除去装置は、入力
された非同期信号のノイズを除去するノイズ除去装置で
あって、所定の基準クロックの所定数分の１の周期の動
作クロックの立ち上がりに同期して、非同期信号を取り
込み、出力する第１の取り込み手段と、動作クロックの
立ち下がりに同期して、非同期信号を取り込み、出力す
る第２の取り込み手段と、第１の取り込み手段の出力
と、第２の取り込み手段の出力に対して、排他的論理和
を演算し、演算結果を出力する演算手段と、動作クロッ
クの立ち下がりで、演算手段の演算結果に応じて、入力
された非同期信号、及び直前の動作クロックの立ち上が
りで取り込み、保持していた非同期信号のいずれかを出
力する第１の出力手段と、動作クロックの立ち上がり
で、演算手段の演算結果に応じて、入力された非同期信
号、及び直前の動作クロックの立ち下がりで取り込み、
保持していた非同期信号のいずれかを出力する第２の出
力手段とを備えることを特徴とする。また、ノイズは、
基準クロックの立ち上がりに同期して混入するグリッジ
ノイズであるようにすることができる。また、第１乃至
第４の取り込み手段は、フリップフロップ回路により構
成されるようにすることができる。また、動作クロック
の周期は、基準クロックの周期の１分の１以下であるよ
うにすることができる。請求項６に記載のノイズ除去方
法は、入力された非同期信号のノイズを除去するノイズ
除去方法であって、所定の基準クロックの所定数分の１
の周期の動作クロックの立ち上がりに同期して、非同期
信号を取り込み、出力する第１の取り込みステップと、
動作クロックの立ち下がりに同期して、非同期信号を取
り込み、出力する第２の取り込みステップと、第１の取
り込みステップにおける出力と、第２の取り込みステッ
プにおける出力に対して、排他的論理和を演算し、演算
結果を出力する演算ステップと、動作クロックの立ち下
がりで、演算ステップにおける演算結果に応じて、入力
された非同期信号、及び直前に取り込み、保持していた
非同期信号のいずれかを出力する保持出力ステップと、
演算ステップにおける出力を、動作クロックの立ち下が
りで取り込む第３の取り込みステップと、第１の取り込
みステップにおける出力を、動作クロックの立ち下がり
で取り込む第４の取り込みステップと、第３の取り込み
ステップにおける出力に応じて、保持出力ステップにお
ける出力、又は第４の取り込みステップにおける出力を
切り替えて出力する切り替えステップとを備えることを
特徴とする。請求項７に記載のノイズ除去方法は、入力
された非同期信号のノイズを除去するノイズ除去方法で
あって、所定の基準クロックの所定数分の１の周期の動
作クロックの立ち上がりに同期して、非同期信号を取り
込み、出力する第１の取り込みステップと、動作クロッ
クの立ち下がりに同期して、非同期信号を取り込み、出
力する第２の取り込みステップと、第１の取り込みステ
ップにおける出力と、第２の取り込みステップにおける
出力に対して、排他的論理和を演算し、演算結果を出力
する演算ステップと、動作クロックの立ち下がりで、演
算ステップにおける演算結果に応じて、入力された非同
期信号、及び直前の動作クロックの立ち上がりで取り込
み、保持していた非同期信号のいずれかを出力する第１
の出力ステップと、動作クロックの立ち上がりで、演算
ステップにおける演算結果に応じて、入力された非同期
信号、及び直前の動作クロックの立ち下がりで取り込
み、保持していた非同期信号のいずれかを出力する第２
の出力ステップとを備えることを特徴とする。請求項８
に記載の記録媒体は、請求項６または請求項７に記載の
ノイズ除去方法を実行可能なプログラムを記録したこと
を特徴とする。本発明に係るノイズ除去装置およびノイ
ズ除去方法、並びに記録媒体においては、動作クロック
の立ち上がりで取り込まれた非同期信号を、演算手段に
よる演算結果に応じて、動作クロックの立ち下がりで取
り込まれた非同期信号に置き換える。
除去装置は、入力された非同期信号のノイズを除去する
ノイズ除去装置であって、所定の基準クロックの所定数
分の１の周期の動作クロックの立ち上がりに同期して、
非同期信号を取り込み、出力する第１の取り込み手段
と、動作クロックの立ち下がりに同期して、非同期信号
を取り込み、出力する第２の取り込み手段と、第１の取
り込み手段の出力と、第２の取り込み手段の出力に対し
て、排他的論理和を演算し、演算結果を出力する演算手
段と、動作クロックの立ち下がりで、演算手段の演算結
果に応じて、入力された非同期信号、及び直前に取り込
み、保持していた非同期信号のいずれかを出力する保持
出力手段と、演算手段の出力を、動作クロックの立ち下
がりで取り込む第３の取り込み手段と、第１の取り込み
手段の出力を、動作クロックの立ち下がりで取り込む第
４の取り込み手段と、第３の取り込み手段の出力に応じ
て、保持出力手段の出力、又は第４の取り込み手段の出
力を切り替えて出力する切り替え手段とを備えることを
特徴とする。請求項２に記載のノイズ除去装置は、入力
された非同期信号のノイズを除去するノイズ除去装置で
あって、所定の基準クロックの所定数分の１の周期の動
作クロックの立ち上がりに同期して、非同期信号を取り
込み、出力する第１の取り込み手段と、動作クロックの
立ち下がりに同期して、非同期信号を取り込み、出力す
る第２の取り込み手段と、第１の取り込み手段の出力
と、第２の取り込み手段の出力に対して、排他的論理和
を演算し、演算結果を出力する演算手段と、動作クロッ
クの立ち下がりで、演算手段の演算結果に応じて、入力
された非同期信号、及び直前の動作クロックの立ち上が
りで取り込み、保持していた非同期信号のいずれかを出
力する第１の出力手段と、動作クロックの立ち上がり
で、演算手段の演算結果に応じて、入力された非同期信
号、及び直前の動作クロックの立ち下がりで取り込み、
保持していた非同期信号のいずれかを出力する第２の出
力手段とを備えることを特徴とする。また、ノイズは、
基準クロックの立ち上がりに同期して混入するグリッジ
ノイズであるようにすることができる。また、第１乃至
第４の取り込み手段は、フリップフロップ回路により構
成されるようにすることができる。また、動作クロック
の周期は、基準クロックの周期の１分の１以下であるよ
うにすることができる。請求項６に記載のノイズ除去方
法は、入力された非同期信号のノイズを除去するノイズ
除去方法であって、所定の基準クロックの所定数分の１
の周期の動作クロックの立ち上がりに同期して、非同期
信号を取り込み、出力する第１の取り込みステップと、
動作クロックの立ち下がりに同期して、非同期信号を取
り込み、出力する第２の取り込みステップと、第１の取
り込みステップにおける出力と、第２の取り込みステッ
プにおける出力に対して、排他的論理和を演算し、演算
結果を出力する演算ステップと、動作クロックの立ち下
がりで、演算ステップにおける演算結果に応じて、入力
された非同期信号、及び直前に取り込み、保持していた
非同期信号のいずれかを出力する保持出力ステップと、
演算ステップにおける出力を、動作クロックの立ち下が
りで取り込む第３の取り込みステップと、第１の取り込
みステップにおける出力を、動作クロックの立ち下がり
で取り込む第４の取り込みステップと、第３の取り込み
ステップにおける出力に応じて、保持出力ステップにお
ける出力、又は第４の取り込みステップにおける出力を
切り替えて出力する切り替えステップとを備えることを
特徴とする。請求項７に記載のノイズ除去方法は、入力
された非同期信号のノイズを除去するノイズ除去方法で
あって、所定の基準クロックの所定数分の１の周期の動
作クロックの立ち上がりに同期して、非同期信号を取り
込み、出力する第１の取り込みステップと、動作クロッ
クの立ち下がりに同期して、非同期信号を取り込み、出
力する第２の取り込みステップと、第１の取り込みステ
ップにおける出力と、第２の取り込みステップにおける
出力に対して、排他的論理和を演算し、演算結果を出力
する演算ステップと、動作クロックの立ち下がりで、演
算ステップにおける演算結果に応じて、入力された非同
期信号、及び直前の動作クロックの立ち上がりで取り込
み、保持していた非同期信号のいずれかを出力する第１
の出力ステップと、動作クロックの立ち上がりで、演算
ステップにおける演算結果に応じて、入力された非同期
信号、及び直前の動作クロックの立ち下がりで取り込
み、保持していた非同期信号のいずれかを出力する第２
の出力ステップとを備えることを特徴とする。請求項８
に記載の記録媒体は、請求項６または請求項７に記載の
ノイズ除去方法を実行可能なプログラムを記録したこと
を特徴とする。本発明に係るノイズ除去装置およびノイ
ズ除去方法、並びに記録媒体においては、動作クロック
の立ち上がりで取り込まれた非同期信号を、演算手段に
よる演算結果に応じて、動作クロックの立ち下がりで取
り込まれた非同期信号に置き換える。
【０００８】
【発明の実施の形態】図１は、本発明のノイズ除去装置
を応用した非同期入力信号のグリッジ除去回路の一実施
の形態の構成例を示すブロック図である。
を応用した非同期入力信号のグリッジ除去回路の一実施
の形態の構成例を示すブロック図である。
【０００９】同図に示したように、グリッジ除去回路
は、非同期入力信号を動作クロックＣ２の立ち上がりで
取り込むフリップフロップ（ＦＦ）１と、非同期入力信
号を動作クロックＣ２の立ち下がりで取り込むＦＦ２
と、ＦＦ１とＦＦ２の出力信号の排他的論理和をとる排
他的論理和回路（ＸＯＲ）３とを有している。これらの
回路により、非同期入力信号の変化点をＨ（ハイ）レベ
ルで表わす信号を生成するようになされている。
は、非同期入力信号を動作クロックＣ２の立ち上がりで
取り込むフリップフロップ（ＦＦ）１と、非同期入力信
号を動作クロックＣ２の立ち下がりで取り込むＦＦ２
と、ＦＦ１とＦＦ２の出力信号の排他的論理和をとる排
他的論理和回路（ＸＯＲ）３とを有している。これらの
回路により、非同期入力信号の変化点をＨ（ハイ）レベ
ルで表わす信号を生成するようになされている。
【００１０】また、グリッジ除去回路は、ＸＯＲ３の出
力のレベルによって、Ｈレベルの時は非同期入力信号を
選択し、Ｌ（ロー）レベルの時はＦＦ５の出力を選択出
力するセレクタ４と、セレクタ４の出力を動作クロック
Ｃ２の立ち下がりで取り込むＦＦ５と、ＸＯＲ３より出
力される非同期入力信号の変化点の検出信号を動作クロ
ックＣ２の立ち下がりで取り込むＦＦ６と、ＦＦ１の出
力を動作クロックＣ２の立ち下がりで取り込むＦＦ７
と、ＦＦ６の出力のレベルが、Ｈレベルの時にＦＦ５の
出力を選択し、Ｌレベルの時にＦＦ７の出力を選択出力
するセレクタ８を有している。
力のレベルによって、Ｈレベルの時は非同期入力信号を
選択し、Ｌ（ロー）レベルの時はＦＦ５の出力を選択出
力するセレクタ４と、セレクタ４の出力を動作クロック
Ｃ２の立ち下がりで取り込むＦＦ５と、ＸＯＲ３より出
力される非同期入力信号の変化点の検出信号を動作クロ
ックＣ２の立ち下がりで取り込むＦＦ６と、ＦＦ１の出
力を動作クロックＣ２の立ち下がりで取り込むＦＦ７
と、ＦＦ６の出力のレベルが、Ｈレベルの時にＦＦ５の
出力を選択し、Ｌレベルの時にＦＦ７の出力を選択出力
するセレクタ８を有している。
【００１１】即ち、ＦＦ１の入力端Ｄ、及びＦＦ２の入
力端Ｄには、それぞれ非同期入力信号が入力され、ＦＦ
１のクロック入力端ＣＫ、及びＦＦ２のクロック入力端
ＣＫには、それぞれ動作クロックＣ２が入力されるよう
になされている。そして、ＦＦ１は、クロック入力端Ｃ
Ｋに入力された動作クロックＣ２の立ち上がりで、入力
端Ｄの入力を取り込む（サンプリングする）ようになさ
れている。ＦＦ２は、クロック入力端ＣＫに入力された
動作クロックＣ２の立ち下がりで、入力端Ｄの入力をサ
ンプリングするようになされている。動作クロックＣ２
の周期は、所定の基準となるクロックＣ１の周期の１／
２とされている。
力端Ｄには、それぞれ非同期入力信号が入力され、ＦＦ
１のクロック入力端ＣＫ、及びＦＦ２のクロック入力端
ＣＫには、それぞれ動作クロックＣ２が入力されるよう
になされている。そして、ＦＦ１は、クロック入力端Ｃ
Ｋに入力された動作クロックＣ２の立ち上がりで、入力
端Ｄの入力を取り込む（サンプリングする）ようになさ
れている。ＦＦ２は、クロック入力端ＣＫに入力された
動作クロックＣ２の立ち下がりで、入力端Ｄの入力をサ
ンプリングするようになされている。動作クロックＣ２
の周期は、所定の基準となるクロックＣ１の周期の１／
２とされている。
【００１２】ＦＦ１の出力端Ｑは、排他的論理和回路
（ＸＯＲ）３の一方の入力端に接続され、ＦＦ２の出力
端Ｑは、ＸＯＲ３の他方の入力端に接続されている。Ｘ
ＯＲ３の出力端は、セレクタ４の入力端Ｓに接続され、
非同期入力信号が入力端Ｂに入力され、ＦＦ５の出力端
Ｑがセレクタ４の入力端Ａに接続されている。セレクタ
４は、入力端Ｓに入力された信号のレベルがＨレベルの
とき、入力端Ｂに入力された信号（非同期入力信号）を
出力端Ｙより出力し、入力端Ｓに入力された信号のレベ
ルがＬレベルのとき、入力端Ａに入力された信号（ＦＦ
５の出力）を出力端Ｙより出力するようになされてい
る。
（ＸＯＲ）３の一方の入力端に接続され、ＦＦ２の出力
端Ｑは、ＸＯＲ３の他方の入力端に接続されている。Ｘ
ＯＲ３の出力端は、セレクタ４の入力端Ｓに接続され、
非同期入力信号が入力端Ｂに入力され、ＦＦ５の出力端
Ｑがセレクタ４の入力端Ａに接続されている。セレクタ
４は、入力端Ｓに入力された信号のレベルがＨレベルの
とき、入力端Ｂに入力された信号（非同期入力信号）を
出力端Ｙより出力し、入力端Ｓに入力された信号のレベ
ルがＬレベルのとき、入力端Ａに入力された信号（ＦＦ
５の出力）を出力端Ｙより出力するようになされてい
る。
【００１３】セレクタ４の出力端Ｙは、ＦＦ５の入力端
Ｄに接続され、ＦＦ５はＦＦ５のクロック入力端ＣＫに
入力される動作クロックＣ２の立ち下がりで入力端Ｄの
入力をサンプリングし、出力端Ｑより出力するようにな
されている。
Ｄに接続され、ＦＦ５はＦＦ５のクロック入力端ＣＫに
入力される動作クロックＣ２の立ち下がりで入力端Ｄの
入力をサンプリングし、出力端Ｑより出力するようにな
されている。
【００１４】ＸＯＲ３の出力端は、ＦＦ６の入力端Ｄと
接続され、ＦＦ６は、クロック入力端ＣＫに入力される
動作クロックＣ２の立ち下がりで入力端Ｄの入力をサン
プリングし、出力端Ｑより出力するようになされてい
る。ＦＦ１の出力端Ｑは、ＦＦ７の入力端Ｄと接続さ
れ、ＦＦ７は、クロック入力端ＣＫに入力される動作ク
ロックＣ２の立ち下がりで、入力端Ｄの入力をサンプリ
ングし、出力端Ｄより出力するようになされている。
接続され、ＦＦ６は、クロック入力端ＣＫに入力される
動作クロックＣ２の立ち下がりで入力端Ｄの入力をサン
プリングし、出力端Ｑより出力するようになされてい
る。ＦＦ１の出力端Ｑは、ＦＦ７の入力端Ｄと接続さ
れ、ＦＦ７は、クロック入力端ＣＫに入力される動作ク
ロックＣ２の立ち下がりで、入力端Ｄの入力をサンプリ
ングし、出力端Ｄより出力するようになされている。
【００１５】ＦＦ７の出力端Ｑはセレクタ８の入力端Ａ
と接続され、ＦＦ６の出力端Ｑはセレクタ８の入力端Ｓ
と接続され、ＦＦ５の出力端Ｑはセレクタ８の入力端Ｂ
と接続されている。そして、セレクタ８は、入力端Ｓの
入力信号のレベルがＨレベルのとき、入力端Ｂに入力さ
れた信号を出力し、入力端Ｓに入力された信号のレベル
がＬレベルのとき、入力端Ａに入力された信号を出力す
るようになされている。
と接続され、ＦＦ６の出力端Ｑはセレクタ８の入力端Ｓ
と接続され、ＦＦ５の出力端Ｑはセレクタ８の入力端Ｂ
と接続されている。そして、セレクタ８は、入力端Ｓの
入力信号のレベルがＨレベルのとき、入力端Ｂに入力さ
れた信号を出力し、入力端Ｓに入力された信号のレベル
がＬレベルのとき、入力端Ａに入力された信号を出力す
るようになされている。
【００１６】次に、図２のタイミングチャートを参照し
て、図１に示したグリッジ除去回路の動作について説明
する。図２に示したように、ＦＦ１の出力を信号Ａ１、
ＦＦ２の出力を信号Ａ２、ＸＯＲ３の出力を信号Ａ３、
ＦＦ５の出力を信号Ａ５、ＦＦ６の出力を信号Ａ６、Ｆ
Ｆ７の出力を信号Ａ７とする。
て、図１に示したグリッジ除去回路の動作について説明
する。図２に示したように、ＦＦ１の出力を信号Ａ１、
ＦＦ２の出力を信号Ａ２、ＸＯＲ３の出力を信号Ａ３、
ＦＦ５の出力を信号Ａ５、ＦＦ６の出力を信号Ａ６、Ｆ
Ｆ７の出力を信号Ａ７とする。
【００１７】非同期入力信号には、非同期入力信号を生
成したクロックＣ１の立ち上がりに同期してグリッジノ
イズが混入している。上記非同期入力信号を動作クロッ
クＣ２の立ち上がりで取り込んだ信号が信号Ａ１であ
る。信号Ａ１は、時刻Ｔ２のＬレベルのグリッジノイズ
と、時刻Ｔ１１のハイレベル（Ｈレベル）のグリッジノ
イズを取り込んでしまっている。
成したクロックＣ１の立ち上がりに同期してグリッジノ
イズが混入している。上記非同期入力信号を動作クロッ
クＣ２の立ち上がりで取り込んだ信号が信号Ａ１であ
る。信号Ａ１は、時刻Ｔ２のＬレベルのグリッジノイズ
と、時刻Ｔ１１のハイレベル（Ｈレベル）のグリッジノ
イズを取り込んでしまっている。
【００１８】また、非同期入力信号を動作クロックＣ２
の立ち下がりで取り込んだ信号が信号Ａ２である。信号
Ａ２は、時刻Ｔ４のＬレベルのグリッジノイズと、時刻
Ｔ１３のＨレベルのグリッジノイズを取り込んでしまっ
ている。
の立ち下がりで取り込んだ信号が信号Ａ２である。信号
Ａ２は、時刻Ｔ４のＬレベルのグリッジノイズと、時刻
Ｔ１３のＨレベルのグリッジノイズを取り込んでしまっ
ている。
【００１９】ＸＯＲ３において、信号Ａ１と信号Ａ２の
排他的論理和をとった信号が信号Ａ３である。信号Ａ３
は、非同期入力信号の変化点を検出した信号であり、非
同期入力信号のレベル変化があったところが、Ｈレベル
で出力される。時刻Ｔ３のＨパルス、時刻Ｔ４から時刻
Ｔ５までのＨパルス、時刻Ｔ１２のＨパルス、及び時刻
Ｔ１３から時刻Ｔ１４までのＨパルスは、グリッジノイ
ズによるものである。
排他的論理和をとった信号が信号Ａ３である。信号Ａ３
は、非同期入力信号の変化点を検出した信号であり、非
同期入力信号のレベル変化があったところが、Ｈレベル
で出力される。時刻Ｔ３のＨパルス、時刻Ｔ４から時刻
Ｔ５までのＨパルス、時刻Ｔ１２のＨパルス、及び時刻
Ｔ１３から時刻Ｔ１４までのＨパルスは、グリッジノイ
ズによるものである。
【００２０】信号Ａ３がＨレベル時であって、かつ動作
クロックＣ２の立ち下がりで非同期入力信号を取り込
み、信号Ａ３がＬレベル時であって、かつ動作クロック
Ｃ２の立ち下がりで前の時刻で取り込んだレベルを保持
した信号が信号Ａ５である。信号Ａ５は、非同期入力信
号のレベル変化があった後のレベルを保持するように変
化する。信号Ａ３を動作クロックＣ２の立ち下がりで取
り込んだ信号が信号Ａ６である。
クロックＣ２の立ち下がりで非同期入力信号を取り込
み、信号Ａ３がＬレベル時であって、かつ動作クロック
Ｃ２の立ち下がりで前の時刻で取り込んだレベルを保持
した信号が信号Ａ５である。信号Ａ５は、非同期入力信
号のレベル変化があった後のレベルを保持するように変
化する。信号Ａ３を動作クロックＣ２の立ち下がりで取
り込んだ信号が信号Ａ６である。
【００２１】信号Ａ１を動作クロックＣ２の立ち下がり
で取り込んだ信号が信号Ａ７である。セレクタ８は、信
号Ａ６がＨレベル時は、信号Ａ５を選択し、信号Ａ６が
Ｌレベル時は、信号Ａ７を選択することで同期化信号を
生成し、出力する。
で取り込んだ信号が信号Ａ７である。セレクタ８は、信
号Ａ６がＨレベル時は、信号Ａ５を選択し、信号Ａ６が
Ｌレベル時は、信号Ａ７を選択することで同期化信号を
生成し、出力する。
【００２２】即ち、信号Ａ６がＨレベル時は、非同期入
力信号を動作クロックＣ２の立ち上がりで取り込んだ信
号（信号Ａ７）のレベルが、非同期入力信号のグリッジ
ノイズを取り込んでいる可能性が高いため、非同期入力
信号を変化点検出（信号Ａ３のＨレベル）後の動作クロ
ックＣ２の立ち下がりで取り込んだ信号（信号Ａ５）の
レベルに置換することで、グリッジノイズを除去してい
る。
力信号を動作クロックＣ２の立ち上がりで取り込んだ信
号（信号Ａ７）のレベルが、非同期入力信号のグリッジ
ノイズを取り込んでいる可能性が高いため、非同期入力
信号を変化点検出（信号Ａ３のＨレベル）後の動作クロ
ックＣ２の立ち下がりで取り込んだ信号（信号Ａ５）の
レベルに置換することで、グリッジノイズを除去してい
る。
【００２３】以上説明したように、本発明を応用した非
同期入力信号のグリッジ除去回路は、非同期入力信号の
変化点を検出し、非同期入力信号を動作クロックＣ２の
立ち上がりで取り込んだ信号を、非同期入力信号に変化
があった時だけ、非同期入力信号を動作クロックＣ２の
立ち下がりで取り込んだ信号に変換することで、動作ク
ロックＣ２の周期の１／２の周期より短い周期のグリッ
ジノイズを除去することができる。
同期入力信号のグリッジ除去回路は、非同期入力信号の
変化点を検出し、非同期入力信号を動作クロックＣ２の
立ち上がりで取り込んだ信号を、非同期入力信号に変化
があった時だけ、非同期入力信号を動作クロックＣ２の
立ち下がりで取り込んだ信号に変換することで、動作ク
ロックＣ２の周期の１／２の周期より短い周期のグリッ
ジノイズを除去することができる。
【００２４】即ち、図１において、まず、ＦＦ１、ＦＦ
２、及びＸＯＲ３によって、非同期入力信号の変化点を
検出する。セレクタ４とＦＦ５によって、非同期入力信
号に変化があった時のみ、非同期入力信号を動作クロッ
クＣ２の立ち下がりで取り込む。セレクタ８において、
非同期入力信号を動作クロックＣ２の立ち上がりで取り
込んだ信号を、非同期入力信号に変化があった時のみ、
非同期入力信号を動作クロックＣ２の立ち下がりで取り
込んだ信号に切り替える。これにより動作クロックＣ２
の立ち上がりでグリッジノイズを取り込んでも、次の動
作クロックＣ２の立ち下がりで取り込んだレベルに変換
されるため、グリッジノイズは除去される。
２、及びＸＯＲ３によって、非同期入力信号の変化点を
検出する。セレクタ４とＦＦ５によって、非同期入力信
号に変化があった時のみ、非同期入力信号を動作クロッ
クＣ２の立ち下がりで取り込む。セレクタ８において、
非同期入力信号を動作クロックＣ２の立ち上がりで取り
込んだ信号を、非同期入力信号に変化があった時のみ、
非同期入力信号を動作クロックＣ２の立ち下がりで取り
込んだ信号に切り替える。これにより動作クロックＣ２
の立ち上がりでグリッジノイズを取り込んでも、次の動
作クロックＣ２の立ち下がりで取り込んだレベルに変換
されるため、グリッジノイズは除去される。
【００２５】以上のようにして、図１の実施の形態にお
いては、次のような効果を得ることができる。第１の効
果は、入力される信号に混入するグリッジノイズの電圧
レベルに関係なくグリッジノイズを除去できるため、全
ての同期化回路に適用できる。第２の効果は、出力側に
てグリッジノイズを除去しなくてよいため、出力回路の
タイミング設計が容易になり、出力回路を簡略化するこ
とができる。第３の効果は、グリッジノイズ除去と同期
化を同時に行うため、入力信号に対して同期化後の信号
の遅延を少なくすることができる。
いては、次のような効果を得ることができる。第１の効
果は、入力される信号に混入するグリッジノイズの電圧
レベルに関係なくグリッジノイズを除去できるため、全
ての同期化回路に適用できる。第２の効果は、出力側に
てグリッジノイズを除去しなくてよいため、出力回路の
タイミング設計が容易になり、出力回路を簡略化するこ
とができる。第３の効果は、グリッジノイズ除去と同期
化を同時に行うため、入力信号に対して同期化後の信号
の遅延を少なくすることができる。
【００２６】次に、本発明の他の実施の形態の構成及び
動作について、図面を参照して詳細に説明する。図３
は、本発明のノイズ除去装置を応用した非同期入力信号
のグリッジ除去回路の他の実施の形態の構成例を示して
いる。
動作について、図面を参照して詳細に説明する。図３
は、本発明のノイズ除去装置を応用した非同期入力信号
のグリッジ除去回路の他の実施の形態の構成例を示して
いる。
【００２７】図３を参照すると、非同期入力信号の変化
点を検出した信号（ＸＯＲ３の出力信号）を使用する点
では、図１に示した実施の形態の場合と同様であるが、
それ以降の回路構成が異なっている。
点を検出した信号（ＸＯＲ３の出力信号）を使用する点
では、図１に示した実施の形態の場合と同様であるが、
それ以降の回路構成が異なっている。
【００２８】即ち、図３に示したグリッジ除去回路は、
非同期入力信号を動作クロックＣ２の立ち上がりで取り
込むフリップフロップ（ＦＦ）１と、非同期入力信号を
動作クロックＣ２の立ち下がりで取り込むＦＦ２と、Ｆ
Ｆ１とＦＦ２の出力信号の排他的論理和をとる排他的論
理和回路（ＸＯＲ）３とを有している。これらの回路に
より、非同期入力信号の変化点をＨレベルであらわす信
号を生成するようになされている。
非同期入力信号を動作クロックＣ２の立ち上がりで取り
込むフリップフロップ（ＦＦ）１と、非同期入力信号を
動作クロックＣ２の立ち下がりで取り込むＦＦ２と、Ｆ
Ｆ１とＦＦ２の出力信号の排他的論理和をとる排他的論
理和回路（ＸＯＲ）３とを有している。これらの回路に
より、非同期入力信号の変化点をＨレベルであらわす信
号を生成するようになされている。
【００２９】さらに、グリッジ除去回路は、ＸＯＲ３の
出力がＨレベルの時は非同期入力信号を選択し、Ｌレベ
ルの時はＦＦ１７の出力信号を選択し、出力するセレク
タ４と、セレクタ４の出力を動作クロックＣ２の立ち下
がりで取り込み、初期状態を決定するために必要なセッ
ト及びリセット端子を装備したＦＦ１５と、ＸＯＲ３の
出力がＨレベルの時は非同期入力信号を選択し、Ｌレベ
ルの時はＦＦ１５の出力を選択し、出力するセレクタ１
６と、セレクタ１６の出力を、動作クロックＣ２の立ち
上がりで取り込み、初期状態を決定するために必要なセ
ット及びリセット端子を装備したＦＦ１７とを有してい
る。
出力がＨレベルの時は非同期入力信号を選択し、Ｌレベ
ルの時はＦＦ１７の出力信号を選択し、出力するセレク
タ４と、セレクタ４の出力を動作クロックＣ２の立ち下
がりで取り込み、初期状態を決定するために必要なセッ
ト及びリセット端子を装備したＦＦ１５と、ＸＯＲ３の
出力がＨレベルの時は非同期入力信号を選択し、Ｌレベ
ルの時はＦＦ１５の出力を選択し、出力するセレクタ１
６と、セレクタ１６の出力を、動作クロックＣ２の立ち
上がりで取り込み、初期状態を決定するために必要なセ
ット及びリセット端子を装備したＦＦ１７とを有してい
る。
【００３０】即ち、ＦＦ１の入力端Ｄ、及びＦＦ２の入
力端Ｄには、それぞれ非同期入力信号が入力され、ＦＦ
１のクロック入力端ＣＫ、及びＦＦ２のクロック入力端
ＣＫには、それぞれ動作クロックＣ２が入力されるよう
になされている。そして、ＦＦ１は、クロック入力端Ｃ
Ｋに入力された動作クロックＣ２の立ち上がりで、入力
端Ｄの入力を取り込む（サンプリングする）ようになさ
れている。ＦＦ２は、クロック入力端ＣＫに入力された
動作クロックＣ２の立ち下がりで、入力端Ｄの入力をサ
ンプリングするようになされている。動作クロックＣ２
の周期は、所定の基準となるクロックＣ１の周期の１／
２とされている。
力端Ｄには、それぞれ非同期入力信号が入力され、ＦＦ
１のクロック入力端ＣＫ、及びＦＦ２のクロック入力端
ＣＫには、それぞれ動作クロックＣ２が入力されるよう
になされている。そして、ＦＦ１は、クロック入力端Ｃ
Ｋに入力された動作クロックＣ２の立ち上がりで、入力
端Ｄの入力を取り込む（サンプリングする）ようになさ
れている。ＦＦ２は、クロック入力端ＣＫに入力された
動作クロックＣ２の立ち下がりで、入力端Ｄの入力をサ
ンプリングするようになされている。動作クロックＣ２
の周期は、所定の基準となるクロックＣ１の周期の１／
２とされている。
【００３１】ＦＦ１の出力端Ｑは、排他的論理和回路
（ＸＯＲ）３の一方の入力端に接続され、ＦＦ２の出力
端Ｑは、ＸＯＲ３の他方の入力端に接続されている。Ｘ
ＯＲ３の出力端は、セレクタ４の入力端Ｓに接続され、
非同期入力信号がセレクタ４の入力端Ｂに入力され、Ｆ
Ｆ１７の出力端Ｑがセレクタ４の入力端Ａに接続されて
いる。
（ＸＯＲ）３の一方の入力端に接続され、ＦＦ２の出力
端Ｑは、ＸＯＲ３の他方の入力端に接続されている。Ｘ
ＯＲ３の出力端は、セレクタ４の入力端Ｓに接続され、
非同期入力信号がセレクタ４の入力端Ｂに入力され、Ｆ
Ｆ１７の出力端Ｑがセレクタ４の入力端Ａに接続されて
いる。
【００３２】セレクタ４は、入力端Ｓに入力された信号
のレベルがＨレベルのとき、入力端Ｂに入力された信号
（非同期入力信号）を出力端Ｙより出力し、入力端Ｓに
入力された信号のレベルがＬレベルのとき、入力端Ａに
入力された信号（ＦＦ１７からの出力）を出力端Ｙより
出力するようになされている。
のレベルがＨレベルのとき、入力端Ｂに入力された信号
（非同期入力信号）を出力端Ｙより出力し、入力端Ｓに
入力された信号のレベルがＬレベルのとき、入力端Ａに
入力された信号（ＦＦ１７からの出力）を出力端Ｙより
出力するようになされている。
【００３３】セレクタ４の出力端Ｙは、ＦＦ１５の入力
端Ｄに接続され、ＦＦ１５はＦＦ１５のクロック入力端
ＣＫに入力される動作クロックＣ２の立ち下がりで入力
端Ｄの入力をサンプリングし、出力端Ｑより出力するよ
うになされている。
端Ｄに接続され、ＦＦ１５はＦＦ１５のクロック入力端
ＣＫに入力される動作クロックＣ２の立ち下がりで入力
端Ｄの入力をサンプリングし、出力端Ｑより出力するよ
うになされている。
【００３４】また、ＸＯＲ３の出力端は、セレクタ１６
の入力端Ｓと接続され、非同期入力信号がＦＦ１６の入
力端Ｂに入力され、ＦＦ１５の出力端ＱがＦＦ１６の入
力端Ａに接続されている。そして、セレクタ１６は、入
力端Ｓに入力されたＸＯＲ３からの信号のレベルがＨレ
ベルのとき、入力端Ｂに入力された非同期入力信号を出
力端Ｙより出力し、入力端Ｓに入力されたＸＯＲ３から
の信号のレベルがＬレベルのとき、入力端Ａに入力され
たＦＦ１５からの信号を出力端Ｙより出力するようにな
されている。
の入力端Ｓと接続され、非同期入力信号がＦＦ１６の入
力端Ｂに入力され、ＦＦ１５の出力端ＱがＦＦ１６の入
力端Ａに接続されている。そして、セレクタ１６は、入
力端Ｓに入力されたＸＯＲ３からの信号のレベルがＨレ
ベルのとき、入力端Ｂに入力された非同期入力信号を出
力端Ｙより出力し、入力端Ｓに入力されたＸＯＲ３から
の信号のレベルがＬレベルのとき、入力端Ａに入力され
たＦＦ１５からの信号を出力端Ｙより出力するようにな
されている。
【００３５】ＦＦ１７は、動作クロックＣ２の立ち上が
りで、セレクタ１６の出力端Ｙより供給される信号をサ
ンプリングし、出力端Ｑより出力するようになされてい
る。
りで、セレクタ１６の出力端Ｙより供給される信号をサ
ンプリングし、出力端Ｑより出力するようになされてい
る。
【００３６】次に、図３に示した実施の形態の動作につ
いて、図４のタイミングチャートを参照して説明する。
図４において、ＦＦ１の出力を信号Ａ１、ＦＦ２の出力
を信号Ａ２、ＸＯＲ３の出力を信号Ａ３、ＦＦ１７の出
力を信号Ａ１７、ＦＦ１５の出力を同期化信号とする。
信号Ａ１、信号Ａ２、信号Ａ３については、図２を参照
して上述した場合と同様であるため、その説明は省略す
る。
いて、図４のタイミングチャートを参照して説明する。
図４において、ＦＦ１の出力を信号Ａ１、ＦＦ２の出力
を信号Ａ２、ＸＯＲ３の出力を信号Ａ３、ＦＦ１７の出
力を信号Ａ１７、ＦＦ１５の出力を同期化信号とする。
信号Ａ１、信号Ａ２、信号Ａ３については、図２を参照
して上述した場合と同様であるため、その説明は省略す
る。
【００３７】信号Ａ３がＨレベル時であり、かつ動作ク
ロックＣ２の立ち上がりで非同期入力信号を取り込み、
信号Ａ３がＬレベル時であり、かつ動作クロックＣ２の
立ち下がりで前の時刻でＦＦ１５が取り込んだレベルを
保持した信号が信号Ａ１７である。信号Ａ１７は、非同
期入力信号のレベル変化があった後の動作クロックＣ２
の立ち下がりで、先に取り込んだ非同期入力信号のレベ
ルを保持するように変化する。信号Ａ１７の初期値は、
ここではリセット端子ＲにＨパルスを入力して、Ｌレベ
ルとしている。
ロックＣ２の立ち上がりで非同期入力信号を取り込み、
信号Ａ３がＬレベル時であり、かつ動作クロックＣ２の
立ち下がりで前の時刻でＦＦ１５が取り込んだレベルを
保持した信号が信号Ａ１７である。信号Ａ１７は、非同
期入力信号のレベル変化があった後の動作クロックＣ２
の立ち下がりで、先に取り込んだ非同期入力信号のレベ
ルを保持するように変化する。信号Ａ１７の初期値は、
ここではリセット端子ＲにＨパルスを入力して、Ｌレベ
ルとしている。
【００３８】信号Ａ３がＨレベル時であり、かつ動作ク
ロックＣ２の立ち下がりで非同期入力信号を取り込み、
信号Ａ３がＬレベル時であり、かつ動作クロックＣ２の
立ち下がりで前の時刻でＦＦ１７が取り込んだレベルを
保持した信号が同期化信号（ＦＦ１５の出力）である。
同期化信号は、非同期入力信号のレベル変化があった後
の動作クロックＣ２の立ち下がりで取り込んだレベルを
保持するように変化する。
ロックＣ２の立ち下がりで非同期入力信号を取り込み、
信号Ａ３がＬレベル時であり、かつ動作クロックＣ２の
立ち下がりで前の時刻でＦＦ１７が取り込んだレベルを
保持した信号が同期化信号（ＦＦ１５の出力）である。
同期化信号は、非同期入力信号のレベル変化があった後
の動作クロックＣ２の立ち下がりで取り込んだレベルを
保持するように変化する。
【００３９】同期化信号の初期値は、ここではリセット
端子ＲにＨパルスを入力して、Ｌレベルとしている。
端子ＲにＨパルスを入力して、Ｌレベルとしている。
【００４０】以上のように、非同期入力信号を動作クロ
ックＣ２の立ち上がりと立ち下がりで取り込んだレベル
（信号Ａ１、信号Ａ２）が、それぞれ非同期入力信号の
グリッジノイズを取り込んでいる可能性が高い。このた
め、信号Ａ３がＨレベルの時において、非同期入力信号
を動作クロックＣ２の立ち下がりで取り込んだレベル
（信号Ａ２）は、変化点検出後の動作クロックＣ２の立
ち上がりで取り込んだレベル（信号Ａ１）に置換し、動
作クロックＣ２の立ち上がりで取り込んだレベル（信号
Ａ１）は、変化点検出後の動作クロックＣ２の立ち下が
りで取り込んだレベル（信号Ａ２）に置換するようにし
ている。このようにして、同期化信号、及び信号Ａ１７
を生成し、グリッジノイズを除去している。
ックＣ２の立ち上がりと立ち下がりで取り込んだレベル
（信号Ａ１、信号Ａ２）が、それぞれ非同期入力信号の
グリッジノイズを取り込んでいる可能性が高い。このた
め、信号Ａ３がＨレベルの時において、非同期入力信号
を動作クロックＣ２の立ち下がりで取り込んだレベル
（信号Ａ２）は、変化点検出後の動作クロックＣ２の立
ち上がりで取り込んだレベル（信号Ａ１）に置換し、動
作クロックＣ２の立ち上がりで取り込んだレベル（信号
Ａ１）は、変化点検出後の動作クロックＣ２の立ち下が
りで取り込んだレベル（信号Ａ２）に置換するようにし
ている。このようにして、同期化信号、及び信号Ａ１７
を生成し、グリッジノイズを除去している。
【００４１】図３に示した実施の形態においても、図１
に示した実施の形態の場合と同様の効果を得ることがで
きる。さらに、図３に示した実施の形態においては、Ｆ
Ｆ１５の出力信号を同期化信号としているが、ＦＦ１７
の出力信号Ａ１７を同期化信号としてもよい。従って、
後段の回路が同期化信号を使用する時、動作クロックＣ
２の立ち上がり同期の信号Ａ１７、及び動作クロックＣ
２の立ち下がり同期の同期化信号（ＦＦ１５の出力）の
いずれかを同期化信号として選ぶことができるという利
点がある。
に示した実施の形態の場合と同様の効果を得ることがで
きる。さらに、図３に示した実施の形態においては、Ｆ
Ｆ１５の出力信号を同期化信号としているが、ＦＦ１７
の出力信号Ａ１７を同期化信号としてもよい。従って、
後段の回路が同期化信号を使用する時、動作クロックＣ
２の立ち上がり同期の信号Ａ１７、及び動作クロックＣ
２の立ち下がり同期の同期化信号（ＦＦ１５の出力）の
いずれかを同期化信号として選ぶことができるという利
点がある。
【００４２】なお、上記実施の形態における動作を、ソ
フトウェアにより行うようにすることも可能である。
フトウェアにより行うようにすることも可能である。
【００４３】
【発明の効果】以上の如く、本発明に係るノイズ除去装
置およびノイズ除去方法、並びに記録媒体によれば、所
定の基準クロックの１分の１以下の周期の動作クロック
の立ち上がりで取り込まれた非同期信号を、演算手段に
よる演算結果に応じて、動作クロックの立ち下がりで取
り込まれた非同期信号に置き換えるようにしたので、簡
単な回路構成で、基準クロックの立ち上がりに同期して
発生するグリッジノイズを除去することができる。
置およびノイズ除去方法、並びに記録媒体によれば、所
定の基準クロックの１分の１以下の周期の動作クロック
の立ち上がりで取り込まれた非同期信号を、演算手段に
よる演算結果に応じて、動作クロックの立ち下がりで取
り込まれた非同期信号に置き換えるようにしたので、簡
単な回路構成で、基準クロックの立ち上がりに同期して
発生するグリッジノイズを除去することができる。
【図１】本発明のノイズ除去装置を応用したグリッジ除
去回路の一実施の形態の構成例を示すブロック図であ
る。
去回路の一実施の形態の構成例を示すブロック図であ
る。
【図２】図１の実施の形態の動作を説明するためのタイ
ミングチャートである。
ミングチャートである。
【図３】本発明のノイズ除去装置を応用したグリッジ除
去回路の他の実施の形態の構成例を示すブロック図であ
る。
去回路の他の実施の形態の構成例を示すブロック図であ
る。
【図４】図３の実施の形態の動作を説明するためのタイ
ミングチャートである。
ミングチャートである。
１，２，５，６，７ ＦＦ ３ ＸＯＲ ４，８ セレクタ １６ セレクタ １５，１７ ＦＦ
Claims (8)
- 【請求項１】 入力された非同期信号のノイズを除去す
るノイズ除去装置であって、 所定の基準クロックの所定数分の１の周期の動作クロッ
クの立ち上がりに同期して、前記非同期信号を取り込
み、出力する第１の取り込み手段と、 前記動作クロックの立ち下がりに同期して、前記非同期
信号を取り込み、出力する第２の取り込み手段と、 前記第１の取り込み手段の出力と、前記第２の取り込み
手段の出力に対して、排他的論理和を演算し、演算結果
を出力する演算手段と、 前記動作クロックの立ち下がりで、前記演算手段の演算
結果に応じて、入力された前記非同期信号、及び直前に
取り込み、保持していた前記非同期信号のいずれかを出
力する保持出力手段と、 前記演算手段の出力を、前記動作クロックの立ち下がり
で取り込む第３の取り込み手段と、 前記第１の取り込み手段の出力を、前記動作クロックの
立ち下がりで取り込む第４の取り込み手段と、 前記第３の取り込み手段の出力に応じて、前記保持出力
手段の出力、又は前記第４の取り込み手段の出力を切り
替えて出力する切り替え手段とを備えることを特徴とす
るノイズ除去装置。 - 【請求項２】 入力された非同期信号のノイズを除去す
るノイズ除去装置であって、 所定の基準クロックの所定数分の１の周期の動作クロッ
クの立ち上がりに同期して、前記非同期信号を取り込
み、出力する第１の取り込み手段と、 前記動作クロックの立ち下がりに同期して、前記非同期
信号を取り込み、出力する第２の取り込み手段と、 前記第１の取り込み手段の出力と、前記第２の取り込み
手段の出力に対して、排他的論理和を演算し、演算結果
を出力する演算手段と、 前記動作クロックの立ち下がりで、前記演算手段の演算
結果に応じて、入力された前記非同期信号、及び直前の
前記動作クロックの立ち上がりで取り込み、保持してい
た前記非同期信号のいずれかを出力する第１の出力手段
と、 前記動作クロックの立ち上がりで、前記演算手段の演算
結果に応じて、入力された前記非同期信号、及び直前の
前記動作クロックの立ち下がりで取り込み、保持してい
た前記非同期信号のいずれかを出力する第２の出力手段
とを備えることを特徴とするノイズ除去装置。 - 【請求項３】 前記ノイズは、前記基準クロックの立ち
上がりに同期して混入するグリッジノイズであることを
特徴とする請求項１または２に記載のノイズ除去装置。 - 【請求項４】 前記第１乃至第４の取り込み手段は、フ
リップフロップ回路により構成されることを特徴とする
請求項１に記載のノイズ除去装置。 - 【請求項５】 前記動作クロックの周期は、前記基準ク
ロックの周期の１分の１以下であることを特徴とする請
求項１または２に記載のノイズ除去装置。 - 【請求項６】 入力された非同期信号のノイズを除去す
るノイズ除去方法であって、 所定の基準クロックの所定数分の１の周期の動作クロッ
クの立ち上がりに同期して、前記非同期信号を取り込
み、出力する第１の取り込みステップと、 前記動作クロックの立ち下がりに同期して、前記非同期
信号を取り込み、出力する第２の取り込みステップと、 前記第１の取り込みステップにおける出力と、前記第２
の取り込みステップにおける出力に対して、排他的論理
和を演算し、演算結果を出力する演算ステップと、 前記動作クロックの立ち下がりで、前記演算ステップに
おける演算結果に応じて、入力された前記非同期信号、
及び直前に取り込み、保持していた前記非同期信号のい
ずれかを出力する保持出力ステップと、 前記演算ステップにおける出力を、前記動作クロックの
立ち下がりで取り込む第３の取り込みステップと、 前記第１の取り込みステップにおける出力を、前記動作
クロックの立ち下がりで取り込む第４の取り込みステッ
プと、 前記第３の取り込みステップにおける出力に応じて、前
記保持出力ステップにおける出力、又は前記第４の取り
込みステップにおける出力を切り替えて出力する切り替
えステップとを備えることを特徴とするノイズ除去方
法。 - 【請求項７】 入力された非同期信号のノイズを除去す
るノイズ除去方法であって、 所定の基準クロックの所定数分の１の周期の動作クロッ
クの立ち上がりに同期して、前記非同期信号を取り込
み、出力する第１の取り込みステップと、 前記動作クロックの立ち下がりに同期して、前記非同期
信号を取り込み、出力する第２の取り込みステップと、 前記第１の取り込みステップにおける出力と、前記第２
の取り込みステップにおける出力に対して、排他的論理
和を演算し、演算結果を出力する演算ステップと、 前記動作クロックの立ち下がりで、前記演算ステップに
おける演算結果に応じて、入力された前記非同期信号、
及び直前の前記動作クロックの立ち上がりで取り込み、
保持していた前記非同期信号のいずれかを出力する第１
の出力ステップと、 前記動作クロックの立ち上がりで、前記演算ステップに
おける演算結果に応じて、入力された前記非同期信号、
及び直前の前記動作クロックの立ち下がりで取り込み、
保持していた前記非同期信号のいずれかを出力する第２
の出力ステップとを備えることを特徴とするノイズ除去
方法。 - 【請求項８】 請求項６または請求項７に記載のノイズ
除去方法を実行可能なプログラムを記録したことを特徴
とする記録媒体。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP10183267A JP3119624B2 (ja) | 1998-06-16 | 1998-06-16 | ノイズ除去装置およびノイズ除去方法、並びに記録媒体 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP10183267A JP3119624B2 (ja) | 1998-06-16 | 1998-06-16 | ノイズ除去装置およびノイズ除去方法、並びに記録媒体 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JP2000004147A JP2000004147A (ja) | 2000-01-07 |
| JP3119624B2 true JP3119624B2 (ja) | 2000-12-25 |
Family
ID=16132682
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|---|---|---|---|
| JP10183267A Expired - Fee Related JP3119624B2 (ja) | 1998-06-16 | 1998-06-16 | ノイズ除去装置およびノイズ除去方法、並びに記録媒体 |
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|---|---|---|---|---|
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| KR100919567B1 (ko) * | 2002-12-27 | 2009-10-01 | 주식회사 하이닉스반도체 | 배타적 오아게이트 회로 |
| WO2009040940A1 (ja) * | 2007-09-28 | 2009-04-02 | Pioneer Corporation | 放送受信装置、放送識別方法、放送識別プログラム及びその記録媒体 |
| JP5509123B2 (ja) | 2011-03-01 | 2014-06-04 | ルネサスエレクトロニクス株式会社 | 半導体装置及びデータ取込方法 |
| JP6386216B2 (ja) * | 2013-08-20 | 2018-09-05 | Ｎｅｃプラットフォームズ株式会社 | ノイズ除去回路およびノイズ除去方法 |
-
1998
- 1998-06-16 JP JP10183267A patent/JP3119624B2/ja not_active Expired - Fee Related
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|---|---|
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