JP2707778B2 - ノイズ除去回路 - Google Patents
ノイズ除去回路Info
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- JP2707778B2 JP2707778B2 JP2012654A JP1265490A JP2707778B2 JP 2707778 B2 JP2707778 B2 JP 2707778B2 JP 2012654 A JP2012654 A JP 2012654A JP 1265490 A JP1265490 A JP 1265490A JP 2707778 B2 JP2707778 B2 JP 2707778B2
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Description
【発明の詳細な説明】 〔産業上の利用分野〕 本発明は、一定時間、保持される信号のノイズ除去回
路に関する。
路に関する。
一定時間、保持される情報信号、たとえば中央演算処
理装置（CPU）のアドレス信号やデータ信号の中に雑音
が混入すると、CPUが誤動作することはよく知られてい
る。そこで、本願出願人は、特願昭63−94611号によ
り、保持された情報信号を時分割的に複数回サンプリン
グして、サンプリングした情報信号のレベルが一致する
個数の多い方の信号を真の情報信号とすることにより雑
音の混入した情報信号を除去する回路を提案している。
理装置（CPU）のアドレス信号やデータ信号の中に雑音
が混入すると、CPUが誤動作することはよく知られてい
る。そこで、本願出願人は、特願昭63−94611号によ
り、保持された情報信号を時分割的に複数回サンプリン
グして、サンプリングした情報信号のレベルが一致する
個数の多い方の信号を真の情報信号とすることにより雑
音の混入した情報信号を除去する回路を提案している。
この雑音除去回路の回路構成を第５図に示し、各信号
の信号波形を第６図に示す。
の信号波形を第６図に示す。
アドレスバスまたはデータバス上の８ビット信号は、
ｎ個のラッチ回路L1〜Lnにより、サンプリングクロック
により同期して異なる時点で保持される。ラッチ回路L1
〜L2によりサンプリングされた信号は多数決回路Ｍに入
力され、一致する個数の多い方の信号が出力される。
ｎ個のラッチ回路L1〜Lnにより、サンプリングクロック
により同期して異なる時点で保持される。ラッチ回路L1
〜L2によりサンプリングされた信号は多数決回路Ｍに入
力され、一致する個数の多い方の信号が出力される。
しかしながら、従来この種のノイズ除去回路において
は、サンプリングクロックに同期して雑音が混入する場
合、その除去性能が落ちるという点において、なお改良
の余地があった。
は、サンプリングクロックに同期して雑音が混入する場
合、その除去性能が落ちるという点において、なお改良
の余地があった。
そこで、本発明の目的は、このような不具合を解消
し、雑音除去性能が高く、雑音環境の異なる場合でも汎
用的に使用できるノイズ除去回路を提供することにあ
る。
し、雑音除去性能が高く、雑音環境の異なる場合でも汎
用的に使用できるノイズ除去回路を提供することにあ
る。
このような目的を達成するために、本発明は、一定時
間保持される情報信号を複数回にわたり時分割的にサン
プリングを行なって、サンプリングした信号の中の一致
個数の最も多い信号を、ノイズ除去後の情報信号として
出力するノイズ除去回路において、前記サンプリングし
た信号の一致の度合いに基づき当該サンプリングした信
号の中にノイズ影響を受けた信号があることを検知する
ノイズ検知手段と、第１のサンプリング周期を発生する
第１のサンプリング周期発生手段と、前記第１のサンプ
リング周期とは異なる第２のサンプリング周期を発生す
る第２のサンプリング周期発生手段と、前記ノイズ検知
手段の検知に応じて、前記第１のサンプリング周期発生
手段と、前記第２のサンプリング周期発生手段を交互に
切換えることにより前記情報信号のサンプリング周期を
変更する切換え手段とを具えたことを特徴とする。
間保持される情報信号を複数回にわたり時分割的にサン
プリングを行なって、サンプリングした信号の中の一致
個数の最も多い信号を、ノイズ除去後の情報信号として
出力するノイズ除去回路において、前記サンプリングし
た信号の一致の度合いに基づき当該サンプリングした信
号の中にノイズ影響を受けた信号があることを検知する
ノイズ検知手段と、第１のサンプリング周期を発生する
第１のサンプリング周期発生手段と、前記第１のサンプ
リング周期とは異なる第２のサンプリング周期を発生す
る第２のサンプリング周期発生手段と、前記ノイズ検知
手段の検知に応じて、前記第１のサンプリング周期発生
手段と、前記第２のサンプリング周期発生手段を交互に
切換えることにより前記情報信号のサンプリング周期を
変更する切換え手段とを具えたことを特徴とする。
さらに本発明は、前記ノイズ検知手段の検知に応じ
て、前記サンプリングの個数を可変設定する制御手段を
具えたことを特徴とする。
て、前記サンプリングの個数を可変設定する制御手段を
具えたことを特徴とする。
本発明は、サンプリング信号の中にノイズが混入した
ことが検知されると、サンプリング周期を変更すること
で、ノイズ発生周期とサンプリング周期の同期によるノ
イズの混入を阻止することができる。
ことが検知されると、サンプリング周期を変更すること
で、ノイズ発生周期とサンプリング周期の同期によるノ
イズの混入を阻止することができる。
また、サンプリングの個数を可変設定することによっ
て、さらにノイズの混入の阻止の効率を高めることがで
きる。
て、さらにノイズの混入の阻止の効率を高めることがで
きる。
以下、図面を参照して本発明実施例を詳細に説明す
る。
る。
第１図は本発明第１実施例の回路構成を示す。
第１図において、ノイズ除去対象の信号線がシフトレ
ジスタ110に接続され、シフトレジスタを構成する各ラ
ッチ回路の保持信号が多数決回路120に入力される。本
例において、シフトレジスタは３個の信号をサンプリン
グする。
ジスタ110に接続され、シフトレジスタを構成する各ラ
ッチ回路の保持信号が多数決回路120に入力される。本
例において、シフトレジスタは３個の信号をサンプリン
グする。
デコーダ（信号解読器）130は上記サンプリング信号
のレベル状態を解読し、サンプンリング信号の中の信号
レベルの組み合わせが下記の組み合わせになったとき
に，雑音の有無を示す判定信号を出力する。
のレベル状態を解読し、サンプンリング信号の中の信号
レベルの組み合わせが下記の組み合わせになったとき
に，雑音の有無を示す判定信号を出力する。
すなわち、３個のサンプリング信号の組み合わせが、
ビット“0,0,1"および“0,1,0",“1,0,0",“0,1,1",
“1,0,1",“1,1,0"のとき雑音の有りの判定信号はレベ
ルオンとなり、その他の信号の組み合わせのとき、すな
わち、“1,1,1"および“0,0,0"のときは雑音無しの判定
信号はレベルオフとなる。
ビット“0,0,1"および“0,1,0",“1,0,0",“0,1,1",
“1,0,1",“1,1,0"のとき雑音の有りの判定信号はレベ
ルオンとなり、その他の信号の組み合わせのとき、すな
わち、“1,1,1"および“0,0,0"のときは雑音無しの判定
信号はレベルオフとなる。
本実施例では雑音が発生すると、信号のレベルの組み
合わせ状態が変化するので、そのデコーダ130によりサ
ンプリング信号のレベル変化を検出することにより雑音
の発生を検出する。したがって、デコーダ130がノイズ
検知手段として動作する。
合わせ状態が変化するので、そのデコーダ130によりサ
ンプリング信号のレベル変化を検出することにより雑音
の発生を検出する。したがって、デコーダ130がノイズ
検知手段として動作する。
雑音有りの判定信号がトグル回路150に入力する毎に
トグル回路150は第１クロック発生器141および第２クロ
ック発生器142を交互に切換える。トグル回路150が制御
手段として動作する。
トグル回路150は第１クロック発生器141および第２クロ
ック発生器142を交互に切換える。トグル回路150が制御
手段として動作する。
第２クロック発生器142は第１クロック発生器141より
も信号発生周期を長く設定してあり、共にノイズ除去対
象の信号の１周期の間に３個のクロック信号を発生す
る。
も信号発生周期を長く設定してあり、共にノイズ除去対
象の信号の１周期の間に３個のクロック信号を発生す
る。
このような回路の動作を第２図のタイミングチャート
を参照しながら説明する。なお、内容の理解を容易とす
るため、ノイズ除去の対象の信号を１ビット（オン／オ
フ）の信号とする。
を参照しながら説明する。なお、内容の理解を容易とす
るため、ノイズ除去の対象の信号を１ビット（オン／オ
フ）の信号とする。
第２図の波形Ａ（レベルオン）の信号をノイズ除去回
路に入力すると、まず第１クロック発生器141の第１ク
ロック信号により、第２図のタイミングT1,T2,T3で入力
信号がサンプリングされ、そのサンプリング信号が３入
力多数決回路120に入力される。多数決回路120では信号
レベルの多数決による決定を行って、次の周期で波形Ｆ
のオンのパルス信号を出力する。
路に入力すると、まず第１クロック発生器141の第１ク
ロック信号により、第２図のタイミングT1,T2,T3で入力
信号がサンプリングされ、そのサンプリング信号が３入
力多数決回路120に入力される。多数決回路120では信号
レベルの多数決による決定を行って、次の周期で波形Ｆ
のオンのパルス信号を出力する。
タイミングT3で入力信号に雑音が混入し、サンプリン
グ信号がレベル“オフ”となった場合、サンプリング信
号の組み合わせは“1,1,0"となるので、デコーダ130に
より雑音の混入が検出され、オンの雑音有りの判定信号
がトグル回路150に出力される。
グ信号がレベル“オフ”となった場合、サンプリング信
号の組み合わせは“1,1,0"となるので、デコーダ130に
より雑音の混入が検出され、オンの雑音有りの判定信号
がトグル回路150に出力される。
この結果、第２クロック発生器142が能動状態とな
り、次の周期のシフトレジスタ110のサンプリングは第
２クロックにより行なわれる。このため、次の周期で第
２図の波形Ａのような同一位置に雑音が混入した信号を
ノイズ除去回路に入力した場合でも、サンプリングのタ
イミングが第１クロックとは異なるので、多数決回路に
入力されるサンプリング信号はノイズ影響を受けない信
号となる。
り、次の周期のシフトレジスタ110のサンプリングは第
２クロックにより行なわれる。このため、次の周期で第
２図の波形Ａのような同一位置に雑音が混入した信号を
ノイズ除去回路に入力した場合でも、サンプリングのタ
イミングが第１クロックとは異なるので、多数決回路に
入力されるサンプリング信号はノイズ影響を受けない信
号となる。
また、第２クロック信号を用いて、サンプリングを行
い、サンプリング信号に雑音の混入がデコーダ130によ
り検出された場合は、上述と同様の手順でサンプリング
クロックが第２クロックから第１クロックに切換えられ
る。
い、サンプリング信号に雑音の混入がデコーダ130によ
り検出された場合は、上述と同様の手順でサンプリング
クロックが第２クロックから第１クロックに切換えられ
る。
本実施例の他に次の応用例が挙げられる。
１） 本実施例は、サンプリングの個数を３個とする例
を示しているがサンプリング個数が多数、たとえば５個
とする場合、クロック発生器の個数を増やし、信号の多
数決の結果に応じて、所望のクロック発生器を選択す
る。
を示しているがサンプリング個数が多数、たとえば５個
とする場合、クロック発生器の個数を増やし、信号の多
数決の結果に応じて、所望のクロック発生器を選択す
る。
例えば、一致するサンプリング信号の個数の比率が4:
1,3:2にそれぞれ対応させて、クロック発生器をデコー
ダ130により択一的に選択してもよい。
1,3:2にそれぞれ対応させて、クロック発生器をデコー
ダ130により択一的に選択してもよい。
また、比率が3:2のときのみクロック発生器を切換え
てもよいことは勿論である。
てもよいことは勿論である。
２） 本実施例では雑音の検出毎にクロック発生回路を
切換えているが、一定回数、連続的に雑音発生を計数し
たときクロック発生回路を切換えるようにしてもよい。
この場合は、上記一定回数を計数したときにカウントア
ップ信号を発生し、初期値に戻るカウンタによりデコー
ダ130の雑音有り信号を計数し、雑音無し信号により上
記カウンタをリセットする。またカウンタのカウントア
ップ信号をトグル回路150に入力することにより上述の
機能を達成することができる。
切換えているが、一定回数、連続的に雑音発生を計数し
たときクロック発生回路を切換えるようにしてもよい。
この場合は、上記一定回数を計数したときにカウントア
ップ信号を発生し、初期値に戻るカウンタによりデコー
ダ130の雑音有り信号を計数し、雑音無し信号により上
記カウンタをリセットする。またカウンタのカウントア
ップ信号をトグル回路150に入力することにより上述の
機能を達成することができる。
３） 本実施例では雑音の混入を検知できるので、デコ
ーダ130の雑音有り信号により、警報ランプを点灯させ
てもよい。
ーダ130の雑音有り信号により、警報ランプを点灯させ
てもよい。
第１実施例はサンプリング信号に雑音が混入したこと
を検出したときは、サンプリング周期を可変設定するよ
うにした例であるが、第２実施例は、雑音の検出に応じ
て、サンプリング個数を可変設定するようにした例であ
る。
を検出したときは、サンプリング周期を可変設定するよ
うにした例であるが、第２実施例は、雑音の検出に応じ
て、サンプリング個数を可変設定するようにした例であ
る。
この機能を実現するための回路構成を第３図に示す。
第３図に示す回路はサンプリング個数を５個と３個と
に切換え使用する例であり、多数決回路，雑音検出用デ
コーダ，クロック発生器に、それぞれサンプリング個数
と対応する回路を用意している。また、サンプリング回
路の信号のラッチ回路は５個用意し、切換え用論理回路
243により、サンプリング個数に応じて、所望のラッチ
回路が能動状態となる。
に切換え使用する例であり、多数決回路，雑音検出用デ
コーダ，クロック発生器に、それぞれサンプリング個数
と対応する回路を用意している。また、サンプリング回
路の信号のラッチ回路は５個用意し、切換え用論理回路
243により、サンプリング個数に応じて、所望のラッチ
回路が能動状態となる。
このような回路構成において、初期状態としてはサン
プリング個数は“3"に設定され、第１〜第３ラッチ回路
211〜213が第２クロック発生器242の第２クロック信号
によりサンプリングを行う。サンプリングされた信号
は、３入力多数決回路222により、ノイズ除去が行なわ
れる。
プリング個数は“3"に設定され、第１〜第３ラッチ回路
211〜213が第２クロック発生器242の第２クロック信号
によりサンプリングを行う。サンプリングされた信号
は、３入力多数決回路222により、ノイズ除去が行なわ
れる。
サンプリング信号の中にノイズが混入していることが
第２デコーダ232により検出されると、切換え用論理回
路243は、サンプリング個数を“5"とするための切換え
信号をサンプリング部210,多数決判定部220,雑音検知部
230,制御部240内のクロック発生器に送信する。
第２デコーダ232により検出されると、切換え用論理回
路243は、サンプリング個数を“5"とするための切換え
信号をサンプリング部210,多数決判定部220,雑音検知部
230,制御部240内のクロック発生器に送信する。
この結果、第４図に示すように、第２クロック信号の
発生時に入力信号にノイズが混入していても、その発生
タイミングと第１クロック信号の発生周期が異なるの
で、サンプリング信号にノイズが混じる確率が低下す
る。
発生時に入力信号にノイズが混入していても、その発生
タイミングと第１クロック信号の発生周期が異なるの
で、サンプリング信号にノイズが混じる確率が低下す
る。
以上、説明したように、本発明では、ノイズの混入を
検知すると、ノイズの混入を躱すべく、サンプリング周
期が変更される。このような学習機能により、発生周期
の異なるノイズが発生してもその混入を阻止することが
できる。また、ノイズの発生周期の異なる場所でも同一
のノイズ除去回路を汎用的に使用することができる。
検知すると、ノイズの混入を躱すべく、サンプリング周
期が変更される。このような学習機能により、発生周期
の異なるノイズが発生してもその混入を阻止することが
できる。また、ノイズの発生周期の異なる場所でも同一
のノイズ除去回路を汎用的に使用することができる。
第１図は本発明第１実施例の回路構成を示すブロック
図、 第２図は本発明第１実施例の信号発生タイミングを示す
タイミングチャート、 第３図は本発明第２実施例の回路構成を示すブロック
図、 第４図は本発明第２実施例の信号発生タイミングを示す
タイミングチャート、 第５図は従来例の回路構成を示すブロック図、 第６図は従来例の信号発生タイミングを示すタイミング
チャートである。
図、 第２図は本発明第１実施例の信号発生タイミングを示す
タイミングチャート、 第３図は本発明第２実施例の回路構成を示すブロック
図、 第４図は本発明第２実施例の信号発生タイミングを示す
タイミングチャート、 第５図は従来例の回路構成を示すブロック図、 第６図は従来例の信号発生タイミングを示すタイミング
チャートである。
Claims (2)
- 【請求項１】一定時間保持される情報信号を複数回にわ
たり時分割的にサンプリングを行なって、サンプリング
した信号の中の一致個数の最も多い信号を、ノイズ除去
後の情報信号として出力するノイズ除去回路において、 前記サンプリングした信号の一致の度合いに基づき当該
サンプリングした信号の中にノイズ影響を受けた信号が
あることを検知するノイズ検知手段と、 第１のサンプリング周期を発生する第１のサンプリング
周期発生手段と、 前記第１のサンプリング周期とは異なる第２のサンプリ
ング周期を発生する第２のサンプリング周期発生手段
と、 前記ノイズ検知手段の検知に応じて、前記第１のサンプ
リング周期発生手段と、前記第２のサンプリング周期発
生手段を交互に切換えることにより前記情報信号のサン
プリング周期を変更する切換え手段と を具えたことを特徴とするノイズ除去回路。 - 【請求項２】請求項１に記載のノイズ除去回路におい
て、前記ノイズ検知手段の検知に応じて、前記サンプリ
ングの個数を可変設定する制御手段を具えたことを特徴
とするノイズ除去回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP2012654A JP2707778B2 (ja) | 1990-01-24 | 1990-01-24 | ノイズ除去回路 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP2012654A JP2707778B2 (ja) | 1990-01-24 | 1990-01-24 | ノイズ除去回路 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPH03218114A JPH03218114A (ja) | 1991-09-25 |
| JP2707778B2 true JP2707778B2 (ja) | 1998-02-04 |
Family
ID=11811350
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP2012654A Expired - Lifetime JP2707778B2 (ja) | 1990-01-24 | 1990-01-24 | ノイズ除去回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JP2707778B2 (ja) |
Families Citing this family (4)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP5620284B2 (ja) * | 2011-01-19 | 2014-11-05 | 横河電子機器株式会社 | 信号処理装置 |
| JP5879688B2 (ja) * | 2011-02-07 | 2016-03-08 | 公立大学法人首都大学東京 | フリップフロップ装置 |
| WO2013008666A1 (ja) * | 2011-07-08 | 2013-01-17 | オリンパスメディカルシステムズ株式会社 | 撮像装置 |
| JP2019097075A (ja) * | 2017-11-24 | 2019-06-20 | オムロン株式会社 | デジタルノイズフィルタ |
Family Cites Families (3)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS6029015A (ja) * | 1983-07-27 | 1985-02-14 | Matsushita Electric Ind Co Ltd | デジタル積分回路 |
| US4585997A (en) * | 1983-12-08 | 1986-04-29 | Televideo Systems, Inc. | Method and apparatus for blanking noise present in an alternating electrical signal |
| JPS61214842A (ja) * | 1985-03-20 | 1986-09-24 | Fujitsu General Ltd | 文字多重放送におけるデ−タサンプリング変換回路 |
-
1990
- 1990-01-24 JP JP2012654A patent/JP2707778B2/ja not_active Expired - Lifetime
Also Published As
| Publication number | Publication date |
|---|---|
| JPH03218114A (ja) | 1991-09-25 |
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Legal Events
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|---|---|---|---|
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